JPH05152945A - 自動周波数・利得制御回路 - Google Patents
自動周波数・利得制御回路Info
- Publication number
- JPH05152945A JPH05152945A JP3335967A JP33596791A JPH05152945A JP H05152945 A JPH05152945 A JP H05152945A JP 3335967 A JP3335967 A JP 3335967A JP 33596791 A JP33596791 A JP 33596791A JP H05152945 A JPH05152945 A JP H05152945A
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- JP
- Japan
- Prior art keywords
- signal
- level
- frequency
- output
- circuit
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- Pending
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】
【目的】 自動周波数・利得制御回路において、入力信
号レベルが急激に変動した場合でも、出力信号周波数を
一定に保って同期外れを防止させる。 【構成】 周波数混合器１、電圧制御発振器２、可変抵
抗減衰器３、ＡＧＣ回路５、周波数位相比較器６、基準
信号発生器７等を備える自動周波数・利得制御回路に、
レベル変化された信号のレベル変動を検出するレベル検
出器１３と、このレベル検出器の出力により信号レベル
が急激に変動されたときに所要の制御信号を出力する論
理回路９と、周波数位相比較器６の出力をサンプルし、
或いは論理回路９からの制御信号に基づいてホールド
し、かつその出力を電圧制御発振器２に出力する保持回
路１１とを備える。
号レベルが急激に変動した場合でも、出力信号周波数を
一定に保って同期外れを防止させる。 【構成】 周波数混合器１、電圧制御発振器２、可変抵
抗減衰器３、ＡＧＣ回路５、周波数位相比較器６、基準
信号発生器７等を備える自動周波数・利得制御回路に、
レベル変化された信号のレベル変動を検出するレベル検
出器１３と、このレベル検出器の出力により信号レベル
が急激に変動されたときに所要の制御信号を出力する論
理回路９と、周波数位相比較器６の出力をサンプルし、
或いは論理回路９からの制御信号に基づいてホールド
し、かつその出力を電圧制御発振器２に出力する保持回
路１１とを備える。
Description
【０００１】
【産業上の利用分野】本発明は受信機の局部発信周波数
制御を使用した自動周波数・利得制御回路に関する。
制御を使用した自動周波数・利得制御回路に関する。
【０００２】
【従来の技術】一般に、所要帯域幅の狭い信号（ＳＣＰ
Ｃ方式等）を使用して通信を行う場合、送信機及び中継
機内の局部発振周波数の経年変化或いは衛星通信におけ
るドップラー効果による周波数変動分を受信機において
吸収し、復調器に送出する周波数を一定にしておく必要
がある。この方法として、衛星通信においては親局より
通信に使用する以外の信号を送出し（パイロット信号と
呼ばれる）、受信局はこのパイロット信号の周波数変動
分を検出し、その検出した信号に対して受信機の局部発
振器の出力周波数を変化させ、復調器に送出する信号の
周波数が一定となるよう制御している。この方式は自動
周波数制御方式（ＡＦＣ）と呼ばれよく知られているも
のである。
Ｃ方式等）を使用して通信を行う場合、送信機及び中継
機内の局部発振周波数の経年変化或いは衛星通信におけ
るドップラー効果による周波数変動分を受信機において
吸収し、復調器に送出する周波数を一定にしておく必要
がある。この方法として、衛星通信においては親局より
通信に使用する以外の信号を送出し（パイロット信号と
呼ばれる）、受信局はこのパイロット信号の周波数変動
分を検出し、その検出した信号に対して受信機の局部発
振器の出力周波数を変化させ、復調器に送出する信号の
周波数が一定となるよう制御している。この方式は自動
周波数制御方式（ＡＦＣ）と呼ばれよく知られているも
のである。
【０００３】又、復調器に送出する信号は、周波数のみ
ならずそのレベルも一定に保つ必要がある。この方法と
して、衛星通信においては前記パイロット信号のレベル
変動分を検出し、その検出した信号に対して受信機内の
可変抵抗減衰器の減衰量を変化させ、復調器に送出する
信号のレベルが一定となるよう制御している。この方式
は自動利得制御方式（ＡＧＣ）と呼ばれている。以上の
ように、一般に衛星通信において狭帯域信号を送受信す
る場合、パイロット信号及び通信信号を受信する受信機
内部には、自動周波数・利得制御回路（以下、ＡＦＣ・
ＡＧＣ回路と称する）が含まれている。
ならずそのレベルも一定に保つ必要がある。この方法と
して、衛星通信においては前記パイロット信号のレベル
変動分を検出し、その検出した信号に対して受信機内の
可変抵抗減衰器の減衰量を変化させ、復調器に送出する
信号のレベルが一定となるよう制御している。この方式
は自動利得制御方式（ＡＧＣ）と呼ばれている。以上の
ように、一般に衛星通信において狭帯域信号を送受信す
る場合、パイロット信号及び通信信号を受信する受信機
内部には、自動周波数・利得制御回路（以下、ＡＦＣ・
ＡＧＣ回路と称する）が含まれている。
【０００４】図２はこのＡＦＣ・ＡＧＣ回路のブロック
図である。入力信号は周波数混合器１において電圧制御
発振器２からの信号と周波数混合され、両信号の差周波
数の信号が出力される。この信号は、外部からの制御信
号によって減衰量が変化される可変抵抗減衰器３により
レベルを変化される。この出力信号の一部は雑音成分を
帯域制限する帯域ろ波器４を通り、一方はＡＧＣ回路５
に、もう一方は周波数位相比較器６に供給される。
図である。入力信号は周波数混合器１において電圧制御
発振器２からの信号と周波数混合され、両信号の差周波
数の信号が出力される。この信号は、外部からの制御信
号によって減衰量が変化される可変抵抗減衰器３により
レベルを変化される。この出力信号の一部は雑音成分を
帯域制限する帯域ろ波器４を通り、一方はＡＧＣ回路５
に、もう一方は周波数位相比較器６に供給される。
【０００５】ＡＧＣ回路５に入力された信号は、ここで
ＡＧＣ制御を受け、その際のＡＧＣ電圧等が可変抵抗減
衰器３の制御信号入力端子に帰還され、入力信号のレベ
ル変動を吸収し、常に一定のレベルとする。一方、周波
数位相比較器６に入力された信号は、基準信号発生器７
の基準信号と周波数位相比較が行なわれ、比較された結
果生ずる誤差成分は前記電圧制御発振器２の制御信号入
力端子に帰還され、その発振周波数を変化させる。この
動作は、周波数位相比較器５の誤差成分がゼロとなるに
なるまで続き、この結果出力周波数は入力信号の周波数
変化を吸収し、常に一定周波数となる。
ＡＧＣ制御を受け、その際のＡＧＣ電圧等が可変抵抗減
衰器３の制御信号入力端子に帰還され、入力信号のレベ
ル変動を吸収し、常に一定のレベルとする。一方、周波
数位相比較器６に入力された信号は、基準信号発生器７
の基準信号と周波数位相比較が行なわれ、比較された結
果生ずる誤差成分は前記電圧制御発振器２の制御信号入
力端子に帰還され、その発振周波数を変化させる。この
動作は、周波数位相比較器５の誤差成分がゼロとなるに
なるまで続き、この結果出力周波数は入力信号の周波数
変化を吸収し、常に一定周波数となる。
【０００６】
【発明が解決しようとする課題】このような従来のＡＦ
Ｃ・ＡＧＣ回路では、入力信号レベルがＡＧＣ回路５の
時定数に比べて早い速度で変動した場合、周波数位相比
較器６に入力される信号レベルも大きく変動してしま
う。このため、周波数位相比較器６にアナログ位相比較
器を使っている回路では、この入力信号レベルの変動に
よって位相同期が外れてしまうという問題がある。
Ｃ・ＡＧＣ回路では、入力信号レベルがＡＧＣ回路５の
時定数に比べて早い速度で変動した場合、周波数位相比
較器６に入力される信号レベルも大きく変動してしま
う。このため、周波数位相比較器６にアナログ位相比較
器を使っている回路では、この入力信号レベルの変動に
よって位相同期が外れてしまうという問題がある。
【０００７】即ち、アナログ位相比較器は、通常、位相
同期している状態で入力信号のレベルが急激に変動した
場合に、入力信号の周波数が変化しないにもかかわらず
誤差信号を出力してしまうという特性を持っており、こ
のため瞬間受信信号に対する位相同期が外れてしまうこ
とになる。本発明の目的は、入力信号レベルが急激に変
動した場合でも、出力信号周波数を一定に保つようにし
たＡＦＣ・ＡＧＣ回路を提供することにある。
同期している状態で入力信号のレベルが急激に変動した
場合に、入力信号の周波数が変化しないにもかかわらず
誤差信号を出力してしまうという特性を持っており、こ
のため瞬間受信信号に対する位相同期が外れてしまうこ
とになる。本発明の目的は、入力信号レベルが急激に変
動した場合でも、出力信号周波数を一定に保つようにし
たＡＦＣ・ＡＧＣ回路を提供することにある。
【０００８】
【課題を解決するための手段】本発明のＡＦＣ・ＡＧＣ
回路は、電圧制御発振器と、入力信号と前記電圧制御発
振器の出力とを混合して周波数変換する周波数混合器
と、周波数変換された信号のレベルを変化させる可変抵
抗減衰器と、レベル変化された信号に基づいて前記可変
抵抗減衰器を制御する自動利得制御回路と、前記レベル
変化された信号と基準信号との間で位相比較を行う周波
数位相比較器と、前記レベル変化された信号のレベル変
動を検出するレベル検出器と、前記レベル検出器の出力
により信号レベルが急激に変動されたときに所要の制御
信号を出力する論理回路と、前記周波数位相比較器の出
力をサンプルし、或いは前記論理回路からの制御信号に
基づいてホールドし、かつその出力を前記電圧制御発振
器に出力する保持回路とを備える。
回路は、電圧制御発振器と、入力信号と前記電圧制御発
振器の出力とを混合して周波数変換する周波数混合器
と、周波数変換された信号のレベルを変化させる可変抵
抗減衰器と、レベル変化された信号に基づいて前記可変
抵抗減衰器を制御する自動利得制御回路と、前記レベル
変化された信号と基準信号との間で位相比較を行う周波
数位相比較器と、前記レベル変化された信号のレベル変
動を検出するレベル検出器と、前記レベル検出器の出力
により信号レベルが急激に変動されたときに所要の制御
信号を出力する論理回路と、前記周波数位相比較器の出
力をサンプルし、或いは前記論理回路からの制御信号に
基づいてホールドし、かつその出力を前記電圧制御発振
器に出力する保持回路とを備える。
【０００９】
【作用】入力信号レベルが急激に変動したときには、レ
ベル検出器の出力によって論理回路から制御信号が出力
され、この制御信号によって保持回路は周波数位相比較
器からの信号をホールドした状態とされ、このホールド
された信号を電圧制御発振器に出力して発振周波数を保
持することで、入力信号レベルの急激な変動に伴う周波
数の変動を防止し、同期外れを防止する。
ベル検出器の出力によって論理回路から制御信号が出力
され、この制御信号によって保持回路は周波数位相比較
器からの信号をホールドした状態とされ、このホールド
された信号を電圧制御発振器に出力して発振周波数を保
持することで、入力信号レベルの急激な変動に伴う周波
数の変動を防止し、同期外れを防止する。
【００１０】
【実施例】次に、本発明について図面を参照して説明す
る。図１に本発明の一実施例を示す。入力信号を電圧制
御発振器２からの信号と周波数混合器１において周波数
混合し、両信号の差周波数の出力信号を可変抵抗減衰器
３によりレベルを変化させ、この出力信号の雑音成分を
帯域制限する帯域ろ波器４を通した信号をＡＧＣ回路５
及び周波数位相比較器６に供給し、ＡＧＣ回路５の出力
信号を可変抵抗減衰器３に帰還する点はこれまでの構成
と同じである。
る。図１に本発明の一実施例を示す。入力信号を電圧制
御発振器２からの信号と周波数混合器１において周波数
混合し、両信号の差周波数の出力信号を可変抵抗減衰器
３によりレベルを変化させ、この出力信号の雑音成分を
帯域制限する帯域ろ波器４を通した信号をＡＧＣ回路５
及び周波数位相比較器６に供給し、ＡＧＣ回路５の出力
信号を可変抵抗減衰器３に帰還する点はこれまでの構成
と同じである。
【００１１】更に、この実施例では、帯域ろ波器４の出
力信号をレベル検出器１３に供給し、その出力信号をア
ナログ・ディジタル変換器８によりディジタル信号に変
換して論理回路９に供給する。論理回路９は入力信号の
時間的変化量の大きさに応じて、Ｈ（高レベル）／Ｌ
（低レベル）に変化する制御信号を発生する。
力信号をレベル検出器１３に供給し、その出力信号をア
ナログ・ディジタル変換器８によりディジタル信号に変
換して論理回路９に供給する。論理回路９は入力信号の
時間的変化量の大きさに応じて、Ｈ（高レベル）／Ｌ
（低レベル）に変化する制御信号を発生する。
【００１２】又、周波数位相比較器６は、帯域ろ波器４
と基準信号発振器７の出力信号との間で周波数位相比較
を行い、その結果得られる誤差信号はアナログ・ディジ
タル変換器１０によりディジタル信号に変換されて保持
回路１１に供給される。保持回路１１は、前記論理回路
９からの制御信号により入力信号をそのまま出力する
か、或いは現在の出力信号を保持するかの動作を行い、
その出力信号はディジタル・アナログ変換器１２により
アナログ信号に変換されて電圧制御発振器２の制御入力
端子に帰還され、ＡＦＣ動作が行われる。
と基準信号発振器７の出力信号との間で周波数位相比較
を行い、その結果得られる誤差信号はアナログ・ディジ
タル変換器１０によりディジタル信号に変換されて保持
回路１１に供給される。保持回路１１は、前記論理回路
９からの制御信号により入力信号をそのまま出力する
か、或いは現在の出力信号を保持するかの動作を行い、
その出力信号はディジタル・アナログ変換器１２により
アナログ信号に変換されて電圧制御発振器２の制御入力
端子に帰還され、ＡＦＣ動作が行われる。
【００１３】このように構成されたＡＦＣ・ＡＧＣ回路
において、図３のＡのように入力信号のレベルが急激に
変動した場合を考える。このレベル変動がＡＧＣ回路５
の時定数に比べ十分早く起こった場合、可変抵抗減衰器
３の出力信号レベルは同図Ｂのように変動する。この結
果、周波数位相比較器６は、入力信号の周波数が変動し
ていないにも関わらず、同図Ｃのように誤った周波数誤
差情報を出力する。
において、図３のＡのように入力信号のレベルが急激に
変動した場合を考える。このレベル変動がＡＧＣ回路５
の時定数に比べ十分早く起こった場合、可変抵抗減衰器
３の出力信号レベルは同図Ｂのように変動する。この結
果、周波数位相比較器６は、入力信号の周波数が変動し
ていないにも関わらず、同図Ｃのように誤った周波数誤
差情報を出力する。
【００１４】従来の回路ではこの誤った誤差情報が電圧
制御発振器２にそのまま帰還されて同期外れを生じてい
たが、この回路では、帯域ろ波器４の出力におけるレベ
ル変動をレベル検出器１３が検出し、このレベル検出器
１３の出力信号の変動を論理回路９が検知して制御信号
を発生させ、この制御信号に基づいて保持回路１１の出
力信号を保持（ホールド）することになる。
制御発振器２にそのまま帰還されて同期外れを生じてい
たが、この回路では、帯域ろ波器４の出力におけるレベ
ル変動をレベル検出器１３が検出し、このレベル検出器
１３の出力信号の変動を論理回路９が検知して制御信号
を発生させ、この制御信号に基づいて保持回路１１の出
力信号を保持（ホールド）することになる。
【００１５】そして、レベル検出器１３の出力変動が収
まれば保持回路１１は再びサンプル状態に戻る（同図
Ｄ）。この動作により、入力信号レベルが急激に変動さ
れた場合でも、電圧制御発振器２に帰還される誤差信号
は常に一定電圧に保たれ、したがってＡＦＣ・ＡＧＣ回
路の出力信号も一定となり位相同期外れを生じることは
ない。
まれば保持回路１１は再びサンプル状態に戻る（同図
Ｄ）。この動作により、入力信号レベルが急激に変動さ
れた場合でも、電圧制御発振器２に帰還される誤差信号
は常に一定電圧に保たれ、したがってＡＦＣ・ＡＧＣ回
路の出力信号も一定となり位相同期外れを生じることは
ない。
【００１６】
【発明の効果】以上説明したように本発明のＡＦＣ・Ａ
ＧＣ回路では、周波数位相比較器の出力側に保持回路を
設け、この保持回路を入力信号レベルの変動を検出する
レベル検出器の出力に基づいて動作する論理回路によっ
て動作させ、入力信号レベルの急激な変動時にはその出
力をホールードして電圧制御発振器に出力させるように
構成することで、入力信号のレベルが急激に増加した場
合でも同期外れを起こすことがないという効果がある。
ＧＣ回路では、周波数位相比較器の出力側に保持回路を
設け、この保持回路を入力信号レベルの変動を検出する
レベル検出器の出力に基づいて動作する論理回路によっ
て動作させ、入力信号レベルの急激な変動時にはその出
力をホールードして電圧制御発振器に出力させるように
構成することで、入力信号のレベルが急激に増加した場
合でも同期外れを起こすことがないという効果がある。
【図１】本発明のＡＦＣ・ＡＧＣ回路の一実施例のブロ
ック図である。
ック図である。
【図２】従来のＡＦＣ・ＡＧＣ回路の一例のブロック図
である。
である。
【図３】図１の回路の各部の信号波形図である。
１ 周波数混合器 ２ 電圧制御発振器 ３ 可変抵抗減衰器 ５ ＡＧＣ回路 ６ 周波数位相比較器 ７ 基準信号発生器 ９ 論理回路 １１ 保持回路 １３ レベル検出器
Claims (1)
- 【請求項１】 電圧制御発振器と、入力信号と前記電圧
制御発振器の出力とを混合して周波数変換する周波数混
合器と、周波数変換された信号のレベルを変化させる可
変抵抗減衰器と、レベル変化された信号に基づいて前記
可変抵抗減衰器を制御する自動利得制御回路と、前記レ
ベル変化された信号と基準信号との間で位相比較を行う
周波数位相比較器と、前記レベル変化された信号のレベ
ル変動を検出するレベル検出器と、前記レベル検出器の
出力により信号レベルが急激に変動されたときに所要の
制御信号を出力する論理回路と、前記周波数位相比較器
の出力をサンプルし、或いは前記論理回路からの制御信
号に基づいてホールドし、かつその出力を前記電圧制御
発振器に出力する保持回路とを備えることを特徴とする
自動周波数・利得制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3335967A JPH05152945A (ja) | 1991-11-27 | 1991-11-27 | 自動周波数・利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3335967A JPH05152945A (ja) | 1991-11-27 | 1991-11-27 | 自動周波数・利得制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05152945A true JPH05152945A (ja) | 1993-06-18 |
Family
ID=18294326
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3335967A Pending JPH05152945A (ja) | 1991-11-27 | 1991-11-27 | 自動周波数・利得制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05152945A (ja) |
-
1991
- 1991-11-27 JP JP3335967A patent/JPH05152945A/ja active Pending
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