JPH05107343A - レーダ干渉除去装置 - Google Patents
レーダ干渉除去装置Info
- Publication number
- JPH05107343A JPH05107343A JP3299863A JP29986391A JPH05107343A JP H05107343 A JPH05107343 A JP H05107343A JP 3299863 A JP3299863 A JP 3299863A JP 29986391 A JP29986391 A JP 29986391A JP H05107343 A JPH05107343 A JP H05107343A
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- JP
- Japan
- Prior art keywords
- interference
- signal
- threshold value
- correlation
- circuit
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】
【目的】 レーダ干渉除去装置において、ウェザークラ
ッタ等に重畳された干渉信号に対してスイープ間の相関
がとれて干渉除去できなくなることを防止する。 【構成】 受信信号を比較器１４においてスレッショホ
ルード値と比較し、雑音を分離した信号を干渉判定器１
７においてスイープ相関処理して干渉判定を行い、相関
がとれない場合にゲート発生器１８でインタフェーアラ
ンスゲート信号を発生して干渉を除去するようにしたレ
ーダ干渉除去装置において、比較器に入力されるスレッ
ショホールド値を、受信信号のレベルに基づいて発生さ
せるスレッショホールド値生成回路１５を設け、ウェザ
ークラッタ等に重畳した干渉信号に対してスイープ相関
がとれないようにする。
ッタ等に重畳された干渉信号に対してスイープ間の相関
がとれて干渉除去できなくなることを防止する。 【構成】 受信信号を比較器１４においてスレッショホ
ルード値と比較し、雑音を分離した信号を干渉判定器１
７においてスイープ相関処理して干渉判定を行い、相関
がとれない場合にゲート発生器１８でインタフェーアラ
ンスゲート信号を発生して干渉を除去するようにしたレ
ーダ干渉除去装置において、比較器に入力されるスレッ
ショホールド値を、受信信号のレベルに基づいて発生さ
せるスレッショホールド値生成回路１５を設け、ウェザ
ークラッタ等に重畳した干渉信号に対してスイープ相関
がとれないようにする。
Description
【０００１】
【産業上の利用分野】本発明はレーダ干渉除去装置に関
し、特にレーダ相互干渉及びパルス間隔超越エコーを除
去することを可能にした装置に関する。
し、特にレーダ相互干渉及びパルス間隔超越エコーを除
去することを可能にした装置に関する。
【０００２】
【従来の技術】従来のレーダ干渉除去装置の一例を図３
に示す。受信信号は増幅器１で増幅された後、ミキサ２
により中間周波信号に変換され、更に増幅器３で増幅さ
れた後、位相検波器４において位相が検出される。この
位相検波器４からはＩコヒアレントビデオとＱコヒアレ
ントビデオの各信号が出力され、これらはＭＴＩ（Movi
ng Target Indicator)５においてＭＴＩ処理され、更に
LOG CFAR６及びスイッチ９を介して出力される。又、Ｉ
及びＱの各コヒアレントビデオ信号は、干渉波を検出す
るための干渉除去回路３１に出力される。
に示す。受信信号は増幅器１で増幅された後、ミキサ２
により中間周波信号に変換され、更に増幅器３で増幅さ
れた後、位相検波器４において位相が検出される。この
位相検波器４からはＩコヒアレントビデオとＱコヒアレ
ントビデオの各信号が出力され、これらはＭＴＩ（Movi
ng Target Indicator)５においてＭＴＩ処理され、更に
LOG CFAR６及びスイッチ９を介して出力される。又、Ｉ
及びＱの各コヒアレントビデオ信号は、干渉波を検出す
るための干渉除去回路３１に出力される。
【０００３】干渉除去回路３１では、これらの信号を消
去回路３２、合成回路３３を通してグランドクラッタを
抑圧し、この信号ａ′を比較器３４に入力してスレッシ
ョホールド信号と比較する。スレッショホールド値を越
えた信号ｂ′と、他の一部をスイープ遅延器３５で数ス
イープ（ここでは２スイープ）遅延させ、これらの信号
ｂ′，ｃ′，ｄ′の相関を干渉判定器３６において求
め、相関がない場合は干渉信号とみなし、ゲート発生器
３７でインターフェアランスゲートｅ′を発生し干渉信
号を除去した信号ｆ′を得ている。ここで、消去回路３
２を用いているのは、干渉信号がグランドクラッタに重
畳した場合に、グランドクラッタによってスイープ相関
がとれ、干渉信号が除去できなくなることを防ぐためで
ある。
去回路３２、合成回路３３を通してグランドクラッタを
抑圧し、この信号ａ′を比較器３４に入力してスレッシ
ョホールド信号と比較する。スレッショホールド値を越
えた信号ｂ′と、他の一部をスイープ遅延器３５で数ス
イープ（ここでは２スイープ）遅延させ、これらの信号
ｂ′，ｃ′，ｄ′の相関を干渉判定器３６において求
め、相関がない場合は干渉信号とみなし、ゲート発生器
３７でインターフェアランスゲートｅ′を発生し干渉信
号を除去した信号ｆ′を得ている。ここで、消去回路３
２を用いているのは、干渉信号がグランドクラッタに重
畳した場合に、グランドクラッタによってスイープ相関
がとれ、干渉信号が除去できなくなることを防ぐためで
ある。
【０００４】即ち、図４に示すように、他レーダからの
干渉信号が自機のレーダ同期に対して非同期であること
から、前の２つのスイープの信号との同期性を判別し、
同期性が無い場合はインタフェアランスゲート信号を発
生することにより干渉信号を除去している。又、自機の
レーダ信号でも、パルス周期外が受信されるパルス間隔
超越エコーは、送信パルスを異なる周期で送信するスタ
ガー同期のため非同期となり、他レーダからの干渉信号
同様に除去している。
干渉信号が自機のレーダ同期に対して非同期であること
から、前の２つのスイープの信号との同期性を判別し、
同期性が無い場合はインタフェアランスゲート信号を発
生することにより干渉信号を除去している。又、自機の
レーダ信号でも、パルス周期外が受信されるパルス間隔
超越エコーは、送信パルスを異なる周期で送信するスタ
ガー同期のため非同期となり、他レーダからの干渉信号
同様に除去している。
【０００５】
【発明が解決しようとする課題】しかしながら、この従
来のレーダ干渉除去装置では、図５に示すように、消去
回路３２では抑圧できないウェザー（雨や雲）クラッタ
や、消去回路の消え残りが干渉信号に重畳した場合に、
スレッショホールドレベルを越えるこれらの信号によっ
てスイープ間の相関がとれてしまい、干渉除去のための
インタフェアランスゲート信号が発生せず、干渉が除去
できないという問題がある。本発明の目的は、ウェザー
クラッタ等に重畳された干渉信号を除去することを可能
にしたレーダ干渉除去装置を提供することにある。
来のレーダ干渉除去装置では、図５に示すように、消去
回路３２では抑圧できないウェザー（雨や雲）クラッタ
や、消去回路の消え残りが干渉信号に重畳した場合に、
スレッショホールドレベルを越えるこれらの信号によっ
てスイープ間の相関がとれてしまい、干渉除去のための
インタフェアランスゲート信号が発生せず、干渉が除去
できないという問題がある。本発明の目的は、ウェザー
クラッタ等に重畳された干渉信号を除去することを可能
にしたレーダ干渉除去装置を提供することにある。
【０００６】
【課題を解決するための手段】本発明のレーダ干渉除去
装置は、受信信号をスレッショホルード値と比較して雑
音を分離する比較器に入力されるスレッショホールド値
を、受信信号のレベルに基づいて発生させるスレッショ
ホールド値生成回路を備えている。例えば、このスレッ
ショホールド値生成回路は、信号のピーク値を検出する
回路と、この検出されたピーク値を平均化する平均化回
路と、平均化された値を記憶するメモリとで構成され
る。
装置は、受信信号をスレッショホルード値と比較して雑
音を分離する比較器に入力されるスレッショホールド値
を、受信信号のレベルに基づいて発生させるスレッショ
ホールド値生成回路を備えている。例えば、このスレッ
ショホールド値生成回路は、信号のピーク値を検出する
回路と、この検出されたピーク値を平均化する平均化回
路と、平均化された値を記憶するメモリとで構成され
る。
【０００７】
【作用】本発明によれば、受信信号は、そのレベルに応
じて得られるスレッシュホールド値によって比較される
ため、ウェザークラッタ等が比較器から出力されること
はなく、ウェザークラッタ等に重畳した干渉を除去する
ことが可能とされる。
じて得られるスレッシュホールド値によって比較される
ため、ウェザークラッタ等が比較器から出力されること
はなく、ウェザークラッタ等に重畳した干渉を除去する
ことが可能とされる。
【０００８】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明のレーダ干渉除去装置の一実施例のブ
ロック構成図である。同図において、従来構成と同一部
分には同一符号を付しており、受信信号は増幅器１で増
幅された後、ミキサ２により中間周波信号に変換され、
更に増幅器３で増幅された後、位相検波器４において位
相が検出される。この位相検波器４からはＩコヒアレン
トビデオとＱコヒアレントビデオの各信号が出力され、
これらはＭＴＩ（Moving Target Indicator)５において
ＭＴＩ処理され、更にLOG CFAR６及びゲート７を介して
出力される。このゲート７はインタフェアランスゲート
信号によって制御される。又、LOG CFAR６を迂回するス
イッチ８が設けられている。
る。図１は本発明のレーダ干渉除去装置の一実施例のブ
ロック構成図である。同図において、従来構成と同一部
分には同一符号を付しており、受信信号は増幅器１で増
幅された後、ミキサ２により中間周波信号に変換され、
更に増幅器３で増幅された後、位相検波器４において位
相が検出される。この位相検波器４からはＩコヒアレン
トビデオとＱコヒアレントビデオの各信号が出力され、
これらはＭＴＩ（Moving Target Indicator)５において
ＭＴＩ処理され、更にLOG CFAR６及びゲート７を介して
出力される。このゲート７はインタフェアランスゲート
信号によって制御される。又、LOG CFAR６を迂回するス
イッチ８が設けられている。
【０００９】一方、Ｉ及びＱの各コヒアレントビデオ信
号は、干渉波を検出するための干渉除去回路１１に出力
される。この干渉除去回路１１は、Ｉ及びＱコヒアレン
トビデオ信号をグランドクラッタを抑圧する消去回路１
２を通し、合成回路１３で合成する。そして、この信号
ａを比較器１４においてスレッショホールド値と比較
し、スレッショホールド値を越える信号ｂと、スイープ
遅延器１６で遅延させた２つのスイープ信号ｃ，ｄとの
相関を干渉判定器１７において判定し、相関がない場合
は干渉信号とみなしてゲート発生器１８からインタフェ
アランスゲート信号ｅを出力する。
号は、干渉波を検出するための干渉除去回路１１に出力
される。この干渉除去回路１１は、Ｉ及びＱコヒアレン
トビデオ信号をグランドクラッタを抑圧する消去回路１
２を通し、合成回路１３で合成する。そして、この信号
ａを比較器１４においてスレッショホールド値と比較
し、スレッショホールド値を越える信号ｂと、スイープ
遅延器１６で遅延させた２つのスイープ信号ｃ，ｄとの
相関を干渉判定器１７において判定し、相関がない場合
は干渉信号とみなしてゲート発生器１８からインタフェ
アランスゲート信号ｅを出力する。
【００１０】又、干渉除去回路１１にはスレッショホー
ルド値生成回路１５が設けられており、Ｉ及びＱの各コ
ヒアレントビデオ信号のピーク値をピーク値検出回路１
９で検出し、これを平均化回路２０で平均化処理し、こ
の平均値をメモリ２１に記憶させる。そして、このメモ
リ２１からスレッショホールド値を出力し、前記比較器
１４でのスレッショホルード値として用いられる。尚、
このメモリ２１は適度な周期でリフレッシュされ、記憶
されるスレッショホールド値が漸次更新される。
ルド値生成回路１５が設けられており、Ｉ及びＱの各コ
ヒアレントビデオ信号のピーク値をピーク値検出回路１
９で検出し、これを平均化回路２０で平均化処理し、こ
の平均値をメモリ２１に記憶させる。そして、このメモ
リ２１からスレッショホールド値を出力し、前記比較器
１４でのスレッショホルード値として用いられる。尚、
このメモリ２１は適度な周期でリフレッシュされ、記憶
されるスレッショホールド値が漸次更新される。
【００１１】したがって、この装置によれば、図２にタ
イミングチャートを示すように、合成された信号ａが比
較器１４に入力されると、スレッショホールド値との比
較により目標信号ｂが得られ、かつその一部のスイープ
遅延された信号ｃ，ｄとにより相関が求められる。そし
て、相関が無い場合にはインタフェアレンスゲート信号
ｅが出力され、これに基づいてゲート７を制御すること
で、干渉が除去された出力信号ｆを得ることができる。
イミングチャートを示すように、合成された信号ａが比
較器１４に入力されると、スレッショホールド値との比
較により目標信号ｂが得られ、かつその一部のスイープ
遅延された信号ｃ，ｄとにより相関が求められる。そし
て、相関が無い場合にはインタフェアレンスゲート信号
ｅが出力され、これに基づいてゲート７を制御すること
で、干渉が除去された出力信号ｆを得ることができる。
【００１２】このとき、消去回路では抑圧できないウェ
ザークラッタや消去回路の消え残りが含まれた信号ａが
比較器１４に入力されても、これらの信号のレベルに応
じたスレッショホールド値がスレッショホールド値生成
回路１５から出力されるため、クラッタがあるところは
スレッショホールド値が増大し、クラッタによって相関
がとれることが防止される。又、クラッタが無いところ
は、スレッショホールド値が低下することにより、低い
レベルの干渉波まで検出除去が可能となる。
ザークラッタや消去回路の消え残りが含まれた信号ａが
比較器１４に入力されても、これらの信号のレベルに応
じたスレッショホールド値がスレッショホールド値生成
回路１５から出力されるため、クラッタがあるところは
スレッショホールド値が増大し、クラッタによって相関
がとれることが防止される。又、クラッタが無いところ
は、スレッショホールド値が低下することにより、低い
レベルの干渉波まで検出除去が可能となる。
【００１３】
【発明の効果】以上説明したように本発明は、受信信号
のレベルに基づいて発生させるスレッショホールド値生
成回路を備えているので、受信信号を発生されたスレッ
シュホールド値によって比較することで、ウェザークラ
ッタ等が比較器から出力されることはなく、スイープ相
関がとられることが防止でき、ウェザークラッタ等に重
畳した干渉を除去することが可能となる。
のレベルに基づいて発生させるスレッショホールド値生
成回路を備えているので、受信信号を発生されたスレッ
シュホールド値によって比較することで、ウェザークラ
ッタ等が比較器から出力されることはなく、スイープ相
関がとられることが防止でき、ウェザークラッタ等に重
畳した干渉を除去することが可能となる。
【図１】本発明のレーダ干渉除去装置の一実施例のブロ
ック構成図である。
ック構成図である。
【図２】図１の装置における信号ａ〜ｆのタイミング図
である。
である。
【図３】従来のレーダ干渉除去装置の一例のブロック構
成図である。
成図である。
【図４】図３の装置における信号ａ′〜ｆ′のタイミン
グ図である。
グ図である。
【図５】図３の装置における不具合を示す図４と同様の
タイミング図である。
タイミング図である。
２ ミキサ ４ 位相検波器 ５ ＭＴＩ ７ ゲート １１ 干渉除去回路 １２ 消去回路 １３ 合成回路 １４ 比較器 １５ スレッショホールド値生成回路 １６ スイープ遅延器 １７ 干渉判定器 １８ ゲート発生器 １９ ピーク値検出回路 ２０ 平均化回路 ２１ メモリ
Claims (2)
- 【請求項１】 受信信号をスレッショホルード値と比較
し、雑音を分離した信号をスイープ相関処理して干渉判
定を行い、相関がとれない場合にインタフェーアランス
ゲート信号を発生して干渉を除去するようにしたレーダ
干渉除去装置において、前記比較器に入力されるスレッ
ショホールド値を受信信号に基づいて発生させるスレッ
ショホールド値生成回路を備えることを特徴とするレー
ダ干渉除去装置。 - 【請求項２】 スレッショホールド値生成回路は、信号
のピーク値を検出する回路と、この検出されたピーク値
を平均化する平均化回路と、平均化された値を記憶する
メモリとで構成される請求項１のレーダ干渉除去装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3299863A JPH05107343A (ja) | 1991-10-19 | 1991-10-19 | レーダ干渉除去装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3299863A JPH05107343A (ja) | 1991-10-19 | 1991-10-19 | レーダ干渉除去装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05107343A true JPH05107343A (ja) | 1993-04-27 |
Family
ID=17877865
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3299863A Pending JPH05107343A (ja) | 1991-10-19 | 1991-10-19 | レーダ干渉除去装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05107343A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0943339A (ja) * | 1995-07-26 | 1997-02-14 | Nec Corp | レーダビデオ圧縮装置 |
| JP2013221756A (ja) * | 2012-04-12 | 2013-10-28 | Furuno Electric Co Ltd | レーダ装置、及びレーダ送受信方法 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5754876A (en) * | 1980-09-19 | 1982-04-01 | Furuno Electric Co Ltd | Interference level setting circuit in removal of interfering wave |
| JPS6143659A (ja) * | 1984-08-07 | 1986-03-03 | Mitsubishi Chem Ind Ltd | 導電性ポリカ−ボネ−ト樹脂組成物 |
-
1991
- 1991-10-19 JP JP3299863A patent/JPH05107343A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5754876A (en) * | 1980-09-19 | 1982-04-01 | Furuno Electric Co Ltd | Interference level setting circuit in removal of interfering wave |
| JPS6143659A (ja) * | 1984-08-07 | 1986-03-03 | Mitsubishi Chem Ind Ltd | 導電性ポリカ−ボネ−ト樹脂組成物 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0943339A (ja) * | 1995-07-26 | 1997-02-14 | Nec Corp | レーダビデオ圧縮装置 |
| JP2013221756A (ja) * | 2012-04-12 | 2013-10-28 | Furuno Electric Co Ltd | レーダ装置、及びレーダ送受信方法 |
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