JPH0466649U - - Google Patents

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JPH0466649U
JPH0466649U JP10755290U JP10755290U JPH0466649U JP H0466649 U JPH0466649 U JP H0466649U JP 10755290 U JP10755290 U JP 10755290U JP 10755290 U JP10755290 U JP 10755290U JP H0466649 U JPH0466649 U JP H0466649U
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例のマルチポートメ
モリ装置のブロツク図、第２図は従来のマルチポ
ートメモリ装置の一例のブロツク図である。 符号の説明、１……マルチポートメモリ装置、
２……メモリアレイ、３，４……アドレスバツフ
ア、５……アービタ、６ａ〜６ｄ……データバツ
フア、７……データバツフア、８……アドレスレ
ジスタ、９……コンパレータ、１０……コントロ
ーラ。

Claims (1)

  1. 【実用新案登録請求の範囲】 データ幅Ｗａでのリード要求を受け付るＡポー
    トと、 データ幅Ｗｂ（≧α・Ｗａ；αは２以上の整数
    ）でのリード要求を受け付けるＢポートと、 データ幅Ｗｂでリード可能なメモリアレイと、 データ幅Ｗａの少なくとも２個のデータバツフ
    アと、 前記Ａポートからのリード要求に対してはその
    リード対象のデータが前記データバツフアにある
    か否か判定し、あるときはデータバツフアからＡ
    ポートに送り、ないときはリード対象のデータを
    含むように前記メモリアレイよりデータ幅Ｗｂで
    データを読み出してリード対象のデータとそれに
    連続する少なくとも１個のデータ幅Ｗａのデータ
    を前記データバツフアに格納すると共にリード対
    象のデータをＡポートに送り、一方、前記Ｂポー
    トからのリード要求に対してはそのリード対象の
    データを前記メモリアレイより読み出してＢポー
    トに送る制御を実行するリードコントローラと を具備したことを特徴とするマルチポートメモリ
    装置。
JP1990107552U 1990-10-11 1990-10-11 マルチポートメモリ装置 Expired - Fee Related JP2606824Y2 (ja)

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56156978A (en) * 1980-04-30 1981-12-03 Toshiba Corp Memory control system
JPS5930156A (ja) * 1982-08-09 1984-02-17 Sharp Corp マイクロコンピユ−タシステム

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56156978A (en) * 1980-04-30 1981-12-03 Toshiba Corp Memory control system
JPS5930156A (ja) * 1982-08-09 1984-02-17 Sharp Corp マイクロコンピユ−タシステム

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