JPH04346553A - 課金信号送出方式 - Google Patents
課金信号送出方式Info
- Publication number
- JPH04346553A JPH04346553A JP11973891A JP11973891A JPH04346553A JP H04346553 A JPH04346553 A JP H04346553A JP 11973891 A JP11973891 A JP 11973891A JP 11973891 A JP11973891 A JP 11973891A JP H04346553 A JPH04346553 A JP H04346553A
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- circuit
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- 230000008054 signal transmission Effects 0.000 title description 2
- 238000012544 monitoring process Methods 0.000 claims description 7
- 230000005540 biological transmission Effects 0.000 abstract description 6
- 238000010586 diagram Methods 0.000 description 7
- 230000000694 effects Effects 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明はＰＣＭ端局装置における
アナログ交換機トランク回路とのインタフェース回路の
課金信号送出方式に関する。ＰＣＭ端局装置においては
アナログ交換機（クロスバー交換機等）のトランク回路
との間にチャンネル毎のインタフェース回路を有し、制
御部の制御により多重化部を経由してＰＣＭ伝送路によ
り対向局との間で多重通信を行っている。この制御部か
らインタフェース回路に対し通話中課金信号が送出され
る。
アナログ交換機トランク回路とのインタフェース回路の
課金信号送出方式に関する。ＰＣＭ端局装置においては
アナログ交換機（クロスバー交換機等）のトランク回路
との間にチャンネル毎のインタフェース回路を有し、制
御部の制御により多重化部を経由してＰＣＭ伝送路によ
り対向局との間で多重通信を行っている。この制御部か
らインタフェース回路に対し通話中課金信号が送出され
る。
【０００２】ＰＣＭ端局装置のシステム構成例を図５に
示す。図において、Ａ局を発信局とし、Ｂ局を対向局と
する。Ａ局において、３１は交換機のトランク回路、３
２はインタフェース回路、３３は制御部、３４は多重化
部を示し、Ｂ局において、３５は多重化部、３６は制御
部、３７はインタフェース部、３８は交換機のトランク
回路を示し、３９はＡ局とＢ局間のＰＣＭ伝送路を示す
。インタフェース回路３２と３７はチャンネル毎に設け
られ、それぞれ交換機のトランク回路３１と３８とにＴ
線及びＲ線により２線接続されている。各インタフェー
ス回路３２と３７は制御部３３と３６により制御され、
多重化部３４と３５とで各チャンネルが多重化されてＰ
ＣＭ多重化信号としてＰＣＭ伝送路３９によりＡ，Ｂ局
間を送受信中継される。Ａ局（発信局）においては通話
中制御部３３よりインタフェース回路３２を経由して交
換機のトランク回路３１に対して課金信号が送出される
。
示す。図において、Ａ局を発信局とし、Ｂ局を対向局と
する。Ａ局において、３１は交換機のトランク回路、３
２はインタフェース回路、３３は制御部、３４は多重化
部を示し、Ｂ局において、３５は多重化部、３６は制御
部、３７はインタフェース部、３８は交換機のトランク
回路を示し、３９はＡ局とＢ局間のＰＣＭ伝送路を示す
。インタフェース回路３２と３７はチャンネル毎に設け
られ、それぞれ交換機のトランク回路３１と３８とにＴ
線及びＲ線により２線接続されている。各インタフェー
ス回路３２と３７は制御部３３と３６により制御され、
多重化部３４と３５とで各チャンネルが多重化されてＰ
ＣＭ多重化信号としてＰＣＭ伝送路３９によりＡ，Ｂ局
間を送受信中継される。Ａ局（発信局）においては通話
中制御部３３よりインタフェース回路３２を経由して交
換機のトランク回路３１に対して課金信号が送出される
。
【０００３】
【従来の技術】従来のＰＣＭ端局装置における課金信号
送出回路のブロック構成図を図６に示す。図において、
２１は制御部、２２はＬＣフィルタ、２３は電流供給回
路、２４はバッテリー制御回路、２５は応答リレーＡＮ
Ｓ 、２６は監視リレーＢＡ、２７は課金リレーＭＰ、
２８は電流検出器、２９は電源制御トランジスタを示す
。
送出回路のブロック構成図を図６に示す。図において、
２１は制御部、２２はＬＣフィルタ、２３は電流供給回
路、２４はバッテリー制御回路、２５は応答リレーＡＮ
Ｓ 、２６は監視リレーＢＡ、２７は課金リレーＭＰ、
２８は電流検出器、２９は電源制御トランジスタを示す
。
【０００４】課金信号は、被呼者側の交換機から、発呼
者側の交換機に送る信号であり、この信号は通話中に発
呼者側の交換機に送られる。通話中の制御部２１の各ポ
ートの状態は、Ｄ３＝”Ｈ”，Ｙ４＝”Ｌ”，Ｙ３＝”
Ｈ”，Ｙ２＝”Ｈ”，Ｙ１＝”Ｈ” となっており、課
金時先ず制御部２１のＹ１に“Ｌ”を送り、バッテリー
制御回路２４でＴ側電流供給回路２３の電圧を０Ｖにし
、制御部２１がＹ２に“Ｌ”を送り、ＭＰリレーをオン
させる。次に制御部２１はＹ１に“Ｈ”を送り、バッテ
リー制御回路２４でＴ側電流供給回路２３の電圧を−４
８Ｖに戻す。２００ 〜３００ｍｓ 後、制御部２１は
Ｙ１に“Ｌ”を送り、バッテリー制御回路２４でＴ側電
流供給回路２３の電圧を０Ｖにし、制御部２１がＹ２に
“Ｈ”を送りＭＰリレーをオフさせる。バッテリー制御
回路２４でＴ側電流供給回路２３の電圧を−４８Ｖに戻
す。この連続動作により通話中にＬＣフィルタを通った
２００ 〜３００ｍｓ の課金パルスを交換機に送出す
る。
者側の交換機に送る信号であり、この信号は通話中に発
呼者側の交換機に送られる。通話中の制御部２１の各ポ
ートの状態は、Ｄ３＝”Ｈ”，Ｙ４＝”Ｌ”，Ｙ３＝”
Ｈ”，Ｙ２＝”Ｈ”，Ｙ１＝”Ｈ” となっており、課
金時先ず制御部２１のＹ１に“Ｌ”を送り、バッテリー
制御回路２４でＴ側電流供給回路２３の電圧を０Ｖにし
、制御部２１がＹ２に“Ｌ”を送り、ＭＰリレーをオン
させる。次に制御部２１はＹ１に“Ｈ”を送り、バッテ
リー制御回路２４でＴ側電流供給回路２３の電圧を−４
８Ｖに戻す。２００ 〜３００ｍｓ 後、制御部２１は
Ｙ１に“Ｌ”を送り、バッテリー制御回路２４でＴ側電
流供給回路２３の電圧を０Ｖにし、制御部２１がＹ２に
“Ｈ”を送りＭＰリレーをオフさせる。バッテリー制御
回路２４でＴ側電流供給回路２３の電圧を−４８Ｖに戻
す。この連続動作により通話中にＬＣフィルタを通った
２００ 〜３００ｍｓ の課金パルスを交換機に送出す
る。
【０００５】バッテリー制御回路２４はローパスフィル
タと電源制御トランジスタ２９を制御する回路からなり
、課金時、Ｙ１に課金パルスＢＣがくるとフィルタ回路
により鈍化されて徐々に電源制御トランジスタ２９を制
御し、ＭＰリレー２７のオンオフするときだけ、Ｔ側電
流供給回路２３にかかる電圧を０Ｖにコントロールする
。従って、ＭＰリレー２７の接点ｍｐが切り替わるとき
ＬＣフィルタ２２でノイズを吸収すると共に、ＭＰリレ
ーの動作復旧時にＴ側電流供給回路２３にかかる電圧を
バッテリー制御回路２４により０Ｖに制御してノイズを
吸収している。
タと電源制御トランジスタ２９を制御する回路からなり
、課金時、Ｙ１に課金パルスＢＣがくるとフィルタ回路
により鈍化されて徐々に電源制御トランジスタ２９を制
御し、ＭＰリレー２７のオンオフするときだけ、Ｔ側電
流供給回路２３にかかる電圧を０Ｖにコントロールする
。従って、ＭＰリレー２７の接点ｍｐが切り替わるとき
ＬＣフィルタ２２でノイズを吸収すると共に、ＭＰリレ
ーの動作復旧時にＴ側電流供給回路２３にかかる電圧を
バッテリー制御回路２４により０Ｖに制御してノイズを
吸収している。
【０００６】
【発明が解決しようとする課題】従来の回路では、通話
中ＬＣフィルタを挿入すると共に、課金用のＭＰリレー
がオン／オフする音（ノイズ）が電話の利用者になるべ
く聞こえないように、バッテリー制御回路や電源制御ト
ランジスタを付加している。その為、機構が複雑になり
、リレーの数も増大し、１チャンネル当たりの面積も大
きくなるという問題があった。
中ＬＣフィルタを挿入すると共に、課金用のＭＰリレー
がオン／オフする音（ノイズ）が電話の利用者になるべ
く聞こえないように、バッテリー制御回路や電源制御ト
ランジスタを付加している。その為、機構が複雑になり
、リレーの数も増大し、１チャンネル当たりの面積も大
きくなるという問題があった。
【０００７】本発明では、通話回路にＬＣフィルタを使
用しないで、リレーの数を減らし、１チャンネル当たり
の実装面積とコストを減らした課金信号送出方式を提供
することを目的とする。
用しないで、リレーの数を減らし、１チャンネル当たり
の実装面積とコストを減らした課金信号送出方式を提供
することを目的とする。
【０００８】
【課題を解決するための手段】本発明の原理構成図を図
１に示す。図において、１は制御部、２は電源電圧制御
回路、３はＴ側電流供給回路、４はＲ側電流供給回路、
５は電流検出器、６は監視リレーを示す。制御部１はＣ
ＰＵと制御端子とからなり、電源電圧制御回路２はフィ
ルタ部とＴ側電源制御部とＲ側電源制御部とからなり、
Ｔ側電流供給回路３とＲ側電流供給回路４はそれぞれＴ
線側とＲ線側に挿入され、全波ブリッジと定電流素子よ
り構成されている。電流検出器５はＲ線側に接続され、
交換機のトランク回路の切断を監視している。監視リレ
ー６は常時動作用のリレーで復旧時はＴ線側とＲ線側と
を切断してインタフェース回路を閉塞するリレーである
。
１に示す。図において、１は制御部、２は電源電圧制御
回路、３はＴ側電流供給回路、４はＲ側電流供給回路、
５は電流検出器、６は監視リレーを示す。制御部１はＣ
ＰＵと制御端子とからなり、電源電圧制御回路２はフィ
ルタ部とＴ側電源制御部とＲ側電源制御部とからなり、
Ｔ側電流供給回路３とＲ側電流供給回路４はそれぞれＴ
線側とＲ線側に挿入され、全波ブリッジと定電流素子よ
り構成されている。電流検出器５はＲ線側に接続され、
交換機のトランク回路の切断を監視している。監視リレ
ー６は常時動作用のリレーで復旧時はＴ線側とＲ線側と
を切断してインタフェース回路を閉塞するリレーである
。
【０００９】
（１） 被呼者応答して通話時は電源電圧制御回路２の
Ｔ側電源制御部より０Ｖの電源がＴ側電流供給回路３に
供給され、Ｒ側電源制御部より−４８ＶがＲ側電流供給
回路４に供給され、Ｔ線と交換機のトランク回路とＲ線
とのループを形勢する。 （２） 通話中、制御部１のＣＰＵより２００ 〜３０
０ｍｓ の課金パルスＰＣを電源電圧制御回路２のフィ
ルタ部に送信すると、その間電源電圧制御回路２のＴ側
電源制御部の電圧は０Ｖより−４８Ｖに反転し、Ｒ側電
源制御部の電圧は−４８Ｖより０Ｖに反転し、Ｔ側電流
供給回路３とＲ側電流供給回路４に課金パルス送出中だ
け反転した電流が供給される。 （３） 課金パルスが終了すれば再び電源電圧制御回路
２は通話時の状態に戻り、Ｔ側電源制御部より０Ｖの電
源がＴ側電流供給回路３に供給され、Ｒ側電源制御部よ
り−４８ＶがＲ側電流供給回路４に供給される。 （４） 通話中は課金パルスが送出される間だけ電流供
給回路が反転するが、電源電圧制御回路２のローパスフ
ィルタ部によりノイズは吸収され、課金時通話回路を切
り換えるリレーが無いので接点切り換えに伴うノイズも
発生しない。
Ｔ側電源制御部より０Ｖの電源がＴ側電流供給回路３に
供給され、Ｒ側電源制御部より−４８ＶがＲ側電流供給
回路４に供給され、Ｔ線と交換機のトランク回路とＲ線
とのループを形勢する。 （２） 通話中、制御部１のＣＰＵより２００ 〜３０
０ｍｓ の課金パルスＰＣを電源電圧制御回路２のフィ
ルタ部に送信すると、その間電源電圧制御回路２のＴ側
電源制御部の電圧は０Ｖより−４８Ｖに反転し、Ｒ側電
源制御部の電圧は−４８Ｖより０Ｖに反転し、Ｔ側電流
供給回路３とＲ側電流供給回路４に課金パルス送出中だ
け反転した電流が供給される。 （３） 課金パルスが終了すれば再び電源電圧制御回路
２は通話時の状態に戻り、Ｔ側電源制御部より０Ｖの電
源がＴ側電流供給回路３に供給され、Ｒ側電源制御部よ
り−４８ＶがＲ側電流供給回路４に供給される。 （４） 通話中は課金パルスが送出される間だけ電流供
給回路が反転するが、電源電圧制御回路２のローパスフ
ィルタ部によりノイズは吸収され、課金時通話回路を切
り換えるリレーが無いので接点切り換えに伴うノイズも
発生しない。
【００１０】
【実施例】本発明の実施例のブロック構成図を図２に、
電源電圧制御回路の実施例を図３に示す。図において、
１は制御部、２は電源電圧制御回路、３はＴ側電流供給
回路、４はＲ側電流供給回路、５は電流検出器、６は監
視リレーを示す。制御部１は８ビットＣＰＵ１１と制御
端子Ｄ１２と制御端子Ｙ１３とからなり、電源電圧制御
回路２はフィルタ回路部１４とＴ側電源制御部１５とＲ
側電源制御部１６とからなる。
電源電圧制御回路の実施例を図３に示す。図において、
１は制御部、２は電源電圧制御回路、３はＴ側電流供給
回路、４はＲ側電流供給回路、５は電流検出器、６は監
視リレーを示す。制御部１は８ビットＣＰＵ１１と制御
端子Ｄ１２と制御端子Ｙ１３とからなり、電源電圧制御
回路２はフィルタ回路部１４とＴ側電源制御部１５とＲ
側電源制御部１６とからなる。
【００１１】制御端子Ｄ１２はＤ０，Ｄ１，Ｄ２，Ｄ３
端子からなり、Ｄ３端子は電流検出器５からのトラン
ク回路の切断制御信号Ａを監視する。制御端子Ｙ１３は
Ｙ０，Ｙ１，Ｙ２，Ｙ３，Ｙ４端子からなり、Ｙ３端子
からの制御信号は監視リレーＢＡ６を制御してＴ線とＲ
線のｂａ接点を閉塞時以外は常時動作させておく。Ｙ４
端子からはＣＰＵ１１より通話中の課金時に、２００
〜３００ｍｓ の課金パルスＰＣを電源電圧制御回路２
のフィルタ回路部１４に供給する。電源電圧制御回路２
のＴ側電源制御部１５はＴ側電流供給回路３に接続され
、Ｒ側電源制御部１６はＲ側電流供給回路４に接続され
ている。尚電源電圧制御回路２において、Ｒ１〜Ｒ２０
は抵抗、Ｔｒ１ 〜Ｔｒ１０はトランジスタ、Ｃ１，
Ｃ２ はコンデンサ、ＩＣ１ 〜ＩＣ３ はオペアンプ
を示す。
端子からなり、Ｄ３端子は電流検出器５からのトラン
ク回路の切断制御信号Ａを監視する。制御端子Ｙ１３は
Ｙ０，Ｙ１，Ｙ２，Ｙ３，Ｙ４端子からなり、Ｙ３端子
からの制御信号は監視リレーＢＡ６を制御してＴ線とＲ
線のｂａ接点を閉塞時以外は常時動作させておく。Ｙ４
端子からはＣＰＵ１１より通話中の課金時に、２００
〜３００ｍｓ の課金パルスＰＣを電源電圧制御回路２
のフィルタ回路部１４に供給する。電源電圧制御回路２
のＴ側電源制御部１５はＴ側電流供給回路３に接続され
、Ｒ側電源制御部１６はＲ側電流供給回路４に接続され
ている。尚電源電圧制御回路２において、Ｒ１〜Ｒ２０
は抵抗、Ｔｒ１ 〜Ｔｒ１０はトランジスタ、Ｃ１，
Ｃ２ はコンデンサ、ＩＣ１ 〜ＩＣ３ はオペアンプ
を示す。
【００１２】通話中制御部１の各ポートはＤ３＝”Ｈ”
，Ｙ４＝”Ｌ”，Ｙ３＝”Ｌ” になっており、電源電
圧制御回路２はＴ側電流供給回路３に０Ｖ、Ｒ側電流供
給回路４に−４８Ｖを供給している。課金時は、先ず制
御部１のＹ４に“Ｈ”を送り、電源電圧制御回路２でＴ
側電流供給回路３の電圧を−４８Ｖに、Ｒ側電流供給回
路４の電圧を０Ｖにする。２００ 〜３００ｍｓ 後、
制御部１のＹ４に“Ｌ”を送り、電源電圧制御回路２で
Ｔ側電流供給回路３の電圧を０Ｖに、Ｒ側電流供給回路
４の電圧を−４８Ｖに戻す。この連続動作により２００
〜３００ｍｓの課金パルスを交換機に送出する。
，Ｙ４＝”Ｌ”，Ｙ３＝”Ｌ” になっており、電源電
圧制御回路２はＴ側電流供給回路３に０Ｖ、Ｒ側電流供
給回路４に−４８Ｖを供給している。課金時は、先ず制
御部１のＹ４に“Ｈ”を送り、電源電圧制御回路２でＴ
側電流供給回路３の電圧を−４８Ｖに、Ｒ側電流供給回
路４の電圧を０Ｖにする。２００ 〜３００ｍｓ 後、
制御部１のＹ４に“Ｌ”を送り、電源電圧制御回路２で
Ｔ側電流供給回路３の電圧を０Ｖに、Ｒ側電流供給回路
４の電圧を−４８Ｖに戻す。この連続動作により２００
〜３００ｍｓの課金パルスを交換機に送出する。
【００１３】本発明の実施例の電源電圧制御回路のタイ
ムチャートを図４に示す。図において、■はＹ４端子よ
り供給される２００ 〜３００ｍｓ の課金パルス、■
はフィルタ回路部１４の出力波形、■はフィルタ回路部
１４からＴ側電源制御部１５に供給される波形、■はフ
ィルタ回路部１４からＲ側電源制御部１６に供給される
波形、■はＴ側電源制御部１５からＴ側電流供給回路３
に供給される課金パルス波形、■はＲ側電源制御部１６
からＲ側電流供給回路４に供給される課金パルス波形を
示す。
ムチャートを図４に示す。図において、■はＹ４端子よ
り供給される２００ 〜３００ｍｓ の課金パルス、■
はフィルタ回路部１４の出力波形、■はフィルタ回路部
１４からＴ側電源制御部１５に供給される波形、■はフ
ィルタ回路部１４からＲ側電源制御部１６に供給される
波形、■はＴ側電源制御部１５からＴ側電流供給回路３
に供給される課金パルス波形、■はＲ側電源制御部１６
からＲ側電流供給回路４に供給される課金パルス波形を
示す。
【００１４】課金時、Ｙ４端子に２００ 〜３００ｍｓ
の課金パルス■がくると、フィルタ回路部１４により
課金パルスは■の形に円滑化される。次に、Ｔ側電源制
御部１５のオペアンプＩＣ３ とＴ側電源制御部１５の
オペアンプＩＣ４ により、Ｔ側には■のパルス、Ｒ側
には■のパルスを送出する。 これによりＴ側電源制御部１５のトランジスタＴＲ６
とＲ側電源制御部１６のトランジスタＴＲ７ とが徐々
にオンし、Ｔ側電流供給回路３には■のパルス波形が、
Ｒ側電流供給回路４には■のパルス波形が送出される。
の課金パルス■がくると、フィルタ回路部１４により
課金パルスは■の形に円滑化される。次に、Ｔ側電源制
御部１５のオペアンプＩＣ３ とＴ側電源制御部１５の
オペアンプＩＣ４ により、Ｔ側には■のパルス、Ｒ側
には■のパルスを送出する。 これによりＴ側電源制御部１５のトランジスタＴＲ６
とＲ側電源制御部１６のトランジスタＴＲ７ とが徐々
にオンし、Ｔ側電流供給回路３には■のパルス波形が、
Ｒ側電流供給回路４には■のパルス波形が送出される。
【００１５】
【発明の効果】本発明により、通話回路にノイズフィル
タを挿入する必要が無く、又、通話回路を課金パルス送
出時切り換えるリレーを省くことが出来、１チャンネル
当たりの実装面積とコストを減らすことが出来る。
タを挿入する必要が無く、又、通話回路を課金パルス送
出時切り換えるリレーを省くことが出来、１チャンネル
当たりの実装面積とコストを減らすことが出来る。
【図１】 本発明の原理構成図
【図２】 実施例のブロック構成図
【図３】 実施例の電源電圧制御回路図
【図４】
実施例のタイムチャート
実施例のタイムチャート
【図５】 ＰＣＭ端局装置のシステム構成例
【図６】
従来例のブロック構成図
従来例のブロック構成図
１，２１，３３，３６ 制御部
２ 電源電圧制御回路
３ Ｔ側電流供給回路
４ Ｒ側電流供給回路
５，２８ 電流検出器
６，２６ 監視リレー
１１ ＣＰＵ
１２，１３ 制御端子
１４ フィルタ回路部
１５ Ｔ側電源制御部
１６ Ｒ側電源制御部
２２ ＬＣフィルタ
２３ 電流供給回路
２４ バッテリー制御回路
２５ 応答リレー
２７ 課金リレー
２９ 電源制御トランジスタ
３１，３８トランク回路
３２，３７ インタフェース回路
３４，３５ 多重化部
３９ ＰＣＭ伝送路
Claims (1)
- 【請求項１】 ＰＣＭ端局装置におけるアナログ交換
機トランク回路とのインタフェース回路において、該イ
ンタフェース回路を制御する制御部（１）と、該制御部
（１）からの課金パルスにより電流供給回路を制御する
電源電圧制御回路（２）と、Ｔ線側に電流を供給するＴ
側電流供給回路（３）と、Ｒ線側に電流を供給するＲ側
電流供給回路（４）と、トランク回路接続時に流れるル
ープ電流を検出する電流検出器（５）と、Ｔ線側とＲ線
側とを閉塞時復旧する常時動作用の監視リレー（６）と
を有し、該制御部（１）はＣＰＵと制御端子とからなり
、該電源電圧制御回路（２）はフィルタ部とＴ側電源制
御部とＲ側電源制御部とからなり、Ｔ側電流供給回路（
３）とＲ側電流供給回路（４）はそれぞれＴ線側とＲ線
側に挿入され、全波ブリッジと定電流素子とからなり、
通話中は電源電圧制御回路（２）からＴ側電流供給回路
（３）に０Ｖを、Ｒ側電流供給回路（４）に−４８Ｖを
供給し、課金パルス送出時はＴ側電流供給回路（３）に
−４８Ｖを、Ｒ側電流供給回路（４）に０Ｖを供給する
ことを特徴とする課金信号送出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11973891A JPH04346553A (ja) | 1991-05-24 | 1991-05-24 | 課金信号送出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11973891A JPH04346553A (ja) | 1991-05-24 | 1991-05-24 | 課金信号送出方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04346553A true JPH04346553A (ja) | 1992-12-02 |
Family
ID=14768908
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11973891A Withdrawn JPH04346553A (ja) | 1991-05-24 | 1991-05-24 | 課金信号送出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04346553A (ja) |
-
1991
- 1991-05-24 JP JP11973891A patent/JPH04346553A/ja not_active Withdrawn
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| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19980806 |