JPH04342075A - Ｃａｄシステムにおける回路図発生方式 - Google Patents
Ｃａｄシステムにおける回路図発生方式Info
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- JPH04342075A JPH04342075A JP3114231A JP11423191A JPH04342075A JP H04342075 A JPH04342075 A JP H04342075A JP 3114231 A JP3114231 A JP 3114231A JP 11423191 A JP11423191 A JP 11423191A JP H04342075 A JPH04342075 A JP H04342075A
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- 238000010586 diagram Methods 0.000 title claims description 21
- 238000000605 extraction Methods 0.000 claims description 16
- 238000000034 method Methods 0.000 claims description 14
- 239000000284 extract Substances 0.000 claims description 12
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明はＣＡＤシステムにおける
回路図発生方式に関する。
回路図発生方式に関する。
【０００２】
【従来の技術】従来、この種のＣＡＤシステムにおける
回路図発生方式では、同一種類のシンボルより構成され
たシンボル群から、個々のシンボルの入出力信号に付与
されていた信号名が、あらかじめ定められたルールに従
ってまとめられ、複数の信号より構成された信号の束で
ある束信号の信号名にすることができるシンボル群（束
シンボル）を決定し、回路図の発生を行っていた。
回路図発生方式では、同一種類のシンボルより構成され
たシンボル群から、個々のシンボルの入出力信号に付与
されていた信号名が、あらかじめ定められたルールに従
ってまとめられ、複数の信号より構成された信号の束で
ある束信号の信号名にすることができるシンボル群（束
シンボル）を決定し、回路図の発生を行っていた。
【０００３】
【発明が解決しようとする課題】上述した従来のＣＡＤ
システムにおける回路図発生方式は、束シンボルを決定
するために、同一種類のシンボルより構成されたシンボ
ル群ごとに、個々のシンボルの入出力信号に付与された
信号名が、束信号名になるか否かをチェックしているた
め、同一種類のシンボルが増加すればするほど、処理が
長くかかるという欠点を有していた。
システムにおける回路図発生方式は、束シンボルを決定
するために、同一種類のシンボルより構成されたシンボ
ル群ごとに、個々のシンボルの入出力信号に付与された
信号名が、束信号名になるか否かをチェックしているた
め、同一種類のシンボルが増加すればするほど、処理が
長くかかるという欠点を有していた。
【０００４】本発明の目的は、容易に束シンボルを決定
することができるＣＡＤシステムにおける回路図発生方
式を提供することにある。
することができるＣＡＤシステムにおける回路図発生方
式を提供することにある。
【０００５】
【課題を解決するための手段】本発明のＣＡＤシステム
における回路図発生方式は、（Ａ）回路の接続情報が記
憶されている論理接続記憶部、（Ｂ）前記回路のレジス
タを抽出し、前記レジスタのシンボルタグをソートし出
力するレジスタ抽出部、（Ｃ）同一の束シンボルに接続
しているシンボル群を回路の接続情報から抽出する仮シ
ンボル抽出部、（Ｄ）信号名群が束信号名に変換できる
か否かを判定する束信号名判定部、（Ｅ）前記束信号名
判定部の判定結果に基づいて、仮シンボルを束シンボル
にするか否かを判定する束シンボル判定部、（Ｆ）前記
束シンボル判定部で判定された束シンボル群とそれ以外
のシンボルとを論理接続情報によって配置し配線する配
置配線部、を備えて構成されている。
における回路図発生方式は、（Ａ）回路の接続情報が記
憶されている論理接続記憶部、（Ｂ）前記回路のレジス
タを抽出し、前記レジスタのシンボルタグをソートし出
力するレジスタ抽出部、（Ｃ）同一の束シンボルに接続
しているシンボル群を回路の接続情報から抽出する仮シ
ンボル抽出部、（Ｄ）信号名群が束信号名に変換できる
か否かを判定する束信号名判定部、（Ｅ）前記束信号名
判定部の判定結果に基づいて、仮シンボルを束シンボル
にするか否かを判定する束シンボル判定部、（Ｆ）前記
束シンボル判定部で判定された束シンボル群とそれ以外
のシンボルとを論理接続情報によって配置し配線する配
置配線部、を備えて構成されている。
【０００６】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
て説明する。
【０００７】図１は本発明のＣＡＤシステムにおける回
路図発生方式の一実施例を示すブロック図である。
路図発生方式の一実施例を示すブロック図である。
【０００８】図１に示すＣＡＤシステムにおける回路図
発生方式は、回路の接続情報が記憶されている論理接続
記憶部１、回路のレジスタを抽出し、レジスタのシンボ
ルタグをソートし出力するレジスタ抽出部２、同一の束
シンボルに接続しているシンボル群を回路の接続情報か
ら抽出する仮シンボル抽出部３、信号名群が束信号名に
変換できるか否かを判定する束信号名判定部５、束信号
名判定部５の判定結果に基づいて、仮シンボルを束シン
ボルにするか否かを判定する束シンボル判定部４、束シ
ンボル判定部４で判定された束シンボル群とそれ以外の
シンボルとを論理接続情報によって配置し配線する配置
配線部６から構成されている。
発生方式は、回路の接続情報が記憶されている論理接続
記憶部１、回路のレジスタを抽出し、レジスタのシンボ
ルタグをソートし出力するレジスタ抽出部２、同一の束
シンボルに接続しているシンボル群を回路の接続情報か
ら抽出する仮シンボル抽出部３、信号名群が束信号名に
変換できるか否かを判定する束信号名判定部５、束信号
名判定部５の判定結果に基づいて、仮シンボルを束シン
ボルにするか否かを判定する束シンボル判定部４、束シ
ンボル判定部４で判定された束シンボル群とそれ以外の
シンボルとを論理接続情報によって配置し配線する配置
配線部６から構成されている。
【０００９】次に、動作を説明する。
【００１０】図１において、論理接続記憶部１には、図
２に示すような回路の接続情報が記憶されており、レジ
スタ抽出部２は、論理接続記憶部１に記憶されている回
路の接続情報を読み出し、その中から回路のレジスタを
抽出し、さらにその第１番目のデータピンの信号名によ
って抽出したレジスタのシンボルタグ（シンボルをユニ
ークに区別する名前）をソートする。そして、ソートし
た順番でシンボルタグを束シンボル判定部４へ渡し、束
シンボルを仮シンボル抽出部３へ渡す。
２に示すような回路の接続情報が記憶されており、レジ
スタ抽出部２は、論理接続記憶部１に記憶されている回
路の接続情報を読み出し、その中から回路のレジスタを
抽出し、さらにその第１番目のデータピンの信号名によ
って抽出したレジスタのシンボルタグ（シンボルをユニ
ークに区別する名前）をソートする。そして、ソートし
た順番でシンボルタグを束シンボル判定部４へ渡し、束
シンボルを仮シンボル抽出部３へ渡す。
【００１１】次に、レジスタ抽出部２からシンボルタグ
を受け取った束シンボル判定部４は、論理接続記憶部１
から接続信号名を取り出し、取り出した接続信号名をグ
ループ分けする。そして、すべてのピンの接続信号のグ
ループ分けを行い、同一グループに含まれるシンボルタ
グの群を求め、束シンボルとして配置配線部６へ渡す。
を受け取った束シンボル判定部４は、論理接続記憶部１
から接続信号名を取り出し、取り出した接続信号名をグ
ループ分けする。そして、すべてのピンの接続信号のグ
ループ分けを行い、同一グループに含まれるシンボルタ
グの群を求め、束シンボルとして配置配線部６へ渡す。
【００１２】次に、レジスタ抽出部２から束シンボルを
受け取った仮シンボル抽出部３は、最初はレジスタ抽出
部２から受け取ったレジスタの束シンボルから、次に束
シンボル判定部４で束シンボルと判定されたレジスタ以
外の束シンボルから、同一の束シンボルに接続している
シンボル群を抽出し、仮束シンボルとする。
受け取った仮シンボル抽出部３は、最初はレジスタ抽出
部２から受け取ったレジスタの束シンボルから、次に束
シンボル判定部４で束シンボルと判定されたレジスタ以
外の束シンボルから、同一の束シンボルに接続している
シンボル群を抽出し、仮束シンボルとする。
【００１３】仮シンボル抽出部３から出力された仮束シ
ンボルは、束シンボル判定部４によって束シンボルか否
かが判定される。次に、束シンボル判定部４は、仮束シ
ンボルとしてまとめたシンボルごとにピン単位で接続信
号名を取り出し、束信号名判定部５へ渡す。そして、束
信号名判定部５によって束信号名になるか否かの判定が
行われる。また、束信号名判定部５は、既知の手法で受
け取った接続信号名から束信号名にできる信号名を求め
、グループ分けする。
ンボルは、束シンボル判定部４によって束シンボルか否
かが判定される。次に、束シンボル判定部４は、仮束シ
ンボルとしてまとめたシンボルごとにピン単位で接続信
号名を取り出し、束信号名判定部５へ渡す。そして、束
信号名判定部５によって束信号名になるか否かの判定が
行われる。また、束信号名判定部５は、既知の手法で受
け取った接続信号名から束信号名にできる信号名を求め
、グループ分けする。
【００１４】束シンボル判定部４は、束信号名判定部５
の判定結果から、シンボルをさらにグループに分けてそ
れぞれ束シンボルとする。
の判定結果から、シンボルをさらにグループに分けてそ
れぞれ束シンボルとする。
【００１５】配置配線部６は、束シンボル判定部４から
束シンボルとなるシンボル群を受け取り、束シンボルと
それ以外のシンボル，束線及び通常の線によって既知の
手法で配置及び配線を行う。
束シンボルとなるシンボル群を受け取り、束シンボルと
それ以外のシンボル，束線及び通常の線によって既知の
手法で配置及び配線を行う。
【００１６】次に、具体的な回路例を示し動作を説明す
る。
る。
【００１７】図３に示す回路例の場合について説明する
が、論理接続記憶部１には、表１のように記憶されてい
るものとする。
が、論理接続記憶部１には、表１のように記憶されてい
るものとする。
【００１８】
【表１】
【００１９】束信号名は、「代表信号名＋“（”＋ビッ
ト番号＋“）”」の形式を取るものとする。
ト番号＋“）”」の形式を取るものとする。
【００２０】また、レジスタは、シンボルの種類名が“
ＲＥＧ”であるシンボルとし、第１番目のデータピン名
はＤ０１ とする。
ＲＥＧ”であるシンボルとし、第１番目のデータピン名
はＤ０１ とする。
【００２１】レジスタ抽出部２は、論理接続記憶部１か
らレジスタのシンボルタグと、接続信号名Ｒ０１ ，Ｒ
０２ ，Ｒ０３ と、Ｉ（１），Ｉ（２），Ｉ（３）と
を取り出し、接続信号名でソートし、Ｒ０１ ，Ｒ０２
，Ｒ０３ の順番で束シンボル判定部４へシンボルタ
グのデータを渡す。束シンボル判定部４では、シンボル
タグＲ０１ ，Ｒ０２ ，Ｒ０３ の信号名Ｉ（１），
Ｉ（２），Ｉ（３），ＳＥＴ，ＳＥＴ，ＳＥＴ，Ａ（１
），Ａ（２），Ａ（３）を取り出し、この順番で束信号
名判定部５へ渡す。束信号名判定部５では、図６（ｃ）
の■，■，■のように束信号名が可能と判定し、Ｒ０１
，Ｒ０２ ，Ｒ０３ は束シンボルＲ０１ 〜Ｒ０３
となる。
らレジスタのシンボルタグと、接続信号名Ｒ０１ ，Ｒ
０２ ，Ｒ０３ と、Ｉ（１），Ｉ（２），Ｉ（３）と
を取り出し、接続信号名でソートし、Ｒ０１ ，Ｒ０２
，Ｒ０３ の順番で束シンボル判定部４へシンボルタ
グのデータを渡す。束シンボル判定部４では、シンボル
タグＲ０１ ，Ｒ０２ ，Ｒ０３ の信号名Ｉ（１），
Ｉ（２），Ｉ（３），ＳＥＴ，ＳＥＴ，ＳＥＴ，Ａ（１
），Ａ（２），Ａ（３）を取り出し、この順番で束信号
名判定部５へ渡す。束信号名判定部５では、図６（ｃ）
の■，■，■のように束信号名が可能と判定し、Ｒ０１
，Ｒ０２ ，Ｒ０３ は束シンボルＲ０１ 〜Ｒ０３
となる。
【００２２】また、仮シンボル抽出部３は、外部端子の
束シンボルＲ０１ 〜Ｒ０３ に接続しているシンボル
群Ｓ０１ ，Ｓ０２ ，Ｓ０３ を取り出し、束シンボ
ル判定部４によりＳ０１ ，Ｓ０２ の束シンボルＳ０
１ 〜Ｓ０２ を決定する。これは、図４の■，■，■
の束信号名の出力グループで、３入力グループ全体に渡
って出力グループが同一になるシンボルがＳ０１ ，Ｓ
０２ であるためである。
束シンボルＲ０１ 〜Ｒ０３ に接続しているシンボル
群Ｓ０１ ，Ｓ０２ ，Ｓ０３ を取り出し、束シンボ
ル判定部４によりＳ０１ ，Ｓ０２ の束シンボルＳ０
１ 〜Ｓ０２ を決定する。これは、図４の■，■，■
の束信号名の出力グループで、３入力グループ全体に渡
って出力グループが同一になるシンボルがＳ０１ ，Ｓ
０２ であるためである。
【００２３】また、同様にして、シンボル群Ｔ０１ ，
Ｔ０２ ，Ｔ０３ は、図４の■から束シンボルＴ０１
〜Ｔ０３ となる。
Ｔ０２ ，Ｔ０３ は、図４の■から束シンボルＴ０１
〜Ｔ０３ となる。
【００２４】次に、束シンボルになったＳ０１ ，Ｓ０
２ に接続するシンボル群から束シンボルＳ０４ 〜Ｓ
０５ が求められる。
２ に接続するシンボル群から束シンボルＳ０４ 〜Ｓ
０５ が求められる。
【００２５】配置配線部６は、束シンボルＲ０１ 〜Ｒ
０３ と、Ｔ０１ 〜Ｔ０３ と、Ｓ０１ 〜Ｓ０２
と、Ｓ０４ 〜Ｓ０５ と、シンボルＳ０３ と、シン
ボルＳＥＴとによって配置を行い、束シンボルへの入出
力は束線によって、またシンボルへの入出力は単線によ
って配線を行う。このようにして、図５に示すような回
路図が発生される。
０３ と、Ｔ０１ 〜Ｔ０３ と、Ｓ０１ 〜Ｓ０２
と、Ｓ０４ 〜Ｓ０５ と、シンボルＳ０３ と、シン
ボルＳＥＴとによって配置を行い、束シンボルへの入出
力は束線によって、またシンボルへの入出力は単線によ
って配線を行う。このようにして、図５に示すような回
路図が発生される。
【００２６】図５において、束シンボル及び束信号は太
線で描かれており、通常のシンボル及び信号は細線で描
かれている。束シンボルとしては、シンボル種類名がＣ
ＯＮ，ＲＥＧ，ＳＳ１ である束シンボルが示されてい
るが、これらのシンボル種類名の上方に記述されている
シンボルタグ、例えばシンボル種類名がＣＯＮの上方に
記述されているシンボルタグＴＯ１ ，ＴＯ３ は、図
３のシンボルタグＴＯ１ 〜ＴＯ３ のＣＯＮが束にな
ったものであることを示している。
線で描かれており、通常のシンボル及び信号は細線で描
かれている。束シンボルとしては、シンボル種類名がＣ
ＯＮ，ＲＥＧ，ＳＳ１ である束シンボルが示されてい
るが、これらのシンボル種類名の上方に記述されている
シンボルタグ、例えばシンボル種類名がＣＯＮの上方に
記述されているシンボルタグＴＯ１ ，ＴＯ３ は、図
３のシンボルタグＴＯ１ 〜ＴＯ３ のＣＯＮが束にな
ったものであることを示している。
【００２７】
【発明の効果】以上説明したように、本発明のＣＡＤシ
ステムにおける回路図発生方式は、レジスタを束シンボ
ルにし同一束シンボルに接続しているシンボル群を仮シ
ンボルとして抽出してから信号名により束シンボルにす
るか否かを判定することにより、容易に束シンボルを決
定することができるという効果を有している。
ステムにおける回路図発生方式は、レジスタを束シンボ
ルにし同一束シンボルに接続しているシンボル群を仮シ
ンボルとして抽出してから信号名により束シンボルにす
るか否かを判定することにより、容易に束シンボルを決
定することができるという効果を有している。
【図１】本発明のＣＡＤシステムにおける回路図発生方
式の一実施例を示すブロック図である。
式の一実施例を示すブロック図である。
【図２】図１の論理接続記憶部１の記憶項目を示す図で
ある。
ある。
【図３】本発明のＣＡＤシステムにおける回路図発生方
式の説明のための回路例を示す図である。
式の説明のための回路例を示す図である。
【図４】図１の束信号名判定部５の入力と出力との関係
を示す図である。
を示す図である。
【図５】図３の回路例について発生された回路図の例を
示す図である。
示す図である。
１ 論理接続記憶部
２ レジスタ抽出部
３ 仮シンボル抽出部
４ 束シンボル判定部
５ 束信号名判定部
６ 配置配線部
Claims (1)
- 【請求項１】（Ａ）回路の接続情報が記憶されている論
理接続記憶部、（Ｂ）前記回路のレジスタを抽出し、前
記レジスタのシンボルタグをソートし出力するレジスタ
抽出部、（Ｃ）同一の束シンボルに接続しているシンボ
ル群を回路の接続情報から抽出する仮シンボル抽出部、
（Ｄ）信号名群が束信号名に変換できるか否かを判定す
る束信号名判定部、（Ｅ）前記束信号名判定部の判定結
果に基づいて、仮シンボルを束シンボルにするか否かを
判定する束シンボル判定部、（Ｆ）前記束シンボル判定
部で判定された束シンボル群とそれ以外のシンボルとを
論理接続情報によって配置し配線する配置配線部、を備
えたことを特徴とするＣＡＤシステムにおける回路図発
生方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3114231A JPH04342075A (ja) | 1991-05-20 | 1991-05-20 | Ｃａｄシステムにおける回路図発生方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3114231A JPH04342075A (ja) | 1991-05-20 | 1991-05-20 | Ｃａｄシステムにおける回路図発生方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04342075A true JPH04342075A (ja) | 1992-11-27 |
Family
ID=14632534
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3114231A Pending JPH04342075A (ja) | 1991-05-20 | 1991-05-20 | Ｃａｄシステムにおける回路図発生方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04342075A (ja) |
-
1991
- 1991-05-20 JP JP3114231A patent/JPH04342075A/ja active Pending
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