JPH0433142U - - Google Patents

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JPH0433142U
JPH0433142U JP7142090U JP7142090U JPH0433142U JP H0433142 U JPH0433142 U JP H0433142U JP 7142090 U JP7142090 U JP 7142090U JP 7142090 U JP7142090 U JP 7142090U JP H0433142 U JPH0433142 U JP H0433142U
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JP7142090U
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Description

【図面の簡単な説明】
第１図は本考案の一実施例に係るライト命令制
御装置のブロツク図、第２図は第１図に示す装置
によるライトダブル命令実行ステツプを示すフロ
ーチヤート、第３図は従来のライト命令制御装置
のブロツク図、第４図は第３図に示す装置による
ライトダブル命令実行ステツプを示すフローチヤ
ートである。 １１……マイクロプログラムを記憶するメモリ
、１２……ライト命令のデータライト先となるメ
モリ、１３……実行処理部、１４……データレジ
スタ、１５……データセレクタ、１６……アドレ
ス演算部、１７……アドレスレジスタ、１８……
アドレスセレクタ、１９……アドレスインクリメ
ンタ、２０……メモリライト制御部。

Claims (1)

  1. 【実用新案登録請求の範囲】 マイクロプログラム記憶部と、 該マイクロプログラム記憶部からのメモリへの
    ライトダブル命令をデコードし制御信号と第１ラ
    イトデータと第２ライトデータとを出力する実行
    処理部と、 該実行処理部と前記メモリのデータ入力端との
    間に配置され、前記第１ライトデータならびに前
    記第２ライトデータを記憶するデータ記憶部と、 前記実行処理部と前記メモリのアドレス入力端
    との間に配置され、前記制御信号に基づき第１ラ
    イトアドレスおよび第２ライトアドレスを求めて
    記憶するアドレス記憶部と、 前記制御信号に基づいて、前記第１ライトデー
    タを前記メモリにおける前記第１ライトアドレス
    に、前記第２ライトデータを前記メモリにおける
    前記第２ライトアドレスにそれぞれライトするよ
    うに前記データ記憶部および前記アドレス記憶部
    の出力動作を制御するメモリライト制御部と、 を備えているライト命令制御装置。
JP7142090U 1990-07-04 1990-07-04 Pending JPH0433142U (ja)

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JP7142090U JPH0433142U (ja) 1990-07-04 1990-07-04

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JPH0433142U true JPH0433142U (ja) 1992-03-18

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ID=31608436

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