JPH04309878A - 受信装置 - Google Patents

受信装置

Info

Publication number
JPH04309878A
JPH04309878A JP3101931A JP10193191A JPH04309878A JP H04309878 A JPH04309878 A JP H04309878A JP 3101931 A JP3101931 A JP 3101931A JP 10193191 A JP10193191 A JP 10193191A JP H04309878 A JPH04309878 A JP H04309878A
Authority
JP
Japan
Prior art keywords
receiver
amplitude
circuit
information
ratio
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3101931A
Other languages
English (en)
Inventor
Munenori Mikami
三上 宗紀
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP3101931A priority Critical patent/JPH04309878A/ja
Publication of JPH04309878A publication Critical patent/JPH04309878A/ja
Pending legal-status Critical Current

Links

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は受信装置に関し、特に
同時に入力する2つの高周波信号の振幅比を正確に測定
できる装置に関するものである。
【0002】
【従来の技術】図4は例えば特開昭57−106875
号公報に示された従来のこの種の受信装置を示すもので
あり、図において、1a,1bは信号の入力端、4a,
4bは同一仕様に基づく受信機であり、それぞれ入力信
号に対応した振幅情報を出力する。15は比較器であり
、受信機4aからの振幅情報と受信機4bからの振幅情
報とを比較し、その振幅比を出力する。7a,7bは記
憶回路であり、比較器15からの振幅比情報を記憶する
。14a,14bは第1切替器、16は第2切替器であ
り、それぞれ回路の切替えを行う。9は較正器であり、
記憶回路7aからの記憶情報を記憶回路7bからの記憶
情報でもって較正する。8はゲート回路であり、指定さ
れたタイミングで記憶回路7a,7bが記憶している記
憶情報を較正器9へ送る。11は出力端であり、入力端
1a,1bに入力した信号の正確な比較比を出力する。 17は周波数記憶器であり、受信機4a,4bが受信し
た同一周波数の入力信号の周波数情報を記憶する。 18は発振器であり、周波数記憶器17が記憶した周波
数情報を受けてその周波数と同一の周波数の信号を発生
する。19は電力分配器であり、発振器18からの信号
を等分する。
【0003】次に動作について説明する。この受信装置
が初期状態、すなわち外部からの未知信号を待受ける状
態にあるとき、第1切替器14a,14bは入力端1a
,1bと受信機4a,4bに対応した入力端とをそれぞ
れ接続し、第2切替器16は比較器15の出力端と記憶
回路7aの入力端とを接続している。従って、入力端1
a,1bに未知信号が入力すると、その信号は対応した
受信機4a,4bでそれぞれ受信され、入力信号の周波
数情報は周波数記憶器17へ、振幅情報は比較器15へ
それぞれ送られる。周波数記憶器17は受信機4a,4
bからの同一の周波数情報を記憶し、それを発振器18
へ送る。発振器18はこの周波数情報どおりの周波数の
信号を発生し、電力分配器19へ送る。電力分配器19
はそれを同電力の信号に分配し、それぞれ第1切替器1
4a,14bに送る。
【0004】一方、比較器15は受信機4a,4bから
それぞれ入力信号の電力に対応した振幅情報を受け、受
信機4aからの振幅情報と受信機4bからの振幅情報と
の振幅比を求めて記憶回路7aに記憶させ、記憶を完了
すると第1切替器14a,14b及び第2切替器16に
命令を発し、回路の切替えを行う。すなわち、第1切替
器14a,14bは電力分配器19の各出力端と受信機
4a,4bの各入力端とを接続し、第2切替器16は比
較器15の出力端と記憶回路7bの入力端とを接続する
。その結果、発振器18から受信した外部入力信号と同
じ周波数でかつ同電力の信号が、受信機4a,4bに入
力することになり、受信機4a,4bは各々この信号を
受信し、それぞれ振幅情報を比較器15に送り、比較器
15は両者の振幅比を求め、記憶回路7bへと送り、こ
れを記憶させる。この振幅比の記憶を完了すると記憶回
路7bは、ゲート回路8に記憶回路7a及び記憶回路7
bの記憶情報を較正器9に送り込むよう命令するととも
に、第1切替器14a,14b及び第2切替器16を初
期の状態に戻すように命令する。較正器9は記憶回路7
aの記憶情報を記憶回路7bの記憶情報で較正し、その
結果を出力端11に出力する。また、第1切替器14a
,14b及び第2切替器16は初期の回路接続の状態に
戻り、次の未知の入力信号に備える。
【0005】
【発明が解決しようとする課題】従来の受信装置は以上
のように構成されているので、受信機の特性の差を較正
するため、較正用の信号の発振周波数を受信周波数に正
確に合わせる必要があり、このため回路が複雑、大型化
するといった問題点があった。
【0006】この発明は上記のような問題点を解消する
ためになされたもので、較正用の信号を用いないで受信
機の振幅特性の差を較正できるとともに、回路が簡単で
小型化され、同時に入力する2つの高周波信号の振幅比
を正確に測定できる受信装置を提供することを目的とす
る。
【0007】
【問題を解決するための手段】この発明に係る受信装置
は、2つの入力信号の一方を第1の受信機で受信し、他
方を第2の受信機で受信するときは、両受信機からの出
力レベルの比、すなわち振幅比を第1の記憶回路に記憶
し、2つの入力信号の一方を第2の受信機で受信し、他
方を第1の受信機で受信するときは、両受信機からの振
幅比を第2の記憶回路に記憶するといった一連の動作を
交互に行わせ、第1の記憶回路に記憶したデータと第2
の記憶回路に記憶したデータとの比を較正器で求めるよ
うにしたものである。
【0008】
【作用】この発明における受信装置は、2台の受信機を
互いに交互に使って2つの入力信号を受信し、その振幅
比を受信機の切替タイミングに合わせ、2つの記憶回路
に一旦記憶させた後、2つの記憶回路の記憶データの比
を求めるようにしたので、2台の受信機の特性差による
振幅比の測定誤差が除去され、この入力信号の正確な振
幅比を測定できる。
【0009】
【実施例】以下、この発明の実施例を図について説明す
る。図1はこの発明の一実施例による受信装置を示すブ
ロック図であり、図において、1a,1bは信号の入力
端、4a,4bは同一仕様に基づく受信機であり、入力
信号に対応した振幅情報を出力する。5は振幅比較器で
あり、受信機4aからの振幅情報と受信機4bからの振
幅情報とを比較し、その振幅比を出力する。7a,7b
は記憶回路であり、振幅比較器5からの振幅比情報を記
憶する。2a,2b,3a,3bは第1切替器を構成し
ているスイッチであり、入力端1a,1bと受信機4a
,4bとの接続を切替える。6は切替器であり、振幅比
較器5と記憶回路7a,7bとの接続を切替える。9は
較正器であり、記憶回路7aからの記憶情報と記憶回路
7bからの記憶情報との比を算出する。8はゲート回路
であり、指定されたタイミングで記憶回路7a,7bの
記憶情報を較正器9へ送る。10は制御器であり、記憶
回路7a,7bからの情報に基づき、スイッチ2a,2
b,3a,3b及び切替器6に回路の切替命令を送ると
ともに、ゲート回路8へ記憶回路7a,7bと較正器9
とを接続するように命令を送る。11は出力端である。
【0010】次に動作について説明する。初期状態にお
いては、スイッチ2a,2b,3a,3bは入力端1a
と受信機4aとを接続し、入力端1bと受信機4bとを
接続するとともに、切替器6は振幅比較器5と記憶回路
7aとを接続する。このとき、入力端1a,1bに入っ
た信号をそれぞれ受信機4a,4bで受信し、それぞれ
の受信情報を振幅比較器5に送り、両者の振幅の比を求
め、このデータを記憶回路7aに記憶させる。記憶回路
7aは、記憶が完了すると完了信号を制御器10に送る
。この信号を受けた制御器10は、スイッチ2a,2b
,3a,3b及び切替器6に回路切替命令を送り、回路
の切替えを行う。すなわちスイッチ2a,2b,3a,
3bは入力端1aと受信機4bとを接続し、入力部1b
と受信機4aとを接続するとともに、切替器6は振幅比
較器5と記憶回路7bとを接続する。このとき入力端1
a,1bに入った信号をそれぞれ受信機4a,4bで受
信し、それぞれの受信情報を振幅比較器5に送り、両者
の振幅の比を求め、このデータを記憶回路7bに記憶さ
せる。記憶回路7bは、記憶が完了すると完了信号を制
御器10に送る。この信号を受けた制御器10はゲート
回路8に記憶回路7a,7bと較正器9とを接続するよ
う命令し、記憶回路7a,7bのデータを較正器9に送
る。較正器9は両者の比を算出し、出力端11に出力す
る。さらに、制御器10はスイッチ2a,2b,3a,
3b及び切替器6に回路の切替え命令を送って初期状態
に戻し、次の入力信号に備える。
【0011】以上のような回路構成において、入力端1
a,1bに入力する信号の振幅をそれぞれPA ,PB
 、受信機4a,4bの利得をそれぞれGA ,GB 
、出力端11の出力データをPとすると、初期状態すな
わち、入力端1aと受信機4a、入力端1bと受信機4
bとがそれぞれ接続され、振幅比較器5と記憶回路7a
とが接続されているとき、記憶回路7aに記憶されるデ
ータはPA GA /PB GB になり、入力端1a
と受信機4b、入力端1bと受信機4aとがそれぞれ接
続され、振幅比較器5と記憶回路7bとが接続されてい
るとき、記憶回路7bに記憶されるデータはPB GA
 /PA GB となる。 較正器9により、記憶回路7aのデータと記憶回路7b
のデータとの比である出力端11のデータPは
【001
2】
【数1】
【0013】となる。すなわち、出力端11のデータは
受信機4a,4bの特性の影響を受けない。従って出力
端11のデータを測定することにより、入力端1a,1
bに入った信号の振幅比を正確に測定することが可能に
なる。
【0014】なお、上記実施例では2a,2bをスイッ
チで構成したが、図2に示すように電力を2等分する電
力分配器12a,12bに代えてもよく、その場合も回
路のブロック構成は図1と同様である。
【0015】また、上記実施例では2つの高周波信号の
振幅比を正確に求める受信装置について説明したが、図
3に示すように、振幅比較器5を位相比較器13に代え
、位相差を検出し、この情報を記憶回路7a,7bに記
憶するようにするとともに、較正器9では記憶回路7a
,7bの記憶情報の差を求めるようにすることにより、
2つの高周波信号の位相差を正確に測定できる受信装置
とすることができる。
【0016】図3に示す回路構成において、入力端1a
,1bに入力する信号の位相差をθとする。入力端1a
の信号の位相量を0とすると、入力端1bの信号の位相
量はθである。入力端1aから受信機4aの入力端まで
に生ずる位相量と入力端1bから受信機4bの入力端ま
でに生ずる位相量を等しくなるようにし、生ずる位相量
をα1とする。入力端1aから受信機4bの入力端まで
に生ずる位相量と入力端1bから受信機4aの入力端ま
でに生ずる位相量を等しくなるようにし、生ずる位相量
をα2とする。また、受信機4a,4bで生ずる位相量
をそれぞれβ1,β2とする。
【0017】入力端1aと受信機4a、入力端1bと受
信機4bがそれぞれ接続しているとき、受信機4aから
の出力の位相量は、0+α1+β1になり、受信機4b
からの出力の位相量は、θ+α1+β2になり、位相比
較器13で両者の差A1を求めると、
【0018】A1=β2−β1+θ
【0019】となり、この値を記憶回路7aに記憶する
。次に、入力端1aと受信機4b、入力端1bと受信機
4aがそれぞれ接続しているとき、受信機4aからの出
力の位相量は、θ+α2+β1になり、受信機4bから
の出力の位相量は、0+α2+β2になり、位相比較器
13で両者の差A2を求めると、
【0020】A2=β2−β1−θ
【0021】となり、この値を記憶回路7bに記憶する
。較正器9により、記憶回路7a,7bからの記憶情報
の差を求めると、
【0022】A1−A2=2θ
【0023】となる。すなわち、受信機4a,4bで生
ずる位相量の差は打ち消されることになり、入力端1a
,1bに入った信号の位相差を正確に測定することがで
きる。
【0024】
【発明の効果】以上のように、この発明に係る受信装置
によれば、2台の受信機を交互に使って2つの入力信号
を受信し、その振幅比を受信機の切替タイミングに合わ
せ、2つの記憶回路に一旦記憶させた後、2つの記憶回
路の記憶データの比を算出するようにしたので、2つの
受信機は特別に特性が揃っている必要はなく、またデー
タを補正するための較正用信号を用いる必要もないので
、装置が小型で安価にでき、また精度の高いものが得ら
れる効果がある。
【図面の簡単な説明】
【図1】この発明の一実施例による受信装置を示すブロ
ック図である。
【図2】この発明の他の実施例による受信装置を示すブ
ロック図である。
【図3】この発明の応用例による受信装置を示すブロッ
ク図である。
【図4】従来の受信装置を示すブロック図である。
【符号の説明】
1a    入力端 1b    入力端 2a    スイッチ 2b    スイッチ 3a    スイッチ 3b    スイッチ 4a    受信機 4b    受信機 5      振幅比較器 6      切替器 7a    記憶回路 7b    記憶回路 8      ゲート回路 9      較正器 10    制御器 11    出力端 12a  電力分配器 12b  電力分配器 13    位相比較器 14a  第1切替器 14b  第1切替器 15    比較器 16    第2切替器 17    周波数記憶器 18    発振器 19    電力分配器

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】  2つの高周波入力信号を受信し、該入
    力信号の振幅情報を出力する第1,第2の受信機と、切
    替タイミングを作成する制御器と、前記第1,第2の受
    信機前段に設けられ、前記制御器からの切替タイミング
    に従って、前記2つの高周波入力信号のうち一方の信号
    を前記第1の受信機へ導くときは他方の信号を前記第2
    の受信機へ導き、一方の信号を前記第2の受信機へ導く
    ときは他方の信号を前記第1の受信機へ導くように回路
    を切替える第1の切替器と、前記第1の受信機からの振
    幅情報と第2の受信機からの振幅情報との比を検出する
    振幅比較器と、該振幅比較器からの出力を記憶する第1
    ,第2の記憶回路と、前記制御器からの切替タイミング
    により、前記振幅比較器からの出力を前記第1の切替器
    と同期して切替えて前記第1,第2の記憶回路へ導く第
    2の切替器と、前記第1,第2の記憶回路の記憶情報の
    比を求める較正器と、前記制御器からの切替タイミング
    により前記第1,第2の記憶回路の記憶情報を前記較正
    器へ送るようにするゲート回路とを備えたことを特徴と
    する受信装置。
JP3101931A 1991-04-05 1991-04-05 受信装置 Pending JPH04309878A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3101931A JPH04309878A (ja) 1991-04-05 1991-04-05 受信装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3101931A JPH04309878A (ja) 1991-04-05 1991-04-05 受信装置

Publications (1)

Publication Number Publication Date
JPH04309878A true JPH04309878A (ja) 1992-11-02

Family

ID=14313660

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3101931A Pending JPH04309878A (ja) 1991-04-05 1991-04-05 受信装置

Country Status (1)

Country Link
JP (1) JPH04309878A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2005124388A1 (ja) * 2004-06-21 2008-04-10 富士通テン株式会社 レーダ装置
JP2013522636A (ja) * 2010-03-24 2013-06-13 ヴァレオ・シャルター・ウント・ゼンゾーレン・ゲーエムベーハー 車両ドライバ支援装置およびレーダ装置操作方法

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2005124388A1 (ja) * 2004-06-21 2008-04-10 富士通テン株式会社 レーダ装置
JP2013522636A (ja) * 2010-03-24 2013-06-13 ヴァレオ・シャルター・ウント・ゼンゾーレン・ゲーエムベーハー 車両ドライバ支援装置およびレーダ装置操作方法
US9176228B2 (en) 2010-03-24 2015-11-03 Valeo Schalter Und Sensoren Gmbh Driver assistance device for a vehicle and method for operating a radar device

Similar Documents

Publication Publication Date Title
EP0540908A1 (en) Method and apparatus for automatic tuning calibration of electronically tuned filters
US20050253646A1 (en) Global Automatic RC Time Constant Tuning Circuit and Method for on Chip RC Filters
EP0647017A1 (en) Synchronization circuit using a high speed digital slip counter
US20040167745A1 (en) Measured data synchronization system
US6876938B2 (en) Method to provide a calibrated path for multi-signal cables in testing of integrated circuits
JP2000040945A (ja) 同調フィルタ校正システム
US6304119B1 (en) Timing generating apparatus with self-calibrating capability
US6882139B2 (en) Electronic component, tester device and method for calibrating a tester device
JPH04309878A (ja) 受信装置
CN112213622B (zh) 高速外设系统及其控制方法
US6373313B1 (en) Delay time regulation method and delay time regulation circuit
JPH0748629B2 (ja) 出力信号合成装置
US2939075A (en) Delay calibrating apparatus
EP0660938A1 (en) APPARATUS AND METHOD FOR COUNTING PARTIAL AND FULL CYCLES.
US7487571B2 (en) Control adjustable device configurations to induce parameter variations to control parameter skews
WO2022186375A1 (ja) 電圧測定システム
JP2594428Y2 (ja) 信号の時間ずれ較正装置
KR950001440B1 (ko) 수평발진 주파수 제어회로
US20020196076A1 (en) Filter circuit
JPH0495784A (ja) Ic試験装置のタイミング校正方法
JPS59144927A (ja) タイミング調整回路
KR20210062225A (ko) 반도체용 테스트 장치 및 테스트 방법
JPS5946350B2 (ja) 受信装置
JPS5880572A (ja) 受信装置
JPH05180960A (ja) 遅延時間測定装置