JPH04257185A - 高能率符号化方法 - Google Patents
高能率符号化方法Info
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- JPH04257185A JPH04257185A JP3039349A JP3934991A JPH04257185A JP H04257185 A JPH04257185 A JP H04257185A JP 3039349 A JP3039349 A JP 3039349A JP 3934991 A JP3934991 A JP 3934991A JP H04257185 A JPH04257185 A JP H04257185A
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- 238000003708 edge detection Methods 0.000 description 12
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
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- H04N19/134—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using adaptive coding characterised by the element, parameter or criterion affecting or controlling the adaptive coding
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- H04N19/152—Data rate or code amount at the encoder output by measuring the fullness of the transmission buffer
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- Multimedia (AREA)
- Signal Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Image Processing (AREA)
- Color Television Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】この発明は、高能率符号化装置、
特にビデオ信号のデータ圧縮に好適な高能率符号化装置
に関する。
特にビデオ信号のデータ圧縮に好適な高能率符号化装置
に関する。
【０００２】
【従来の技術】従来からビデオ信号のデータ圧縮を行な
うための高能率符号化装置については、種々の提案がな
されている。例えば、本願出願人の提案にかかる特開昭
６２−９２６２０号公報の高能率符号化装置には画像の
データを適応的に量子化する技術が開示されている。
うための高能率符号化装置については、種々の提案がな
されている。例えば、本願出願人の提案にかかる特開昭
６２−９２６２０号公報の高能率符号化装置には画像の
データを適応的に量子化する技術が開示されている。
【０００３】ところで、ＭＰＥＧ（Ｍｏｖｉｎｇ Ｐｉ
ｃｔｕｒｅ Ｅｘｐｅｒｔｓ Ｇｒｏｕｐ）では動画像
のデータ圧縮の方式について勧告を行っている。この勧
告では、１フレームの画像を、垂直走査方向では２４０
ラインにすると共に、１ラインを３５２画素で構成する
ものとし、この１フレームを１６画素×１６画素のマク
ロブロックＭＢに分割するものとしている。従って、１
フレームの画像には、水平走査方向に２２個、垂直走査
方向に１５個のマクロブロックＭＢが形成されることに
なる。
ｃｔｕｒｅ Ｅｘｐｅｒｔｓ Ｇｒｏｕｐ）では動画像
のデータ圧縮の方式について勧告を行っている。この勧
告では、１フレームの画像を、垂直走査方向では２４０
ラインにすると共に、１ラインを３５２画素で構成する
ものとし、この１フレームを１６画素×１６画素のマク
ロブロックＭＢに分割するものとしている。従って、１
フレームの画像には、水平走査方向に２２個、垂直走査
方向に１５個のマクロブロックＭＢが形成されることに
なる。
【０００４】図１０に、ＤＣＴを用いた高能率符号化装
置の回路構成が示されている。ビデオ信号ＳＶは、端子
８０を介してＡ／Ｄ コンバータ８１に供給され、この
Ａ／Ｄ コンバータ８１よってビデオデータＤＶに変換
される。 そして、ビデオデータＤＶがフレームバッフア８２に供
給される。
置の回路構成が示されている。ビデオ信号ＳＶは、端子
８０を介してＡ／Ｄ コンバータ８１に供給され、この
Ａ／Ｄ コンバータ８１よってビデオデータＤＶに変換
される。 そして、ビデオデータＤＶがフレームバッフア８２に供
給される。
【０００５】アドレスジエネレータ８３では書込みアド
レスＡＤＷ が形成され、この書込みアドレスＡＤＷ
がフレームバッフア８２に供給される。フレームバッフ
ア８２では、上述の書込みアドレスＡＤＷ に基づいて
、ビデオデータＤＶが書き込まれる。このフレームバッ
フア８２に書き込まれるビデオデータＤＶは、１フレー
ムが、垂直走査方向に２４０ライン〔即ち、２４０画素
〕にされると共に、１ラインが３５２画素で構成されて
いる。
レスＡＤＷ が形成され、この書込みアドレスＡＤＷ
がフレームバッフア８２に供給される。フレームバッフ
ア８２では、上述の書込みアドレスＡＤＷ に基づいて
、ビデオデータＤＶが書き込まれる。このフレームバッ
フア８２に書き込まれるビデオデータＤＶは、１フレー
ムが、垂直走査方向に２４０ライン〔即ち、２４０画素
〕にされると共に、１ラインが３５２画素で構成されて
いる。
【０００６】アドレスジエネレータ８３では読出しアド
レスＡＤＲ が形成され、この読出しアドレスＡＤＲ
がフレームバッフア８２に供給される。フレームバッフ
ア８２では、上述の読出しアドレスＡＤＲ に基づいて
、ビデオデータＤＶが読出される。このビデオデータＤ
Ｖの読出し時には、１６画素×１６画素で構成されるマ
クロブロックＭＢの単位で、フレームバッフア８２から
ビデオデータＤＶが読出される。読出されたマクロブロ
ックＭＢ毎のビデオデータＤＶは、データ生成回路８４
に供給される。
レスＡＤＲ が形成され、この読出しアドレスＡＤＲ
がフレームバッフア８２に供給される。フレームバッフ
ア８２では、上述の読出しアドレスＡＤＲ に基づいて
、ビデオデータＤＶが読出される。このビデオデータＤ
Ｖの読出し時には、１６画素×１６画素で構成されるマ
クロブロックＭＢの単位で、フレームバッフア８２から
ビデオデータＤＶが読出される。読出されたマクロブロ
ックＭＢ毎のビデオデータＤＶは、データ生成回路８４
に供給される。
【０００７】データ生成回路８４では、各マクロブロッ
クＭＢが８画素×８画素で構成されるブロックに分割さ
れる。従って、１個のマクロブロックＭＢは４個のブロ
ックに分割されることになる。ブロック毎に、当該ブロ
ック内のビデオデータＤＶに対し、ＤＣＴ処理が施され
た後、再量子化され可変長コードに変換されることによ
って、データ圧縮がなされ、新たなビデオデータＤＶ０
が形成される。このビデオデータＤＶ０は、バッフアメ
モリ８５に書込まれた後、順次に読出される。そして、
端子８７を介して次段の回路に供給され、或いは伝送さ
れる。
クＭＢが８画素×８画素で構成されるブロックに分割さ
れる。従って、１個のマクロブロックＭＢは４個のブロ
ックに分割されることになる。ブロック毎に、当該ブロ
ック内のビデオデータＤＶに対し、ＤＣＴ処理が施され
た後、再量子化され可変長コードに変換されることによ
って、データ圧縮がなされ、新たなビデオデータＤＶ０
が形成される。このビデオデータＤＶ０は、バッフアメ
モリ８５に書込まれた後、順次に読出される。そして、
端子８７を介して次段の回路に供給され、或いは伝送さ
れる。
【０００８】制御回路８６では、ビデオデータＤＶがバ
ッフアメモリ８５内でオーバーフローしないように、バ
ッフアメモリ８５に於ける書込み可能な領域の容量をモ
ニタしている。これは、複雑でない絵柄のマクロブロッ
クＭＢではデータを多量には発生しないのに対し、複雑
な絵柄のマクロブロックＭＢでは多量のデータを発生す
ることから、１フレーム、或いは多数フレーム、例えば
、１５フレームの単位で、データの発生量が略一定にな
るようにデータ生成パラメータを制御するために行うも
のである。尚、上述の書込み可能な領域の容量のモニタ
する方法としては、例えば、バッフアメモリ８５に於け
る書込みアドレスカウンタと読出しアドレスカウンタと
の値が用いられる。このバッフアメモリ８５、制御回路
８６、データ生成回路８４はフィードバックループを構
成している。
ッフアメモリ８５内でオーバーフローしないように、バ
ッフアメモリ８５に於ける書込み可能な領域の容量をモ
ニタしている。これは、複雑でない絵柄のマクロブロッ
クＭＢではデータを多量には発生しないのに対し、複雑
な絵柄のマクロブロックＭＢでは多量のデータを発生す
ることから、１フレーム、或いは多数フレーム、例えば
、１５フレームの単位で、データの発生量が略一定にな
るようにデータ生成パラメータを制御するために行うも
のである。尚、上述の書込み可能な領域の容量のモニタ
する方法としては、例えば、バッフアメモリ８５に於け
る書込みアドレスカウンタと読出しアドレスカウンタと
の値が用いられる。このバッフアメモリ８５、制御回路
８６、データ生成回路８４はフィードバックループを構
成している。
【０００９】
【発明が解決しようとする課題】上述の図１０に示され
る従来技術では、以下のような問題点があった。 （１） 画像の一部が、複雑な絵柄、例えば、エッジの
多い部分であるとき、その部分で大量のデータが発生し
てしまう。このような時、バッフアメモリ８５、制御回
路８６、データ生成回路８４のフィードバックループが
動作し、データの生成量を減少させるようなコントロー
ルがなされる。しかしながら、フィードバックループに
は遅延があるため、複雑な絵柄の部分に続いて現れる複
雑でない絵柄の部分に対し上述のコントロールがなされ
ると、画質が劣化してしまう。
る従来技術では、以下のような問題点があった。 （１） 画像の一部が、複雑な絵柄、例えば、エッジの
多い部分であるとき、その部分で大量のデータが発生し
てしまう。このような時、バッフアメモリ８５、制御回
路８６、データ生成回路８４のフィードバックループが
動作し、データの生成量を減少させるようなコントロー
ルがなされる。しかしながら、フィードバックループに
は遅延があるため、複雑な絵柄の部分に続いて現れる複
雑でない絵柄の部分に対し上述のコントロールがなされ
ると、画質が劣化してしまう。
【００１０】（２） 上述のバッフアメモリ８５、制御
回路８６、データ生成回路８４のフィードバックループ
によるコントロールには、必ず遅延があるため、上述の
複雑な絵柄の部分の場合のように、大量のデータが突然
に発生すると、これを避けることが出来ず、このような
場合には、オーバーフローしてしまうことがある。
回路８６、データ生成回路８４のフィードバックループ
によるコントロールには、必ず遅延があるため、上述の
複雑な絵柄の部分の場合のように、大量のデータが突然
に発生すると、これを避けることが出来ず、このような
場合には、オーバーフローしてしまうことがある。
【００１１】従って、この発明の目的は、画質の向上と
、データのオーバーフローを防止し得る高能率符号化装
置を提供することにある。
、データのオーバーフローを防止し得る高能率符号化装
置を提供することにある。
【００１２】
【課題を解決するための手段】この発明は、ビデオ信号
に対し、高能率符号化する手段、量子化する手段を少な
くとも備え、量子化する手段のステップ幅を可変して発
生データ量を制御するようにした高能率符号化装置に於
いて、ビデオ信号の所定の大きさの領域毎に絵柄の複雑
さを判別する手段を備え、絵柄の複雑さの判別結果に応
じて、量子化する手段のステップ幅を制御するようにし
た構成としている。
に対し、高能率符号化する手段、量子化する手段を少な
くとも備え、量子化する手段のステップ幅を可変して発
生データ量を制御するようにした高能率符号化装置に於
いて、ビデオ信号の所定の大きさの領域毎に絵柄の複雑
さを判別する手段を備え、絵柄の複雑さの判別結果に応
じて、量子化する手段のステップ幅を制御するようにし
た構成としている。
【００１３】
【作用】高能率符号化する手段に入る前のビデオ信号の
フレーム内の所定の大きさの領域毎に絵柄の複雑さが判
別される。複雑な絵柄であると判別された場合には、デ
ータ生成パラメータが変更されて量子化する手段の量子
化ステップ幅が制御され、発生データ量が抑圧される。
フレーム内の所定の大きさの領域毎に絵柄の複雑さが判
別される。複雑な絵柄であると判別された場合には、デ
ータ生成パラメータが変更されて量子化する手段の量子
化ステップ幅が制御され、発生データ量が抑圧される。
【００１４】
【実施例】以下、この発明の一の実施例について図１乃
至図７を参照して説明する。一実施例の詳細な説明に入
る前に、この発明の基本的な考え方について説明する。
至図７を参照して説明する。一実施例の詳細な説明に入
る前に、この発明の基本的な考え方について説明する。
【００１５】ビデオ信号ＳＶのデータ圧縮では、少なく
とも重要な部分では画質劣化の生じないように圧縮しな
ければならない。換言すれば、一定のデータ量で最良の
画質を実現することが必要である。
とも重要な部分では画質劣化の生じないように圧縮しな
ければならない。換言すれば、一定のデータ量で最良の
画質を実現することが必要である。
【００１６】図４Ａの画像を対象とした場合に、図４Ａ
中、矢示Ｘ線に沿って発生するデータ量の分布が図４Ｂ
に示されている。この図４Ｂより明らかなように、矢示
Ｘ線に沿って発生するデータ量は、花壇の部分ＡＲ１に
て最大のレベルを示し、また、画像上部の部分ＡＲ３で
は、花壇の部分ＡＲ１に次ぐ高いレベルを示し、更に、
画像中央の部分ＡＲ２では最低のレベルを示している。
中、矢示Ｘ線に沿って発生するデータ量の分布が図４Ｂ
に示されている。この図４Ｂより明らかなように、矢示
Ｘ線に沿って発生するデータ量は、花壇の部分ＡＲ１に
て最大のレベルを示し、また、画像上部の部分ＡＲ３で
は、花壇の部分ＡＲ１に次ぐ高いレベルを示し、更に、
画像中央の部分ＡＲ２では最低のレベルを示している。
【００１７】画像の下部にある花壇の部分ＡＲ１は、比
較的、複雑な絵柄であるために発生するデータ量が多く
なるが、全体のデータ量は一定でなければならない。従
って、このままでは花壇の部分ＡＲ１以外に於ける発生
データ量が抑制され、花壇の部分ＡＲ１以外の、例えば
画像上部の部分ＡＲ３の画質が劣化してしまうことにな
る。これを解消するには、花壇の部分ＡＲ１にて発生す
るデータ量を抑圧し、これにより生じた余剰ビットを花
壇の部分ＡＲ１以外の部分に振り向けることが必要であ
る。
較的、複雑な絵柄であるために発生するデータ量が多く
なるが、全体のデータ量は一定でなければならない。従
って、このままでは花壇の部分ＡＲ１以外に於ける発生
データ量が抑制され、花壇の部分ＡＲ１以外の、例えば
画像上部の部分ＡＲ３の画質が劣化してしまうことにな
る。これを解消するには、花壇の部分ＡＲ１にて発生す
るデータ量を抑圧し、これにより生じた余剰ビットを花
壇の部分ＡＲ１以外の部分に振り向けることが必要であ
る。
【００１８】一般的に、画像に於いて、花壇の部分ＡＲ
１のような複雑な絵柄の部分では量子化ステップ幅を大
きくする等して発生データ量を削減しても、それほど画
質が劣化したとは感じられないといわれている。そこで
、この発明では、画像上部の部分ＡＲ３に生じている画
質劣化を防止するために、ＤＣＴその他の符号化処理を
行う前に、フィードフオワードによって複雑な絵柄の部
分の検出を予め行い、検出された複雑な絵柄の部分に対
する量子化ステップ幅を大きくすることによって、該複
雑な絵柄の部分に於ける発生データ量を抑圧する。また
、複雑な絵柄の部分以外では、上述の複雑な絵柄の検出
に基づく量子化ステップ幅の変更を行わず、発生データ
量の抑圧を行わない。このことは、結果的に、複雑な絵
柄の部分以外の部分に余剰ビットを振り向けていること
と等価になる。
１のような複雑な絵柄の部分では量子化ステップ幅を大
きくする等して発生データ量を削減しても、それほど画
質が劣化したとは感じられないといわれている。そこで
、この発明では、画像上部の部分ＡＲ３に生じている画
質劣化を防止するために、ＤＣＴその他の符号化処理を
行う前に、フィードフオワードによって複雑な絵柄の部
分の検出を予め行い、検出された複雑な絵柄の部分に対
する量子化ステップ幅を大きくすることによって、該複
雑な絵柄の部分に於ける発生データ量を抑圧する。また
、複雑な絵柄の部分以外では、上述の複雑な絵柄の検出
に基づく量子化ステップ幅の変更を行わず、発生データ
量の抑圧を行わない。このことは、結果的に、複雑な絵
柄の部分以外の部分に余剰ビットを振り向けていること
と等価になる。
【００１９】図１の構成に於いて、ビデオ信号ＳＶが端
子１を介してＡ／Ｄ コンバータ２に供給される。この
Ａ／Ｄ コンバータ２よってビデオ信号ＳＶがビデオデ
ータＤＶに変換され、このビデオデータＤＶがフレーム
バッフア回路３に供給される。アドレスジエネレータ４
では書込みアドレスＡＤＷ が形成され、この書込みア
ドレスＡＤＷ がフレームバッフア回路３に供給される
。
子１を介してＡ／Ｄ コンバータ２に供給される。この
Ａ／Ｄ コンバータ２よってビデオ信号ＳＶがビデオデ
ータＤＶに変換され、このビデオデータＤＶがフレーム
バッフア回路３に供給される。アドレスジエネレータ４
では書込みアドレスＡＤＷ が形成され、この書込みア
ドレスＡＤＷ がフレームバッフア回路３に供給される
。
【００２０】フレームバッフア回路３では、書込みアド
レスＡＤＷ に基づいてビデオデータＤＶの書込みがな
される。フレームバッフア回路３の構成が図２に示され
ている。フレームバッフア回路３は、図２に示されるよ
うに、フレームメモリ５と、ブロック変換回路６とから
主に構成されている。
レスＡＤＷ に基づいてビデオデータＤＶの書込みがな
される。フレームバッフア回路３の構成が図２に示され
ている。フレームバッフア回路３は、図２に示されるよ
うに、フレームメモリ５と、ブロック変換回路６とから
主に構成されている。
【００２１】ビデオデータＤＶが端子７を介してフレー
ムメモリ５に供給され、また、書込みアドレスＡＤＷ
が端子８を介してフレームメモリ５に供給される。これ
によって、ビデオデータＤＶが書込みアドレスＡＤＷ
によって指定されたアドレスに、順次、書込まれる。こ
のビデオデータＤＶは、１フレームの画素数が前述のＭ
ＰＥＧで規定されている垂直走査方向に２４０ライン〔
即ち、２４０画素〕にされると共に、１ラインが３５２
画素とされている。
ムメモリ５に供給され、また、書込みアドレスＡＤＷ
が端子８を介してフレームメモリ５に供給される。これ
によって、ビデオデータＤＶが書込みアドレスＡＤＷ
によって指定されたアドレスに、順次、書込まれる。こ
のビデオデータＤＶは、１フレームの画素数が前述のＭ
ＰＥＧで規定されている垂直走査方向に２４０ライン〔
即ち、２４０画素〕にされると共に、１ラインが３５２
画素とされている。
【００２２】また、アドレスジエネレータ４では読出し
アドレスＡＤＲ が形成され、この読出しアドレスＡＤ
Ｒ がフレームバッフア回路３に供給される。フレーム
バッフア回路３のフレームメモリ５では、上述の読出し
アドレスＡＤＲ が端子８を介して供給されると、保持
されているビデオデータＤＶが読出され、ブロック変換
回路６に供給される。
アドレスＡＤＲ が形成され、この読出しアドレスＡＤ
Ｒ がフレームバッフア回路３に供給される。フレーム
バッフア回路３のフレームメモリ５では、上述の読出し
アドレスＡＤＲ が端子８を介して供給されると、保持
されているビデオデータＤＶが読出され、ブロック変換
回路６に供給される。
【００２３】ブロック変換回路６は、図３に示されるよ
うに、１６画素×１６画素で構成されるマクロブロック
ＭＢを、８画素×８画素で構成されるブロックＢＬＫ１
〜ＢＬＫ４に分割するものである。ビデオデータＤＶは
、ブロックＢＬＫ１〜ＢＬＫ４単位で、ＤＣＴ回路１２
、検出回路１３に端子９を介して供給される。ＤＣＴ回
路１２では、ブロックＢＬＫ１〜ＢＬＫ４毎に供給され
るビデオデータＤＶにＤＣＴ処理が施され、周波数成分
を表わす８行８列〔８×８〕の変換係数が形成される。 この変換係数は量子化回路１４に供給される。
うに、１６画素×１６画素で構成されるマクロブロック
ＭＢを、８画素×８画素で構成されるブロックＢＬＫ１
〜ＢＬＫ４に分割するものである。ビデオデータＤＶは
、ブロックＢＬＫ１〜ＢＬＫ４単位で、ＤＣＴ回路１２
、検出回路１３に端子９を介して供給される。ＤＣＴ回
路１２では、ブロックＢＬＫ１〜ＢＬＫ４毎に供給され
るビデオデータＤＶにＤＣＴ処理が施され、周波数成分
を表わす８行８列〔８×８〕の変換係数が形成される。 この変換係数は量子化回路１４に供給される。
【００２４】検出回路１３では、フレームバッフア回路
３から供給されるビデオデータＤＶについて、マクロブ
ロックＭＢ単位で、複雑な絵柄か否かを判断している。 尚、この判断のタイミングは、処理されているマクロブ
ロックＭＢより先行していることが必要である。
３から供給されるビデオデータＤＶについて、マクロブ
ロックＭＢ単位で、複雑な絵柄か否かを判断している。 尚、この判断のタイミングは、処理されているマクロブ
ロックＭＢより先行していることが必要である。
【００２５】この実施例では、８×８画素のブロックＢ
ＬＫ１〜ＢＬＫ４で構成される輝度信号Ｙのマクロブロ
ックＭＢのみを用いて複雑な絵柄であるか否かについて
判断している。判断の仕方について、図５を参照して以
下に説明する。尚、この判断の仕方は、全てのブロック
ＢＬＫ１〜ＢＬＫ４で共通であるため、例として、ブロ
ックＢＬＫ１のみについて説明する。
ＬＫ１〜ＢＬＫ４で構成される輝度信号Ｙのマクロブロ
ックＭＢのみを用いて複雑な絵柄であるか否かについて
判断している。判断の仕方について、図５を参照して以
下に説明する。尚、この判断の仕方は、全てのブロック
ＢＬＫ１〜ＢＬＫ４で共通であるため、例として、ブロ
ックＢＬＫ１のみについて説明する。
【００２６】図５に於いて、Ｐｘｙ（ｘ＝０，〜，７，
ｙ＝０，〜，７） を画素とした場合に、ブロックＢＬ
Ｋ１内に於いて、２×２画素Ｐｘｙからなるサンプルブ
ロックＳＢｘｙ（ｘ＝０，〜，７，ｙ＝０，〜，７）
を４９個を形成する。隣り合うサンプルブロックＳＢｘ
ｙでは、夫々１画素Ｐ分が重複している。
ｙ＝０，〜，７） を画素とした場合に、ブロックＢＬ
Ｋ１内に於いて、２×２画素Ｐｘｙからなるサンプルブ
ロックＳＢｘｙ（ｘ＝０，〜，７，ｙ＝０，〜，７）
を４９個を形成する。隣り合うサンプルブロックＳＢｘ
ｙでは、夫々１画素Ｐ分が重複している。
【００２７】図５に於いて、サンプルブロックＳＢの画
素データＹｘｙは次の式によって表される。
素データＹｘｙは次の式によって表される。
【数１】
【００２８】複雑な絵柄であるか否かは、サンプルブロ
ックＳＢｘｙがエッジであるか否かによって判断される
。エッジ検出に際しては、対角要素の輝度レベルの差の
自乗が用いられる。即ち、各サンプルブロックＳＢｘｙ
では、２つの値が得られるが、２つの結果の内、大きい
方の値が所定値、例えば、〔４０００〕より大なる時に
、該サンプルブロックＳＢｘｙはエッジであると判断さ
れる。
ックＳＢｘｙがエッジであるか否かによって判断される
。エッジ検出に際しては、対角要素の輝度レベルの差の
自乗が用いられる。即ち、各サンプルブロックＳＢｘｙ
では、２つの値が得られるが、２つの結果の内、大きい
方の値が所定値、例えば、〔４０００〕より大なる時に
、該サンプルブロックＳＢｘｙはエッジであると判断さ
れる。
【００２９】このエッジ検出は次の式によって表される
。
。
【数２】
【００３０】１マクロブロックＭＢは、１９６個〔＝４
×４９〕のサンプルブロックＳＢｘｙで構成される。こ
の内、所定数、例えば、６５個以上のサンプルブロック
ＳＢｘｙに於いてエッジが検出された場合には、該マク
ロブロックＭＢは複雑な絵柄であると判断される。この
時、検出回路１３からは、ハイレベルのエッジ検出信号
ＥＤＧ が制御回路１５に供給される。
×４９〕のサンプルブロックＳＢｘｙで構成される。こ
の内、所定数、例えば、６５個以上のサンプルブロック
ＳＢｘｙに於いてエッジが検出された場合には、該マク
ロブロックＭＢは複雑な絵柄であると判断される。この
時、検出回路１３からは、ハイレベルのエッジ検出信号
ＥＤＧ が制御回路１５に供給される。
【００３１】上述の複雑な絵柄であると判別する所定数
、この例では６５個の根拠について説明する。この実施
例では、対角要素の輝度レベルの差が、輝度のダイナミ
ックレンジ〔２８ ＝２５６〕の２５％以上〔即ち、２
８ ×０．２５＝６４〕あれば、そのサンプルブロック
ＳＢｘｙをエッジであるとしている〔６４２ ＞４００
０〕。また、１マクロブロックＭＢに含まれる１９６個
〔＝４×４９〕のサンプルブロックＳＢｘｙの内、（１
／３）以上のサンプルブロックＳＢｘｙからエッジが検
出されれば〔１９６×（１／３）＞６５〕、そのマクロ
ブロックＭＢを複雑な絵柄であると判断している。この
基準は確定的なものではなく、画像の内容、その他の条
件の変化によって、各種の値をとり得るものである。
、この例では６５個の根拠について説明する。この実施
例では、対角要素の輝度レベルの差が、輝度のダイナミ
ックレンジ〔２８ ＝２５６〕の２５％以上〔即ち、２
８ ×０．２５＝６４〕あれば、そのサンプルブロック
ＳＢｘｙをエッジであるとしている〔６４２ ＞４００
０〕。また、１マクロブロックＭＢに含まれる１９６個
〔＝４×４９〕のサンプルブロックＳＢｘｙの内、（１
／３）以上のサンプルブロックＳＢｘｙからエッジが検
出されれば〔１９６×（１／３）＞６５〕、そのマクロ
ブロックＭＢを複雑な絵柄であると判断している。この
基準は確定的なものではなく、画像の内容、その他の条
件の変化によって、各種の値をとり得るものである。
【００３２】制御回路１５では、上述の検出回路１３か
らハイレベルのエッジ検出信号ＥＤＧ が供給される時
、制御信号ＳＣ０が形成され、この制御信号ＳＣ０が量
子化回路１４に供給される。或いはバッフアメモリ１７
から供給される書込み可能な領域の容量に応じて制御信
号ＳＣ１が形成され、この制御信号ＳＣ１が量子化回路
１４に供給される。この制御回路１５に於いて、バッフ
アメモリ１７に書込み可能な領域の容量を検出する方法
としては、前述した書込みアドレスカウンタと読出しア
ドレスカウンタとの値を用いる他に、例えば、書込まれ
るデータの個数と読出されるデータの個数の値を用いる
こともできる。これによって、バッフアメモリ１７に於
けるオーバーフロー、アンダーフローが防止される。
らハイレベルのエッジ検出信号ＥＤＧ が供給される時
、制御信号ＳＣ０が形成され、この制御信号ＳＣ０が量
子化回路１４に供給される。或いはバッフアメモリ１７
から供給される書込み可能な領域の容量に応じて制御信
号ＳＣ１が形成され、この制御信号ＳＣ１が量子化回路
１４に供給される。この制御回路１５に於いて、バッフ
アメモリ１７に書込み可能な領域の容量を検出する方法
としては、前述した書込みアドレスカウンタと読出しア
ドレスカウンタとの値を用いる他に、例えば、書込まれ
るデータの個数と読出されるデータの個数の値を用いる
こともできる。これによって、バッフアメモリ１７に於
けるオーバーフロー、アンダーフローが防止される。
【００３３】量子化回路１４では、ＤＣＴ回路１２から
供給される変換係数に対して再量子化が施される。この
量子化回路１４に於ける量子化ステップ幅は、制御回路
１５からの制御信号ＳＣ０、ＳＣ１に基づいて制御され
る。
供給される変換係数に対して再量子化が施される。この
量子化回路１４に於ける量子化ステップ幅は、制御回路
１５からの制御信号ＳＣ０、ＳＣ１に基づいて制御され
る。
【００３４】量子化回路１４では、制御回路１５から供
給される制御信号ＳＣ０、ＳＣ１に応じて量子化ステッ
プ幅が、マクロブロックＭＢ単位で適応的に制御される
。
給される制御信号ＳＣ０、ＳＣ１に応じて量子化ステッ
プ幅が、マクロブロックＭＢ単位で適応的に制御される
。
【００３５】例えば、制御信号ＳＣ０に於いて、複雑な
絵柄であると判断されたマクロブロックＭＢの時には、
量子化ステップ幅に更に所定の値、例えば、〔１６〕が
加算されて量子化ステップ幅が大きくさせれると共に、
丸められる。量子化ステップ幅が大きくされると、再量
子化されたデータが小さな値となり、次段の可変長符号
化回路１６にて短い可変長コードが割り当てられるので
、発生するデータ量を抑圧することが可能となる。また
、これによって、バッフアメモリ１７に於けるオーバー
フロー、アンダーフローが防止される。
絵柄であると判断されたマクロブロックＭＢの時には、
量子化ステップ幅に更に所定の値、例えば、〔１６〕が
加算されて量子化ステップ幅が大きくさせれると共に、
丸められる。量子化ステップ幅が大きくされると、再量
子化されたデータが小さな値となり、次段の可変長符号
化回路１６にて短い可変長コードが割り当てられるので
、発生するデータ量を抑圧することが可能となる。また
、これによって、バッフアメモリ１７に於けるオーバー
フロー、アンダーフローが防止される。
【００３６】制御信号ＳＣ０に於いて、複雑な絵柄でな
いと判断されたマクロブロックＭＢの時には上述の所定
の値が加算されない状態の量子化ステップ幅が用いられ
る。
いと判断されたマクロブロックＭＢの時には上述の所定
の値が加算されない状態の量子化ステップ幅が用いられ
る。
【００３７】このように、複雑な絵柄のマクロブロック
ＭＢに対して量子化ステップ幅を大きくすることは、結
果的には、複雑ではない絵柄のマクロブロックＭＢに対
し、発生データ量の増加を許容することとなる。つまり
、複雑な絵柄のマクロブロックＭＢに対するデータ量の
抑圧にて生じた余剰ビットを、複雑ではない絵柄のマク
ロブロックＭＢに割り振ることと等価になる。
ＭＢに対して量子化ステップ幅を大きくすることは、結
果的には、複雑ではない絵柄のマクロブロックＭＢに対
し、発生データ量の増加を許容することとなる。つまり
、複雑な絵柄のマクロブロックＭＢに対するデータ量の
抑圧にて生じた余剰ビットを、複雑ではない絵柄のマク
ロブロックＭＢに割り振ることと等価になる。
【００３８】一方、制御信号ＳＣ１の場合には、バッフ
アメモリ１７から供給される書込み可能な領域の容量に
応じて量子化ステップ幅が、上述の制御信号ＳＣ０の場
合と同様にして適応的に制御される。この量子化された
データが可変長符号化回路１６に供給される。
アメモリ１７から供給される書込み可能な領域の容量に
応じて量子化ステップ幅が、上述の制御信号ＳＣ０の場
合と同様にして適応的に制御される。この量子化された
データが可変長符号化回路１６に供給される。
【００３９】可変長符号化回路１６では、上述の量子化
されたデータが可変長コードに変換される。このように
して、ＤＣＴ、再量子化、可変長コードへの変換等によ
って、ビデオデータＤＶの圧縮がなされる。そして、こ
の可変長コードがバッフアメモリ１７に供給される。
されたデータが可変長コードに変換される。このように
して、ＤＣＴ、再量子化、可変長コードへの変換等によ
って、ビデオデータＤＶの圧縮がなされる。そして、こ
の可変長コードがバッフアメモリ１７に供給される。
【００４０】バッフアメモリ１７では、可変長コードが
、制御回路１５から供給される書込みアドレスＡＤＷ
に基づいて書込まれると共に、前述したように書込み可
能な領域の容量が制御回路１５に供給される。そして、
バッフアメモリ１７からは、制御回路１５から供給され
る読出しアドレスＡＤＲ に基づいて可変長コードが読
み出され、該可変長コードが端子１８を介して取出され
て次段の回路に供給され、或いは伝送される。
、制御回路１５から供給される書込みアドレスＡＤＷ
に基づいて書込まれると共に、前述したように書込み可
能な領域の容量が制御回路１５に供給される。そして、
バッフアメモリ１７からは、制御回路１５から供給され
る読出しアドレスＡＤＲ に基づいて可変長コードが読
み出され、該可変長コードが端子１８を介して取出され
て次段の回路に供給され、或いは伝送される。
【００４１】制御回路１５の動作を図７を参照して説明
する。ステップ１５１にて、バッフアメモリ１７に於け
る書込み可能な領域の容量が読み取られる。そして、ス
テップ１５２ に移る。ステップ１５２ にて、検出回
路１３からハイレベルのエッジ検出信号ＥＤＧ が出力
されているか否かが読取られる。そして、ステップ１５
３ に移る。
する。ステップ１５１にて、バッフアメモリ１７に於け
る書込み可能な領域の容量が読み取られる。そして、ス
テップ１５２ に移る。ステップ１５２ にて、検出回
路１３からハイレベルのエッジ検出信号ＥＤＧ が出力
されているか否かが読取られる。そして、ステップ１５
３ に移る。
【００４２】ステップ１５３ にて、当該マクロブロッ
クＭＢが複雑な絵柄であるか否かの判断がなされる。複
雑な絵柄でない場合にはステップ１５４ に移り、複雑
な絵柄である場合にはステップ１５５ に移る。
クＭＢが複雑な絵柄であるか否かの判断がなされる。複
雑な絵柄でない場合にはステップ１５４ に移り、複雑
な絵柄である場合にはステップ１５５ に移る。
【００４３】ステップ１５４ では、ステップ１５１
にて読み取られたバッフアメモリ１７に於ける書込み可
能な領域の容量に基づいて量子化ステップ幅が適応的に
制御され、ステップ１５６ に移る。ステップ１５５
では、ステップ１５１ にて読み取られたバッフアメモ
リ１７に於ける書込み可能な領域の容量に基づいて形成
される量子化ステップ幅に更に所定の値、例えば、〔１
６〕がマクロブロックＭＢ毎に加算されて大きくされる
と共に、丸められる。そして、この後、ステップ１５６
に移る。
にて読み取られたバッフアメモリ１７に於ける書込み可
能な領域の容量に基づいて量子化ステップ幅が適応的に
制御され、ステップ１５６ に移る。ステップ１５５
では、ステップ１５１ にて読み取られたバッフアメモ
リ１７に於ける書込み可能な領域の容量に基づいて形成
される量子化ステップ幅に更に所定の値、例えば、〔１
６〕がマクロブロックＭＢ毎に加算されて大きくされる
と共に、丸められる。そして、この後、ステップ１５６
に移る。
【００４４】ステップ１５６ では、上述の適応的に決
定された量子化ステップ幅がデータ生成パラメータとし
て、マクロブロックＭＢ毎に量子化回路１４に供給され
る。
定された量子化ステップ幅がデータ生成パラメータとし
て、マクロブロックＭＢ毎に量子化回路１４に供給され
る。
【００４５】この一の実施例によれば、マクロブロック
ＭＢ毎に複雑な絵柄であるか否かをフィードフォワード
によって予め判別し、もし複雑な絵柄のマクロブロック
ＭＢであると判別された場合には、量子化ステップ幅に
所定の値が加算されて量子化ステップ幅が大きくされる
ので、上述の複雑な絵柄であるマクロブロックＭＢにて
発生するデータ量を抑圧することが可能となり、複雑な
絵柄の部分に於いて多量のデータが突出して発生するこ
とを防止でき、オーバーフローしてしまうことを防止で
きる。
ＭＢ毎に複雑な絵柄であるか否かをフィードフォワード
によって予め判別し、もし複雑な絵柄のマクロブロック
ＭＢであると判別された場合には、量子化ステップ幅に
所定の値が加算されて量子化ステップ幅が大きくされる
ので、上述の複雑な絵柄であるマクロブロックＭＢにて
発生するデータ量を抑圧することが可能となり、複雑な
絵柄の部分に於いて多量のデータが突出して発生するこ
とを防止でき、オーバーフローしてしまうことを防止で
きる。
【００４６】このように、複雑な絵柄のマクロブロック
ＭＢに対して量子化ステップ幅が大きくされることは、
結果的には、複雑ではない絵柄のマクロブロックＭＢに
於ける発生データ量を増加させることとなる。即ち、複
雑な絵柄のマクロブロックＭＢに対する発生データ量の
抑圧にて生じた余剰ビットを、複雑ではない絵柄のマク
ロブロックＭＢに割り振ることと等価になる。従って、
全体的な画質を向上できる。
ＭＢに対して量子化ステップ幅が大きくされることは、
結果的には、複雑ではない絵柄のマクロブロックＭＢに
於ける発生データ量を増加させることとなる。即ち、複
雑な絵柄のマクロブロックＭＢに対する発生データ量の
抑圧にて生じた余剰ビットを、複雑ではない絵柄のマク
ロブロックＭＢに割り振ることと等価になる。従って、
全体的な画質を向上できる。
【００４７】次いで、この発明の他の実施例について図
８を参照して説明する。この他の実施例が、前述の一の
実施例と異なる点は、量子化回路１４に代えて、スレッ
ショルド回路２５によって発生データ量を抑圧している
ことである。マクロブロックＭＢ内で、複雑な絵柄であ
るブロックＢＬＫ と、複雑な絵柄でないブロックＢＬ
Ｋ とに分割できる場合には、複雑な絵柄のブロックＢ
ＬＫ のスレッショルドレベルを、複雑な絵柄でないブ
ロックＢＬＫ のスレッショルドレベルよりも大きくな
るように適応的に変化させるものである。この他の実施
例に於ける説明は、上述の一の実施例と異なる部分のみ
について行うものとし、上述の一の実施例と共通する部
分には同一符号を付し、重複する説明を省略する。
８を参照して説明する。この他の実施例が、前述の一の
実施例と異なる点は、量子化回路１４に代えて、スレッ
ショルド回路２５によって発生データ量を抑圧している
ことである。マクロブロックＭＢ内で、複雑な絵柄であ
るブロックＢＬＫ と、複雑な絵柄でないブロックＢＬ
Ｋ とに分割できる場合には、複雑な絵柄のブロックＢ
ＬＫ のスレッショルドレベルを、複雑な絵柄でないブ
ロックＢＬＫ のスレッショルドレベルよりも大きくな
るように適応的に変化させるものである。この他の実施
例に於ける説明は、上述の一の実施例と異なる部分のみ
について行うものとし、上述の一の実施例と共通する部
分には同一符号を付し、重複する説明を省略する。
【００４８】検出回路２６では、フレームバッフア回路
３から供給されるビデオデータＤＶについて、８×８画
素のブロックＢＬＫ１〜ＢＬＫ４単位で、複雑な絵柄で
あるか否かについて判断している。この複雑な絵柄であ
るか否かの判断の方法は、前述の一の実施例と同様にし
てなされる。或るブロックＢＬＫ１〜ＢＬＫ４が、複雑
な絵柄であると判断される時、検出回路２６からは、ハ
イレベルのエッジ検出信号ＥＤＧ が制御回路２７に供
給される。
３から供給されるビデオデータＤＶについて、８×８画
素のブロックＢＬＫ１〜ＢＬＫ４単位で、複雑な絵柄で
あるか否かについて判断している。この複雑な絵柄であ
るか否かの判断の方法は、前述の一の実施例と同様にし
てなされる。或るブロックＢＬＫ１〜ＢＬＫ４が、複雑
な絵柄であると判断される時、検出回路２６からは、ハ
イレベルのエッジ検出信号ＥＤＧ が制御回路２７に供
給される。
【００４９】制御回路１５では、上述の検出回路１３か
らハイレベルのエッジ検出信号ＥＤＧ が供給される時
、制御信号ＳＣ０が形成され、この制御信号ＳＣ０がス
レッショルド回路２５に供給される。或いはバッフアメ
モリ１７から供給される書込み可能な領域の容量に応じ
て制御信号ＳＣ１が形成され、この制御信号ＳＣ１がス
レッショルド回路２５に供給される。
らハイレベルのエッジ検出信号ＥＤＧ が供給される時
、制御信号ＳＣ０が形成され、この制御信号ＳＣ０がス
レッショルド回路２５に供給される。或いはバッフアメ
モリ１７から供給される書込み可能な領域の容量に応じ
て制御信号ＳＣ１が形成され、この制御信号ＳＣ１がス
レッショルド回路２５に供給される。
【００５０】スレッショルド回路２５では、制御回路２
７から供給される制御信号ＳＣ０、ＳＣ１に応じてスレ
ッショルドレベルがブロックＢＬＫ１〜ＢＬＫ４単位で
、適応的に制御される。即ち、複雑な絵柄であると判断
されたブロックＢＬＫ１〜ＢＬＫ４の時には、上述のス
レッショルドレベルが所定の値に引き上げられる。
７から供給される制御信号ＳＣ０、ＳＣ１に応じてスレ
ッショルドレベルがブロックＢＬＫ１〜ＢＬＫ４単位で
、適応的に制御される。即ち、複雑な絵柄であると判断
されたブロックＢＬＫ１〜ＢＬＫ４の時には、上述のス
レッショルドレベルが所定の値に引き上げられる。
【００５１】スレッショルド回路２５では、ＤＣＴ回路
１２から供給される変換係数がスレッショルドレベル以
上である場合には上述の変換係数をそのまま使用する。 また変換係数がスレッショルドレベル以下の場合には、
ＤＣＴ回路１２から供給される変換係数は全て〔零〕デ
ータとされる。このように、スレッショルドレベルが引
き上げられると、発生するデータ量を抑圧することが可
能となる。その他の内容については、前述の一の実施例
と同様であるので、重複する説明を省略する。
１２から供給される変換係数がスレッショルドレベル以
上である場合には上述の変換係数をそのまま使用する。 また変換係数がスレッショルドレベル以下の場合には、
ＤＣＴ回路１２から供給される変換係数は全て〔零〕デ
ータとされる。このように、スレッショルドレベルが引
き上げられると、発生するデータ量を抑圧することが可
能となる。その他の内容については、前述の一の実施例
と同様であるので、重複する説明を省略する。
【００５２】この他の実施例によれば、複雑な絵柄であ
ると判断されたブロックＢＬＫ１〜ＢＬＫ４の時には、
スレッショルドレベルが所定の値に引き上げられるので
、発生するデータ量を抑圧することが可能となる。その
他の効果については、前述した一の実施例と同様である
。
ると判断されたブロックＢＬＫ１〜ＢＬＫ４の時には、
スレッショルドレベルが所定の値に引き上げられるので
、発生するデータ量を抑圧することが可能となる。その
他の効果については、前述した一の実施例と同様である
。
【００５３】次いで、この発明の更に他の実施例につい
て図９を参照して説明する。この更に他の実施例が、前
述の一の実施例、他の実施例と異なる点は、スレッショ
ルド回路３８及び量子化回路３５を用いて、発生するデ
ータ量を抑圧していることである。即ち、マクロブロッ
クＭＢ内で、複雑な絵柄であるブロックＢＬＫ と、複
雑な絵柄でないブロックＢＬＫ とに分割できる場合に
は、複雑な絵柄のブロックＢＬＫ のスレッショルドレ
ベルを、複雑な絵柄でないブロックＢＬＫ のスレッシ
ョルドレベルよりも大きくなるように適応的に変化させ
る。また、これと共に、マクロブロックＭＢ毎の量子化
ステップ幅も適応的に変化させるものである。この他の
実施例に於ける説明は、上述の一の実施例及び他の実施
例と異なる部分のみについて行うものとし、上述の一の
実施例及び他の実施例と共通する部分には同一符号を付
し、重複する説明を省略する。
て図９を参照して説明する。この更に他の実施例が、前
述の一の実施例、他の実施例と異なる点は、スレッショ
ルド回路３８及び量子化回路３５を用いて、発生するデ
ータ量を抑圧していることである。即ち、マクロブロッ
クＭＢ内で、複雑な絵柄であるブロックＢＬＫ と、複
雑な絵柄でないブロックＢＬＫ とに分割できる場合に
は、複雑な絵柄のブロックＢＬＫ のスレッショルドレ
ベルを、複雑な絵柄でないブロックＢＬＫ のスレッシ
ョルドレベルよりも大きくなるように適応的に変化させ
る。また、これと共に、マクロブロックＭＢ毎の量子化
ステップ幅も適応的に変化させるものである。この他の
実施例に於ける説明は、上述の一の実施例及び他の実施
例と異なる部分のみについて行うものとし、上述の一の
実施例及び他の実施例と共通する部分には同一符号を付
し、重複する説明を省略する。
【００５４】検出回路３６では、フレームバッフア回路
３から供給されるビデオデータＤＶについて、８×８画
素のブロックＢＬＫ１〜ＢＬＫ４単位で複雑な絵柄であ
るか否かについて判断している。この複雑な絵柄である
か否かの判断の方法は、前述の一の実施例と同様にして
なされる。或るブロックＢＬＫ１〜ＢＬＫ４が、複雑な
絵柄であると判断される時、検出回路２６からは、ハイ
レベルのエッジ検出信号ＥＤＧ が制御回路２７に供給
される。
３から供給されるビデオデータＤＶについて、８×８画
素のブロックＢＬＫ１〜ＢＬＫ４単位で複雑な絵柄であ
るか否かについて判断している。この複雑な絵柄である
か否かの判断の方法は、前述の一の実施例と同様にして
なされる。或るブロックＢＬＫ１〜ＢＬＫ４が、複雑な
絵柄であると判断される時、検出回路２６からは、ハイ
レベルのエッジ検出信号ＥＤＧ が制御回路２７に供給
される。
【００５５】制御回路３７では、上述の検出回路１３か
らハイレベルのエッジ検出信号ＥＤＧ が供給される時
、制御信号ＳＣ０が形成され、この制御信号ＳＣ０がス
レッショルド回路２５に供給される。また、ハイレベル
のエッジ検出信号ＥＤＧ が所定の条件を満たしている
時は、制御信号ＳＣ２が量子化回路３５に供給される。 或いはバッフアメモリ１７から供給される書込み可能な
領域の容量に応じて制御信号ＳＣ１が形成され、この制
御信号ＳＣ１が量子化回路３５に供給される。
らハイレベルのエッジ検出信号ＥＤＧ が供給される時
、制御信号ＳＣ０が形成され、この制御信号ＳＣ０がス
レッショルド回路２５に供給される。また、ハイレベル
のエッジ検出信号ＥＤＧ が所定の条件を満たしている
時は、制御信号ＳＣ２が量子化回路３５に供給される。 或いはバッフアメモリ１７から供給される書込み可能な
領域の容量に応じて制御信号ＳＣ１が形成され、この制
御信号ＳＣ１が量子化回路３５に供給される。
【００５６】スレッショルド回路３８では、制御回路３
７から供給される制御信号ＳＣ０に応じてスレッショル
ドレベルがブロックＢＬＫ１〜ＢＬＫ４単位で適応的に
制御される。そして、複雑な絵柄であると判断されたブ
ロックＢＬＫ１〜ＢＬＫ４の時には、上述のスレッショ
ルドレベルが所定の値に引き上げられる。
７から供給される制御信号ＳＣ０に応じてスレッショル
ドレベルがブロックＢＬＫ１〜ＢＬＫ４単位で適応的に
制御される。そして、複雑な絵柄であると判断されたブ
ロックＢＬＫ１〜ＢＬＫ４の時には、上述のスレッショ
ルドレベルが所定の値に引き上げられる。
【００５７】スレッショルド回路３８では、ＤＣＴ回路
１２から供給される変換係数がスレッショルドレベル以
上である場合には上述の変換係数をそのまま使用する。 また変換係数がスレッショルドレベルに達しない場合に
は、ＤＣＴ回路１２から供給される変換係数は全て〔零
〕データとされる。
１２から供給される変換係数がスレッショルドレベル以
上である場合には上述の変換係数をそのまま使用する。 また変換係数がスレッショルドレベルに達しない場合に
は、ＤＣＴ回路１２から供給される変換係数は全て〔零
〕データとされる。
【００５８】量子化回路３５では、制御回路３７から供
給される制御信号ＳＣ１、ＳＣ２に応じて量子化ステッ
プ幅がマクロブロックＭＢ単位で適応的に制御される。 そして、複雑な絵柄のブロックＢＬＫ が有ると判断さ
れ且つ所定の条件を満たすマクロブロックＭＢの時には
、上述の量子化ステップ幅に更に所定の値、例えば、〔
１６〕が加算されて大きくされると共に、丸められる。 その他の内容については、前述の一の実施例及び他の実
施例と同様であるので、重複する説明を省略する。
給される制御信号ＳＣ１、ＳＣ２に応じて量子化ステッ
プ幅がマクロブロックＭＢ単位で適応的に制御される。 そして、複雑な絵柄のブロックＢＬＫ が有ると判断さ
れ且つ所定の条件を満たすマクロブロックＭＢの時には
、上述の量子化ステップ幅に更に所定の値、例えば、〔
１６〕が加算されて大きくされると共に、丸められる。 その他の内容については、前述の一の実施例及び他の実
施例と同様であるので、重複する説明を省略する。
【００５９】この更に他の実施例によれば、マクロブロ
ックＭＢ内で、複雑な絵柄であるブロックＢＬＫ と、
複雑な絵柄でないブロックＢＬＫ とに分割できる場合
には、複雑な絵柄のブロックＢＬＫ のスレッショルド
レベルを、複雑な絵柄でないブロックＢＬＫ のスレッ
ショルドレベルよりも大きくなるように適応的に変化さ
せると共に、マクロブロックＭＢ毎の量子化ステップ幅
も適応的に変化させているので、スレッショルドレベル
を大きくすることによって、発生するデータ量を抑圧で
き、また、量子化ステップ幅を大きくすると再量子化さ
れたデータが小さな値となって短い可変長コードが割り
当てられるので、発生するデータ量をより一層、抑圧す
ることが可能となる。その他の効果については、前述の
一の実施例及び他の実施例と同様である。
ックＭＢ内で、複雑な絵柄であるブロックＢＬＫ と、
複雑な絵柄でないブロックＢＬＫ とに分割できる場合
には、複雑な絵柄のブロックＢＬＫ のスレッショルド
レベルを、複雑な絵柄でないブロックＢＬＫ のスレッ
ショルドレベルよりも大きくなるように適応的に変化さ
せると共に、マクロブロックＭＢ毎の量子化ステップ幅
も適応的に変化させているので、スレッショルドレベル
を大きくすることによって、発生するデータ量を抑圧で
き、また、量子化ステップ幅を大きくすると再量子化さ
れたデータが小さな値となって短い可変長コードが割り
当てられるので、発生するデータ量をより一層、抑圧す
ることが可能となる。その他の効果については、前述の
一の実施例及び他の実施例と同様である。
【００６０】
【発明の効果】この発明にかかる高能率符号化装置によ
れば、高能率符号化する手段に入る前のビデオ信号のフ
レーム内の所定の大きさの領域毎に、フィードフオワー
ドによって複雑な絵柄の部分の判別がなされ、複雑な絵
柄であると判別された場合には、データ生成パラメータ
が変更され量子化する手段の量子化ステップ幅が適応的
に制御されるので、複雑な絵柄の部分から発生するデー
タ量を抑圧することができて、該複雑な絵柄の部分に於
いて多量のデータが突出して発生することを防止でき、
オーバーフローしてしまうことを防止でき、そして、こ
のことは、結果的に複雑な絵柄の部分以外の部分に於け
る発生データ量を増すことになり、従って、全体的な画
質を向上できるという効果がある。
れば、高能率符号化する手段に入る前のビデオ信号のフ
レーム内の所定の大きさの領域毎に、フィードフオワー
ドによって複雑な絵柄の部分の判別がなされ、複雑な絵
柄であると判別された場合には、データ生成パラメータ
が変更され量子化する手段の量子化ステップ幅が適応的
に制御されるので、複雑な絵柄の部分から発生するデー
タ量を抑圧することができて、該複雑な絵柄の部分に於
いて多量のデータが突出して発生することを防止でき、
オーバーフローしてしまうことを防止でき、そして、こ
のことは、結果的に複雑な絵柄の部分以外の部分に於け
る発生データ量を増すことになり、従って、全体的な画
質を向上できるという効果がある。
【図１】この発明に係る高能率符号化装置の一の実施例
を示すブロック図である。
を示すブロック図である。
【図２】フレームバッフア回路の詳細を示すブロック図
である。
である。
【図３】マクロブロックの構成を示す説明図である。
【図４】実施例を説明するため用いた画像及びデータ量
の分布を示す図である。
の分布を示す図である。
【図５】サンプルブロックの取り方を示す略線図である
。
。
【図６】サンプルブロック内に於けるエッジ検出を示す
略線図である。
略線図である。
【図７】制御回路に於ける処理手順を示すフローチャー
トである。
トである。
【図８】この発明の他の実施例を示すブロック図である
。
。
【図９】この発明の更に他の実施例を示すブロック図で
ある。
ある。
【図１０】従来例を示すブロック図である。
１２ ＤＣＴ回路
１３、２６、３６ 検出回路
１４、３５ 量子化回路
１５、２７、３７、８６ 制御回路
２５、３８ スレッショルド回路
ＳＶ ビデオ信号
ＤＶ ビデオデータ
ＳＣ０、ＳＣ１、ＳＣ２ 制御信号
ＭＢ マクロブロック
ＢＬＫ１〜ＢＬＫ４ ブロック
ＳＢ サンプルブロック
ＥＤＧ エッジ検出信号
Claims (1)
- 【請求項１】 ビデオ信号に対し、高能率符号化する
手段、量子化する手段を少なくとも備え、上記量子化す
る手段のステップ幅を可変して発生データ量を制御する
ようにした高能率符号化装置に於いて、上記ビデオ信号
の所定の大きさの領域毎に絵柄の複雑さを判別する手段
を備え、上記絵柄の複雑さの判別結果に応じて、上記量
子化する手段のステップ幅を制御するようにしたことを
特徴とする高能率符号化装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03934991A JP3187852B2 (ja) | 1991-02-08 | 1991-02-08 | 高能率符号化方法 |
| US07/828,294 US5317396A (en) | 1991-02-08 | 1992-01-30 | Highly efficient encoding apparatus |
| KR1019920001509A KR920017479A (ko) | 1991-02-08 | 1992-01-31 | 고능률 부호화 장치 |
| DE69213271T DE69213271T2 (de) | 1991-02-08 | 1992-02-07 | Kodierung von Videosignalen |
| EP92301032A EP0498656B1 (en) | 1991-02-08 | 1992-02-07 | Encoding video signals |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03934991A JP3187852B2 (ja) | 1991-02-08 | 1991-02-08 | 高能率符号化方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04257185A true JPH04257185A (ja) | 1992-09-11 |
| JP3187852B2 JP3187852B2 (ja) | 2001-07-16 |
Family
ID=12550604
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03934991A Expired - Lifetime JP3187852B2 (ja) | 1991-02-08 | 1991-02-08 | 高能率符号化方法 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5317396A (ja) |
| EP (1) | EP0498656B1 (ja) |
| JP (1) | JP3187852B2 (ja) |
| KR (1) | KR920017479A (ja) |
| DE (1) | DE69213271T2 (ja) |
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