JPH0385732A - 回路パターン形成用ガラス基板 - Google Patents

回路パターン形成用ガラス基板

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Publication number
JPH0385732A
JPH0385732A JP22407989A JP22407989A JPH0385732A JP H0385732 A JPH0385732 A JP H0385732A JP 22407989 A JP22407989 A JP 22407989A JP 22407989 A JP22407989 A JP 22407989A JP H0385732 A JPH0385732 A JP H0385732A
Authority
JP
Japan
Prior art keywords
glass substrate
outer periphery
photoresist
along
groove
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP22407989A
Other languages
English (en)
Inventor
Yoichi Kondo
洋一 近藤
Hiroyuki Kasai
笠井 広幸
Shingo Shirogishi
慎吾 城岸
Mutsumi Nakajima
睦 中島
Hideo Taniguchi
英男 谷口
Toshio Takemoto
竹本 敏夫
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
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Filing date
Publication date
Application filed by Sharp Corp filed Critical Sharp Corp
Priority to JP22407989A priority Critical patent/JPH0385732A/ja
Publication of JPH0385732A publication Critical patent/JPH0385732A/ja
Pending legal-status Critical Current

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  • Liquid Crystal (AREA)
  • Thin Film Transistor (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (イ)産業上の利用分野 この発明は、表面に回路パターンが形成されるガラス基
板に関し、更に詳しくはフォトレジストをスピンコード
法を用いて塗布されるガラス基板に関するものである。
(ロ)従来の技術 例えば、薄膜トランジスタを備えた、いわゆるアクティ
ブマトリックス型液晶表示素子の製造工程においては、
透明導電膜や各種の金属膜及び絶縁膜などの微細パター
ン加工を行う必要があり、この微細パターン加工には一
般にフォトエツチング法が用いられている。
このフォトエツチング法の場合には、ガラス基板上にフ
ォトレジストを滴下してガラス基板を回転させ、フォト
レジストを遠心力でガラス基板上に広げて塗布するスピ
ンコーターと称される塗布装置が使用される。
第4図はこのスピンコーターの基本的な構成を示したも
のであり、スピンコーターlは、容器2の中にガラス基
板3を吸着して保持する真空チャック4が設けられ、フ
ォトレジストを吐出するレジスト吐出ノズル5が上部に
、バックリンス肢を吐出するバックリンス吐出ノズル6
が下部にそれぞれ配置されている。ガラス基板3は所定
の回路ノくターンが形成されるもので、第5図に示すよ
うに例えば略正方形となっており、図示しない駆動モー
ターによって真空チャック4を駆動してガラス基板3を
回転させる。レジスト吐出ノズル5は真空チャック4の
中心に立置し、またバックリンス吐出ノズル6は真空チ
ャック4の外周部Qlとガラス基板3の仮想内接円I2
2との間に位置している。
第3図はスピンコーターの運転状態、即ちフォトレジス
トの塗布時Iこおlする経過時間と回転数の関係を例示
したものである。まず、時刻toから1、までのフォト
レジスト滴下期間W、たけレジスト吐出ノズル5から所
定量のフォトレジストをガラス基板3上に滴下し、時刻
t、に回転を開始して回転数R,(例えば20Orpm
)でガラス基板3を回転させ、ガラス基板3上にフォト
レジストを塗り広げる。また時刻t4からは、R,(例
えば101000rp (Rt>R+)まで回転数を上
げてガラス基板3上の過剰なフォトレジストを振り切り
、時刻tllで回転を停止してガラス基板3上へのフォ
トレジストの塗布が終了する。この間、回転数がR1に
達した時刻t3から回転数R7の時刻t、までのバック
リンス吐出期間W、にバックリンス吐出ノズル6からバ
ックリンス液を吐出し、ガラス基板3の裏面に付着する
フォトレジスト液を除去するバックリンス処理が行われ
る。
(ハ)発明が解決しようとする課題 上記のようなスピンコーターにおいて、従来では過剰な
フォトレジストを振り切るために表面がフラットなガラ
ス基板3を回転させても、表面張力の関係からフォトレ
ジストがガラス基板3の外周端部近傍で盛り上がった状
態で付着したままとなり、フォトレジストを外方に十分
振り切ることが出来ない場合があった。その結果、回転
を停止して遠心力が作用しなくなると盛り上がっていた
フォトレジストが外周端部近傍から内側に戻り、ガラス
基板3の中央部の均一なフォトレジスト薄膜より外側の
ガラス基板3の周囲に沿った外周に近い部分の膜厚が大
きくなるという現象が生じていた。そのため、このまま
次の露光工程を行うと、ガラス基板3の周囲に沿った外
周に近い部分に形成されたフォトレジストが正常にパタ
ーニングされなくなるという問題があった。しからばこ
れを避けてパターニングすればよいが、これではパタニ
ングできる有効面積が小さくなる。
この発明はこの点に着目し、ガラス基板の周囲に沿った
外周に近い部分のフォトレノストの盛り上がりをなくし
て、パターニングできる有効面積を従来より拡大するこ
とを目的としてなされた乙のである。
(ニ)課題を解決ずろfコめの手段 この発明は、導電性、半導電性等の各種薄膜に上って表
面に所定の回路パターンを形成するためのガラス基板で
あって、少なくとも片面に、外周に沿って、かつ外周か
ら少許間隔を45いて形成された凹溝を有する回路パタ
ーン形成用ガラス基板である。
すなわち、この発明は、少なくとも片面に、ガラス基板
の外周(辺)に沿って、外周(辺)から少許間隔をおい
て凹溝を形威し、これを、ガラス基板の周囲に沿ってス
ピンコードされるフォトレジスト膜の盛り上がりを防止
する表面張力低減部としたものである。
この発明におけるガラス基板としては、矩形板や円板あ
るいは正方形の板が挙げられる。
この発明において、少許間隔とは、例えば、ガラス基板
が矩形板であるとき、第1[fflに示すように、ガラ
ス基板3における外周辺Qから凹溝11までの平面i3
aが有する幅りを意味する。この際、平面部3aはガラ
ス基板3の外周辺Qに沿って幅りの枠領域を形成する。
(ホ)作用 ガラス基板の外周端部近傍では表面張力低減部によって
フォトレジストの表面張力が遠心力に対して相対的に小
さくなり、過剰なフォトレジストを遠心力によって外周
端部近傍から外方に振り切ることが可能となる。従って
、従来のようにガラス基板の周囲に沿った外周に近い部
分のフォトレジストの膜厚が大きくなるということがな
く、パターニングできる有効面積が従来のものより拡大
される。
(へ)実施例 以下図に示す実施例にもとづいてこの発明を詳述する。
なお、これによってこの発明は限定を受けるものではな
い。
第1図は、300x320xiのガラス基板の端6 部並びにその近傍の断面を示したものであり、この実施
例ではガラス基板3の表面の外周Qに沿って、かつ外周
Qから小さな間隔りをおいて表面張力低減部として凹状
の溝部2を設けている。この溝部11はガラス基板表面
に設けられ、溝部の大きさは、例えば板厚t=1.1m
mのものにおいて図示のへ寸法が1.2mm5B寸法が
0 、5.、、、C寸法か0゜4mmに選定される。ま
た、ガラス基板表面には、外周辺eから溝KS11まで
の平面部3aが外周辺gに沿って枠状に形成され、その
幅りが0.7μm程度である。
この実施例は上記のような構成であり、ガラス基板3を
回転させた場合、溝部IIに集中したフォトレジストに
対して作用する表面張力の状態が変化し、遠心力に打ち
勝つことが出来なくなり過剰なフォトレジストが平面部
3+Lを介して外方に振り切られてしまうのである。こ
のため溝部11より外側すなわち、平面部3aにはフォ
トレジストの回り込みがなく、回転を停止した後にフォ
トレジストが溝部11を介してより内側に戻ることな=
7 く、ガラス基板3の外周gに沿った外周Qに近い部分の
フォトレジストの膜厚が大きくなることがなくなるので
ある。
その結果、上記ガラス基板3を用い、従来技術の項で述
べたフォトレジストの塗布条件(第3図)にて塗布し、
塗布状態を目視検査したところ、溝部11より外側には
フォトレジストの回り込みがなく、ガラス基板3の外周
eに沿った外周Qに近い部分に膜厚の大きな箇所が部分
的に形成されることもなく、この実施例の効果が確認さ
れた。
(ト)発明の効果 以上のように、この発明によれは、ガラス基板の少なく
とも片面に、外周に沿って、かつ外周から少許間隔をお
いて、溝部を設けたので、この溝部を表面張力低減部と
して、スピンコードされるフォトレジストの盛り上がり
を防止でき、スピンコードの工程で過剰なフォトレジス
トを十分に振り切ることが可能となって、ガラス基板の
外周に沿った外周に近い部分のフォトレジストの膜厚が
大きくなるということがなくなり、パターニングできる
有効面積を拡大できるのである。
【図面の簡単な説明】
第1図はこの発明の一実施例を示す要部構成説明図、第
2図は上記実施例における概略平面図、第3図は上記実
施例におけるスピンコーターの運転状態を示す説明図、
第4図および第5図はそれぞれスピンコーターの構成説
明図である。 1・・・・・スピンコーター、2・・・・・・容器、3
・・・・・・ガラス基板、3a・・・・・・枠状の平面
部、4・・・・・・真空チャック、11・・・・・・凹
状の溝部、(0・・・・・・ガラス基板の外周辺。

Claims (1)

    【特許請求の範囲】
  1. 1、導電性、半導電性等の各種薄膜によって表面に所定
    の回路パターンを形成するためのガラス基板であって、
    少なくとも片面に、外周に沿って、かつ外周から少許間
    隔をおいて形成された凹溝を有する回路パターン形成用
    ガラス基板。
JP22407989A 1989-08-29 1989-08-29 回路パターン形成用ガラス基板 Pending JPH0385732A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP22407989A JPH0385732A (ja) 1989-08-29 1989-08-29 回路パターン形成用ガラス基板

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP22407989A JPH0385732A (ja) 1989-08-29 1989-08-29 回路パターン形成用ガラス基板

Publications (1)

Publication Number Publication Date
JPH0385732A true JPH0385732A (ja) 1991-04-10

Family

ID=16808231

Family Applications (1)

Application Number Title Priority Date Filing Date
JP22407989A Pending JPH0385732A (ja) 1989-08-29 1989-08-29 回路パターン形成用ガラス基板

Country Status (1)

Country Link
JP (1) JPH0385732A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7018926B2 (en) 2002-06-14 2006-03-28 Oki Electric Industry Co., Ltd. Method of manufacturing semiconductor device
US8009253B2 (en) * 2005-06-22 2011-08-30 Sony Corporation Electro-optical device having insulating layer with varying thickness in the reflection and transmission displays

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7018926B2 (en) 2002-06-14 2006-03-28 Oki Electric Industry Co., Ltd. Method of manufacturing semiconductor device
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