JPH0361339B2 - - Google Patents
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- JPH0361339B2 JPH0361339B2 JP1911782A JP1911782A JPH0361339B2 JP H0361339 B2 JPH0361339 B2 JP H0361339B2 JP 1911782 A JP1911782 A JP 1911782A JP 1911782 A JP1911782 A JP 1911782A JP H0361339 B2 JPH0361339 B2 JP H0361339B2
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/80—Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier
- H01L29/812—Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier with a Schottky gate
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- General Physics & Mathematics (AREA)
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- Junction Field-Effect Transistors (AREA)
Description
本発明はGaAsとGaAlAsで成る高信頼度の半
導体装置に関する。 GaAsは電子の移動度の大きいところから高速
デバイスとして適しており、一例としてGaAs
MESFET(シヨツトキゲート電界効果トランジス
タ)がマイクロ波帯の増巾素子として実用化され
ている。近年、更に一部GaAlAs層を導入するこ
とによつて特性を改善することが行われている。
その一例は、従来基板の悪影響を防ぐために基板
と能動層間に備えていた高純度GaAsエピタキシ
ヤル層で成るバツフア層をGaAlAs層で構成する
ものである。これはGaAlAs例えばGa0.7Al0.3As
がGaAsより約0.4eV電子親和力が小さいため
GaAlAs/GaAs界面において伝導帯に障壁がで
きるので、同じ物質であるGaAsをバツフア層と
して用いた場合より基板側への漏れ電流が小さく
なることを利用するものである。かかるGaAs
MESFETの構造は、例えば第1図および第2図
に示すようになる。第1図は平面図、第2図は第
1図中A−A′線に沿う断面図を示し、11は半
絶縁性GaAs基板、12はバツフア層、13はn
型GaAs能動層、14はゲート電極、15と16
はNi/Au−Geを熱処理しGaAsと合金化させた
オーム性電極であり、15がソース電極、16が
ドレイン電極となる。なお実際には15と16の
オーム性電極上に配線抵抗を感じボンデイングを
容易にするために、例えばTiP+Au層が設けら
れることが多い。また17はゲートパツドであ
る。 第1図中破線18で囲まれた部分がいわゆるメ
サ領域であり、第2図でわかるように能動層13
が残された部分である。このメサ領域の形成は、
ドレイン電流路を限定するとともに、ゲートパツ
ド17をメサ領域外の高抵抗バツフア層上に形成
し、浮遊容量を減ずるために必要である。ここで
ソース電極はボンデイングのためのスペースをと
ることおよびソース接地インダクタンスを小さく
とるために大きく形成されるのが普通で、第1図
のようにゲートパツドを囲むように形成される例
等メサ領域外のバツフア層上に形成される場合も
多い。この時基板半導体との接着性を良好にする
ためにAu−Geを主成分とする金属を熱処理合金
化させて成るオーム性電極も同じくバツフア層上
に形成される。 しかしながら、かかる平面構造を有する
MESFETにおいて、バツフア層にGaAlAsを用
いた場合、すなわちGaAs層上に加えてGaAlAs
層上にかなりの面積にわたつてAu−Geを主成分
とするオーム性電極が形成された場合には次のよ
うな不都合が見出された。すなわちオーム性を得
るためのAu−GeとGaAsおよびGaAlAsとの熱処
理合金化の後に、250℃程度の高温プロセスを受
けるとオーム性電極が高抵抗化し、かつ整流性と
なり、劣化する現象が見出されたのである。 本発明は、以上のようなオーム性電極の劣化を
防止した高信頼度のGaAsとGaAlAsとで構成さ
れる半導体装置を提供するものであり、GaAsと
m個(m1)の層あるいは領域のGaAlAsで構
成される半導体装置において、Au−Geを主成分
とする一つの連結されたオーム性電極において、
k番目のGaAlAs層上に形成された面積の該オー
ム性電極の全面積に対する割合をS(k)、およびk
番目のGaAlAsのAlAsのモル分率をX(k)とする
と、 F=n 〓k=1 {S(k)・X(k)}0.08 (1) であることを特徴とするものである。かかる条件
を満足するようにGaAlAs層のオーム性電極形成
部を設計することにより、オーム性電極の劣化の
ない高信頼度の半導体装置を実現できる。 以下具体的実施例によつて本発明を詳述しその
効果について説明する。 半絶縁性GaAs基板上に3μmの厚さの高抵抗
Ga0.7Al0.3Asバツフア層と、その上にキヤリア密
度約3×1017cm-3、厚さ0.15μmのn型GaAs能動
層を成長させたウエハーを用いて0.5μmゲートの
MESFETを製作した。ゲート幅は280μmで、ゲ
ートはAlで形成し、ソースおよびドレインのオ
ーム性電極は1000Åの厚さのAu−Geを300Åの
厚さのNiで被覆し、420℃で30秒間熱処理し、
GaAsおよびGaAlAsと合金化して形成した。製
作したFETのパターンは、第1図に示したもの、
および第3図に示したように破線18で囲まれる
メサ領域を大きくし、オーム性電極15,16特
にソース電極15の大部分をメサ領域すなわち
GaAs層上に形成したものである。第1図のパタ
ーンにおいてソースのオーム性電極の前記
GaAlAs層上に形成された面積のソース電極全体
に対する割合S(1)は0.8、AlAsのモル分率X(1)は
0.3で、前記(1)式の特性数Fは0.24である。同様
に第1図のパターンのドレイン電極ではF=
0.09、第3図のパターンのソース電極ではF=
0.01、ドレイン電極ではF=0.04である。各
MESFETの特性を測定した後、水素中250℃にお
いて1時間高温放置して特性の劣化を比較検討し
た。下表は高温放置によるソースおよびドレイン
直列抵抗の増加割合△R/Roを特性数Fに対し
て示したものである。また第4図
導体装置に関する。 GaAsは電子の移動度の大きいところから高速
デバイスとして適しており、一例としてGaAs
MESFET(シヨツトキゲート電界効果トランジス
タ)がマイクロ波帯の増巾素子として実用化され
ている。近年、更に一部GaAlAs層を導入するこ
とによつて特性を改善することが行われている。
その一例は、従来基板の悪影響を防ぐために基板
と能動層間に備えていた高純度GaAsエピタキシ
ヤル層で成るバツフア層をGaAlAs層で構成する
ものである。これはGaAlAs例えばGa0.7Al0.3As
がGaAsより約0.4eV電子親和力が小さいため
GaAlAs/GaAs界面において伝導帯に障壁がで
きるので、同じ物質であるGaAsをバツフア層と
して用いた場合より基板側への漏れ電流が小さく
なることを利用するものである。かかるGaAs
MESFETの構造は、例えば第1図および第2図
に示すようになる。第1図は平面図、第2図は第
1図中A−A′線に沿う断面図を示し、11は半
絶縁性GaAs基板、12はバツフア層、13はn
型GaAs能動層、14はゲート電極、15と16
はNi/Au−Geを熱処理しGaAsと合金化させた
オーム性電極であり、15がソース電極、16が
ドレイン電極となる。なお実際には15と16の
オーム性電極上に配線抵抗を感じボンデイングを
容易にするために、例えばTiP+Au層が設けら
れることが多い。また17はゲートパツドであ
る。 第1図中破線18で囲まれた部分がいわゆるメ
サ領域であり、第2図でわかるように能動層13
が残された部分である。このメサ領域の形成は、
ドレイン電流路を限定するとともに、ゲートパツ
ド17をメサ領域外の高抵抗バツフア層上に形成
し、浮遊容量を減ずるために必要である。ここで
ソース電極はボンデイングのためのスペースをと
ることおよびソース接地インダクタンスを小さく
とるために大きく形成されるのが普通で、第1図
のようにゲートパツドを囲むように形成される例
等メサ領域外のバツフア層上に形成される場合も
多い。この時基板半導体との接着性を良好にする
ためにAu−Geを主成分とする金属を熱処理合金
化させて成るオーム性電極も同じくバツフア層上
に形成される。 しかしながら、かかる平面構造を有する
MESFETにおいて、バツフア層にGaAlAsを用
いた場合、すなわちGaAs層上に加えてGaAlAs
層上にかなりの面積にわたつてAu−Geを主成分
とするオーム性電極が形成された場合には次のよ
うな不都合が見出された。すなわちオーム性を得
るためのAu−GeとGaAsおよびGaAlAsとの熱処
理合金化の後に、250℃程度の高温プロセスを受
けるとオーム性電極が高抵抗化し、かつ整流性と
なり、劣化する現象が見出されたのである。 本発明は、以上のようなオーム性電極の劣化を
防止した高信頼度のGaAsとGaAlAsとで構成さ
れる半導体装置を提供するものであり、GaAsと
m個(m1)の層あるいは領域のGaAlAsで構
成される半導体装置において、Au−Geを主成分
とする一つの連結されたオーム性電極において、
k番目のGaAlAs層上に形成された面積の該オー
ム性電極の全面積に対する割合をS(k)、およびk
番目のGaAlAsのAlAsのモル分率をX(k)とする
と、 F=n 〓k=1 {S(k)・X(k)}0.08 (1) であることを特徴とするものである。かかる条件
を満足するようにGaAlAs層のオーム性電極形成
部を設計することにより、オーム性電極の劣化の
ない高信頼度の半導体装置を実現できる。 以下具体的実施例によつて本発明を詳述しその
効果について説明する。 半絶縁性GaAs基板上に3μmの厚さの高抵抗
Ga0.7Al0.3Asバツフア層と、その上にキヤリア密
度約3×1017cm-3、厚さ0.15μmのn型GaAs能動
層を成長させたウエハーを用いて0.5μmゲートの
MESFETを製作した。ゲート幅は280μmで、ゲ
ートはAlで形成し、ソースおよびドレインのオ
ーム性電極は1000Åの厚さのAu−Geを300Åの
厚さのNiで被覆し、420℃で30秒間熱処理し、
GaAsおよびGaAlAsと合金化して形成した。製
作したFETのパターンは、第1図に示したもの、
および第3図に示したように破線18で囲まれる
メサ領域を大きくし、オーム性電極15,16特
にソース電極15の大部分をメサ領域すなわち
GaAs層上に形成したものである。第1図のパタ
ーンにおいてソースのオーム性電極の前記
GaAlAs層上に形成された面積のソース電極全体
に対する割合S(1)は0.8、AlAsのモル分率X(1)は
0.3で、前記(1)式の特性数Fは0.24である。同様
に第1図のパターンのドレイン電極ではF=
0.09、第3図のパターンのソース電極ではF=
0.01、ドレイン電極ではF=0.04である。各
MESFETの特性を測定した後、水素中250℃にお
いて1時間高温放置して特性の劣化を比較検討し
た。下表は高温放置によるソースおよびドレイン
直列抵抗の増加割合△R/Roを特性数Fに対し
て示したものである。また第4図
【表】
は第1図のパターンのMESFETのゲートを開放
した時のソースとドレイン間の電流電圧特性の高
温放置による変化を示すもので実線が高温放置前
の特性、点線が高温放置後の特性である。すなわ
ちGaAlAs層上にオーム性電極を形成した割合の
大きいほど劣化は顕著である。したがつて第4図
の高温放置後の電流電圧特性は抵抗増加の大きい
ソース電極の特性と考えて良く、高抵抗化に加え
てシヨツトキ型の電流成分が増して整流性が顕著
になつていることがわかる。GaAsだけで構成し
た半導体装置においてはかかる劣化は起こらない
ので、該劣化にはAlが関与していることは明ら
かで、熱処理合金化によつてオーム性電極中に取
込まれたAlが、高温放置によつてGaAs能動層上
の本来のオーム性電極部に拡散し、障壁高さが高
くなる等の原因で高抵抗劣化するものと考えられ
る。なおかかる劣化は比較的短時間で起こり、さ
らに高温放置を続けても特性はほとんど変化しな
かつた。一方第3図のパターンのMESFETすな
わち本発明の一実施例では抵抗増加は僅小で、ソ
ース−ドレイン間の電流電圧特性もほとんど変化
はなかつた。抵抗の20%の増加をもつて劣化を規
定するものとすれば、高信頼度のためには、特性
数Fは0.08以下である必要がある。 以上GaAlAs層が一種類である場合について説
明したが、オーム性電極中に取り込まれるAlの
量が劣化に関与しているので組成すなわちAlAs
のモル分率の異なるGaAlAs層あるいは領域が2
つ以上ある場合には、特性数Fとして、それぞれ
のGaAlAs層上に形成されるオーム性電極面積の
割合と、それぞれのAlAsのモル分率との積を1
つの連結されたオーム性電極中の各GaAlAsにつ
いて和をとれば良い。また該GaAlAs層が非常に
薄く、オーム性電極の熱処理によつてさらに下層
のGaAsまで合金化する場合においては、前記電
極面積の代わりに、該電極面積にGaAlAsの合金
化割合を乗じた有効電極面積なるものを用いれば
良い。さらに2種以上のGaAlAs層が積層とな
り、何層にもわたつてオーム性電極を合金化する
場合にも同様な取扱いができる。以上本発明は
GaAlAsをバツフア層とするGaAs MESFETば
かりでなく他の半導体装置にも適用できる。
した時のソースとドレイン間の電流電圧特性の高
温放置による変化を示すもので実線が高温放置前
の特性、点線が高温放置後の特性である。すなわ
ちGaAlAs層上にオーム性電極を形成した割合の
大きいほど劣化は顕著である。したがつて第4図
の高温放置後の電流電圧特性は抵抗増加の大きい
ソース電極の特性と考えて良く、高抵抗化に加え
てシヨツトキ型の電流成分が増して整流性が顕著
になつていることがわかる。GaAsだけで構成し
た半導体装置においてはかかる劣化は起こらない
ので、該劣化にはAlが関与していることは明ら
かで、熱処理合金化によつてオーム性電極中に取
込まれたAlが、高温放置によつてGaAs能動層上
の本来のオーム性電極部に拡散し、障壁高さが高
くなる等の原因で高抵抗劣化するものと考えられ
る。なおかかる劣化は比較的短時間で起こり、さ
らに高温放置を続けても特性はほとんど変化しな
かつた。一方第3図のパターンのMESFETすな
わち本発明の一実施例では抵抗増加は僅小で、ソ
ース−ドレイン間の電流電圧特性もほとんど変化
はなかつた。抵抗の20%の増加をもつて劣化を規
定するものとすれば、高信頼度のためには、特性
数Fは0.08以下である必要がある。 以上GaAlAs層が一種類である場合について説
明したが、オーム性電極中に取り込まれるAlの
量が劣化に関与しているので組成すなわちAlAs
のモル分率の異なるGaAlAs層あるいは領域が2
つ以上ある場合には、特性数Fとして、それぞれ
のGaAlAs層上に形成されるオーム性電極面積の
割合と、それぞれのAlAsのモル分率との積を1
つの連結されたオーム性電極中の各GaAlAsにつ
いて和をとれば良い。また該GaAlAs層が非常に
薄く、オーム性電極の熱処理によつてさらに下層
のGaAsまで合金化する場合においては、前記電
極面積の代わりに、該電極面積にGaAlAsの合金
化割合を乗じた有効電極面積なるものを用いれば
良い。さらに2種以上のGaAlAs層が積層とな
り、何層にもわたつてオーム性電極を合金化する
場合にも同様な取扱いができる。以上本発明は
GaAlAsをバツフア層とするGaAs MESFETば
かりでなく他の半導体装置にも適用できる。
第1図および第3図はGaAs MESFETの平面
パターンを示すもので、第3図は本発明の一実施
例である。第2図は第1図中A−A′線に沿う断
面図を示したものである。ここで、11は半絶縁
性GaAs基板、12はバツフア層、13はGaAs
能動層、14はゲート電極、15はソースオーム
性電極、16はドレインオーム性電極、17はゲ
ートパツド、18の破線で囲つた部分がメサ領域
である。第4図は第1図のパターンのGa0.7Al0.3
Asをバツフア層とするMESFETのゲート開放時
のソース−ドレイン間の電流電圧特性であり、実
線が高温放置前、破線が高温放置後の特性であ
る。
パターンを示すもので、第3図は本発明の一実施
例である。第2図は第1図中A−A′線に沿う断
面図を示したものである。ここで、11は半絶縁
性GaAs基板、12はバツフア層、13はGaAs
能動層、14はゲート電極、15はソースオーム
性電極、16はドレインオーム性電極、17はゲ
ートパツド、18の破線で囲つた部分がメサ領域
である。第4図は第1図のパターンのGa0.7Al0.3
Asをバツフア層とするMESFETのゲート開放時
のソース−ドレイン間の電流電圧特性であり、実
線が高温放置前、破線が高温放置後の特性であ
る。
Claims (1)
- 【特許請求の範囲】 1 GaAsおよび1以上のm個のGaAlAsの層あ
るいは領域で構成された半導体装置において、
Au−Geを主成分とする一つの連結されたオーム
性電極内で、k番目のGaAlAs層上に形成された
面積の該オーム性電極全体に対する割合をS(k)、
およびk番目のGaAlAs中のAlAsのモル分率を
X(k)として、 n 〓k=1 {S(k)・X(k)}0.08 であることを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1911782A JPS58137261A (ja) | 1982-02-09 | 1982-02-09 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1911782A JPS58137261A (ja) | 1982-02-09 | 1982-02-09 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58137261A JPS58137261A (ja) | 1983-08-15 |
JPH0361339B2 true JPH0361339B2 (ja) | 1991-09-19 |
Family
ID=11990523
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1911782A Granted JPS58137261A (ja) | 1982-02-09 | 1982-02-09 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58137261A (ja) |
-
1982
- 1982-02-09 JP JP1911782A patent/JPS58137261A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS58137261A (ja) | 1983-08-15 |
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