JPH034922B2 - - Google Patents
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- JPH034922B2 JPH034922B2 JP55172812A JP17281280A JPH034922B2 JP H034922 B2 JPH034922 B2 JP H034922B2 JP 55172812 A JP55172812 A JP 55172812A JP 17281280 A JP17281280 A JP 17281280A JP H034922 B2 JPH034922 B2 JP H034922B2
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- JP
- Japan
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- 238000010586 diagram Methods 0.000 claims description 41
- 238000000034 method Methods 0.000 claims description 6
- 238000006243 chemical reaction Methods 0.000 claims description 4
- 239000011159 matrix material Substances 0.000 claims description 2
- 230000004044 response Effects 0.000 claims description 2
- 230000002159 abnormal effect Effects 0.000 description 4
- 230000005856 abnormality Effects 0.000 description 2
- 230000011514 reflex Effects 0.000 description 2
- 238000007689 inspection Methods 0.000 description 1
- 238000012423 maintenance Methods 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/04—Programme control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/05—Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
- G05B19/056—Programming the PLC
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/10—Plc systems
- G05B2219/13—Plc programming
- G05B2219/13052—Display of ladder diagram
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
- Y02P90/00—Enabling technologies with a potential contribution to greenhouse gas [GHG] emissions mitigation
- Y02P90/02—Total factory control, e.g. smart factories, flexible manufacturing systems [FMS] or integrated manufacturing systems [IMS]
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Programmable Controllers (AREA)
- Testing And Monitoring For Control Systems (AREA)
Description
【発明の詳細な説明】
この発明は、シーケンス制御系の表示装置に関
するもので、例えば指定されたシーケンス回路図
とともに、それを構成する素子のオン、オフ情
報、およびシーケンス回路の電気的導通、非導通
状態をも同時に表示する表示装置に関するもので
ある。
するもので、例えば指定されたシーケンス回路図
とともに、それを構成する素子のオン、オフ情
報、およびシーケンス回路の電気的導通、非導通
状態をも同時に表示する表示装置に関するもので
ある。
従来ワイヤロジツク方式のリレーシーケンス制
御装置においては、制御リレー、リミツトスイツ
チ、ソレノイドバルブ等の劣化や、さらに被制御
器の異常が発生した場合、テスタやその他の測定
器により各素子のメーク、ブレーク状態をモニタ
することにより被制御機器の異常動作の原因を追
求している場合が多かつた。また、プログラムメ
モリに制御手順を記憶させ順次プログラムを読み
出して被制御器を制御するプログラム方式のシー
ケンス制御装置においては、入力、出力のメー
ク、ブレーク状態をモニタランプに点灯し、点灯
しているランプを調べシーケンス回路図面上にメ
ーク、ブレーク状態の記号を記入したり、あるい
はCRT上に表示されるシーケンス回路図上の接
点部にメーク、ブレーク状態を表示して異常動作
の原因を究明していた。
御装置においては、制御リレー、リミツトスイツ
チ、ソレノイドバルブ等の劣化や、さらに被制御
器の異常が発生した場合、テスタやその他の測定
器により各素子のメーク、ブレーク状態をモニタ
することにより被制御機器の異常動作の原因を追
求している場合が多かつた。また、プログラムメ
モリに制御手順を記憶させ順次プログラムを読み
出して被制御器を制御するプログラム方式のシー
ケンス制御装置においては、入力、出力のメー
ク、ブレーク状態をモニタランプに点灯し、点灯
しているランプを調べシーケンス回路図面上にメ
ーク、ブレーク状態の記号を記入したり、あるい
はCRT上に表示されるシーケンス回路図上の接
点部にメーク、ブレーク状態を表示して異常動作
の原因を究明していた。
即ち、第１図は、リレーシーケンス回路の一例
を示す回路図面である。このような回路において
異常動作が発生した時に、従来のリレー接点のオ
ン、オフ状態のみをCRT画面上にシーケンス回
路図に表示する表示装置の場合は、第２図に示す
例のような表示形態となる。また、モニタランプ
に入力、出力のメーク、ブレーク状態を点灯し、
ランプの点灯状態を調べてシーケンス回路図面上
にメーク、ブレーク状態の信号を記入する場合も
第２図と同様に接点のオン、オフ状態の検知のみ
である。
を示す回路図面である。このような回路において
異常動作が発生した時に、従来のリレー接点のオ
ン、オフ状態のみをCRT画面上にシーケンス回
路図に表示する表示装置の場合は、第２図に示す
例のような表示形態となる。また、モニタランプ
に入力、出力のメーク、ブレーク状態を点灯し、
ランプの点灯状態を調べてシーケンス回路図面上
にメーク、ブレーク状態の信号を記入する場合も
第２図と同様に接点のオン、オフ状態の検知のみ
である。
なお、第１図、第２図に於て、Ｘ１〜Ｘ４はリ
レー接点、Y1は出力を示すものである。
レー接点、Y1は出力を示すものである。
このような従来の表示装置においては、第２図
に示すようにシーケンス回路における接点のオ
ン、オフ情報しか得られないため、シーケンス回
路における電気信号の導通、非導通は人間がシー
ケンス回路図面を見て、接点のオン、オフ情報を
もとに論理的に判断していた。そのため接点数が
多く、AND，ORが複雑に組み合わさつたような
シーケンス回路においては、異常動作箇所を見つ
け出すのに多くの時間を費し非常に煩わしいとい
う欠点があつた。
に示すようにシーケンス回路における接点のオ
ン、オフ情報しか得られないため、シーケンス回
路における電気信号の導通、非導通は人間がシー
ケンス回路図面を見て、接点のオン、オフ情報を
もとに論理的に判断していた。そのため接点数が
多く、AND，ORが複雑に組み合わさつたような
シーケンス回路においては、異常動作箇所を見つ
け出すのに多くの時間を費し非常に煩わしいとい
う欠点があつた。
この発明は、上記のものの欠点を除去するため
になされたもので、対象としているシーケンス回
路図表示と同時に、それを構成している各素子の
オン、オフ情報表示、およびシーケンス回路にお
ける電気信号の導通部分の活線表示、非導通部分
の非活線表示を、シーケンス制御装置にて逐次出
力されるラダーシーケンス対応の現在シーケンス
制御中におけるシーケンス命令に同期してこのシ
ーケンス命令に等価的なラダーシーケンス回路図
として同一画面上に表示する表示装置を提供する
ことを目的としている。
になされたもので、対象としているシーケンス回
路図表示と同時に、それを構成している各素子の
オン、オフ情報表示、およびシーケンス回路にお
ける電気信号の導通部分の活線表示、非導通部分
の非活線表示を、シーケンス制御装置にて逐次出
力されるラダーシーケンス対応の現在シーケンス
制御中におけるシーケンス命令に同期してこのシ
ーケンス命令に等価的なラダーシーケンス回路図
として同一画面上に表示する表示装置を提供する
ことを目的としている。
以下、この発明の一実施例を図について説明す
る。第３図において、１は操作盤、２は制御部３
は操作盤１から指示されるシーケンス回路を探し
出す探索回路、４は探索されたシーケンス回路に
対応するシーケンス命令からシーケンス回路図を
復元するシーケンス命令→シーケンス回路図変換
部、５は表示情報を記憶するリフレツシユメモ
リ、６はリフレツシユメモリ５の記憶情報から表
示文字を作り出すキヤラクタジエネレータ部、７
は表示制御部、８は上記リフレツシユメモリ５の
記憶情報及び後述するシーケンス制御装置１５に
おける現在シーケンス制御中の制御プロセスの入
出力が各々取り込まれ、この取り込まれた内容に
基づいてシーケンス制御装置１５の現在シーケン
ス制御中におけるシーケンス命令（実行命令）に
同期してこのシーケンス命令（実行命令）に等価
的なラダーシーケンス回路図として表示するシー
ケンス回路図の接点、出力のオン、オフ表示と電
気的導通、非導通を活線、非活線表示するための
モニタ制御部、９はメモリ、１０はブラウン管か
らなる表示部、１１はシーケンス命令記憶部、１
２はプロセス入力を取り入れる入力部、１３はプ
ロセス出力を送り出す出力部、１４はシーケンス
制御部で、１５は１０，１１，１２，１３，１４
で構成されるシーケンス制御装置である。
る。第３図において、１は操作盤、２は制御部３
は操作盤１から指示されるシーケンス回路を探し
出す探索回路、４は探索されたシーケンス回路に
対応するシーケンス命令からシーケンス回路図を
復元するシーケンス命令→シーケンス回路図変換
部、５は表示情報を記憶するリフレツシユメモ
リ、６はリフレツシユメモリ５の記憶情報から表
示文字を作り出すキヤラクタジエネレータ部、７
は表示制御部、８は上記リフレツシユメモリ５の
記憶情報及び後述するシーケンス制御装置１５に
おける現在シーケンス制御中の制御プロセスの入
出力が各々取り込まれ、この取り込まれた内容に
基づいてシーケンス制御装置１５の現在シーケン
ス制御中におけるシーケンス命令（実行命令）に
同期してこのシーケンス命令（実行命令）に等価
的なラダーシーケンス回路図として表示するシー
ケンス回路図の接点、出力のオン、オフ表示と電
気的導通、非導通を活線、非活線表示するための
モニタ制御部、９はメモリ、１０はブラウン管か
らなる表示部、１１はシーケンス命令記憶部、１
２はプロセス入力を取り入れる入力部、１３はプ
ロセス出力を送り出す出力部、１４はシーケンス
制御部で、１５は１０，１１，１２，１３，１４
で構成されるシーケンス制御装置である。
次に第３図に示すような構成において、第１図
に示すようなシーケンス回路の接点、出力のオ
ン、オフ表示および導通、非導通状態を電気信号
の流れとして活線、非活線表示して、モニタする
場合についてその動作について詳細に説明する。
に示すようなシーケンス回路の接点、出力のオ
ン、オフ表示および導通、非導通状態を電気信号
の流れとして活線、非活線表示して、モニタする
場合についてその動作について詳細に説明する。
モニタしたいシーケンス回路を操作盤１に与え
ると、操作盤１は制御部２に接続されているので
制御部２は指示されたシーケンス回路の探索を探
索回路３に指令し、それを受けた探索回路３はシ
ーケンス命令記憶部１１より探索指示されている
シーケンス回路に対応するシーケンス命令を探索
する。シーケンス命令→シーケンス回路図変換部
４は探索された該当シーケンス命令をシーケンス
回路図に変換し、表示シンボルコードをリフレツ
シユメモリ５に送り出す。リフレツシユメモリ５
は表示部１０の画面全体に表示できる文字、記号
を記憶できるメモリ容量をもち、シーケンス命令
→シーケンス回路図変換部４から送られてくる表
示シンボルコードを表示部１０の表示画面の位置
に対応するメモリ番地に記憶する。リフレツシユ
メモリ５に記憶された内容は周期的に順次読出さ
れ、キヤラクタジエネレータ部６に送られる。キ
ヤラクタジエネレータ部６は、リフレツシユメモ
リ５から送られてくる表示シンボルコードに対応
したｍ×ｎのドツトマトリツクスで構成されるシ
ンボルパターンを表示制御部７に送り出す。表示
制御部７は表示部１０にラスタスキヤンに同期し
て上から順次ｎドツトずつｍラスタスキヤンで読
み出し一つのシンボルを表示部１０に表示し、順
次読み出すことにより表示部１０にモニタしたい
シーケンス回路図を表示する。一方、モニタ制御
部８はプロセス入力、出力のオン、オフ情報をシ
ーケンス制御装置１５の入力部１２と出力部１３
から受け取り、表示部１０に表示されるモニタ対
象のシーケンス回路図におけるシーケンス制御装
置１５の現在シーケンス制御中におけるシーケン
ス命令（実行命令）に該当する接点、出力番号の
シンボルパターンに対応するメモリ９のビツトに
オン、オフ情報を記録する。メモリ９は表示部１
０の画面全体に表示できる文字、記号の１つずつ
に対応したビツト容量を持つ。また、モニタ制御
部８はリフレツシユメモリ５に記憶されているモ
ニタ対象のシーケンス回路のシンボルコードを読
み出し、入力部１２と出力部１３から送出される
シーケンス制御装置１５の現在シーケンス制御中
におけるシーケンス命令（実行命令）であるオ
ン、オフ情報をもとにシーケンス回路図上で電気
的に導通、非導通な部分を算出し、表示部１０に
表示されるモニタ対象のシーケンス回路図の回路
配線、接点、出力リレー記号のシンボルパターン
に対応するメモリ９のビツトに活線、非活線情報
を記録する。表示制御部７は、キヤラクタジエネ
レータ部６から送られてくるシーケンス回路図
と、メモリー９から送られてくる接点、出力番号
のオン、オフ情報とシーケンス回路の回路配線、
接点、出力リレーの活線、非活線情報を受けて表
示部１０にシーケンス制御装置１５における現在
シーケンス制御中のシーケンス命令に等価的なラ
ダーシーケンス回路図の制御状態をモニタ表示す
る。
ると、操作盤１は制御部２に接続されているので
制御部２は指示されたシーケンス回路の探索を探
索回路３に指令し、それを受けた探索回路３はシ
ーケンス命令記憶部１１より探索指示されている
シーケンス回路に対応するシーケンス命令を探索
する。シーケンス命令→シーケンス回路図変換部
４は探索された該当シーケンス命令をシーケンス
回路図に変換し、表示シンボルコードをリフレツ
シユメモリ５に送り出す。リフレツシユメモリ５
は表示部１０の画面全体に表示できる文字、記号
を記憶できるメモリ容量をもち、シーケンス命令
→シーケンス回路図変換部４から送られてくる表
示シンボルコードを表示部１０の表示画面の位置
に対応するメモリ番地に記憶する。リフレツシユ
メモリ５に記憶された内容は周期的に順次読出さ
れ、キヤラクタジエネレータ部６に送られる。キ
ヤラクタジエネレータ部６は、リフレツシユメモ
リ５から送られてくる表示シンボルコードに対応
したｍ×ｎのドツトマトリツクスで構成されるシ
ンボルパターンを表示制御部７に送り出す。表示
制御部７は表示部１０にラスタスキヤンに同期し
て上から順次ｎドツトずつｍラスタスキヤンで読
み出し一つのシンボルを表示部１０に表示し、順
次読み出すことにより表示部１０にモニタしたい
シーケンス回路図を表示する。一方、モニタ制御
部８はプロセス入力、出力のオン、オフ情報をシ
ーケンス制御装置１５の入力部１２と出力部１３
から受け取り、表示部１０に表示されるモニタ対
象のシーケンス回路図におけるシーケンス制御装
置１５の現在シーケンス制御中におけるシーケン
ス命令（実行命令）に該当する接点、出力番号の
シンボルパターンに対応するメモリ９のビツトに
オン、オフ情報を記録する。メモリ９は表示部１
０の画面全体に表示できる文字、記号の１つずつ
に対応したビツト容量を持つ。また、モニタ制御
部８はリフレツシユメモリ５に記憶されているモ
ニタ対象のシーケンス回路のシンボルコードを読
み出し、入力部１２と出力部１３から送出される
シーケンス制御装置１５の現在シーケンス制御中
におけるシーケンス命令（実行命令）であるオ
ン、オフ情報をもとにシーケンス回路図上で電気
的に導通、非導通な部分を算出し、表示部１０に
表示されるモニタ対象のシーケンス回路図の回路
配線、接点、出力リレー記号のシンボルパターン
に対応するメモリ９のビツトに活線、非活線情報
を記録する。表示制御部７は、キヤラクタジエネ
レータ部６から送られてくるシーケンス回路図
と、メモリー９から送られてくる接点、出力番号
のオン、オフ情報とシーケンス回路の回路配線、
接点、出力リレーの活線、非活線情報を受けて表
示部１０にシーケンス制御装置１５における現在
シーケンス制御中のシーケンス命令に等価的なラ
ダーシーケンス回路図の制御状態をモニタ表示す
る。
第４図は、この発明の実施例によるモニタ表示
例を示す図である。図において太線部は活線を示
し、CRT画面上で濃く表示され、点線部は非活
線を示し、薄く表示される。第４図ａにおいて
は、接点Ｘ１，Ｘ４がオンしている接点Ｘ２，Ｘ
３がオフのため、出力Ｙ１がオンしないことが分
かる。第４図ｂにおいては、第４図ａの状態で接
点Ｘ３がオンしたが、接点Ｘ４がオフのため電気
信号は接点Ｘ１，Ｘ３までは導通しているが接点
Ｘ４以降非導通のための出力Ｙ１がオンしないの
が分かる。第４図ｃにおいては、第４図ｂの状態
で接点Ｘ４がオンしたため、電気信号が接点Ｘ
１，Ｘ３，Ｘ４と導通状態になり、出力Ｙ１まで
導通したことが分かる。
例を示す図である。図において太線部は活線を示
し、CRT画面上で濃く表示され、点線部は非活
線を示し、薄く表示される。第４図ａにおいて
は、接点Ｘ１，Ｘ４がオンしている接点Ｘ２，Ｘ
３がオフのため、出力Ｙ１がオンしないことが分
かる。第４図ｂにおいては、第４図ａの状態で接
点Ｘ３がオンしたが、接点Ｘ４がオフのため電気
信号は接点Ｘ１，Ｘ３までは導通しているが接点
Ｘ４以降非導通のための出力Ｙ１がオンしないの
が分かる。第４図ｃにおいては、第４図ｂの状態
で接点Ｘ４がオンしたため、電気信号が接点Ｘ
１，Ｘ３，Ｘ４と導通状態になり、出力Ｙ１まで
導通したことが分かる。
なお、上記実施例では表示部１０はブラウン管
としたが、パネルデイスプレイ等の表示器を設け
てもよい。接点、出力のオン、オフ表示、及びシ
ーケンス回路図の活線、非活線表示は、表示文
字、記号を太い表示、細い表示あるいはカラー表
示で色別の識別表示としてもよい。
としたが、パネルデイスプレイ等の表示器を設け
てもよい。接点、出力のオン、オフ表示、及びシ
ーケンス回路図の活線、非活線表示は、表示文
字、記号を太い表示、細い表示あるいはカラー表
示で色別の識別表示としてもよい。
以上のように、この発明によれば、対象とする
ラダーシーケンス回路図と共に、このラダーシー
ケンス回路図を実行するシーケンス制御装置にて
逐次出力されるラダーシーケンス対応の現在のシ
ーケンス制御中におけるシーケンス命令に同期し
てこのシーケンス命令に等価的な回路中における
構成素子のオン、オフ情報を表示し、シーケンス
回路図において電気信号の導通部分を活線表示、
非導通部分を非活線表示してシーケンス制御装置
の現在シーケンス制御中の素子情報を選択抽出し
てラダーシーケンス回路図を表示して制御状態を
確認できる効果を奏する。よつてこのシーケンス
回路の制御状態が表示画面を見るだけで、どの素
子がオン、オフしているので電気信号がシーケン
ス回路図上のどの箇所までは導通し、それ以降は
非導通なのでシーケンス制御上異常をきたしてい
るのだと一目で知ることができ、熟練者、非熟練
者を問わず故障箇所の発見、保守点検が容易とな
り、これらに要する時間の短縮により、プラント
の稼動率が向上する効果がある。
ラダーシーケンス回路図と共に、このラダーシー
ケンス回路図を実行するシーケンス制御装置にて
逐次出力されるラダーシーケンス対応の現在のシ
ーケンス制御中におけるシーケンス命令に同期し
てこのシーケンス命令に等価的な回路中における
構成素子のオン、オフ情報を表示し、シーケンス
回路図において電気信号の導通部分を活線表示、
非導通部分を非活線表示してシーケンス制御装置
の現在シーケンス制御中の素子情報を選択抽出し
てラダーシーケンス回路図を表示して制御状態を
確認できる効果を奏する。よつてこのシーケンス
回路の制御状態が表示画面を見るだけで、どの素
子がオン、オフしているので電気信号がシーケン
ス回路図上のどの箇所までは導通し、それ以降は
非導通なのでシーケンス制御上異常をきたしてい
るのだと一目で知ることができ、熟練者、非熟練
者を問わず故障箇所の発見、保守点検が容易とな
り、これらに要する時間の短縮により、プラント
の稼動率が向上する効果がある。
第１図はリレーシーケンス回路図面の一例を示
す図、第２図は従来の表示装置によるモニタ表示
例を示す図、第３図はこの発明の一実施例を示す
図、第４図はこの発明によるモニタ表示例を示す
図である。 図において、１は操作盤、２は制御部、３は探
索回路、４はシーケンス命令→シーケンス回路図
変換部、５はリフレツシユメモリ、６はキヤラク
タジエネレータ部、７は表示制御部、８はモニタ
制御部、９はメモリ、１０は表示部、１１はシー
ケンス命令記憶部である。なお、図中、同一符号
は同一、又は相当部分を示す。
す図、第２図は従来の表示装置によるモニタ表示
例を示す図、第３図はこの発明の一実施例を示す
図、第４図はこの発明によるモニタ表示例を示す
図である。 図において、１は操作盤、２は制御部、３は探
索回路、４はシーケンス命令→シーケンス回路図
変換部、５はリフレツシユメモリ、６はキヤラク
タジエネレータ部、７は表示制御部、８はモニタ
制御部、９はメモリ、１０は表示部、１１はシー
ケンス命令記憶部である。なお、図中、同一符号
は同一、又は相当部分を示す。
Claims (1)
- １ モニタしたいシーケンス回路を与える操作盤
と、該操作盤に接続されており指示されたシーケ
ンス回路の探索を探索回路に指令する制御部と、
シーケンス命令記憶部より探索指示されているシ
ーケンス回路に対応するシーケンス命令を探索す
る探索回路と、探索された該当シーケンス命令を
シーケンス回路図に変換し表示シンボルコードを
リフレツシユメモリに送り出す変換部と、表示部
一画面分の表示シンボルコードを記憶できるメモ
リ容量を有し前記変換部から送られてくる前記表
示シンボルコードを前記表示部の表示画面の位置
に対応するメモリ番地に記憶するリフレツシユメ
モリと、該リフレツシユメモリから送られてくる
前記表示シンボルコードに対応したｍ×ｎのドツ
トマトリツクスで構成されるシンボルパターンを
表示制御部に送り出すキヤラクタジエネレータ部
と、表示制御部と、モニタ制御部と、メモリと、
ブラウン管表示部と、シーケンス制御装置とを有
し、前記モニタ制御部は、プロセス入力、出力の
オン、オフ情報を前記シーケンス制御装置の入力
部と出力部から受けとり、前記表示部に表示され
るモニタ対象のシーケンス回路図における前記シ
ーケンス制御装置の現在シーケンス制御中におけ
るシーケンス命令に該当する接点、出力番号のシ
ンボルパターンに対応する前記メモリのビツトに
オン、オフ情報を記憶するとともに前記リフレツ
シユメモリに記憶されているモニタ対象のシーケ
ンス回路のシンボルコードを読み出し前記オン、
オフ情報をもとにシーケンス回路図上で電気的に
導通、非導通な部分を算出し、前記表示部に表示
されるモニタ対象のシーケンス回路図の回路配
線、接点、出力リレー記号のシンボルパターンに
対応する前記メモリのビツトに活線、非活線情報
を記録し、前記表示制御部は、前記キヤラクタジ
エネレータ部から送られてくるシーケンス回路図
と、前記メモリから送られてくる接点、出力番号
のオン、オフ情報とシーケンス回路図の回路配
線、接点、出力リレーの活線、非活線情報を受け
て前記表示部にシーケンス回路の制御状態をモニ
タ表示することを特徴とするシーケンス制御系の
表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55172812A JPS5797110A (en) | 1980-12-08 | 1980-12-08 | Display device of sequence controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55172812A JPS5797110A (en) | 1980-12-08 | 1980-12-08 | Display device of sequence controller |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5797110A JPS5797110A (en) | 1982-06-16 |
| JPH034922B2 true JPH034922B2 (ja) | 1991-01-24 |
Family
ID=15948824
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55172812A Granted JPS5797110A (en) | 1980-12-08 | 1980-12-08 | Display device of sequence controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5797110A (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59166993A (ja) * | 1983-03-14 | 1984-09-20 | 富士通株式会社 | 論理回路の状態表示方式 |
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| JP3388140B2 (ja) * | 1997-07-16 | 2003-03-17 | 三菱電機ビルテクノサービス株式会社 | シーケンス制御回路の監視装置 |
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Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5349239A (en) * | 1976-10-15 | 1978-05-04 | Hitachi Ltd | Indication method of system operation content |
-
1980
- 1980-12-08 JP JP55172812A patent/JPS5797110A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5349239A (en) * | 1976-10-15 | 1978-05-04 | Hitachi Ltd | Indication method of system operation content |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5797110A (en) | 1982-06-16 |
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