JPH0338183A - Ａ／ｄ変換回路 - Google Patents
Ａ／ｄ変換回路Info
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- JPH0338183A JPH0338183A JP1173509A JP17350989A JPH0338183A JP H0338183 A JPH0338183 A JP H0338183A JP 1173509 A JP1173509 A JP 1173509A JP 17350989 A JP17350989 A JP 17350989A JP H0338183 A JPH0338183 A JP H0338183A
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- 238000006243 chemical reaction Methods 0.000 title claims abstract description 17
- 230000005236 sound signal Effects 0.000 claims abstract description 31
- 238000000034 method Methods 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 12
- 238000005070 sampling Methods 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
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- Compression Or Coding Systems Of Tv Signals (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、Ａ／Ｄコンバータの活用方法の改善に関する
。
。
本発明は、ビデオ信号をデジタル信号化するＡ／Ｄコン
バータにおいて、Ａ／Ｄコンバータのアナログ信号入力
として映像情報入力、左音声信号入力、右音声信号入力
のいずれを供給するかを切換える入力切換えスイッチを
設け、有効な映像情報が存在する時は映像情報信号をＡ
／Ｄ変換し、水平同期期間中に左音声信号、右音声信号
をＡ／Ｄ変換することにより、１系統のＡ／Ｄコンバー
タで映像情報信号をデジタル信号化するのみならず、右
音声信号、左音声信号をもデジタル信号化することを可
能にしたものである。
バータにおいて、Ａ／Ｄコンバータのアナログ信号入力
として映像情報入力、左音声信号入力、右音声信号入力
のいずれを供給するかを切換える入力切換えスイッチを
設け、有効な映像情報が存在する時は映像情報信号をＡ
／Ｄ変換し、水平同期期間中に左音声信号、右音声信号
をＡ／Ｄ変換することにより、１系統のＡ／Ｄコンバー
タで映像情報信号をデジタル信号化するのみならず、右
音声信号、左音声信号をもデジタル信号化することを可
能にしたものである。
カラーテレビ等で映像信号、音声信号をデジタル信号処
理する場合、画像処理用のＡ／Ｄコンバータ、音声処理
用のＡ／Ｄコンバータの２系統のＡ／Ｄコンバータが必
要となる。
理する場合、画像処理用のＡ／Ｄコンバータ、音声処理
用のＡ／Ｄコンバータの２系統のＡ／Ｄコンバータが必
要となる。
第４図は、映像信号、及び音声信号をデジタル信号化す
るＡ／Ｄ変換回路の従来のブロック構成図である。
るＡ／Ｄ変換回路の従来のブロック構成図である。
ビデオ信号入力５６は、ビデオクランプ回路５０でクラ
ンプされた後、ビデオ用Ａ／Ｄコンバータ５１でデジタ
ル信号化され、ラッチ５３に転送される。ビデオコンバ
ータ５１のサンプリング周波数は３ｆｓｃ、又は４ｆｓ
ｃ （ｆｓｃ−３，５８ＭＨｚ）が一般的である。
ンプされた後、ビデオ用Ａ／Ｄコンバータ５１でデジタ
ル信号化され、ラッチ５３に転送される。ビデオコンバ
ータ５１のサンプリング周波数は３ｆｓｃ、又は４ｆｓ
ｃ （ｆｓｃ−３，５８ＭＨｚ）が一般的である。
左音声入力５７、右音声入力５８は、オーディオ用Ａ／
Ｄコンバータ５２でデジタル信号化され、ラッチ５４、
ラッチ５５に転送される。
Ｄコンバータ５２でデジタル信号化され、ラッチ５４、
ラッチ５５に転送される。
第５図は、第４図におけるビデオ系のＡ／Ｄ変換回路の
詳細な回路図である。
詳細な回路図である。
ビデオ信号７１はビデオクランプ回路７２でクランプさ
れ、８ビツトＡ／Ｄコンバータ７０の内部に構成される
２５６個のコンパレータ７４〜７８に入力する。
れ、８ビツトＡ／Ｄコンバータ７０の内部に構成される
２５６個のコンパレータ７４〜７８に入力する。
Ｒ２９１、Ｒ２９２、Ｒ２９３、Ｑ５、Ｑ６、Ｒ３００
〜Ｒ５５５により、もう一方のコンパレータ比較入力レ
ベルが決められ、この各比較電圧と入力映像信号９２と
をコンパレータ７４〜７８は電圧レベルを比較して、２
５６ｔｏ８エンコーダ７９に出力する。
〜Ｒ５５５により、もう一方のコンパレータ比較入力レ
ベルが決められ、この各比較電圧と入力映像信号９２と
をコンパレータ７４〜７８は電圧レベルを比較して、２
５６ｔｏ８エンコーダ７９に出力する。
２５６ ｔ ｏ８エンコーダ７９は、コンパレータ７４
〜７８からの２８個のデータを８ビツトのパラレルデー
タに変換し、ラッチ８０に転送する。
〜７８からの２８個のデータを８ビツトのパラレルデー
タに変換し、ラッチ８０に転送する。
第６図は、第５図の各箇所におけるタイミング図である
。
。
８ピッＩ−Ａ／Ｄコンバータのサンプリング周波数を３
ｆｓｃとすると、１周期は９３（ｎｓｅｃ）になり、コ
ンパレータ７４〜７８のクロック信号７３の１周期は９
３（ｎｓｅｃ）になる。
ｆｓｃとすると、１周期は９３（ｎｓｅｃ）になり、コ
ンパレータ７４〜７８のクロック信号７３の１周期は９
３（ｎｓｅｃ）になる。
コンパレータ７４〜７８はクロック７３の立上りで電圧
比較すると８１〜８５に示すタイミングでデジタルデー
タが得られる。
比較すると８１〜８５に示すタイミングでデジタルデー
タが得られる。
この２５６個のデジタルデータをクロック７３の立下り
で８ビツトパラレルデータに変換すると８６〜８８に示
すタイミングでデジタルデータが得られる。
で８ビツトパラレルデータに変換すると８６〜８８に示
すタイミングでデジタルデータが得られる。
ラッチ８０は、クロック７３の立下りでラッチすると、
８９〜９１にタイミングで出力される。
８９〜９１にタイミングで出力される。
しかし、従来技術では映像系、音声系で独立した２系統
のＡ／Ｄコンバータを有する。
のＡ／Ｄコンバータを有する。
音声回路を１６ビツトＡ／Ｄコンバータを用いて高音質
設計をする場合はその方が望ましいが、サラウンド用の
遅延音声信号を得るためにＡ／Ｄコンバータでデジタル
信号化する場合、高価なＡ／Ｄフンバータを２系統もつ
ことはコストが高くなる。
設計をする場合はその方が望ましいが、サラウンド用の
遅延音声信号を得るためにＡ／Ｄコンバータでデジタル
信号化する場合、高価なＡ／Ｄフンバータを２系統もつ
ことはコストが高くなる。
そこで、本発明はこのような問題点を角ｑ決するための
もので、その目的とするところは１系統のＡ／Ｄコンバ
ータで映像情報のみならず音声信号をもデジタル信号化
することができるＡ／Ｄ変換回路を供給することにある
。
もので、その目的とするところは１系統のＡ／Ｄコンバ
ータで映像情報のみならず音声信号をもデジタル信号化
することができるＡ／Ｄ変換回路を供給することにある
。
本発明は、
ａ）Ａ／Ｄ変換回路において、
ｂ）映像信号入力、
Ｃ）左音声信号入力、
ｄ）右音声信号入力、
ｅ）Ａ／Ｄコンバータのアナログ信号入力として、映像
信号入力、左音声信号入力、右音声信号入力のどれを選
択するかを切換える入力切換えスイッチ、 ｆ）該入力切換えスイッチが、非同期期間に映像信号を
Ａ／Ｄ変換し、同期期間に左音声信号、右音声信号をＡ
／Ｄ変換するように命令する入力切換えスイッチ制御信
号を有することを特徴とする。
信号入力、左音声信号入力、右音声信号入力のどれを選
択するかを切換える入力切換えスイッチ、 ｆ）該入力切換えスイッチが、非同期期間に映像信号を
Ａ／Ｄ変換し、同期期間に左音声信号、右音声信号をＡ
／Ｄ変換するように命令する入力切換えスイッチ制御信
号を有することを特徴とする。
以下、本発明について実施例に基づいて詳細に説明する
。
。
第１図は、本発明のＡ／Ｄ変換回路のブロック構成図で
ある。
ある。
ビデオ信号人カフは、ビデオクランプ回路１でクランプ
された後、入力切換え回路２に入力する。
された後、入力切換え回路２に入力する。
入力切換え回路２では、有効な映像情報が存在する間は
映像信号８を選択し、水平同期Ｍ間中には低域通過型フ
ィルタ１８で帯域制限された左音声９、又は低域通過型
フィルタ１９で帯域制限された右音声１０を選択してＡ
／Ｄコンバータ３のアナログ信号入力端子に入力する。
映像信号８を選択し、水平同期Ｍ間中には低域通過型フ
ィルタ１８で帯域制限された左音声９、又は低域通過型
フィルタ１９で帯域制限された右音声１０を選択してＡ
／Ｄコンバータ３のアナログ信号入力端子に入力する。
Ａ／Ｄコンバータ３では映像データは映像データ用ラッ
チ４に、左音声は左音声用ラッチ５に、右音声は右音声
用ラッチ６に転送する。
チ４に、左音声は左音声用ラッチ５に、右音声は右音声
用ラッチ６に転送する。
第２図は、第１図におけるＡ／Ｄコンバータ、入力切換
えスイッチの詳細な回路図である。
えスイッチの詳細な回路図である。
ビデオ信号入力３６は、ビデオクランプ回路２２でクラ
ンプされアナログスイッチ２７に入力する。左音声入力
３４、右音声入力３５は、ｃｌ、Ｒ１、Ｒ２、Ｃ２、Ｒ
３、Ｒ４でレベルシフトされて、アナログスイッチ２５
．２６に入力する。
ンプされアナログスイッチ２７に入力する。左音声入力
３４、右音声入力３５は、ｃｌ、Ｒ１、Ｒ２、Ｃ２、Ｒ
３、Ｒ４でレベルシフトされて、アナログスイッチ２５
．２６に入力する。
アナログスイッチ２５．２６．２７は制御信号３７．３
８．３９により常にどれか１つのアナログスイッチのみ
がＯＮになり、８ビツトＡ／Ｄコンバータ２１の内部に
構成される２５６個のコンパレータ２８〜３２に入力す
る。
８．３９により常にどれか１つのアナログスイッチのみ
がＯＮになり、８ビツトＡ／Ｄコンバータ２１の内部に
構成される２５６個のコンパレータ２８〜３２に入力す
る。
Ｒ６、Ｒ７、Ｒ８、Ｑ２、Ｑ３、Ｒ９−Ｒ２６４により
、もう一方のコンパレータ比較入力レベルが決められ、
この各比較電圧と入力映像信号４０とをコンパレータ２
８〜３２は電圧レベルを比較して、２５６ ｔ ｏ８エ
ンコーダ３３に出力する。
、もう一方のコンパレータ比較入力レベルが決められ、
この各比較電圧と入力映像信号４０とをコンパレータ２
８〜３２は電圧レベルを比較して、２５６ ｔ ｏ８エ
ンコーダ３３に出力する。
２５６ ｔ ｏ８エンコーダ３３は、コンパレータ２８
〜３２からの２８個のデータを８ビツトのパラレルデー
タに変換し、映像データは映像データ用ラッチ２２に、
左音声は左音声用ラッチ２３に、右音声は右音声用ラッ
チ２４に転送される。
〜３２からの２８個のデータを８ビツトのパラレルデー
タに変換し、映像データは映像データ用ラッチ２２に、
左音声は左音声用ラッチ２３に、右音声は右音声用ラッ
チ２４に転送される。
第３図は、第２図の各箇所における詳しいタイミング図
である。
である。
ビデオ信号３６、左音声信号３４、右音声信号３５が図
示する波形で入力した峙、アナログスイッチ２５をコン
トロール波形３７で、アナログスイッチ２６をコントロ
ール波形３８て、アナログスイッチ２７をコントロール
波形３９で切換えると水平同期期間中は左音声、又は右
音声が選択され、水平同期期間外は映像信号が選択され
、入力切換えスイッチ出力４０を得る。
示する波形で入力した峙、アナログスイッチ２５をコン
トロール波形３７で、アナログスイッチ２６をコントロ
ール波形３８て、アナログスイッチ２７をコントロール
波形３９で切換えると水平同期期間中は左音声、又は右
音声が選択され、水平同期期間外は映像信号が選択され
、入力切換えスイッチ出力４０を得る。
入力切換えスイッチ出力４０を、水平同期期間中は３１
．５ （ＫＨｚｌ 、水平同期期間外は１０゜３（ＭＨ
ｚ）で発振するクロック４１でサンプリングすると、映
像信号は４２に示すように１０゜３（ＭＨｚ）でデジタ
ル信号化され、左音声信号は４３に示すように１５．７
５ （ＨＨｚ）でサンプリングされ、右音声信号は４４
に示すように１５．７５ （ＫＨｚ）でサンプリングさ
れる。
．５ （ＫＨｚｌ 、水平同期期間外は１０゜３（ＭＨ
ｚ）で発振するクロック４１でサンプリングすると、映
像信号は４２に示すように１０゜３（ＭＨｚ）でデジタ
ル信号化され、左音声信号は４３に示すように１５．７
５ （ＨＨｚ）でサンプリングされ、右音声信号は４４
に示すように１５．７５ （ＫＨｚ）でサンプリングさ
れる。
〔発明の効果〕
以上述べたように、本発明は入力切換えスイッチでＡ／
Ｄコンバータのアナログ信号入力に供給する信号を切換
えることにより、１個のＡ／Ｄコンバータで映像信号の
みならず音声信号をもデジタル信号化できるため従来よ
りもコストを大幅に安くすることができる。又、この回
路をサラウンド回路に応用した場合、このＡ／Ｄ変換回
路により必要十分な情報がデジタル化されるため、後段
にシフトレジスタ、演算回路を付加するだけの極めて簡
単な構成でサラウンド回路が実現できる。
Ｄコンバータのアナログ信号入力に供給する信号を切換
えることにより、１個のＡ／Ｄコンバータで映像信号の
みならず音声信号をもデジタル信号化できるため従来よ
りもコストを大幅に安くすることができる。又、この回
路をサラウンド回路に応用した場合、このＡ／Ｄ変換回
路により必要十分な情報がデジタル化されるため、後段
にシフトレジスタ、演算回路を付加するだけの極めて簡
単な構成でサラウンド回路が実現できる。
第１図は、本発明のＡ／Ｄ変換回路のブロック構成図。
第２図は、Ａ／Ｄコンバータ、入力切換えスイッチの回
路図。 第３図は、第２図の各箇所におけるタイミング図。 第４図は、従来のＡ／Ｄ変換回路のブロック構成図。 第５図は、従来のビデオ系のＡ／Ｄ変換回路の回路図。 第６図は、第５図の各箇所におけるタイミング図である
。 ・・ビデオクランプ回路 ・・入力切換え回路 ・・Ａ／Ｄコンバータ ・・映像データ用ラッチ ・・左音声用ラッチ ・・右音声用ラッチ ・・ビデオ信号入力 ８・ ・ ９ ・ ・ １０ ・ ・ １１ ・ ・ １２ ・ ・ １３・ ・ １４ ・ ・ １５ ・ ・ １６ ・ ・ １７ ・ ・ １８・ ・ １９・ ・ ２０ ・ ・ ２１ ・ ・ ２２ ・ ・ ２３ ◆ ・ ２４ ・ ・ ２５ ・ ・ ２６ ・ ・ ・ビデオ信号 ・左音声入力 ・右音声入力 ・Ａ／Ｄコンバータのアナログ信号人 力 ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・Ｌ、 Ｐ、 Ｆ。 ・Ｌ、 Ｐ、 Ｆ。 ・入力切換えスイッチ ・８ビツトＡ／Ｄコンバータ ・映像データ用ラッチ ・左音声用ラッチ ・右音声用ラッチ ・アナログスイッチ ・アナログスイッチ ２７ ・ ・ ２８ ・ ・ ２９ ・ ・ ３０ ・ ・ ３１ ・ ・ ３２ ・ ・ ３３ ・ ・ ３４ ・ ・ ３５ ・ ・ ３６ ・ ・ ３７ ・ ・ ３８ ・ ・ ３９ ・ ・ ４０ ・ ・ ４１ ・ ４２ ・ ４３ ・ ４４ ・ ５０ ・ ・アナログスイッチ ・コンパレータ ・コンパレータ ・コンパレータ ・コンパレータ ・コンパレータ ・２５６ ｔ ｏ８エンコーダ ・左音声入力 ・右音声入力 ・ビデオ信号入力 ・入力切換えスイッチ制御信号 ・入力切換えスイッチ制御信号 ・入力切換えスイッチ制御信号 ・Ａ／Ｄコンバータのアナログ信号人 力 ・コンパレータクロック ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・ビデオクランプ回路 ５１ ・ ５２ ・ ５３ ◆ ５４ ・ ５５ ・ ５６・ ５７ ・ ５８ ・ ５９ ・ ６０ ・ ６１ ・ ６２ ・ ６３ ・ ６４ ・ ６５ ・ ６６ ・ ６７ ・ ７１ ・ ７２ ・ ・ビデオ用Ａ／Ｄコンバータ ・オーディオ用Ａ／Ｄコンバータ ・ラッチ ・ラッチ ・ラッチ ・ビデオ信号入力 ・左音声入力 ・右音声入力 ・Ａ／Ｄコンバータのアナログ信号人 力 ◆デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・Ｌ、 Ｐ、 Ｆ。 ・Ｌ、 Ｐ、 Ｆ。 ・ビデオ信号入力 ・ビデオクランプ回路 ７３ ・ ・ ７４ ・ ・ ７５ ・ ・ ７６ ・ ・ ７７ ・ ・ ７８◆ ・ ７９ ・ ・ ８０ ・ ・ ８１ ・ ・ ８２ ・ ・ ８３ ◆ ・ ８４ ・ ・ ８５ ・ ・ ８６ ・ ・ ８７ ・ ・ ８８・ ・ ８９ ・ ・ ９０ ◆ ・ ９１ ・ ・ ・コンパレータクロック ・コンパレータ ◆コンパレータ ・コンパレータ ・コンパレータ ・コンパレータ ・２５６ ｔ ｏ８エンコーダ ーラッチ ・コンパレータ出力 ・コンパレータ出力 ・コンパレータ出力 ・コンパレータ出力 ・コンパレータ出力 ・８ビツトデジタル映像データ ・８ビツトデジタル映像データ ・８ビットデジタル映１象データ ・８ビツトデジタル映像データ ・８ビツトデジタル映像データ ・８ビットデジタル映像データ ３３ 第３図 第４図 Ｑ月ｏ−Ｒｙ、５５・・・・＄６抗
路図。 第３図は、第２図の各箇所におけるタイミング図。 第４図は、従来のＡ／Ｄ変換回路のブロック構成図。 第５図は、従来のビデオ系のＡ／Ｄ変換回路の回路図。 第６図は、第５図の各箇所におけるタイミング図である
。 ・・ビデオクランプ回路 ・・入力切換え回路 ・・Ａ／Ｄコンバータ ・・映像データ用ラッチ ・・左音声用ラッチ ・・右音声用ラッチ ・・ビデオ信号入力 ８・ ・ ９ ・ ・ １０ ・ ・ １１ ・ ・ １２ ・ ・ １３・ ・ １４ ・ ・ １５ ・ ・ １６ ・ ・ １７ ・ ・ １８・ ・ １９・ ・ ２０ ・ ・ ２１ ・ ・ ２２ ・ ・ ２３ ◆ ・ ２４ ・ ・ ２５ ・ ・ ２６ ・ ・ ・ビデオ信号 ・左音声入力 ・右音声入力 ・Ａ／Ｄコンバータのアナログ信号人 力 ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・Ｌ、 Ｐ、 Ｆ。 ・Ｌ、 Ｐ、 Ｆ。 ・入力切換えスイッチ ・８ビツトＡ／Ｄコンバータ ・映像データ用ラッチ ・左音声用ラッチ ・右音声用ラッチ ・アナログスイッチ ・アナログスイッチ ２７ ・ ・ ２８ ・ ・ ２９ ・ ・ ３０ ・ ・ ３１ ・ ・ ３２ ・ ・ ３３ ・ ・ ３４ ・ ・ ３５ ・ ・ ３６ ・ ・ ３７ ・ ・ ３８ ・ ・ ３９ ・ ・ ４０ ・ ・ ４１ ・ ４２ ・ ４３ ・ ４４ ・ ５０ ・ ・アナログスイッチ ・コンパレータ ・コンパレータ ・コンパレータ ・コンパレータ ・コンパレータ ・２５６ ｔ ｏ８エンコーダ ・左音声入力 ・右音声入力 ・ビデオ信号入力 ・入力切換えスイッチ制御信号 ・入力切換えスイッチ制御信号 ・入力切換えスイッチ制御信号 ・Ａ／Ｄコンバータのアナログ信号人 力 ・コンパレータクロック ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・ビデオクランプ回路 ５１ ・ ５２ ・ ５３ ◆ ５４ ・ ５５ ・ ５６・ ５７ ・ ５８ ・ ５９ ・ ６０ ・ ６１ ・ ６２ ・ ６３ ・ ６４ ・ ６５ ・ ６６ ・ ６７ ・ ７１ ・ ７２ ・ ・ビデオ用Ａ／Ｄコンバータ ・オーディオ用Ａ／Ｄコンバータ ・ラッチ ・ラッチ ・ラッチ ・ビデオ信号入力 ・左音声入力 ・右音声入力 ・Ａ／Ｄコンバータのアナログ信号人 力 ◆デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・デジタル映像データ群 ・デジタル左音声データ群 ・デジタル右音声データ群 ・Ｌ、 Ｐ、 Ｆ。 ・Ｌ、 Ｐ、 Ｆ。 ・ビデオ信号入力 ・ビデオクランプ回路 ７３ ・ ・ ７４ ・ ・ ７５ ・ ・ ７６ ・ ・ ７７ ・ ・ ７８◆ ・ ７９ ・ ・ ８０ ・ ・ ８１ ・ ・ ８２ ・ ・ ８３ ◆ ・ ８４ ・ ・ ８５ ・ ・ ８６ ・ ・ ８７ ・ ・ ８８・ ・ ８９ ・ ・ ９０ ◆ ・ ９１ ・ ・ ・コンパレータクロック ・コンパレータ ◆コンパレータ ・コンパレータ ・コンパレータ ・コンパレータ ・２５６ ｔ ｏ８エンコーダ ーラッチ ・コンパレータ出力 ・コンパレータ出力 ・コンパレータ出力 ・コンパレータ出力 ・コンパレータ出力 ・８ビツトデジタル映像データ ・８ビツトデジタル映像データ ・８ビットデジタル映１象データ ・８ビツトデジタル映像データ ・８ビツトデジタル映像データ ・８ビットデジタル映像データ ３３ 第３図 第４図 Ｑ月ｏ−Ｒｙ、５５・・・・＄６抗
Claims (1)
- （１）ａ）Ａ／Ｄ変換回路において、 ｂ）映像信号入力、 ｃ）左音声信号入力、 ｄ）右音声信号入力、 ｅ）Ａ／Ｄコンバータのアナログ信号入力として、映像
信号入力、左音声信号入力、右音声信号入力のどれを選
択するかを切換える入力切換えスイッチ、 ｆ）該入力切換えスイッチが、非同期期間に映像信号を
Ａ／Ｄ変換し、同期期間に左音声信号、右音声信号をＡ
／Ｄ変換するように命令する入力切換えスイッチ制御信
号を有することを特徴とするＡ／Ｄ変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1173509A JPH0338183A (ja) | 1989-07-05 | 1989-07-05 | Ａ／ｄ変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1173509A JPH0338183A (ja) | 1989-07-05 | 1989-07-05 | Ａ／ｄ変換回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0338183A true JPH0338183A (ja) | 1991-02-19 |
Family
ID=15961849
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1173509A Pending JPH0338183A (ja) | 1989-07-05 | 1989-07-05 | Ａ／ｄ変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0338183A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0738436A (ja) * | 1993-06-22 | 1995-02-07 | Internatl Business Mach Corp <Ibm> | アナログ信号受信回路 |
-
1989
- 1989-07-05 JP JP1173509A patent/JPH0338183A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0738436A (ja) * | 1993-06-22 | 1995-02-07 | Internatl Business Mach Corp <Ibm> | アナログ信号受信回路 |
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