JPH0313014B2 - - Google Patents
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- JPH0313014B2 JPH0313014B2 JP57199043A JP19904382A JPH0313014B2 JP H0313014 B2 JPH0313014 B2 JP H0313014B2 JP 57199043 A JP57199043 A JP 57199043A JP 19904382 A JP19904382 A JP 19904382A JP H0313014 B2 JPH0313014 B2 JP H0313014B2
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Links
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Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
- B23H—WORKING OF METAL BY THE ACTION OF A HIGH CONCENTRATION OF ELECTRIC CURRENT ON A WORKPIECE USING AN ELECTRODE WHICH TAKES THE PLACE OF A TOOL; SUCH WORKING COMBINED WITH OTHER FORMS OF WORKING OF METAL
- B23H1/00—Electrical discharge machining, i.e. removing metal with a series of rapidly recurring electrical discharges between an electrode and a workpiece in the presence of a fluid dielectric
- B23H1/02—Electric circuits specially adapted therefor, e.g. power supply, control, preventing short circuits or other abnormal discharges
- B23H1/024—Detection of, and response to, abnormal gap conditions, e.g. short circuits
Landscapes
- Engineering & Computer Science (AREA)
- Mechanical Engineering (AREA)
- Electrical Discharge Machining, Electrochemical Machining, And Combined Machining (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ワイヤ電極を用いて放電加工を行う
ワイヤカツト放電加工装置の制御回路において、
フアーストカツト後に行われるセカンドカツトの
ための専用回路をもつたワイヤカツトの放電加工
制御回路に関する。
ワイヤカツト放電加工装置の制御回路において、
フアーストカツト後に行われるセカンドカツトの
ための専用回路をもつたワイヤカツトの放電加工
制御回路に関する。
従来の技術
ワイヤカツト放電加工においては、フアースト
カツト後に形状の修正、面の粗さの改良、加工変
質層の除去等のために加工条件を変えたセカンド
カツトが行われる（例えば、特開昭57−102724号
公報参照）。
カツト後に形状の修正、面の粗さの改良、加工変
質層の除去等のために加工条件を変えたセカンド
カツトが行われる（例えば、特開昭57−102724号
公報参照）。
発明が解決しようとする問題点
セカンドカツトの場合、面の粗さを改良するに
は、小エネルギーで加工することが望ましいし、
また、小エネルギーであれば、形状修正も容易で
ある。しかし、板厚の厚いワークを加工するとき
には、小エネルギーで行うと加工壁面が曲り、真
直性が失われる。例えば、60mmの板厚のワークを
セカンドカツトすると20〜30μｍ加工壁面の端部
より内部がえぐり取られ真直性が失われることが
多かつた。
は、小エネルギーで加工することが望ましいし、
また、小エネルギーであれば、形状修正も容易で
ある。しかし、板厚の厚いワークを加工するとき
には、小エネルギーで行うと加工壁面が曲り、真
直性が失われる。例えば、60mmの板厚のワークを
セカンドカツトすると20〜30μｍ加工壁面の端部
より内部がえぐり取られ真直性が失われることが
多かつた。
また、加工エネルギーを大にすると、この真直
性はよくなるが、ワイヤが放電圧力で振動し加工
壁面から逃げるため、形状修正が充分にできなか
つた。
性はよくなるが、ワイヤが放電圧力で振動し加工
壁面から逃げるため、形状修正が充分にできなか
つた。
そのため、セカンドカツト方法の研究、実験を
積み重ねたところ、加工中の平均加工電圧を下げ
ると、上記欠点を改善できるることがわかつた。
積み重ねたところ、加工中の平均加工電圧を下げ
ると、上記欠点を改善できるることがわかつた。
そこで、本発明の目的は、フアーストカツト時
においても、及び平均加工電圧を下げて加工を行
うセカンドカツト時においても、安定した加工が
行え、セカンドカツト時には、形状の修正、面粗
さの改良、加工変質層の除去等が容易に行え、か
つ、加工面の真直性が良いセカンドカツトができ
るワイヤカツト放電加工装置の制御回路を提供す
ることにある。
においても、及び平均加工電圧を下げて加工を行
うセカンドカツト時においても、安定した加工が
行え、セカンドカツト時には、形状の修正、面粗
さの改良、加工変質層の除去等が容易に行え、か
つ、加工面の真直性が良いセカンドカツトができ
るワイヤカツト放電加工装置の制御回路を提供す
ることにある。
問題点を解決するための手段
本発明の放電加工制御回路は、パルス発振制御
回路と、該パルス発振制御回路からの発振パルス
を受けてオン・オフするスイツチング素子により
コンデンサを充電させ、該コンデンサに充電され
た充電電流をワイヤ電極とワーク間に放電させる
放電加工回路と、上記ワイヤ電極、ワーク間の加
工電圧と基準電圧とを比較して上記ワイヤ電極と
ワークとの短絡を判定する短絡判定回路を有し、
上記短絡判定回路から短絡検出信号が送出される
と、数制御装置は上記パルスの発振制御回路のパ
ルス発振を停止させるようにしたワイヤカツト放
電加工の放電加工制御回路において、上記パルス
発振制御回路は、上記ワイヤ電極とワーク間の電
圧が瞬間的に低下したとき、インターバル信号を
出力し、上記発振パルスを一定間隔毎に出力しな
いようにするインターバル信号発振回路とセカン
ドカツト指令信号により上記インターバル信号の
出力を阻止するインターバル信号阻止回路とを有
し、上記セカンドカツトの指令信号が入力された
とき作動して、上記短絡判定回路の基準電圧を低
下させる基準電圧切換回路を設け、平均加工電圧
を下げてセカンドカツトを行なえるようにするこ
とによつて上記問題点を解決した。
回路と、該パルス発振制御回路からの発振パルス
を受けてオン・オフするスイツチング素子により
コンデンサを充電させ、該コンデンサに充電され
た充電電流をワイヤ電極とワーク間に放電させる
放電加工回路と、上記ワイヤ電極、ワーク間の加
工電圧と基準電圧とを比較して上記ワイヤ電極と
ワークとの短絡を判定する短絡判定回路を有し、
上記短絡判定回路から短絡検出信号が送出される
と、数制御装置は上記パルスの発振制御回路のパ
ルス発振を停止させるようにしたワイヤカツト放
電加工の放電加工制御回路において、上記パルス
発振制御回路は、上記ワイヤ電極とワーク間の電
圧が瞬間的に低下したとき、インターバル信号を
出力し、上記発振パルスを一定間隔毎に出力しな
いようにするインターバル信号発振回路とセカン
ドカツト指令信号により上記インターバル信号の
出力を阻止するインターバル信号阻止回路とを有
し、上記セカンドカツトの指令信号が入力された
とき作動して、上記短絡判定回路の基準電圧を低
下させる基準電圧切換回路を設け、平均加工電圧
を下げてセカンドカツトを行なえるようにするこ
とによつて上記問題点を解決した。
作 用
パルス発振制御回路からの発振パルスを受けて
オン・オフするスイツチング素子によりコンデン
サが充電され、放電加工回路が前記コンデンサに
充電された充電電流をワイヤ電極とワーク間に放
電し、短絡判定回路が前記ワイヤ電極、ワーク間
のギヤツプ電圧と基準電圧とを比較してワイヤ電
極とワークとの短絡を判定し、前記短絡判定回路
から数値制御装置に短絡検出信号が送出される
と、前記数値制御装置がパルス発振制御回路のパ
ルス発振を停止する。そして、フアーストカツト
時に、前記ワイヤ電極とワークの瞬間的接触や加
工屑等により短絡に似た現象が生じワイヤ電極と
ワーク間の電圧が瞬間的に低下したとき、パルス
発振制御回路のインターバル信号発振回路がイン
ターバル信号を出力して発振パルスを一定間隔毎
に出力しないようにする。
オン・オフするスイツチング素子によりコンデン
サが充電され、放電加工回路が前記コンデンサに
充電された充電電流をワイヤ電極とワーク間に放
電し、短絡判定回路が前記ワイヤ電極、ワーク間
のギヤツプ電圧と基準電圧とを比較してワイヤ電
極とワークとの短絡を判定し、前記短絡判定回路
から数値制御装置に短絡検出信号が送出される
と、前記数値制御装置がパルス発振制御回路のパ
ルス発振を停止する。そして、フアーストカツト
時に、前記ワイヤ電極とワークの瞬間的接触や加
工屑等により短絡に似た現象が生じワイヤ電極と
ワーク間の電圧が瞬間的に低下したとき、パルス
発振制御回路のインターバル信号発振回路がイン
ターバル信号を出力して発振パルスを一定間隔毎
に出力しないようにする。
一方、セカンドカツト時には、セカンドカツト
指令信号により、パルス発振制御回路のインター
バル信号阻止回路が上記インターバル信号の出力
を阻止し、放電加工の安定を図ると共に、基準電
圧切換回路が短絡判定回路の基準電圧を低下さ
せ、平均加工電圧を下げて行うセカンドカツトの
加工を最適に制御する。
指令信号により、パルス発振制御回路のインター
バル信号阻止回路が上記インターバル信号の出力
を阻止し、放電加工の安定を図ると共に、基準電
圧切換回路が短絡判定回路の基準電圧を低下さ
せ、平均加工電圧を下げて行うセカンドカツトの
加工を最適に制御する。
実施例
以下、本発明の一実施例を、図面に基づいて詳
細に説明する。
細に説明する。
第１図は、本発明の一実施例のワイヤカツト放
電加工制御回路図である。第２図は、上記制御回
路の中のパルス発振制御回路２の詳細図である。
１は放電加工回路で、Ｐはワイヤ電極、Ｗはワー
ク、V0は加工電圧を出力する直流電源、TRはス
イツチング素子例えばスイツチングトランジス
タ、C0，C1はコンデンサ、R0〜R10は抵抗、２は
パルス発振制御回路、３は数値制御装置、４は基
準電圧切換回路、５は短絡判定回路、６はパルス
発振器、７はインターバル信号発振回路、８はコ
ンパレータ、９はインターバル信号阻止回路、
Re1，Re2はリレー、r1，r2はそのリレーRe1，
Re2の接点、G1はアンドゲート、G2はオアゲー
ト、A1，A2は増幅器、l1〜l3は信号線を示す。
電加工制御回路図である。第２図は、上記制御回
路の中のパルス発振制御回路２の詳細図である。
１は放電加工回路で、Ｐはワイヤ電極、Ｗはワー
ク、V0は加工電圧を出力する直流電源、TRはス
イツチング素子例えばスイツチングトランジス
タ、C0，C1はコンデンサ、R0〜R10は抵抗、２は
パルス発振制御回路、３は数値制御装置、４は基
準電圧切換回路、５は短絡判定回路、６はパルス
発振器、７はインターバル信号発振回路、８はコ
ンパレータ、９はインターバル信号阻止回路、
Re1，Re2はリレー、r1，r2はそのリレーRe1，
Re2の接点、G1はアンドゲート、G2はオアゲー
ト、A1，A2は増幅器、l1〜l3は信号線を示す。
通常のフアーストカツトにおいては、オン・オ
フパルス発振制御回路２からの出力パルスにより
放電加工回路１のトランジスタTRは、オン・オ
フ動作を繰り返して直流電源V0からコンデンサ
C0を抵抗R0を介して充電する。この充電電圧が
ワイヤ電極ＰとワークＷとの間に印加され、正常
の状態では、コンデンサC0の放電電流がそれら
の対向間隙に放電となつて流れて、放電加工が行
われる。そして、ワイヤ電極ＰとワークＷとの間
に抵抗R1，R2が接続されて加工電圧が分圧され、
その分圧信号は信号線l3によりパルス発振制御回
路２に入力され、かつ、抵抗R6，R7、コンデン
サC1、一次遅れの伝達関数を有した差動増幅器
A1、コンパレータＣからなる短絡判定回路５に
入力され、ワイヤ電極Ｐ、ワークＷ間のギヤツプ
電圧と基準電圧Vsとが比較され、短絡判定回路
５がワイヤ電極ＰとワークＷが短絡しているか否
か判定する。短絡判定回路５から短絡信号が送出
されると、数値制御回路３は信号線l1に信号を出
し、第２図におけるパルス発振制御回路２のパル
ス発振器６の発振を止め、放電加工を停止させ
る。また、ワイヤ電極ＰとワークＷとの間に接続
された抵抗R1，R2による分圧信号が信号線l3によ
りパルス発振制御回路２のコンパレータ８に入力
され、基準電圧V1と比較されるようになつてい
る。この基準電圧V1は、上記短絡判定回路５の
負の基準電圧Vsより負の電圧レベルが高い状態
（V1＜Vs）に設定されており、放電加工回路１の
ワイヤ電極ＰとワークＷが短時間に瞬間的接触し
たときや加工屑の介入によつて起こされる短絡に
似た現象が起き、ワイヤ電極ＰとワークＷ間の電
圧が瞬間的に低下し、上記分圧電圧がこの基準電
圧V1を超えるとコンパレータ８より出力信号を
出力する。なお、短絡判定回路５の基準電圧Vs
は上記基準電圧V1より負の電圧レベルが低く、
かつ、一次遅れの伝達関数を有した差動増幅器
A1で構成しているから、コンパレータ８から出
力信号が出力されても、ただちには短絡信号を出
力せず、ワイヤ電極ＰとワークＷ間の電圧が長く
低いレベルを続けたとき短絡として短絡信号を出
力する。
フパルス発振制御回路２からの出力パルスにより
放電加工回路１のトランジスタTRは、オン・オ
フ動作を繰り返して直流電源V0からコンデンサ
C0を抵抗R0を介して充電する。この充電電圧が
ワイヤ電極ＰとワークＷとの間に印加され、正常
の状態では、コンデンサC0の放電電流がそれら
の対向間隙に放電となつて流れて、放電加工が行
われる。そして、ワイヤ電極ＰとワークＷとの間
に抵抗R1，R2が接続されて加工電圧が分圧され、
その分圧信号は信号線l3によりパルス発振制御回
路２に入力され、かつ、抵抗R6，R7、コンデン
サC1、一次遅れの伝達関数を有した差動増幅器
A1、コンパレータＣからなる短絡判定回路５に
入力され、ワイヤ電極Ｐ、ワークＷ間のギヤツプ
電圧と基準電圧Vsとが比較され、短絡判定回路
５がワイヤ電極ＰとワークＷが短絡しているか否
か判定する。短絡判定回路５から短絡信号が送出
されると、数値制御回路３は信号線l1に信号を出
し、第２図におけるパルス発振制御回路２のパル
ス発振器６の発振を止め、放電加工を停止させ
る。また、ワイヤ電極ＰとワークＷとの間に接続
された抵抗R1，R2による分圧信号が信号線l3によ
りパルス発振制御回路２のコンパレータ８に入力
され、基準電圧V1と比較されるようになつてい
る。この基準電圧V1は、上記短絡判定回路５の
負の基準電圧Vsより負の電圧レベルが高い状態
（V1＜Vs）に設定されており、放電加工回路１の
ワイヤ電極ＰとワークＷが短時間に瞬間的接触し
たときや加工屑の介入によつて起こされる短絡に
似た現象が起き、ワイヤ電極ＰとワークＷ間の電
圧が瞬間的に低下し、上記分圧電圧がこの基準電
圧V1を超えるとコンパレータ８より出力信号を
出力する。なお、短絡判定回路５の基準電圧Vs
は上記基準電圧V1より負の電圧レベルが低く、
かつ、一次遅れの伝達関数を有した差動増幅器
A1で構成しているから、コンパレータ８から出
力信号が出力されても、ただちには短絡信号を出
力せず、ワイヤ電極ＰとワークＷ間の電圧が長く
低いレベルを続けたとき短絡として短絡信号を出
力する。
コンパレータ８より出力信号が出力されると、
該信号により、インターバル信号発振回路７から
パルス発振器６で発振されるパルスのオン・オフ
期間よりも長いパルスのインターバル信号を送出
し、インターバル信号発振回路７がパルス発振器
６の発振パルスを所定間隔毎に出力しないように
し、オアゲートG2を通して、インターバル信号
のＨレベル期間のみアンドゲートG1を開き、パ
ルス発振器６からの発振パルスを増幅器A2を通
してトランジスタTRのベースに入力する。その
結果、放電加工回路１のトランジスタTRはイン
ターバル信号のＨレベル中のみパルス発振制御回
路２のパルス発振器６から送出される発振パルス
のデユーテイ・サイクルでオン・オフし、インタ
ーバル信号がＬレベルの間はオフ状態となり、短
期間のワイヤ電極ＰとワークＷの短絡に対して制
御している。なお、このような短期間の短絡が生
じてない正常な加工状態のときは、コンパレータ
８からの信号によりインターバル信号発振回路７
は常にトリガーされ、Ｈレベルの信号を常に出
し、パルス発振器６からの発振パルスをトランジ
スタTRに印加している。
該信号により、インターバル信号発振回路７から
パルス発振器６で発振されるパルスのオン・オフ
期間よりも長いパルスのインターバル信号を送出
し、インターバル信号発振回路７がパルス発振器
６の発振パルスを所定間隔毎に出力しないように
し、オアゲートG2を通して、インターバル信号
のＨレベル期間のみアンドゲートG1を開き、パ
ルス発振器６からの発振パルスを増幅器A2を通
してトランジスタTRのベースに入力する。その
結果、放電加工回路１のトランジスタTRはイン
ターバル信号のＨレベル中のみパルス発振制御回
路２のパルス発振器６から送出される発振パルス
のデユーテイ・サイクルでオン・オフし、インタ
ーバル信号がＬレベルの間はオフ状態となり、短
期間のワイヤ電極ＰとワークＷの短絡に対して制
御している。なお、このような短期間の短絡が生
じてない正常な加工状態のときは、コンパレータ
８からの信号によりインターバル信号発振回路７
は常にトリガーされ、Ｈレベルの信号を常に出
し、パルス発振器６からの発振パルスをトランジ
スタTRに印加している。
以上は、公知のフアーストカツトにおけるワイ
ヤカツト放電加工装置の作動である。
ヤカツト放電加工装置の作動である。
次に、本発明におけるセカンドカツトの作動に
ついて述べる。本発明における放電加工制御回路
には、従来の制御回路と比べ、基準電圧切換回路
４が付加されており、さらに、放電を安定にする
ためにパルス発振制御回路２にインターバル信号
阻止回路９が付加されている。数値制御装置３ま
たは手動スイツチによりセカンドカツト指令が出
されると、パルス発振制御回路２のパルス発振器
６のデユーテイ・サイクルを変える一方、放電加
工回路１の抵抗R0の抵抗値を高くし、電流値を
下げ、かつ、コンデンサC0の容量を小さくし、
放電加工回路１の加工平均電圧を下げる。なお、
デユーテイ・サイクル、抵抗値、コンデンサ容量
の変更手段については周知であるので省略する。
ついて述べる。本発明における放電加工制御回路
には、従来の制御回路と比べ、基準電圧切換回路
４が付加されており、さらに、放電を安定にする
ためにパルス発振制御回路２にインターバル信号
阻止回路９が付加されている。数値制御装置３ま
たは手動スイツチによりセカンドカツト指令が出
されると、パルス発振制御回路２のパルス発振器
６のデユーテイ・サイクルを変える一方、放電加
工回路１の抵抗R0の抵抗値を高くし、電流値を
下げ、かつ、コンデンサC0の容量を小さくし、
放電加工回路１の加工平均電圧を下げる。なお、
デユーテイ・サイクル、抵抗値、コンデンサ容量
の変更手段については周知であるので省略する。
このようにして、放電加工回路１の加工平均電
圧が下げられると、短絡判定回路５の基準電圧
Vsを下げないと、数値制御装置３は、常にワイ
ヤ電極ＰとワークＷの短絡検知信号を受信したよ
うになり、パルス発振器６のパルス発振を止める
ことになる。そのため、本発明では、短絡判定回
路５の基準電圧Vsを下げるための基準電圧切換
回路４を設け、セカンドカツトの場合には、数値
制御装置３から信号線l2に信号を送出し、基準電
圧切換回路４のリレーRe1を作動させ、その接点
r1のONにより基準電圧Vsを発生させている抵抗
R4と並列に抵抗R5を挿入し、短絡判定回路５の
基準電圧を下げる。一方、上記信号線l2に送出さ
れた信号は、パルス発振制御回路２のインターバ
ル信号阻止回路９にも入力され、このインターバ
ル信号阻止回路９のリレーRe2を作動させ、その
接点r2をONさせ、オアゲートG2を通して常にＨ
レベルの信号をアンドゲートG1に入力する。こ
れによつて、インターバル信号を無効にさせる。
これは、セカンドカツトの場合、パルス発振器６
のデユーテイ・サイクルを変え、抵抗R0の抵抗
値を高くし、コンデンサC0の容量を小さくして、
加工平均電圧を下げ、加工エネルギーをフアース
トカツト時より小さくし、かつ、ワイヤ電極Ｐと
ワークＷ間のギヤツプは小さくなる。この状態で
インターバル信号が送出されて加工エネルギーを
さらに小さくすると、放電が不安定となり、ワイ
ヤ電極ＰとワークＷがシヨートして加工が不可能
になつてしまうことがあるため、インターバル信
号を無効にするものである。
圧が下げられると、短絡判定回路５の基準電圧
Vsを下げないと、数値制御装置３は、常にワイ
ヤ電極ＰとワークＷの短絡検知信号を受信したよ
うになり、パルス発振器６のパルス発振を止める
ことになる。そのため、本発明では、短絡判定回
路５の基準電圧Vsを下げるための基準電圧切換
回路４を設け、セカンドカツトの場合には、数値
制御装置３から信号線l2に信号を送出し、基準電
圧切換回路４のリレーRe1を作動させ、その接点
r1のONにより基準電圧Vsを発生させている抵抗
R4と並列に抵抗R5を挿入し、短絡判定回路５の
基準電圧を下げる。一方、上記信号線l2に送出さ
れた信号は、パルス発振制御回路２のインターバ
ル信号阻止回路９にも入力され、このインターバ
ル信号阻止回路９のリレーRe2を作動させ、その
接点r2をONさせ、オアゲートG2を通して常にＨ
レベルの信号をアンドゲートG1に入力する。こ
れによつて、インターバル信号を無効にさせる。
これは、セカンドカツトの場合、パルス発振器６
のデユーテイ・サイクルを変え、抵抗R0の抵抗
値を高くし、コンデンサC0の容量を小さくして、
加工平均電圧を下げ、加工エネルギーをフアース
トカツト時より小さくし、かつ、ワイヤ電極Ｐと
ワークＷ間のギヤツプは小さくなる。この状態で
インターバル信号が送出されて加工エネルギーを
さらに小さくすると、放電が不安定となり、ワイ
ヤ電極ＰとワークＷがシヨートして加工が不可能
になつてしまうことがあるため、インターバル信
号を無効にするものである。
なお、上記実施例において、インターバル信号
発振回路７は、短絡検知により、長いインターバ
ルの信号を発振する回路で構成したが、パルス発
振器６のパルス数を計数し、オン・オフの信号を
出すようにしてもよい。また、上記インターバル
信号阻止回路９をインターバル信号発信回路７の
電圧側にいれたが、コンパレータ８の出力側に入
れ、常に、インターバル信号発振回路７から常に
Ｈレベルの信号を出すようにしてもよい。
発振回路７は、短絡検知により、長いインターバ
ルの信号を発振する回路で構成したが、パルス発
振器６のパルス数を計数し、オン・オフの信号を
出すようにしてもよい。また、上記インターバル
信号阻止回路９をインターバル信号発信回路７の
電圧側にいれたが、コンパレータ８の出力側に入
れ、常に、インターバル信号発振回路７から常に
Ｈレベルの信号を出すようにしてもよい。
発明の効果
以上に述べたように、本発明の放電加工制御回
路によれば、セカンドカツト指令が入力される
と、平均加工電圧を自動的に下げ、かつ、短絡判
定回路の基準電圧も自動的に下げて短絡を正確に
検出し、安定した放電を得れるからセカンドカツ
ト時の形状修正を容易にし、加工面の粗さを改良
でき、加工変質層を確実に除去し、かつ、加工壁
面の真直性が良いセカンドカツトを行うことがで
きる。
路によれば、セカンドカツト指令が入力される
と、平均加工電圧を自動的に下げ、かつ、短絡判
定回路の基準電圧も自動的に下げて短絡を正確に
検出し、安定した放電を得れるからセカンドカツ
ト時の形状修正を容易にし、加工面の粗さを改良
でき、加工変質層を確実に除去し、かつ、加工壁
面の真直性が良いセカンドカツトを行うことがで
きる。
さらに、フアーストカツト時にワイヤ電極とワ
ークの瞬間的接触や短絡に似た現象を生じた場
合、パルス発振制御回路からの発振パルスを所定
間隔毎に出力しないようにし、発振パルスを受け
てオン・オフするスイツチング素子を所定間隔毎
オフ状態として放電加工を制御するインターバル
信号発振回路の出力をセカンドカツト指令によ
り、自動的に阻止しインターバル信号が発生しな
いようにしたので、平均加工電圧を下げて加工す
るセカンドカツト時においても放電加工を安定に
制御することができる。
ークの瞬間的接触や短絡に似た現象を生じた場
合、パルス発振制御回路からの発振パルスを所定
間隔毎に出力しないようにし、発振パルスを受け
てオン・オフするスイツチング素子を所定間隔毎
オフ状態として放電加工を制御するインターバル
信号発振回路の出力をセカンドカツト指令によ
り、自動的に阻止しインターバル信号が発生しな
いようにしたので、平均加工電圧を下げて加工す
るセカンドカツト時においても放電加工を安定に
制御することができる。
第１図は、本発明の一実施例のワイヤカツト放
電加工の制御回路図、第２図は、パルス発振制御
回路２の詳細図である。 １……放電加工回路、２……パルス発振制御回
路、３……数値制御装置、４……基準電圧切換回
路、５……短絡判定回路、６……パルス発振器、
７……インターバル信号発信回路、８……コンパ
レータ、９……インターバル信号阻止回路、Ｃ…
…コンパレータ、Ｐ……ワイヤ電極、Ｗ……ワー
ク、A1，A2……増幅器、C0，C1……コンデン
サ、G1……アンドゲート、G2……オアゲート、
R0〜R10……抵抗、Re1，Re2……リレー、r1，r2
……接点、TR……トランジスタ、V0……直流電
源、Vs……基準電圧、l1〜l3……信号線。
電加工の制御回路図、第２図は、パルス発振制御
回路２の詳細図である。 １……放電加工回路、２……パルス発振制御回
路、３……数値制御装置、４……基準電圧切換回
路、５……短絡判定回路、６……パルス発振器、
７……インターバル信号発信回路、８……コンパ
レータ、９……インターバル信号阻止回路、Ｃ…
…コンパレータ、Ｐ……ワイヤ電極、Ｗ……ワー
ク、A1，A2……増幅器、C0，C1……コンデン
サ、G1……アンドゲート、G2……オアゲート、
R0〜R10……抵抗、Re1，Re2……リレー、r1，r2
……接点、TR……トランジスタ、V0……直流電
源、Vs……基準電圧、l1〜l3……信号線。
Claims (1)
- 【特許請求の範囲】 １ パルス発振器と該パルス発振器の発振周期よ
り長い周期のインターバル信号を出力するインタ
ーバル信号発信回路とを有するパルス発振制御回
路からの上記パルス発振器の発振パルスを受けて
オン・オフするスイツチング素子によりコンデン
サを充電させ、該コンデンサに充電された充電電
流をワイヤ電極とワーク間に放電させると共に、
上記ワイヤ電極、ワーク間の加工電圧と基準電圧
とを比較して上記ワイヤ電極とワークとの短絡を
判定する短絡判定回路を有し、上記短絡判定回路
から短絡検出信号が送出されると、数値制御装置
は上記パルス発振制御回路のパルス発振器のパル
ス発振を停止させ、又、上記ワイヤ電極とワーク
間の電圧が瞬間的に低下したとき、上記インター
バル信号発振回路を作動させインターバル信号を
出力して、上記パルス発振器の発振パルス出力を
所定間隔毎に阻止するようにしたワイヤカツト放
電加工の放電加工制御回路において、セカンドカ
ツト指令信号により上記インターバル信号の出力
を阻止するインターバル信号阻止回路と、上記セ
カンドカツトの指令信号が入力されたとき作動し
て、上記短絡判定回路の基準電圧を低下させる基
準電圧切替回路とを設け、平均加工電圧を下げて
セカンドカツトを行なえるようにしたことを特徴
とする放電加工制御回路。 ２ 上記インターバル信号発振回路は発振回路で
構成された特許請求の範囲第１項記載の放電加工
制御回路。 ３ 上記インターバル信号発振回路は上記パルス
発振器の出力パルスを計数し、所定数毎にオン・
オフするインターバル信号を出力する特許請求の
範囲第１項記載の放電加工制御回路。 ４ 上記インターバル信号阻止回路は上記インタ
ーバル信号発振回路から送出される出力を阻止す
る特許請求の範囲第１項、第２項または第３項記
載の放電加工制御回路。 ５ 上記インターバル信号阻止回路は上記インタ
ーバル信号発振回路の発振を阻止する特許請求の
範囲第１項、第２項または第３項記載の放電加工
制御回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57199043A JPS5993227A (ja) | 1982-11-15 | 1982-11-15 | 放電加工制御回路 |
| DE8383903571T DE3381349D1 (de) | 1982-11-15 | 1983-11-11 | Elektrofunkenerosive steuerschaltung. |
| PCT/JP1983/000407 WO1984001915A1 (en) | 1982-11-15 | 1983-11-11 | Electric discharge machining control circuit |
| EP83903571A EP0124625B1 (en) | 1982-11-15 | 1983-11-11 | Electric discharge machining control circuit |
| US06/618,394 US4614854A (en) | 1982-11-15 | 1984-05-22 | Wire EDM control circuit for rough and finished machining |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57199043A JPS5993227A (ja) | 1982-11-15 | 1982-11-15 | 放電加工制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5993227A JPS5993227A (ja) | 1984-05-29 |
| JPH0313014B2 true JPH0313014B2 (ja) | 1991-02-21 |
Family
ID=16401160
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57199043A Granted JPS5993227A (ja) | 1982-11-15 | 1982-11-15 | 放電加工制御回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4614854A (ja) |
| EP (1) | EP0124625B1 (ja) |
| JP (1) | JPS5993227A (ja) |
| DE (1) | DE3381349D1 (ja) |
| WO (1) | WO1984001915A1 (ja) |
Families Citing this family (14)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60161029A (ja) * | 1984-02-01 | 1985-08-22 | Nec Corp | 放電間隙検出回路 |
| JPS6156829A (ja) * | 1984-08-27 | 1986-03-22 | Amada Co Ltd | 放電加工装置の加工条件設定方法 |
| US4733058A (en) * | 1986-02-28 | 1988-03-22 | Colt Industries Inc. | Fail transistor detection and display system for electrical discharge machining apparatus |
| US4751363A (en) * | 1986-02-28 | 1988-06-14 | Ho Kuang Ta | Automatic turn-on fine finish circuit for electrical discharge machining |
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| JP2660529B2 (ja) * | 1988-02-04 | 1997-10-08 | ファナック株式会社 | ワイヤ放電加工装置 |
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1982
- 1982-11-15 JP JP57199043A patent/JPS5993227A/ja active Granted
-
1983
- 1983-11-11 WO PCT/JP1983/000407 patent/WO1984001915A1/ja active IP Right Grant
- 1983-11-11 EP EP83903571A patent/EP0124625B1/en not_active Expired - Lifetime
- 1983-11-11 DE DE8383903571T patent/DE3381349D1/de not_active Expired - Lifetime
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1984
- 1984-05-22 US US06/618,394 patent/US4614854A/en not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| DE3381349D1 (de) | 1990-04-26 |
| WO1984001915A1 (en) | 1984-05-24 |
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| US4614854A (en) | 1986-09-30 |
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