JPH03125209U - - Google Patents

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JPH03125209U
JPH03125209U JP3439290U JP3439290U JPH03125209U JP H03125209 U JPH03125209 U JP H03125209U JP 3439290 U JP3439290 U JP 3439290U JP 3439290 U JP3439290 U JP 3439290U JP H03125209 U JPH03125209 U JP H03125209U
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  • Measurement Of Current Or Voltage (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第１図は本考案に係るデジタルオシロスコープ
における最大・最小検出回路の一実施例を示す構
成図、第２図は動作説明用のタイムチヤート、第
３図および第４図は従来の最大・最小検出回路の
原理ブロツク図である。 １０……コンパレータ群、２０……ラツチ群、
６０……第１のフリツプフロツプ群、７０……第
２のフリツプフロツプ群、８０１……第１のプラ
イオリテイエンコーダ、８０２……第２のプライ
オリテイエンコーダ、９０１……第１のメモリ、
９０２……第２のメモリ。

Claims (1)

  1. 【実用新案登録請求の範囲】 アナログ入力信号をそれぞれ異なる比較値と個
    別に比較してそれぞれ２値化データとして出力す
    るする複数個のコンパレータからなるコンパレー
    タ群と、 前記各コンパレータの出力データをＡＤクロツ
    ク入力ごとにラツチし、非反転出力と反転出力を
    送出する複数個のラツチより構成されたラツチ群
    と、 このラツチ群の各ラツチの非反転出力を個別に
    受け、その非反転出力の立ち上がりで出力がＨＩ
    ＧＨレベルに変化する複数個のエツジトリガ型の
    フリツプフロツプからなる第１のフリツプフロツ
    プ群と、 前記ラツチ群の各ラツチの反転出力を個別に受
    け、その反転出力の立ち上がりで出力がＨＩＧＨ
    レベルに変化する複数個のエツジトリガ型のフリ
    ツプフロツプからなる第２のフリツプフロツプ群
    と、 前記第１のフリツプフロツプ群の出力の最大値
    を求める第１のプライオリテイエンコーダと、 前記第２のフリツプフロツプ群の出力の最大値
    を求める第２のプライオリテイエンコーダと、 前記ＡＤクロツク入力開始時より所定の期間後
    に与えられるメモリライト信号により、前記第１
    および第２のプライオリテイエンコーダの値を記
    憶する第１および第２のメモリ を具備し、ある特定期間中のアナログ入力信号の
    最大値と最小値が前記第１および第２のメモリに
    格納されるように構成したことを特徴とする最大
    ・最小検出回路。
JP3439290U 1990-03-30 1990-03-30 最大・最小検出回路 Expired - Lifetime JPH079046Y2 (ja)

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JP3439290U JPH079046Y2 (ja) 1990-03-30 1990-03-30 最大・最小検出回路

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JP3439290U JPH079046Y2 (ja) 1990-03-30 1990-03-30 最大・最小検出回路

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Publication Number Publication Date
JPH03125209U true JPH03125209U (ja) 1991-12-18
JPH079046Y2 JPH079046Y2 (ja) 1995-03-06

Family

ID=31538824

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JP3439290U Expired - Lifetime JPH079046Y2 (ja) 1990-03-30 1990-03-30 最大・最小検出回路

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JPH079046Y2 (ja) 1995-03-06

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