JPH0311038B2 - - Google Patents
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- JPH0311038B2 JPH0311038B2 JP57190201A JP19020182A JPH0311038B2 JP H0311038 B2 JPH0311038 B2 JP H0311038B2 JP 57190201 A JP57190201 A JP 57190201A JP 19020182 A JP19020182 A JP 19020182A JP H0311038 B2 JPH0311038 B2 JP H0311038B2
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- JP
- Japan
- Prior art keywords
- analog switch
- terminal
- operational amplifier
- input terminal
- inverting input
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- 239000003990 capacitor Substances 0.000 description 20
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
- H03F3/005—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements using switched capacitors, e.g. dynamic amplifiers; using switched capacitors as resistors in differential amplifiers
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Filters That Use Time-Delay Elements (AREA)
- Amplifiers (AREA)
Description
【発明の詳細な説明】
(1) 発明の属する技術分野
本発明はMOSアナログ回路技術に関し、特に
サンプルド・データ回路に関する。
サンプルド・データ回路に関する。
(2) 従来技術の説明
MOSアナログ回路技術における主要な回路技
術は、アナログ信号値をキヤパシタに保持して信
号処理を施す技術、いわゆるサンプルド・データ
回路技術である。上記回路において、演算増幅器
の反転入力端子と出力端子との間にアナログ・ス
イツチを設けて、ある時刻に短絡できるようにし
た回路がしばしば用いられる。
術は、アナログ信号値をキヤパシタに保持して信
号処理を施す技術、いわゆるサンプルド・データ
回路技術である。上記回路において、演算増幅器
の反転入力端子と出力端子との間にアナログ・ス
イツチを設けて、ある時刻に短絡できるようにし
た回路がしばしば用いられる。
この種の回路として例えば、第1図に示すよう
な係数回路が挙げられる。係数回路はアナログ電
圧に、キヤパシタの容量比で決まる係数を乗算す
る回路である。
な係数回路が挙げられる。係数回路はアナログ電
圧に、キヤパシタの容量比で決まる係数を乗算す
る回路である。
以下、第1図の係数回路の動作を説明する。第
1のフエーズにはアナログ・スイツチ15,16
はONとなり、アナログ・スイツチ14はOFFと
なり演算増幅器11の反転入力端子N13の電位
と出力端子N14の電位とは等しくなり、上記演
算増幅器の動作によつて端子N12,N13,N
14,N15の電位はすべて等しくなり、従つて
キヤパシタ12,13の電位は零となる。次に第
2のフエーズにはアナログ・スイツチ15,16
はOFFとなり、アナログ・スイツチ14はONと
なり、端子11の電圧V11によつて容量値C1
2のキヤパシタ12には、C12,V11なる電
荷が流入し、容量値13のキヤパシタ13にも同
じくC12,V11なる電荷が流入し、従つて−
V11・C12/C13なる電圧が端子14に生
じて端子11の電圧に−C12/C13なる係数
を乗算した結果が端子N14に得られる。クロツ
ク信号により周期的に、第1のフエーズと第2の
フエーズは繰り返される。
1のフエーズにはアナログ・スイツチ15,16
はONとなり、アナログ・スイツチ14はOFFと
なり演算増幅器11の反転入力端子N13の電位
と出力端子N14の電位とは等しくなり、上記演
算増幅器の動作によつて端子N12,N13,N
14,N15の電位はすべて等しくなり、従つて
キヤパシタ12,13の電位は零となる。次に第
2のフエーズにはアナログ・スイツチ15,16
はOFFとなり、アナログ・スイツチ14はONと
なり、端子11の電圧V11によつて容量値C1
2のキヤパシタ12には、C12,V11なる電
荷が流入し、容量値13のキヤパシタ13にも同
じくC12,V11なる電荷が流入し、従つて−
V11・C12/C13なる電圧が端子14に生
じて端子11の電圧に−C12/C13なる係数
を乗算した結果が端子N14に得られる。クロツ
ク信号により周期的に、第1のフエーズと第2の
フエーズは繰り返される。
しかしながら、一搬に集積回路中で得られるア
ナログ・スイツチはOFF状態の抵抗値が有限値
であり、アナログ・スイツチ両端の電圧によつて
わずかに電流が流れる。第1図の例では、第2の
フエーズに端子N14と端子N13との電位差に
より、N14からアナログ・スイツチ16を介し
て端子N13へ電流が流れ込み、キヤパシタ1
2,13の充電電圧に誤差を生じ、端子N14の
電圧に誤差を生じて乗算誤差となる。
ナログ・スイツチはOFF状態の抵抗値が有限値
であり、アナログ・スイツチ両端の電圧によつて
わずかに電流が流れる。第1図の例では、第2の
フエーズに端子N14と端子N13との電位差に
より、N14からアナログ・スイツチ16を介し
て端子N13へ電流が流れ込み、キヤパシタ1
2,13の充電電圧に誤差を生じ、端子N14の
電圧に誤差を生じて乗算誤差となる。
(3) 発明の目的
本発明の目的は、演算増幅器の入力端子に
OFF状態のアナログ・スイツチを介して流入す
る電流を低減してキヤパシタに誤差電圧が生じる
のを低減したサンプルド・データ回路を提供する
ことである。
OFF状態のアナログ・スイツチを介して流入す
る電流を低減してキヤパシタに誤差電圧が生じる
のを低減したサンプルド・データ回路を提供する
ことである。
(4) 発明の構成
本発明の特徴は、演算増幅器の反転入力端子が
第1のアナログ・スイツチを介して上記演算増幅
器の出力端子に接続され、上記演算増幅器の非反
転入力端子が接地点もしくは電圧源に接続されて
いるサンプルド・データ回路において、第1のア
ナログ・スイツチと上記出力端子と間に第2のア
ナログ・スイツチを挿入し、かつ第1のアナロ
グ・スイツチと第2のアナログ・スイツチとの接
続点が第3のアナログ・スイツチを介して上記非
反転入力端子に接続されたサンプルド・データ回
路にある。
第1のアナログ・スイツチを介して上記演算増幅
器の出力端子に接続され、上記演算増幅器の非反
転入力端子が接地点もしくは電圧源に接続されて
いるサンプルド・データ回路において、第1のア
ナログ・スイツチと上記出力端子と間に第2のア
ナログ・スイツチを挿入し、かつ第1のアナロ
グ・スイツチと第2のアナログ・スイツチとの接
続点が第3のアナログ・スイツチを介して上記非
反転入力端子に接続されたサンプルド・データ回
路にある。
(5) 実施例
次に本発明の実施例について図面を参照して説
明する。先づ、第2図に示した第1の実施例につ
いて説明する。
明する。先づ、第2図に示した第1の実施例につ
いて説明する。
第2図において21は演算増幅器であり、2
4,25,26,27,28はそれぞれアナロ
グ・スイツチであり、22,23はそれぞれキヤ
パシタであり、N21は入力端子であり、N24
は出力端子であり、N25は接地点であり、N2
2は信号端子であり、23は反転入力端子であ
る。
4,25,26,27,28はそれぞれアナロ
グ・スイツチであり、22,23はそれぞれキヤ
パシタであり、N21は入力端子であり、N24
は出力端子であり、N25は接地点であり、N2
2は信号端子であり、23は反転入力端子であ
る。
第1のフエーズにおいてアナログ・スイツチ2
5,26,27はONであり、アナログ・スイツ
チ24,28はOFFであり、演算増幅器21の
動作によつて端子N22,N23,N24,N2
5,N26はすべて同電位であり、キヤパシタ2
2,23の電荷は共に零となる。
5,26,27はONであり、アナログ・スイツ
チ24,28はOFFであり、演算増幅器21の
動作によつて端子N22,N23,N24,N2
5,N26はすべて同電位であり、キヤパシタ2
2,23の電荷は共に零となる。
第2のフエーズにおいて、アナログ・スイツチ
25,26,27はOFFとなり、アナログ・ス
イツチ24,28はONとなり、容量値がC22
であるキヤパシタ22には、入力端子N21の電
位V21によりV21,C22なる電荷が流入
し、キヤパシタ23にはキヤパシタ22と同量の
電荷が流入し、端子N24に−V21・C22/
C23なる電圧が生じ、その結果、入力電圧に係
数−C22/C23を乗算した結果が端子N24
に得られる。
25,26,27はOFFとなり、アナログ・ス
イツチ24,28はONとなり、容量値がC22
であるキヤパシタ22には、入力端子N21の電
位V21によりV21,C22なる電荷が流入
し、キヤパシタ23にはキヤパシタ22と同量の
電荷が流入し、端子N24に−V21・C22/
C23なる電圧が生じ、その結果、入力電圧に係
数−C22/C23を乗算した結果が端子N24
に得られる。
この実施例で、第2のフエーズのとき、アナロ
グ・スイツチ28を介して端子N26と端子N2
5が接続されており、演算増幅器21の動作によ
り端子N23の電位も端子N25の電位と等し
く、端子N23と端子N26との間に電位差がな
いため、アナログスイツチ26を介して端子N2
3に電流が流れ込むことはなく、従つてキヤパシ
タ22,23に誤差電圧が生じることはなく、正
確な乗算が行われる。
グ・スイツチ28を介して端子N26と端子N2
5が接続されており、演算増幅器21の動作によ
り端子N23の電位も端子N25の電位と等し
く、端子N23と端子N26との間に電位差がな
いため、アナログスイツチ26を介して端子N2
3に電流が流れ込むことはなく、従つてキヤパシ
タ22,23に誤差電圧が生じることはなく、正
確な乗算が行われる。
以上、第2図に示した係数回路の実施例につい
て説明したが、本発明は演算増幅器の反転入力端
子と出力端子がアナログ・スイツチで接続されて
いるサンプルド・データ回路すべてに有効であ
る。
て説明したが、本発明は演算増幅器の反転入力端
子と出力端子がアナログ・スイツチで接続されて
いるサンプルド・データ回路すべてに有効であ
る。
(6) 発明の効果
本発明は、以上説明したように、演算増幅器の
反転入力端子と出力端子とを接続している第1の
アナログ・スイツチと、上記出力端子との間に第
2のアナログ・スイツチを挿入し、かつ上記2つ
のアナログ・スイツチの接続点と上記演算増幅器
の非反転入力端子とを第3のアナログ・スイツチ
で接続することにより、上記反転入力端子に接続
している第1のアナログ・スイツチを介して流入
する不要な電流が低減でき、正確な信号処理が可
能となる。
反転入力端子と出力端子とを接続している第1の
アナログ・スイツチと、上記出力端子との間に第
2のアナログ・スイツチを挿入し、かつ上記2つ
のアナログ・スイツチの接続点と上記演算増幅器
の非反転入力端子とを第3のアナログ・スイツチ
で接続することにより、上記反転入力端子に接続
している第1のアナログ・スイツチを介して流入
する不要な電流が低減でき、正確な信号処理が可
能となる。
第1図は従来の係数回路を示す回路図、第2図
は本発明実施例の回路図、である。 なお図において、11……演算増幅器、12…
…キヤパシタ(容量値C12)、13……キヤパ
シタ(容量値C13)、14,15,16……ア
ナログ・スイツチ、N11……入力端子、N14
……出力端子、N12……信号端子、N13……
反転入力端子、N15……接地点、21……演算
増幅器、22……キヤパシタ(容量値C22)、
23……キヤパシタ(容量値C23)、24,2
5,26,27,28……アナログ・スイツチ、
N21……入力端子、N24……出力端子、N2
2,N26……信号端子、N23……反転入力端
子、N25……接地点、である。
は本発明実施例の回路図、である。 なお図において、11……演算増幅器、12…
…キヤパシタ(容量値C12)、13……キヤパ
シタ(容量値C13)、14,15,16……ア
ナログ・スイツチ、N11……入力端子、N14
……出力端子、N12……信号端子、N13……
反転入力端子、N15……接地点、21……演算
増幅器、22……キヤパシタ(容量値C22)、
23……キヤパシタ(容量値C23)、24,2
5,26,27,28……アナログ・スイツチ、
N21……入力端子、N24……出力端子、N2
2,N26……信号端子、N23……反転入力端
子、N25……接地点、である。
Claims (1)
- 【特許請求の範囲】 1 演算増幅器の反転入力端子が第1のアナロ
グ・スイツチを介して該演算増幅器の出力端子に
接続され、該演算増幅器の非反転入力端子が接地
点もしくは電圧源に接続されているサンプルド・
データ回路において、 第1のアナログ・スイツチと前記出力端子との
間に第2のアナログ・スイツチが挿入され、該第
1のアナログ・スイツチと該第2のアナログ・ス
イツチとの接続点が第3のアナログ・スイツチを
介して前記非反転入力端子に接続されていること
を特徴とするサンプルド・データ回路。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57190201A JPS5979496A (ja) | 1982-10-29 | 1982-10-29 | サンプルド・デ−タ回路 |
EP83110699A EP0110130B1 (en) | 1982-10-29 | 1983-10-26 | Circuit producing an output free from a leakage between output and input ends |
US06/545,692 US4617481A (en) | 1982-10-29 | 1983-10-26 | Amplifier circuit free from leakage between input and output ports |
DE8383110699T DE3372561D1 (en) | 1982-10-29 | 1983-10-26 | Circuit producing an output free from a leakage between output and input ends |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57190201A JPS5979496A (ja) | 1982-10-29 | 1982-10-29 | サンプルド・デ−タ回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5979496A JPS5979496A (ja) | 1984-05-08 |
JPH0311038B2 true JPH0311038B2 (ja) | 1991-02-15 |
Family
ID=16254131
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57190201A Granted JPS5979496A (ja) | 1982-10-29 | 1982-10-29 | サンプルド・デ−タ回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4617481A (ja) |
EP (1) | EP0110130B1 (ja) |
JP (1) | JPS5979496A (ja) |
DE (1) | DE3372561D1 (ja) |
Families Citing this family (24)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5024221A (en) * | 1985-05-17 | 1991-06-18 | Siemens-Pacesetter, Inc. | Programmable band-pass amplifier for use with implantable medical device |
IT1200824B (it) * | 1985-11-08 | 1989-01-27 | Sgs Microelettronica Spa | Integratore di dati di campionamento a capacita' commutate utilizzante un amplificatore a guadagno unitario |
US4785207A (en) * | 1987-01-21 | 1988-11-15 | Hughes Aircraft Company | Leakage regulator circuit for a field effect transistor |
JPS63269399A (ja) * | 1987-04-28 | 1988-11-07 | Yokogawa Electric Corp | トラツクホ−ルド回路 |
US4894620A (en) * | 1988-04-11 | 1990-01-16 | At&T Bell Laboratories | Switched-capacitor circuit with large time constant |
US5168179A (en) * | 1988-11-04 | 1992-12-01 | Silicon Systems, Inc. | Balanced modulator for auto zero networks |
FR2641924B1 (fr) * | 1988-12-28 | 1991-05-03 | Sgs Thomson Microelectronics | Generateur de forme d'onde de signal analogique |
US5027003A (en) * | 1989-12-29 | 1991-06-25 | Texas Instruments Incorporated | Read/write switching circuit |
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US5142238A (en) * | 1991-07-18 | 1992-08-25 | Silicon Systems, Inc. | Switched-capacitor differential amplifier |
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US5444312A (en) * | 1992-05-04 | 1995-08-22 | Compaq Computer Corp. | Soft switching circuit for audio muting or filter activation |
DE69227244T2 (de) * | 1992-07-28 | 1999-03-04 | Stmicroelectronics S.R.L., Agrate Brianza, Mailand/Milano | Sättigungssteuerung eines integrierten bipolaren Transistors |
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CN102545808B (zh) * | 2012-01-17 | 2015-10-21 | 辉芒微电子(深圳)有限公司 | 误差放大器、控制器和原边反馈控制ac/dc转换器 |
CN109379067B (zh) * | 2018-12-12 | 2024-09-03 | 北京集创北方科技股份有限公司 | 开关电路及信号采集系统 |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US4186700A (en) * | 1978-09-01 | 1980-02-05 | Motorola, Inc. | Low leakage integrator for carburetor control |
US4306196A (en) * | 1980-01-14 | 1981-12-15 | Bell Telephone Laboratories, Incorporated | Operational amplifier with offset compensation |
US4323798A (en) * | 1980-04-18 | 1982-04-06 | The United States Of America As Represented By The Secretary Of The Air Force | Fast operating switchable operational amplifier driven circuits |
GB2083723B (en) * | 1980-09-05 | 1984-06-27 | Philips Electronic Associated | Electronic analogue switching device |
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-
1982
- 1982-10-29 JP JP57190201A patent/JPS5979496A/ja active Granted
-
1983
- 1983-10-26 US US06/545,692 patent/US4617481A/en not_active Expired - Lifetime
- 1983-10-26 EP EP83110699A patent/EP0110130B1/en not_active Expired
- 1983-10-26 DE DE8383110699T patent/DE3372561D1/de not_active Expired
Also Published As
Publication number | Publication date |
---|---|
EP0110130A1 (en) | 1984-06-13 |
US4617481A (en) | 1986-10-14 |
EP0110130B1 (en) | 1987-07-15 |
DE3372561D1 (en) | 1987-08-20 |
JPS5979496A (ja) | 1984-05-08 |
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