JPH03105408A - 電子機器 - Google Patents
電子機器Info
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- JPH03105408A JPH03105408A JP1241742A JP24174289A JPH03105408A JP H03105408 A JPH03105408 A JP H03105408A JP 1241742 A JP1241742 A JP 1241742A JP 24174289 A JP24174289 A JP 24174289A JP H03105408 A JPH03105408 A JP H03105408A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野１
本発明は電子機器，特に内部にＣＰＵおよびその外部の
回路部材の制御に必要な制御回路部材を一体化した制御
手段を有する電子＃！器に関するものである． ［従来の技術］ 従来より、電池駆動の電子機器において、消費電力を低
減するため、主電源がオンの状態でもデータ処理や計算
を行なっていない（たとえばキー人力待ち）！ｔｌ１間
では，主制御部としてのＣＰＵへのクロック供給を停止
し、キー人力に応じてＣＰＵの動作を再開する節電技術
が知られている． ［発明が解決しようとする課題］ 一方，機器の小型化、コストダウンのため、機器の制御
回路の集積化が進んでおり、主制御部のＣＰＵ．ＲＯＭ
．ＲＡＭあるいは周辺内蔵回路などを１チップＬＳＩ化
したマイクロプロセッサが知られている． ところが，このようなプロセッサでも、上記の節電モー
ドではＣＰＵ部へのクロック供給のみを停止し，他の内
蔵周辺回路にはクロックを供給しており，機器の消費電
力を大幅に低減することはできなかった． 本発明の課題は、以上の問題を解決し、電子機器の消費
電力を大きく低減することにある．［課題を解決するた
めの千段］ 以上の課題を解決するために、本発明においては、内部
にＣ Ｐ Ｕおよびその外部の回路部材の制御に必要な
制御回路部材を一体化した制御手段を有する電子機器に
おいて、前記制御手段の所定制御処理を必要としない期
間において前記制御手段内部のＣＰＵＪｌｌ５よび制御
回路部材に対するクロック供給を停止させる動作制御手
段を設けた構成を探用した． ［作 用１ 以上の構成によれば、制御手段内のＣＰＵのみならず、
外部の回路部材の制御に必要な制御回路部材に対するク
ロック供給を停止させることにより消費電力を低減でき
る。
回路部材の制御に必要な制御回路部材を一体化した制御
手段を有する電子＃！器に関するものである． ［従来の技術］ 従来より、電池駆動の電子機器において、消費電力を低
減するため、主電源がオンの状態でもデータ処理や計算
を行なっていない（たとえばキー人力待ち）！ｔｌ１間
では，主制御部としてのＣＰＵへのクロック供給を停止
し、キー人力に応じてＣＰＵの動作を再開する節電技術
が知られている． ［発明が解決しようとする課題］ 一方，機器の小型化、コストダウンのため、機器の制御
回路の集積化が進んでおり、主制御部のＣＰＵ．ＲＯＭ
．ＲＡＭあるいは周辺内蔵回路などを１チップＬＳＩ化
したマイクロプロセッサが知られている． ところが，このようなプロセッサでも、上記の節電モー
ドではＣＰＵ部へのクロック供給のみを停止し，他の内
蔵周辺回路にはクロックを供給しており，機器の消費電
力を大幅に低減することはできなかった． 本発明の課題は、以上の問題を解決し、電子機器の消費
電力を大きく低減することにある．［課題を解決するた
めの千段］ 以上の課題を解決するために、本発明においては、内部
にＣ Ｐ Ｕおよびその外部の回路部材の制御に必要な
制御回路部材を一体化した制御手段を有する電子機器に
おいて、前記制御手段の所定制御処理を必要としない期
間において前記制御手段内部のＣＰＵＪｌｌ５よび制御
回路部材に対するクロック供給を停止させる動作制御手
段を設けた構成を探用した． ［作 用１ 以上の構成によれば、制御手段内のＣＰＵのみならず、
外部の回路部材の制御に必要な制御回路部材に対するク
ロック供給を停止させることにより消費電力を低減でき
る。
［実施例１
以下，図面に示す実施例に基づき、本発明を詳細に説明
する。
する。
第１図において、符号１はＣ Ｐ Ｕ ５、発振制御回
路１０１５よびこれらの回路にクロックを供給する発振
制御回路ＩＯをｌチップ化したマイクロプロセッサであ
る． マイクロプロセッサｌの発振制御回路には、水晶振動子
などからなる発振子９が接続される。ＣＰＵ５．内蔵周
辺回路６に対する発振制御回路ＩＯからのクロック供給
は、独立した信号線１１．１２を介して行なわれる。
路１０１５よびこれらの回路にクロックを供給する発振
制御回路ＩＯをｌチップ化したマイクロプロセッサであ
る． マイクロプロセッサｌの発振制御回路には、水晶振動子
などからなる発振子９が接続される。ＣＰＵ５．内蔵周
辺回路６に対する発振制御回路ＩＯからのクロック供給
は、独立した信号線１１．１２を介して行なわれる。
Ｃ Ｐ Ｕ ５と内蔵周辺回路６は、アドレスバスおよ
びデータパスからなる内部バス７および各種制御！１８
によって接続される。内蔵周辺回路６と外部の周辺回路
（たとえばプリンタや表示器などからなる）２は、外部
バス３および各種制御線（リード／ライト、あるいはチ
ップセレクト線などを含む）４によって接続される． 本実施例では、キー人力はサブＣＰＵｌ７を介して制御
する．すなわち，サブＣＰＵｌ７は公知のキー人力制御
用のＣＰＵなどから構成され、内蔵周辺回路６とバスｌ
６を介して接続される。リブＣＰＵ ｌ ７は、信号線
ｌ５を介して公知のキーマトリクス回路などを用いてキ
ー人力を検出するキー人力装置ｌ４と接続される。
びデータパスからなる内部バス７および各種制御！１８
によって接続される。内蔵周辺回路６と外部の周辺回路
（たとえばプリンタや表示器などからなる）２は、外部
バス３および各種制御線（リード／ライト、あるいはチ
ップセレクト線などを含む）４によって接続される． 本実施例では、キー人力はサブＣＰＵｌ７を介して制御
する．すなわち，サブＣＰＵｌ７は公知のキー人力制御
用のＣＰＵなどから構成され、内蔵周辺回路６とバスｌ
６を介して接続される。リブＣＰＵ ｌ ７は、信号線
ｌ５を介して公知のキーマトリクス回路などを用いてキ
ー人力を検出するキー人力装置ｌ４と接続される。
サブＣ Ｐ Ｕ ｌ ７は定期的にキー人力装置１４に
対してキースキャン信号を出力し、キー人力があった場
合その入力に対応した情報をバスｌ６を介してマイクロ
プロセッサｌに伝達する．ＣＰＵ５および内蔵周辺回路
６に対する信号線１１．１２を介したクロック供給は、
内蔵周辺回路６に含まれる制御回路が信号線ｌ３を介し
て発振制御回路１０を制御することによってオンまたは
オフされる。内蔵周辺回路６に含まれるこの制御回路６
ａは内蔵周辺回路６の他の部分に対するクロック供給が
停止されている時でも動作可能であり、制御回路６ａは
サブＣＰＵ ｌ ７からのキー人力を常時検出できるも
のとする． なお、装置の電源は、不図示の電池および安定化回路な
どからなる？Ｓｆ源回路から供給されるものとする． 制御回路６ａを用いたマイクロプロセッサｌ全体の制御
手類を示した状態遷移図を、第２図に示す．第２図の手
順は主電源投入状態で行なわれる．第１図の構成におい
て通常のデータ処理（たとえば計算、言語処理など）を
行なっている時（第２図の状態４１）は、マイクロプロ
セッサ１内ではＣＰＵ５、内蔵周辺回路６に動作クロッ
クが供給され、所定の処理動作を行なっている。
対してキースキャン信号を出力し、キー人力があった場
合その入力に対応した情報をバスｌ６を介してマイクロ
プロセッサｌに伝達する．ＣＰＵ５および内蔵周辺回路
６に対する信号線１１．１２を介したクロック供給は、
内蔵周辺回路６に含まれる制御回路が信号線ｌ３を介し
て発振制御回路１０を制御することによってオンまたは
オフされる。内蔵周辺回路６に含まれるこの制御回路６
ａは内蔵周辺回路６の他の部分に対するクロック供給が
停止されている時でも動作可能であり、制御回路６ａは
サブＣＰＵ ｌ ７からのキー人力を常時検出できるも
のとする． なお、装置の電源は、不図示の電池および安定化回路な
どからなる？Ｓｆ源回路から供給されるものとする． 制御回路６ａを用いたマイクロプロセッサｌ全体の制御
手類を示した状態遷移図を、第２図に示す．第２図の手
順は主電源投入状態で行なわれる．第１図の構成におい
て通常のデータ処理（たとえば計算、言語処理など）を
行なっている時（第２図の状態４１）は、マイクロプロ
セッサ１内ではＣＰＵ５、内蔵周辺回路６に動作クロッ
クが供給され、所定の処理動作を行なっている。
この処理動作はキー人力装置ｌ４を介した人力操作（サ
ブＣＰＵｌ７によって検出され、マイクロプロセッサｌ
に入力される）に応じて進められる．このキー人力待ち
は状態４ｌのデータ処理内部で、あるいは所定のデータ
処理が終了した場合には状態４２で検出される。
ブＣＰＵｌ７によって検出され、マイクロプロセッサｌ
に入力される）に応じて進められる．このキー人力待ち
は状態４ｌのデータ処理内部で、あるいは所定のデータ
処理が終了した場合には状態４２で検出される。
状態４２におけるマイクロプロセッサのキー人力待ち朋
間では、内蔵タイマなどを用いてキー人力が連続して行
なわれない時間が計測されており、このキー人力無しの
時間が一定値に達すると状態４３に進む． 状態４３ではマイクロプロセッサｌのＣ Ｐ Ｕ ５は
内蔵周辺回路６を介して周辺回路２の消費電力が最も少
なくなるように、また供給するクロックが停止する前の
状態を保持できるように設定するとともに、状！ｒＪ．
４４ではＣＰＵ５ｊ；よび内蔵周辺回路６の制御回路６
ａを除く部分に対するクロック供給を停ＩＬする．この
クロック供給は信号線１１．１２を遮断するか、あるい
は発振そのものを停止させることによって行なう． 状態４３．４４では、内蔵周辺回路６内の制御回路６ａ
は常にサブＣＰＵ１７からのキー人力情報を検出してい
る．何らかのキー人力がキー人力装置Ｉ４で行なわれる
と、サブＣＰＵｌ７は入力されたキーのコードをＣＰＵ
５、あるいは内蔵周辺回路６が再び動作し始めた時に利
用できるようにラッチし．！いて信号ＩＩｌ６に含まれ
る所定のラインを使用して制御回路６ａにキー人力があ
ったことを報知する． 制御回路６ａはこれを検出し、信号線ｌ３を介して発振
制御回路ＩＯからＣＰＵ５、内蔵周辺回路６に対するク
ロック供給を開始させる．このクロック供給開始は、信
号線１１，１２を接続状態とする、あるいは発振そのも
のを開始させることによって行なう，ＣＰＵ５は再起動
されるとサブＣＰＵｌ７がラッチしたキー人力データを
取り込んで、状態４ｌのデータ処理に戻る． 以上のように、本実施例による電子機器においては，周
辺回路を含むマイクロプロセッサのデータ処理を必要と
しない時、プロセッサのほぼ全てのシステム動作を停止
しているので、消費電力を大幅に節約し，電池の寿命を
延長して機器の駆動時間を延ばすことができるという優
れた効果がある． また，上記実施例によればキー人力をサブｃＰＵｌ７で
検出し，マイクロプロセッサｌが休止している状態でも
入力されたキーの情報を保持できるため、ユーザは何ら
再起動の操作を行なうことなく，所望のキー操作を行な
うだけでマイクロプロセッサの休止、あるいは再起動を
意識せずに作業を行なえる． 以上ではサブＣＰＵを用いる構成を示したが、第３図の
ようにサブＣＰＵを用いず、キー人力装ｒａｌ４のキー
操作を周辺回路２に含まれるキースキャン回路ｌ８によ
って行なう構成も考えられる． キー人力装置ｌ４はキースキャン回路ｌ８と信号線ｌ９
によって接続され，また第１図と同様の構成を有するマ
イクロプロセッサ！内の内蔵周辺回路６に含まれる制御
回路６ａ（不図示）に対して動作開始要求を行なうため
の信号線２０によってキー人力装置１４とマイクロプロ
セッサｌを接続している．その他の構成は、第１図と全
く同様である． キー人力装置１４は何らかのキー人力があった場合には
信号線２０を介して所定の信号を入力し，マイクロプロ
セッサｌ内の制御回路６ａによってＣＰＵ５および内蔵
周辺回路６に対するクロック供給を再開させる．キー人
力データはキースキャン回路ｌ８でラッチし、マイクロ
プロセッサ■の動作が再開した後このラッチされたキー
データを読み取らせる． このようなより簡略な構造によっても，前記実施例とほ
ぼ同様の効果を期待できる．なお、マイクロプロセッサ
ｌ内のＣＰＵ５、内蔵周辺回路６に対するクロック供給
の停止制御は，前記実施例と全く同じである． 第３図の実施例ではキー人力装置ｌ４は何らかのキー操
作Ｃ全での入力キーのうちいずれかの、少なくとも１つ
）が行なわれた場合，信号Ｉ１２０を介して再起動要求
を発生するが、第４図に示すように特定のスイッチ２３
を設け，このスイッチ２３の操作によってマイクロプロ
セッサｌの再起動を行なってもよい． これにより、キー人力装ｆｉｌ４の構造をより簡略にす
ることができる．ただし、この構成ではマイクロプロセ
ッサｌの再起動のためにユーザのスイッチ２３の操作が
必要となるため，ユーザはマイクロプロセッサｌの動作
状態ないし休止状態を明確に区別できるよう，不図示の
表示器などによって適当な表示を行なう必要がある．な
お，スイッチ２３の接点の１つは抵抗２ｌを介して電源
電圧にプルアップし、他方の電極を抵抗２２を介して接
地電位にプルダウンした状態でマイクロプロセッサｌの
内蔵周辺回路６に含まれる制御回路６ａと接続し、スイ
ッチ２３の操作状態を検出する． 以上では、電源に電池を使用することを前提としたが、
消費電力低減効果番ま他の電源を用いる装置においても
同様であるのはいうまでもない．［発明の効果］ 以上から明らかなように、本発明によれば、内部にＣＰ
Ｕおよびその外部の回路部材の制御に必要な制御回路部
材を一体化した制御手段を有する電子機器において、前
記制御手段の所定制御処理を必要としない期間において
前記制御手段内部のＣＰＵＪ５よび制御回路部材に対す
るクロック供給を停＋ｈさせる動作制御手段を設けた構
成を採用しているので、制ｒＢ＋段内のＣＰＵのみなら
ず、外部の回路部材の制御に必要な制御回路部材に対す
るクロック供給を停ＩＬさせることにより消費電力を大
幅に低減でき、電池を電源とする装置においてはその寿
命を延長できるという優れた効果がある。
間では、内蔵タイマなどを用いてキー人力が連続して行
なわれない時間が計測されており、このキー人力無しの
時間が一定値に達すると状態４３に進む． 状態４３ではマイクロプロセッサｌのＣ Ｐ Ｕ ５は
内蔵周辺回路６を介して周辺回路２の消費電力が最も少
なくなるように、また供給するクロックが停止する前の
状態を保持できるように設定するとともに、状！ｒＪ．
４４ではＣＰＵ５ｊ；よび内蔵周辺回路６の制御回路６
ａを除く部分に対するクロック供給を停ＩＬする．この
クロック供給は信号線１１．１２を遮断するか、あるい
は発振そのものを停止させることによって行なう． 状態４３．４４では、内蔵周辺回路６内の制御回路６ａ
は常にサブＣＰＵ１７からのキー人力情報を検出してい
る．何らかのキー人力がキー人力装置Ｉ４で行なわれる
と、サブＣＰＵｌ７は入力されたキーのコードをＣＰＵ
５、あるいは内蔵周辺回路６が再び動作し始めた時に利
用できるようにラッチし．！いて信号ＩＩｌ６に含まれ
る所定のラインを使用して制御回路６ａにキー人力があ
ったことを報知する． 制御回路６ａはこれを検出し、信号線ｌ３を介して発振
制御回路ＩＯからＣＰＵ５、内蔵周辺回路６に対するク
ロック供給を開始させる．このクロック供給開始は、信
号線１１，１２を接続状態とする、あるいは発振そのも
のを開始させることによって行なう，ＣＰＵ５は再起動
されるとサブＣＰＵｌ７がラッチしたキー人力データを
取り込んで、状態４ｌのデータ処理に戻る． 以上のように、本実施例による電子機器においては，周
辺回路を含むマイクロプロセッサのデータ処理を必要と
しない時、プロセッサのほぼ全てのシステム動作を停止
しているので、消費電力を大幅に節約し，電池の寿命を
延長して機器の駆動時間を延ばすことができるという優
れた効果がある． また，上記実施例によればキー人力をサブｃＰＵｌ７で
検出し，マイクロプロセッサｌが休止している状態でも
入力されたキーの情報を保持できるため、ユーザは何ら
再起動の操作を行なうことなく，所望のキー操作を行な
うだけでマイクロプロセッサの休止、あるいは再起動を
意識せずに作業を行なえる． 以上ではサブＣＰＵを用いる構成を示したが、第３図の
ようにサブＣＰＵを用いず、キー人力装ｒａｌ４のキー
操作を周辺回路２に含まれるキースキャン回路ｌ８によ
って行なう構成も考えられる． キー人力装置ｌ４はキースキャン回路ｌ８と信号線ｌ９
によって接続され，また第１図と同様の構成を有するマ
イクロプロセッサ！内の内蔵周辺回路６に含まれる制御
回路６ａ（不図示）に対して動作開始要求を行なうため
の信号線２０によってキー人力装置１４とマイクロプロ
セッサｌを接続している．その他の構成は、第１図と全
く同様である． キー人力装置１４は何らかのキー人力があった場合には
信号線２０を介して所定の信号を入力し，マイクロプロ
セッサｌ内の制御回路６ａによってＣＰＵ５および内蔵
周辺回路６に対するクロック供給を再開させる．キー人
力データはキースキャン回路ｌ８でラッチし、マイクロ
プロセッサ■の動作が再開した後このラッチされたキー
データを読み取らせる． このようなより簡略な構造によっても，前記実施例とほ
ぼ同様の効果を期待できる．なお、マイクロプロセッサ
ｌ内のＣＰＵ５、内蔵周辺回路６に対するクロック供給
の停止制御は，前記実施例と全く同じである． 第３図の実施例ではキー人力装置ｌ４は何らかのキー操
作Ｃ全での入力キーのうちいずれかの、少なくとも１つ
）が行なわれた場合，信号Ｉ１２０を介して再起動要求
を発生するが、第４図に示すように特定のスイッチ２３
を設け，このスイッチ２３の操作によってマイクロプロ
セッサｌの再起動を行なってもよい． これにより、キー人力装ｆｉｌ４の構造をより簡略にす
ることができる．ただし、この構成ではマイクロプロセ
ッサｌの再起動のためにユーザのスイッチ２３の操作が
必要となるため，ユーザはマイクロプロセッサｌの動作
状態ないし休止状態を明確に区別できるよう，不図示の
表示器などによって適当な表示を行なう必要がある．な
お，スイッチ２３の接点の１つは抵抗２ｌを介して電源
電圧にプルアップし、他方の電極を抵抗２２を介して接
地電位にプルダウンした状態でマイクロプロセッサｌの
内蔵周辺回路６に含まれる制御回路６ａと接続し、スイ
ッチ２３の操作状態を検出する． 以上では、電源に電池を使用することを前提としたが、
消費電力低減効果番ま他の電源を用いる装置においても
同様であるのはいうまでもない．［発明の効果］ 以上から明らかなように、本発明によれば、内部にＣＰ
Ｕおよびその外部の回路部材の制御に必要な制御回路部
材を一体化した制御手段を有する電子機器において、前
記制御手段の所定制御処理を必要としない期間において
前記制御手段内部のＣＰＵＪ５よび制御回路部材に対す
るクロック供給を停＋ｈさせる動作制御手段を設けた構
成を採用しているので、制ｒＢ＋段内のＣＰＵのみなら
ず、外部の回路部材の制御に必要な制御回路部材に対す
るクロック供給を停ＩＬさせることにより消費電力を大
幅に低減でき、電池を電源とする装置においてはその寿
命を延長できるという優れた効果がある。
第１図は本発明を採用した電子機器の構成を示したブロ
ック図、第２図は第１図の装置の制御を示した状態遷移
図、第３図および第４図はそれぞれ異なる電子機器の構
成を示したブロック図である。 ｌ・・・マイクロプロセッサ ５・・・Ｃ Ｐ ＩＪ ９・・一発振子 ｌ４−キー人力装置 ｌ７・・−サブＣＰＵ ｌ８・・・キースキャン回路 ２−・一周辺回路 ６−・・内蔵周辺回路 １０・・・発振制御回路 １６−・−バス ４１ ４２ ４３ ４４ ？ｌ’ｌ徂呼咄芝示し■状綬遼杼面 第２図
ック図、第２図は第１図の装置の制御を示した状態遷移
図、第３図および第４図はそれぞれ異なる電子機器の構
成を示したブロック図である。 ｌ・・・マイクロプロセッサ ５・・・Ｃ Ｐ ＩＪ ９・・一発振子 ｌ４−キー人力装置 ｌ７・・−サブＣＰＵ ｌ８・・・キースキャン回路 ２−・一周辺回路 ６−・・内蔵周辺回路 １０・・・発振制御回路 １６−・−バス ４１ ４２ ４３ ４４ ？ｌ’ｌ徂呼咄芝示し■状綬遼杼面 第２図
Claims (1)
- 【特許請求の範囲】 １）内部にＣＰＵおよびその外部の回路部材の制御に必
要な制御回路部材を一体化した制御手段を有する電子機
器において、 前記制御手段の所定制御処理を必要としない期間におい
て前記制御手段内部のＣＰＵおよび制御回路部材に対す
るクロック供給を停止させる動作制御手段を設けたこと
を特徴とする電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1241742A JPH03105408A (ja) | 1989-09-20 | 1989-09-20 | 電子機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1241742A JPH03105408A (ja) | 1989-09-20 | 1989-09-20 | 電子機器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03105408A true JPH03105408A (ja) | 1991-05-02 |
Family
ID=17078869
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1241742A Pending JPH03105408A (ja) | 1989-09-20 | 1989-09-20 | 電子機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03105408A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7000140B2 (en) | 2000-11-29 | 2006-02-14 | Renesas Technology Corporation | Data processor and data processing system |
-
1989
- 1989-09-20 JP JP1241742A patent/JPH03105408A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7000140B2 (en) | 2000-11-29 | 2006-02-14 | Renesas Technology Corporation | Data processor and data processing system |
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