JPH0298955A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0298955A JPH0298955A JP25232188A JP25232188A JPH0298955A JP H0298955 A JPH0298955 A JP H0298955A JP 25232188 A JP25232188 A JP 25232188A JP 25232188 A JP25232188 A JP 25232188A JP H0298955 A JPH0298955 A JP H0298955A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 29
- 238000004519 manufacturing process Methods 0.000 title claims description 8
- 239000000758 substrate Substances 0.000 claims abstract description 30
- 238000000034 method Methods 0.000 claims abstract description 14
- 230000015572 biosynthetic process Effects 0.000 claims abstract description 12
- 238000005259 measurement Methods 0.000 claims description 23
- 238000005229 chemical vapour deposition Methods 0.000 claims description 5
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 8
- 229910052721 tungsten Inorganic materials 0.000 description 8
- 239000010937 tungsten Substances 0.000 description 8
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 5
- 238000010586 diagram Methods 0.000 description 5
- 229910052814 silicon oxide Inorganic materials 0.000 description 5
- 238000001228 spectrum Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 4
- 239000012535 impurity Substances 0.000 description 2
- 239000011229 interlayer Substances 0.000 description 2
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 2
- 230000002250 progressing effect Effects 0.000 description 2
- CVOFKRWYWCSDMA-UHFFFAOYSA-N 2-chloro-n-(2,6-diethylphenyl)-n-(methoxymethyl)acetamide;2,6-dinitro-n,n-dipropyl-4-(trifluoromethyl)aniline Chemical compound CCC1=CC=CC(CC)=C1N(COC)C(=O)CCl.CCCN(CCC)C1=C([N+]([O-])=O)C=C(C(F)(F)F)C=C1[N+]([O-])=O CVOFKRWYWCSDMA-UHFFFAOYSA-N 0.000 description 1
- BLRPTPMANUNPDV-UHFFFAOYSA-N Silane Chemical compound [SiH4] BLRPTPMANUNPDV-UHFFFAOYSA-N 0.000 description 1
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000006378 damage Effects 0.000 description 1
- 229910003460 diamond Inorganic materials 0.000 description 1
- 239000010432 diamond Substances 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 238000005468 ion implantation Methods 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
- 229910000077 silane Inorganic materials 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- NXHILIPIEUBEPD-UHFFFAOYSA-H tungsten hexafluoride Chemical compound F[W](F)(F)(F)(F)F NXHILIPIEUBEPD-UHFFFAOYSA-H 0.000 description 1
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- Electrodes Of Semiconductors (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は半導体装置の製造方法、特に化学気相成長法
による選択成長膜の膜厚が高精度で測定できる方法に関
するものである。
による選択成長膜の膜厚が高精度で測定できる方法に関
するものである。
半導体装置の進歩はめざましく、高集積化・微細化が急
速に進んでいる。これに伴い、電極配線の低抵抗化、エ
レクトロマイグレーション耐性の向上−プロセスの低温
化等解決すべき課題も多い。
速に進んでいる。これに伴い、電極配線の低抵抗化、エ
レクトロマイグレーション耐性の向上−プロセスの低温
化等解決すべき課題も多い。
電極が形成されるコンタクトホールや、層間配線が行な
われるスルーホールにおいても、微細化に伴いアスペク
ト比(深さ寸法に対する平面寸法の比)がますます大き
くなり、問題が顕在化してきている。これに対し、上記
コンタクトホールやスルーホールに化学気相成長法(以
下CVD法と称す)を用いて選択的に金属膜を形成させ
る技術を適用することは極めて有効である。
われるスルーホールにおいても、微細化に伴いアスペク
ト比(深さ寸法に対する平面寸法の比)がますます大き
くなり、問題が顕在化してきている。これに対し、上記
コンタクトホールやスルーホールに化学気相成長法(以
下CVD法と称す)を用いて選択的に金属膜を形成させ
る技術を適用することは極めて有効である。
選択的に膜成長を行なうCVD法を用いて、コンタクト
ホールにタングステン膜を埋め込んだ場合の模式図を第
5図に示す。図において(I)は素子等が形成されて半
導体装置となる領域、(1)はこの半導体装置となるべ
き領域(1)を分離しているダイシングライン領域であ
る。(1)は−導電型のシリコン単結晶等から成る半導
体基板(以下一基板と称す)、(2)はこの基板(1)
上に形成され、例えばドープト多結晶シリコン等からな
るゲート電極、(31はこのゲート電極12)と上記基
板(1)との間に形成され、例えば薄いシリコン酸化膜
からなるゲート絶縁膜である。(4)は上記基板(1)
と逆導電型であり、上記ゲート電極+21の両側の上記
基板(1)の−主面に形成される不純物領域、この場合
(4a)はソース、(4b)はドレインである。(5)
は上記ゲート電極を被覆するように上記基板(1)上に
形成される、例えばシリコン酸化膜からなる絶縁膜、(
6)はこの絶縁膜15)に形成され一上記ソース(4a
)、ドレイン(4b)の一部を露出させるように開口さ
れるコンタクトホール、(7)は上記基板(1)の露出
面に選択的に成長形成される、例えばタングステンより
なる選択成長膜、18)は素子間を分離し、上記基板(
1)上に形成され、例えば厚いシリコン酸化膜よりなる
フィールド酸化膜である。
ホールにタングステン膜を埋め込んだ場合の模式図を第
5図に示す。図において(I)は素子等が形成されて半
導体装置となる領域、(1)はこの半導体装置となるべ
き領域(1)を分離しているダイシングライン領域であ
る。(1)は−導電型のシリコン単結晶等から成る半導
体基板(以下一基板と称す)、(2)はこの基板(1)
上に形成され、例えばドープト多結晶シリコン等からな
るゲート電極、(31はこのゲート電極12)と上記基
板(1)との間に形成され、例えば薄いシリコン酸化膜
からなるゲート絶縁膜である。(4)は上記基板(1)
と逆導電型であり、上記ゲート電極+21の両側の上記
基板(1)の−主面に形成される不純物領域、この場合
(4a)はソース、(4b)はドレインである。(5)
は上記ゲート電極を被覆するように上記基板(1)上に
形成される、例えばシリコン酸化膜からなる絶縁膜、(
6)はこの絶縁膜15)に形成され一上記ソース(4a
)、ドレイン(4b)の一部を露出させるように開口さ
れるコンタクトホール、(7)は上記基板(1)の露出
面に選択的に成長形成される、例えばタングステンより
なる選択成長膜、18)は素子間を分離し、上記基板(
1)上に形成され、例えば厚いシリコン酸化膜よりなる
フィールド酸化膜である。
半導体装置の製造工程fこおいて、形成した膜の膜厚測
定が行われるが、上記コンタクトホール(6)中での選
択成長膜(7)の膜厚を測定する場合、従来は、基板(
1)上のコンタクトホール(6)を有する部分をダイヤ
モンドカッター等を用いて分割し、得られた試料を走査
型電子顕微鏡にセットし、その断面形状を観察すること
で、上記選択成長膜(7)の膜厚を測定する方法がとら
れていた。この方法による測定では、基板は破壊される
ことになる。
定が行われるが、上記コンタクトホール(6)中での選
択成長膜(7)の膜厚を測定する場合、従来は、基板(
1)上のコンタクトホール(6)を有する部分をダイヤ
モンドカッター等を用いて分割し、得られた試料を走査
型電子顕微鏡にセットし、その断面形状を観察すること
で、上記選択成長膜(7)の膜厚を測定する方法がとら
れていた。この方法による測定では、基板は破壊される
ことになる。
ところで、基板(1)に形成された溝等の深さを非破壊
で検査できるものに、触針式段差計や、可視光を用いた
装置がある。前者は被測定部に針を当ててスキャンさせ
5段差寸法が測定できるものであり、後者は被測定部に
可視光を当て、そこから得られる反射干渉スペクトルを
解析することにより測定するものである。ここで−この
反射干渉スペクトルを用いて選択成長膜の膜厚を測定す
る場合を例にとる。これを第5図を参照にして説明すれ
ば、選択成長膜(7)の上面、絶縁膜(5)の上面、絶
縁膜(5)と基板(1)との界面からの反射光だけでな
く。
で検査できるものに、触針式段差計や、可視光を用いた
装置がある。前者は被測定部に針を当ててスキャンさせ
5段差寸法が測定できるものであり、後者は被測定部に
可視光を当て、そこから得られる反射干渉スペクトルを
解析することにより測定するものである。ここで−この
反射干渉スペクトルを用いて選択成長膜の膜厚を測定す
る場合を例にとる。これを第5図を参照にして説明すれ
ば、選択成長膜(7)の上面、絶縁膜(5)の上面、絶
縁膜(5)と基板(1)との界面からの反射光だけでな
く。
ゲート電極(3)上面からの反射光等さまざまな部分か
らの反射干渉スペクトルが混在することになる。
らの反射干渉スペクトルが混在することになる。
一方、ダイシングライン領域において、選択成長膜(7
)を測定する場合、ダイシングライン領域(I)の全面
にわたり形成された選択成長膜[61を測定することに
なる。
)を測定する場合、ダイシングライン領域(I)の全面
にわたり形成された選択成長膜[61を測定することに
なる。
以上のように一走査型電子顕微鏡を用いた測定の場合、
試料作りから測定までの測定作業が煩雑であるばかりで
なく、基板(1)を破壊しなければ測定できず、極めて
不経済なものであった。
試料作りから測定までの測定作業が煩雑であるばかりで
なく、基板(1)を破壊しなければ測定できず、極めて
不経済なものであった。
また、触針式段差計もしくは反射干渉スペクトルを解析
する装置を用いてコンタクトホール(6)中の選択成長
膜(7)の膜厚を測定する場合、第5図で示したように
コンタクトホール(6)の周辺における構造が極めて複
雑かつ段差も大きいため、ゲート電極(3)等の形状の
影響を受けて、選択成長膜(7)の膜厚のみを、これら
の方法を用いて精度良く測定することは不可能であり、
高信頼度の半導体装置を得ることができないという問題
点があった。
する装置を用いてコンタクトホール(6)中の選択成長
膜(7)の膜厚を測定する場合、第5図で示したように
コンタクトホール(6)の周辺における構造が極めて複
雑かつ段差も大きいため、ゲート電極(3)等の形状の
影響を受けて、選択成長膜(7)の膜厚のみを、これら
の方法を用いて精度良く測定することは不可能であり、
高信頼度の半導体装置を得ることができないという問題
点があった。
一方、ダイシングラインの部分(1)で選択成長膜の膜
厚を測定する場合、基板(1)の露出面積がコンタクト
ホール(6)とダイシングライン(1)では大きく異な
るため、ガスの供給量が両者に差ができ、成膜条件が違
ったものとなってしまう。このためコンタクトホール1
61とダイシングライン領域(1)とにおける選択成長
膜の膜厚は異なったものとなり、膜厚測定の精度は非常
に悪くなる。
厚を測定する場合、基板(1)の露出面積がコンタクト
ホール(6)とダイシングライン(1)では大きく異な
るため、ガスの供給量が両者に差ができ、成膜条件が違
ったものとなってしまう。このためコンタクトホール1
61とダイシングライン領域(1)とにおける選択成長
膜の膜厚は異なったものとなり、膜厚測定の精度は非常
に悪くなる。
この発明は、以上のような従来の問題点に鑑みてなされ
たもので、選択成長膜の膜厚を精度良く測定するための
測定領域が形成されるため、高信頼度化が図られる半導
体装置の製造方法を提供することを目的としている。
たもので、選択成長膜の膜厚を精度良く測定するための
測定領域が形成されるため、高信頼度化が図られる半導
体装置の製造方法を提供することを目的としている。
[課題を解決するための手段]
この発明に係る半導体装置の製造方法は、基板上に素子
形成領域と測定領域とを同一領域又は異なる領域に形成
する第1工程と、上記測定領域上に、上記素子形成領域
の所望膜厚が測定されるべきパターンと同じパターンを
形成する第2工程と、上記両領域に同時に選択成長膜を
形成する第3工程と、上記測定領域の膜厚を得る第4工
程とを含んでいる。
形成領域と測定領域とを同一領域又は異なる領域に形成
する第1工程と、上記測定領域上に、上記素子形成領域
の所望膜厚が測定されるべきパターンと同じパターンを
形成する第2工程と、上記両領域に同時に選択成長膜を
形成する第3工程と、上記測定領域の膜厚を得る第4工
程とを含んでいる。
この発明における測定領域は、平坦となされた基板上に
形成されており、かつ、素子形成領域の測定すべき部分
と同パターンとなるように形成されている。従って、測
定領域に形成される選択成長膜を測定することによって
、上記素子形成領域における測定すべき部分の膜厚を高
精度に知ることが可能となる。
形成されており、かつ、素子形成領域の測定すべき部分
と同パターンとなるように形成されている。従って、測
定領域に形成される選択成長膜を測定することによって
、上記素子形成領域における測定すべき部分の膜厚を高
精度に知ることが可能となる。
以下、この発明の一実施例を図について説明する。なお
従来の技術の説明と重複する部分は、適宜その説明を省
略する。
従来の技術の説明と重複する部分は、適宜その説明を省
略する。
第1図はこの発明の一実施例による測定領域が形成され
るウェハの全体を示す図、第2図はyg1図に示すもの
のA部拡大図、第3図は第2図夏−厘における断面図で
ある。
るウェハの全体を示す図、第2図はyg1図に示すもの
のA部拡大図、第3図は第2図夏−厘における断面図で
ある。
図において(IHI)およびfil +51 f7+は
従来のものと同一のもの、11αは半導体装置となる複
数のチップが配列されるウェハ、11Dはダイシングラ
イン(1)領域に形成され、測定領域となるコンタクト
ホールである。
従来のものと同一のもの、11αは半導体装置となる複
数のチップが配列されるウェハ、11Dはダイシングラ
イン(1)領域に形成され、測定領域となるコンタクト
ホールである。
次に、このように構成される半導体装置の製造方法につ
いて第4図(A)〜0を参照しながら説明する。第4図
において(1)および(1)は第5図に示すものと同じ
ように、半導体装tσとなる領域、およびダイシングラ
イン領域である。
いて第4図(A)〜0を参照しながら説明する。第4図
において(1)および(1)は第5図に示すものと同じ
ように、半導体装tσとなる領域、およびダイシングラ
イン領域である。
まず第4図(5)に示すように一基板(1)上に、例え
ば選択酸化法によりフィールド酸化膜(8)を形成し−
その後、例えば薄いシリコン酸化膜、ドープト多結晶シ
リコン膜を順次形成する。続いて、これらの膜をバター
ニングにより順次選択的に除去し、上記フィールド酸化
膜(8)の内央部にゲート電極(2)。
ば選択酸化法によりフィールド酸化膜(8)を形成し−
その後、例えば薄いシリコン酸化膜、ドープト多結晶シ
リコン膜を順次形成する。続いて、これらの膜をバター
ニングにより順次選択的に除去し、上記フィールド酸化
膜(8)の内央部にゲート電極(2)。
ゲート絶縁膜(3)を形成する。この後、上記ゲート電
極(2)をマスクとして上記基板(1)上Iこ、イオン
注入等により不純物を注入し、熱処理を施し、ソース(
4a)及びドレイン(4b)を形成する。このとき、ダ
イシングライン領域(1)は、基板(1)表面が露出さ
れた状態となっている。
極(2)をマスクとして上記基板(1)上Iこ、イオン
注入等により不純物を注入し、熱処理を施し、ソース(
4a)及びドレイン(4b)を形成する。このとき、ダ
イシングライン領域(1)は、基板(1)表面が露出さ
れた状態となっている。
次に第4図(5)に示すように、上記基板(1)上の全
面に、上記ゲート電極12)を被覆するように、この場
合、シリコン酸化膜よりなる絶縁膜(5)をCVD法等
により所定膜厚に形成する。
面に、上記ゲート電極12)を被覆するように、この場
合、シリコン酸化膜よりなる絶縁膜(5)をCVD法等
により所定膜厚に形成する。
次いで、第4図(qに示すように、上記絶縁膜(5)を
反応性イオンエツチング法等により選択的に除去する。
反応性イオンエツチング法等により選択的に除去する。
これにより一半導体装置となる領域(1)では−ソース
(4a)、ドレインの一部が露出するように開口され、
またダイシングライン領域(1)では、上記基板(1)
の一部が露出するように開口される。このとき、測定領
域となるコンタクトホールf111の平面形状は、半導
体装置となる領域(1)に形成されたコンタクトホール
(6)と同じ寸法となされている。また、この場合、上
記パターンの配置密度は上記コンタクトホール(6)形
成部分とほぼ同じとなっている。
(4a)、ドレインの一部が露出するように開口され、
またダイシングライン領域(1)では、上記基板(1)
の一部が露出するように開口される。このとき、測定領
域となるコンタクトホールf111の平面形状は、半導
体装置となる領域(1)に形成されたコンタクトホール
(6)と同じ寸法となされている。また、この場合、上
記パターンの配置密度は上記コンタクトホール(6)形
成部分とほぼ同じとなっている。
次に、第4図0に示すように1例えば、六フッ化タング
ステンガス及びシランガスを用いたCVD法で処理する
ことにより、上記基板(1)の露出面に、この場合タン
グステン膜(5)が選択的に成長される。このとき、上
記タングステン膜(5)は、上記半導体装置となる領域
(1)のコンタクトホール(6)と、上記ダイシングラ
インとなる領域(1)のコンタクトホールIllとに、
はぼ同条件で選択成長されることになる。このように、
上記ダイシングライン領域(1)に形成したコンタクト
ホールが平坦な基板(1)上に形成されることになり、
複雑な構造とはなっていない。このため−その領域を用
いて膜厚測定を行なう場合、段差状態1こよる影響が回
避されるばかりか、可視光を照射した場合には、多重反
射の影響が回避されることになる。従って、反射干渉ス
ペクトルを利用した嘆厚測定装置を用いてコンタクトホ
ール(111中の選択成長膜(7)の膜厚を高精度で測
定することが可能となる。また同様に触針式段差針を用
いても、上記選択成長膜(7)の膜厚を高精度に測定す
ることができる。
ステンガス及びシランガスを用いたCVD法で処理する
ことにより、上記基板(1)の露出面に、この場合タン
グステン膜(5)が選択的に成長される。このとき、上
記タングステン膜(5)は、上記半導体装置となる領域
(1)のコンタクトホール(6)と、上記ダイシングラ
インとなる領域(1)のコンタクトホールIllとに、
はぼ同条件で選択成長されることになる。このように、
上記ダイシングライン領域(1)に形成したコンタクト
ホールが平坦な基板(1)上に形成されることになり、
複雑な構造とはなっていない。このため−その領域を用
いて膜厚測定を行なう場合、段差状態1こよる影響が回
避されるばかりか、可視光を照射した場合には、多重反
射の影響が回避されることになる。従って、反射干渉ス
ペクトルを利用した嘆厚測定装置を用いてコンタクトホ
ール(111中の選択成長膜(7)の膜厚を高精度で測
定することが可能となる。また同様に触針式段差針を用
いても、上記選択成長膜(7)の膜厚を高精度に測定す
ることができる。
このように、半導体装置となる領域(1)におけるソー
ス(4a)、ドレイン(4,b)上のコンタクトホール
(6)中に選択成長されたタングステン膜(7)の膜厚
は、ダイシングラインとなる領域(1)の基板(1)上
のコンタクトホール(IHI中に同時に形成されたタン
グステン膜(7)の膜厚を高精度で測定することによっ
て知ることができる。従って高精度な膜厚制御を行なう
ことができるようになり、半導体装置の高信頼度化を図
ることが可能となる。
ス(4a)、ドレイン(4,b)上のコンタクトホール
(6)中に選択成長されたタングステン膜(7)の膜厚
は、ダイシングラインとなる領域(1)の基板(1)上
のコンタクトホール(IHI中に同時に形成されたタン
グステン膜(7)の膜厚を高精度で測定することによっ
て知ることができる。従って高精度な膜厚制御を行なう
ことができるようになり、半導体装置の高信頼度化を図
ることが可能となる。
なお、上記一実施例の説明において、選択成長膜(7)
の測定領域をダイシングライン領域(1)の所定部に形
成した場合について述べたが、これに限定されず、ウェ
ハflGに複数配列される半導体装置となる領域(1)
の一部に上記測定領域を一つまたは複数配置させたもの
であってもよく、また、上記測定領域を上記半導体装置
となる領域(1)の中に含めたものとしても良い。
の測定領域をダイシングライン領域(1)の所定部に形
成した場合について述べたが、これに限定されず、ウェ
ハflGに複数配列される半導体装置となる領域(1)
の一部に上記測定領域を一つまたは複数配置させたもの
であってもよく、また、上記測定領域を上記半導体装置
となる領域(1)の中に含めたものとしても良い。
また、上記一実施例においてはコンタクトホール(6)
中にタングステン膜(7)を選択成長させた場合lこつ
いて述べたが、層間配線を行なうスルーホール中にタン
グステン膜を選択成長させたときの膜厚測定の場合にも
遠用され、上記と同様の効果を奏する。
中にタングステン膜(7)を選択成長させた場合lこつ
いて述べたが、層間配線を行なうスルーホール中にタン
グステン膜を選択成長させたときの膜厚測定の場合にも
遠用され、上記と同様の効果を奏する。
以上のように、この発明によれば、基板上に素子形成領
域と測定領域とを形成し、上記測定領域において、素子
形成領域と同時に選択成長された膜の膜厚を高精度に測
定することにより、上記素子形成領域における所望の選
択成長膜の膜厚を得るようになされているため、高精度
な膜厚測定が可能となり、半導体装置の高信頼度化が図
れる効果がある。
域と測定領域とを形成し、上記測定領域において、素子
形成領域と同時に選択成長された膜の膜厚を高精度に測
定することにより、上記素子形成領域における所望の選
択成長膜の膜厚を得るようになされているため、高精度
な膜厚測定が可能となり、半導体装置の高信頼度化が図
れる効果がある。
第1図は、この発明の一実施例によるウェハの全体を示
す図、第2図は第1図のA部拡大図−第3図は′@2図
の冨−璽における断面図である。第4図(A)〜0は、
この発明の一実施例による半導体装置の製造方法を示す
断面図、第5図は従来の半導体装置を示す図である。 図において、(1)は半導体装置となる領域、(1)は
ダイシングラインの領域、(1)は基板、(6)はコン
タクトホール、(7)は選択成長膜、 (IGはウェハ
、fillはコンタクトホールである。 なお、各図中同一符号は同一または相当部分を示す。
す図、第2図は第1図のA部拡大図−第3図は′@2図
の冨−璽における断面図である。第4図(A)〜0は、
この発明の一実施例による半導体装置の製造方法を示す
断面図、第5図は従来の半導体装置を示す図である。 図において、(1)は半導体装置となる領域、(1)は
ダイシングラインの領域、(1)は基板、(6)はコン
タクトホール、(7)は選択成長膜、 (IGはウェハ
、fillはコンタクトホールである。 なお、各図中同一符号は同一または相当部分を示す。
Claims (1)
- 半導体基板上に素子形成領域と測定領域とが同一領域又
は異なる領域に形成される第1工程と、上記測定領域に
上記素子形成領域の所望膜厚が測定されるべきパターン
と同じパターンを形成する第2工程と、上記両領域に同
時に化学気相成長法による選択成長膜を形成する第3工
程と、上記測定領域の膜厚測定を行なうことにより上記
素子形成領域の所望部の膜厚を得る第4工程とを含む半
導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25232188A JPH0298955A (ja) | 1988-10-06 | 1988-10-06 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25232188A JPH0298955A (ja) | 1988-10-06 | 1988-10-06 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0298955A true JPH0298955A (ja) | 1990-04-11 |
Family
ID=17235632
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP25232188A Pending JPH0298955A (ja) | 1988-10-06 | 1988-10-06 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0298955A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6733619B2 (en) * | 1998-11-08 | 2004-05-11 | Nova Measuring Instruments Ltd. | Apparatus for integrated monitoring of wafers and for process control in semiconductor manufacturing and a method for use thereof |
US6791686B1 (en) | 2000-07-26 | 2004-09-14 | Nova Measuring Instruments Ltd. | Apparatus for integrated monitoring of wafers and for process control in the semiconductor manufacturing and a method for use thereof |
WO2005093875A1 (en) * | 2004-03-18 | 2005-10-06 | Eastman Kodak Company | Monitoring the deposition properties of an oled |
JPWO2013176222A1 (ja) * | 2012-05-24 | 2016-01-14 | 株式会社ニコン | 基板処理装置、及びデバイス製造方法 |
-
1988
- 1988-10-06 JP JP25232188A patent/JPH0298955A/ja active Pending
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US7214554B2 (en) | 2004-03-18 | 2007-05-08 | Eastman Kodak Company | Monitoring the deposition properties of an OLED |
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JP2018067717A (ja) * | 2012-05-24 | 2018-04-26 | 株式会社ニコン | 基板処理方法 |
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