JPH0284345U - - Google Patents
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- Publication number
- JPH0284345U JPH0284345U JP16307788U JP16307788U JPH0284345U JP H0284345 U JPH0284345 U JP H0284345U JP 16307788 U JP16307788 U JP 16307788U JP 16307788 U JP16307788 U JP 16307788U JP H0284345 U JPH0284345 U JP H0284345U
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- JP
- Japan
- Prior art keywords
- tri
- resistor
- package
- pull
- driver chip
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- Pending
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- 239000004065 semiconductor Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
Landscapes
- Semiconductor Integrated Circuits (AREA)
Description
第1図は本考案の実施例に係る半導体装置の構
成を示す図である。 1:パツケージ、2:トライステートドライバ
チツプ、3:出力配線パタン、4:プルアツプ抵
抗、5:出力端子、6:VCC端子、7:配線パ
タン、8:GND端子、9:入力端子、10:絶
縁物。
成を示す図である。 1:パツケージ、2:トライステートドライバ
チツプ、3:出力配線パタン、4:プルアツプ抵
抗、5:出力端子、6:VCC端子、7:配線パ
タン、8:GND端子、9:入力端子、10:絶
縁物。
Claims (1)
- パツケージにトライステートドライバチツプを
実装した半導体装置において、上記パツケージに
プルアツプ抵抗を内蔵するとともに、該プルアツ
プ抵抗をトライステートドライバチツプからの配
線経路に接続したことを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16307788U JPH0284345U (ja) | 1988-12-16 | 1988-12-16 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16307788U JPH0284345U (ja) | 1988-12-16 | 1988-12-16 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0284345U true JPH0284345U (ja) | 1990-06-29 |
Family
ID=31447478
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16307788U Pending JPH0284345U (ja) | 1988-12-16 | 1988-12-16 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0284345U (ja) |
-
1988
- 1988-12-16 JP JP16307788U patent/JPH0284345U/ja active Pending