JPH0272790A - ループ検出回路 - Google Patents
ループ検出回路Info
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- JPH0272790A JPH0272790A JP22414988A JP22414988A JPH0272790A JP H0272790 A JPH0272790 A JP H0272790A JP 22414988 A JP22414988 A JP 22414988A JP 22414988 A JP22414988 A JP 22414988A JP H0272790 A JPH0272790 A JP H0272790A
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- 238000001514 detection method Methods 0.000 claims description 13
- 238000012544 monitoring process Methods 0.000 description 9
- 238000010586 diagram Methods 0.000 description 5
- 101000634404 Datura stramonium Tropinone reductase 1 Proteins 0.000 description 1
- 101000848007 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) Thioredoxin-1 Proteins 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000005236 sound signal Effects 0.000 description 1
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- Monitoring And Testing Of Exchanges (AREA)
- Interface Circuits In Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
加入者回路において加入者のループを検出する回路に関
し、 電源障害等によってコンパレータに供給すべき電源が与
えられなかったときでもループありと誤判定することが
ないループ検出回路を提供することを目的として オンフックとオフフックに応じて大きさが変化する入力
電圧を−入力に閾値電圧を＋入力に与えられ第１の電源
電圧と該第２の電源電圧より作る第２の電源電圧を供給
されるコンパレータと、該コンパレータの出力をベース
に与えられエミッタに第１の電源電圧を供給されるＮＰ
ＮＩ−ランジスタと、該Ｎ Ｐ Ｎ ＋−ランジスタの
コレクタ出力をベースに与えられエミッタを接地された
ＰＮＰ トランジスタとを備え、該Ｐ、ＮＰｌ−ランジ
スタのコレクタからオンフックとオフフッタに応じてハ
イレベルとローレベルとに変化する出力を得ることによ
って構成する。
し、 電源障害等によってコンパレータに供給すべき電源が与
えられなかったときでもループありと誤判定することが
ないループ検出回路を提供することを目的として オンフックとオフフックに応じて大きさが変化する入力
電圧を−入力に閾値電圧を＋入力に与えられ第１の電源
電圧と該第２の電源電圧より作る第２の電源電圧を供給
されるコンパレータと、該コンパレータの出力をベース
に与えられエミッタに第１の電源電圧を供給されるＮＰ
ＮＩ−ランジスタと、該Ｎ Ｐ Ｎ ＋−ランジスタの
コレクタ出力をベースに与えられエミッタを接地された
ＰＮＰ トランジスタとを備え、該Ｐ、ＮＰｌ−ランジ
スタのコレクタからオンフックとオフフッタに応じてハ
イレベルとローレベルとに変化する出力を得ることによ
って構成する。
本発明は時分割交換機等における加入者回路において加
入者のループを検出する回路に係り、特に電源障害時に
おけるループ検出の誤出力を防止したループ検出回路に
関するものである。
入者のループを検出する回路に係り、特に電源障害時に
おけるループ検出の誤出力を防止したループ検出回路に
関するものである。
時分割交換機等における加入者回路においては、ループ
検出回路を備え加入者のオンフック、オフフックを検ｄ
口、て交換機側の制御を行う。
検出回路を備え加入者のオンフック、オフフックを検ｄ
口、て交換機側の制御を行う。
このようなループ検出回路は、電源の障害時にオフフッ
クと誤判定して出力を発生することがないものであるこ
とが要望される。
クと誤判定して出力を発生することがないものであるこ
とが要望される。
第２図は時分割交換機の加入者回路の概略構成をブロッ
ク図によって示したものである。同図において置は電話
機を示し端子Ｔ、Ｒを経て加入者回路側に接続される。
ク図によって示したものである。同図において置は電話
機を示し端子Ｔ、Ｒを経て加入者回路側に接続される。
加入者回路側においてリンガ−リレー接点ｒ１１．ｒ１
２は呼出時リンガー回路Ｒを電話機側に接続し、リンガ
−回路Ｒは呼出信号を電話機に対して送出する。通話時
には電話機はリンガ−リレー接点ｒｌｌ、ｒ１２を経て
給電回路Ｂに接続されて直流電流を供給される。電話機
における２線回線の音声信号は２線〜４線変換回路Ｉ４
を経て４１Ｊ３１回線の信号に変換され、コーディフク
Ｃにおいて符号化／復号化されてネットワークＮＷと接
続される。
２は呼出時リンガー回路Ｒを電話機側に接続し、リンガ
−回路Ｒは呼出信号を電話機に対して送出する。通話時
には電話機はリンガ−リレー接点ｒｌｌ、ｒ１２を経て
給電回路Ｂに接続されて直流電流を供給される。電話機
における２線回線の音声信号は２線〜４線変換回路Ｉ４
を経て４１Ｊ３１回線の信号に変換され、コーディフク
Ｃにおいて符号化／復号化されてネットワークＮＷと接
続される。
給電回ｔ！ｌからは、加入者のオンフック、オフフック
に応じてｆｆ１３図に示すように大きさが変化する信号
Ｖｉが出力される。監視回路Ｓは信号■ｉを閾値電圧ｖ
ｔｈと比較することによってループ検出を行い、加入者
のオンフック、オフフックに応じて“■４”と“Ｌ”に
変化する監視信号ＳＣＮを発生する。制御回路は信号Ｓ
Ｃ，Ｎに応じてネットワークＮＷを制御して所要の接
続動作を行わせる。なお監視回路Ｓはこれ以外にリンガ
−回路Ｒからの信号に応じて、加入者側におけるリング
トリップの検出を行う。
に応じてｆｆ１３図に示すように大きさが変化する信号
Ｖｉが出力される。監視回路Ｓは信号■ｉを閾値電圧ｖ
ｔｈと比較することによってループ検出を行い、加入者
のオンフック、オフフックに応じて“■４”と“Ｌ”に
変化する監視信号ＳＣＮを発生する。制御回路は信号Ｓ
Ｃ，Ｎに応じてネットワークＮＷを制御して所要の接
続動作を行わせる。なお監視回路Ｓはこれ以外にリンガ
−回路Ｒからの信号に応じて、加入者側におけるリング
トリップの検出を行う。
第４図は従来のループ検出回路を示したものであって、
ＣＭＰはコンパレータ、ＴＲＩ、ＴＲ２はＮ Ｐ Ｎ
トランジスタ、Ｄｌはダイオード、Ｒ１−Ｒ４は抵抗で
ある。
ＣＭＰはコンパレータ、ＴＲＩ、ＴＲ２はＮ Ｐ Ｎ
トランジスタ、Ｄｌはダイオード、Ｒ１−Ｒ４は抵抗で
ある。
第４図においてコンパレータＣＭＰには電源電圧として
−ＶＤと−ＶＢＢ （〜ＶＤ＞−ＶＢＢ）が与えられて
いるとともに、入力信号■１を＋入力に、閾値電圧ｖｔ
ｈを−入力に与えられている。
−ＶＤと−ＶＢＢ （〜ＶＤ＞−ＶＢＢ）が与えられて
いるとともに、入力信号■１を＋入力に、閾値電圧ｖｔ
ｈを−入力に与えられている。
オンフック時にはＶｉ＞Ｖｔｈであり、従ってコンパ・
レータＣＭＰの出力電圧は−ＶＤ（例えば−２０Ｖ）と
なる、トランジスタＴＲＩはコレクタ側電源に＋ｖｃｃ
ｃ例えば＋５Ｖ）を、エミッタ側電源に−ＶＢＢ （
−４８Ｖ）を与えられており、従ってトランジスタＴＲ
Ｉはオンとなって抵抗Ｒ２およびダイオードＤ１．抵抗
Ｒ３に電流が流れ、トランジスタＴＲ２のベースは零電
位となる。従ってトランジスタＴＲ２はオフとなり、監
視信号ＳＣＮは”Ｈ”となって、ループなしくオンフッ
ク）を判定する。
レータＣＭＰの出力電圧は−ＶＤ（例えば−２０Ｖ）と
なる、トランジスタＴＲＩはコレクタ側電源に＋ｖｃｃ
ｃ例えば＋５Ｖ）を、エミッタ側電源に−ＶＢＢ （
−４８Ｖ）を与えられており、従ってトランジスタＴＲ
Ｉはオンとなって抵抗Ｒ２およびダイオードＤ１．抵抗
Ｒ３に電流が流れ、トランジスタＴＲ２のベースは零電
位となる。従ってトランジスタＴＲ２はオフとなり、監
視信号ＳＣＮは”Ｈ”となって、ループなしくオンフッ
ク）を判定する。
一方、オフフック時にはｖｔ＜ｖｔｈであって、コンパ
レータＣＭＰの出力電圧は−ＶＢＢとなる。
レータＣＭＰの出力電圧は−ＶＢＢとなる。
これによりトランジスタＴＲＩはオフとなり、Ａ点（ト
ランジスタＴＲＩのコレクタ）の電位は十■ＣＣとなる
。従ってトランジスタＴＲ２はオンとなり、抵抗Ｒ４を
経てトランジスタＴＲ２に電流が流れて監視信号ＳＣＮ
は“Ｌ”となって、ループあり （オフフッタ）を判定
する。
ランジスタＴＲＩのコレクタ）の電位は十■ＣＣとなる
。従ってトランジスタＴＲ２はオンとなり、抵抗Ｒ４を
経てトランジスタＴＲ２に電流が流れて監視信号ＳＣＮ
は“Ｌ”となって、ループあり （オフフッタ）を判定
する。
しかしながら第４図に示された従来のループ検出回路で
は、電源障害等によって＋ＶＣＣ＜例えば＋５Ｖ）は入
力されるが、コンパレータを動作させるための第１の電
源−ＶＢＢ （交換機電源）と第１の電源−ＶＢＢより
作る第２の電源−ＶＤが入力されないときは、コンパレ
ータＣＭＰは動作せず従ってトランジスタＴＲＩはオフ
となるため、Ａ点の電位は十■ＣＣとなってトランジス
タＴＲ２がオンとなり、そのため監視信号ＳＣＮは常に
“Ｌ”となってオンフックの場合もループあり （オフ
フッタ）と誤判定する。
は、電源障害等によって＋ＶＣＣ＜例えば＋５Ｖ）は入
力されるが、コンパレータを動作させるための第１の電
源−ＶＢＢ （交換機電源）と第１の電源−ＶＢＢより
作る第２の電源−ＶＤが入力されないときは、コンパレ
ータＣＭＰは動作せず従ってトランジスタＴＲＩはオフ
となるため、Ａ点の電位は十■ＣＣとなってトランジス
タＴＲ２がオンとなり、そのため監視信号ＳＣＮは常に
“Ｌ”となってオンフックの場合もループあり （オフ
フッタ）と誤判定する。
本発明はこのような従来技術の課題を解決しようとする
ものであって、電源障害等によってコンパレータに供給
すべき電源が与えられなからたときでもループありと誤
判定することがないループ検出回路を）是供することを
目的としている。
ものであって、電源障害等によってコンパレータに供給
すべき電源が与えられなからたときでもループありと誤
判定することがないループ検出回路を）是供することを
目的としている。
本発明のループ検出回路は第１図の実施例に示されるよ
うに、コンパレータＣＭＰと、ＮＰＮ トランジスタＴ
ＲＩと、ＰＮＰ ！−ランジスタＴＲ２’とを備え、こ
のＰＮＰ トランジスタＴＲ２’のコレクタからオフフ
ックとオフフックに応じてハイレベルとローレベルとに
変化する出力を得るものである。ここで コンパレータＣＭＰは、オンフックとオフフックに応じ
て大きさが変化する入力電圧を−入力に閾値電圧を十入
力に与えられ、第１および第２の電源電圧（−ＶＢＢ、
−ＶＤ）（−ＶＤ＞−ＶＢＢ）を供給されるものである
。
うに、コンパレータＣＭＰと、ＮＰＮ トランジスタＴ
ＲＩと、ＰＮＰ ！−ランジスタＴＲ２’とを備え、こ
のＰＮＰ トランジスタＴＲ２’のコレクタからオフフ
ックとオフフックに応じてハイレベルとローレベルとに
変化する出力を得るものである。ここで コンパレータＣＭＰは、オンフックとオフフックに応じ
て大きさが変化する入力電圧を−入力に閾値電圧を十入
力に与えられ、第１および第２の電源電圧（−ＶＢＢ、
−ＶＤ）（−ＶＤ＞−ＶＢＢ）を供給されるものである
。
ＮＰＮ トランジスタＴＲ１は、このコンパレータＣＭ
Ｐの出力をベースに与えられエミッタに第１の電源電圧
（−ＶＢＢ）を供給されるものである。
Ｐの出力をベースに与えられエミッタに第１の電源電圧
（−ＶＢＢ）を供給されるものである。
ＰＮＰ ｌ−ランジスタＴＲ２’は、このＮＰＮトラン
ジスタＴＲＩのコレクタ出力をベースに与えられエミッ
タを接地されたものである。
ジスタＴＲＩのコレクタ出力をベースに与えられエミッ
タを接地されたものである。
コンパレータＣＭＰは、第２の電源電圧（−ＶＤ）と第
１の電源電圧（−ＶＢＢ）（ただし−ＶＤ＞−ＶＢＢ）
を供給されて動作するものであり、オンフックとオフフ
ックに応じて大きさが変化する入力電圧Ｖｉを−入力に
、閾値電圧ｖｔｈを十入力に与えられることに応じて、
入力電圧Ｖ ｉ ｆ）＜閾値電圧ｖｔｈより大きいか否
かに応じて−ＶＢＢまたは−ＶＤを出力として発生する
。
１の電源電圧（−ＶＢＢ）（ただし−ＶＤ＞−ＶＢＢ）
を供給されて動作するものであり、オンフックとオフフ
ックに応じて大きさが変化する入力電圧Ｖｉを−入力に
、閾値電圧ｖｔｈを十入力に与えられることに応じて、
入力電圧Ｖ ｉ ｆ）＜閾値電圧ｖｔｈより大きいか否
かに応じて−ＶＢＢまたは−ＶＤを出力として発生する
。
ＮＰＮＩ−ランジスタＴＲＩは、コレクタを抵抗Ｒ２を
経て電源＋■ＣＣに接続され、エミッタを第１の電源電
圧（−Ｖ Ｂ Ｂ）に接続されており、コンパレータＣ
ＭＰの出力が−ＶＢＢのときオフとなり、コンパレータ
ＣＭＰの出力が−ＶＤのときオンとなる。
経て電源＋■ＣＣに接続され、エミッタを第１の電源電
圧（−Ｖ Ｂ Ｂ）に接続されており、コンパレータＣ
ＭＰの出力が−ＶＢＢのときオフとなり、コンパレータ
ＣＭＰの出力が−ＶＤのときオンとなる。
ＰＮＰ ｌ−ランジスタＴＲ２’は、コレクタを抵抗Ｒ
４を経て電源＋■ＣＣに接続され、エミッタを接地され
ていて、ＮＰＮトランジスタＴＲＩがオフのときオフと
なり、ＮＰＮ トランジスタＴＲＩがオンのときオンと
なる。
４を経て電源＋■ＣＣに接続され、エミッタを接地され
ていて、ＮＰＮトランジスタＴＲＩがオフのときオフと
なり、ＮＰＮ トランジスタＴＲＩがオンのときオンと
なる。
これによってＰＮＰ トランジスタＴＲ２’の出力であ
る監視信号ＳＣＮは、オンフン、りのとき” Ｈｏとな
り、オフフックのとき”Ｌ”となる。従って監視信号Ｓ
ＣＮの１Ｈ”によってループなしが判定され、“Ｌ”に
よってループありか判定される。
る監視信号ＳＣＮは、オンフン、りのとき” Ｈｏとな
り、オフフックのとき”Ｌ”となる。従って監視信号Ｓ
ＣＮの１Ｈ”によってループなしが判定され、“Ｌ”に
よってループありか判定される。
電源障害によって第１の電源電圧（−ＶＢＢ）と第１の
電源電圧（、−ＶＢＢ）より作る第２の電源電圧（−Ｖ
Ｄ）が供給されないとき、コンパレータＣＭＰは動作
しないため、ＮＰＮ ！−ランジスタＴＲＩがオフとな
りＰＮＰ トランジスタＴＲ２’もオフとなるので、監
視信号ＳＣＮはＨ″となってループなしが判定され、ル
ープありの誤判定出力を発生することはない。
電源電圧（、−ＶＢＢ）より作る第２の電源電圧（−Ｖ
Ｄ）が供給されないとき、コンパレータＣＭＰは動作
しないため、ＮＰＮ ！−ランジスタＴＲＩがオフとな
りＰＮＰ トランジスタＴＲ２’もオフとなるので、監
視信号ＳＣＮはＨ″となってループなしが判定され、ル
ープありの誤判定出力を発生することはない。
第１図は本発明の一実施例の構成を示す図であって、第
４図におけると同じ部分を同じ符号で示し、第４図の場
合と比較してコンパレータＣＭＰにおける十入力端子と
−入力端子の関係が逆になっているとともに、ダイオー
ドＤＩを欠き、トランジスタＴＲ２° はＰＮＰＩ−ラ
ンジスタに代えられている。
４図におけると同じ部分を同じ符号で示し、第４図の場
合と比較してコンパレータＣＭＰにおける十入力端子と
−入力端子の関係が逆になっているとともに、ダイオー
ドＤＩを欠き、トランジスタＴＲ２° はＰＮＰＩ−ラ
ンジスタに代えられている。
オンフック時にはＶｔ＞Ｖｔｈであり、従ってコンパレ
ークＣＭＰの出力電圧は−ＶＢＢとなる。
ークＣＭＰの出力電圧は−ＶＢＢとなる。
これによりトランジスタＴＲＩはオフとなってＡ点の電
位は十■ＣＣとなるため、トランジスタＴＲ２°はオフ
となり、監視信号ＳＣＮは“Ｈ”となって、ループなし
くオンフック）を判定する。
位は十■ＣＣとなるため、トランジスタＴＲ２°はオフ
となり、監視信号ＳＣＮは“Ｈ”となって、ループなし
くオンフック）を判定する。
一方、オフフッタ時にはＶｉ＜Ｖｔｈであって、コンパ
レータＣＭＰの出力電圧は−ＶＤとなる。
レータＣＭＰの出力電圧は−ＶＤとなる。
従ってトランジスタＴＲＩはオンとなり、Ａ点の電位は
−ＶＢＢとなる。これによりトランジスタＴＲ２°はオ
ンとなり監視信号ＳＣＮは“Ｌ”となって、ループあり
（オフフック）を判定する。
−ＶＢＢとなる。これによりトランジスタＴＲ２°はオ
ンとなり監視信号ＳＣＮは“Ｌ”となって、ループあり
（オフフック）を判定する。
電源障害等によって十■ＣＣは入力されるが−ＶＢＢ、
−ＶＤが入力されないときは、コンパレータＣＭＰは動
作せず従ってトランジスタＴＲＩはオフとなるため、Ａ
点の電位は十■ＣＣとなってトランジスタＴＲ２″がオ
フとなるので、監視信号ＳＣＮは常に”Ｈ”となってル
ープなしくオンフック）を判定する。
−ＶＤが入力されないときは、コンパレータＣＭＰは動
作せず従ってトランジスタＴＲＩはオフとなるため、Ａ
点の電位は十■ＣＣとなってトランジスタＴＲ２″がオ
フとなるので、監視信号ＳＣＮは常に”Ｈ”となってル
ープなしくオンフック）を判定する。
以上説明したように本発明によれば、給電回路から入力
される、加入者のオンフック、オフフッタに応じて大き
さが変化する人力信号によって加入者回路のループの有
無を検出するループ検出回路において、入力信号の変化
を検出するコンパレータに供給すべき電源が与えられな
かったときでも、ループの有無を示す監視信号がループ
なしを判定する出力になるので、電源障害に基づくルー
プありの誤判定出力の発生を防止することができる。
される、加入者のオンフック、オフフッタに応じて大き
さが変化する人力信号によって加入者回路のループの有
無を検出するループ検出回路において、入力信号の変化
を検出するコンパレータに供給すべき電源が与えられな
かったときでも、ループの有無を示す監視信号がループ
なしを判定する出力になるので、電源障害に基づくルー
プありの誤判定出力の発生を防止することができる。
第１図は本発明の一実施例の構成を示す図、第２図は時
分割交換機の加入者回路の概略構成を示すブロック図、 第３図は給電回路から出力される信号Ｖｉの変化を示す
図、 第４図は従来のループ検出回路の構成を示す図である。 ＣＭＰ−・・コンパレータ ＴＲ１，ＴＲ２−ＮＰＮ ｌ−ランジスタＴＲ２’
−・・ＰＮＰトランジスタＤＩ・−ダイオード Ｒ１−Ｒ４−抵抗
分割交換機の加入者回路の概略構成を示すブロック図、 第３図は給電回路から出力される信号Ｖｉの変化を示す
図、 第４図は従来のループ検出回路の構成を示す図である。 ＣＭＰ−・・コンパレータ ＴＲ１，ＴＲ２−ＮＰＮ ｌ−ランジスタＴＲ２’
−・・ＰＮＰトランジスタＤＩ・−ダイオード Ｒ１−Ｒ４−抵抗
Claims (1)
- 【特許請求の範囲】 オンフックとオフフックに応じて大きさが変化する入力
電圧を−入力に閾値電圧を＋入力に与えられ第１の電源
電圧（−ＶＢＢ）と該第１の電源電圧（−ＶＢＢ）より
作る第２の電源電圧（−ＶＤ）（−ＶＤ＞−ＶＢＢ）を
供給されるコンパレータ（ＣＭＰ）と、 該コンパレータ（ＣＭＰ）の出力をベースに与えられエ
ミッタに第１の電源電圧（−ＶＢＢ）を供給されるＮＰ
Ｎトランジスタ（ＴＲ１）と、該ＮＰＮトランジスタ（
ＴＲ１）のコレクタ出力をベースに与えられエミッタを
接地されたＰＮＰトランジスタ（ＴＲ２’）とを備え、 該ＰＮＰトランジスタ（ＴＲ２’）のコレクタからオン
フックとオフフックに応じてハイレベルとローレベルと
に変化する出力を得ることを特徴とするループ検出回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22414988A JPH0272790A (ja) | 1988-09-07 | 1988-09-07 | ループ検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22414988A JPH0272790A (ja) | 1988-09-07 | 1988-09-07 | ループ検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0272790A true JPH0272790A (ja) | 1990-03-13 |
Family
ID=16809312
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22414988A Pending JPH0272790A (ja) | 1988-09-07 | 1988-09-07 | ループ検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0272790A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05219199A (ja) * | 1992-02-06 | 1993-08-27 | Nec Corp | 加入者回路 |
| JPH077545A (ja) * | 1993-06-15 | 1995-01-10 | Nec Corp | 加入者回路 |
-
1988
- 1988-09-07 JP JP22414988A patent/JPH0272790A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05219199A (ja) * | 1992-02-06 | 1993-08-27 | Nec Corp | 加入者回路 |
| JPH077545A (ja) * | 1993-06-15 | 1995-01-10 | Nec Corp | 加入者回路 |
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