JPH0241666A - トランジスタインバータ装置 - Google Patents
トランジスタインバータ装置Info
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- JPH0241666A JPH0241666A JP63191422A JP19142288A JPH0241666A JP H0241666 A JPH0241666 A JP H0241666A JP 63191422 A JP63191422 A JP 63191422A JP 19142288 A JP19142288 A JP 19142288A JP H0241666 A JPH0241666 A JP H0241666A
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- voltage
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- 238000001514 detection method Methods 0.000 claims description 20
- 238000009499 grossing Methods 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 7
- 230000000694 effects Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 230000001934 delay Effects 0.000 description 1
- 210000004072 lung Anatomy 0.000 description 1
- 229920006395 saturated elastomer Polymers 0.000 description 1
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- Control Of Ac Motors In General (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は電動機の回転数を任意に変化させるトランジス
タインバータ装置に関するものである。
タインバータ装置に関するものである。
従来の技術
近年、電動機の回転数を可変にし、各種機器の能力を減
少または増加させて使用するために、ト２ ・＼−７ ランジスタインバータ装置が多く利用されて来ている。
少または増加させて使用するために、ト２ ・＼−７ ランジスタインバータ装置が多く利用されて来ている。
従来の技術としては、例えば特開昭６２２４７７６６号
公報がある。
公報がある。
以下図面を参照しながら、上述したトランジスタインバ
ータ装置の一例について説明する。
ータ装置の一例について説明する。
第４図は、従来のトランジスタインバータ装置の概略構
成図である。第４図において、１は整流平滑回路で、交
流電源の直流化を行なっている。
成図である。第４図において、１は整流平滑回路で、交
流電源の直流化を行なっている。
２は主回路トランジスタ群で、トランジスタインバータ
装置の主回路を構成している。３，４はそれぞれ第１の
主回路トランジスタと第２の主回路トランジスタであシ
、１つのアームを構成している。５はモータで、前記主
回路トランジスタ群２の出力と接続されている。６は波
形発生部であり、前記主回路トランジスタ群２のベース
駆動信号を発生する。７はオンディレィ回路であり、前
記波形発生部６の出力のベース駆動信号にオンディレィ
時間を設ける。
装置の主回路を構成している。３，４はそれぞれ第１の
主回路トランジスタと第２の主回路トランジスタであシ
、１つのアームを構成している。５はモータで、前記主
回路トランジスタ群２の出力と接続されている。６は波
形発生部であり、前記主回路トランジスタ群２のベース
駆動信号を発生する。７はオンディレィ回路であり、前
記波形発生部６の出力のベース駆動信号にオンディレィ
時間を設ける。
ここで、前記オンディレィ回路について、さらに詳細に
述べる。前記第１の主回路トランジヌタ３ ヘ一７ ３と前記第２Ｃ主回路トランジスタ４は交互にオン、オ
フさせるが、そのスイッチング特性は、第６図のＴｏｆ
ｆで示すようにスイッチングの遅れがある。したがって
、前記第１の主回路トランジスタ３のオフと同時に、前
記第２の主回路トランジスタ４をオンさせたり、前記第
２の主回路トランジスタ４のオフと同時に、前記第１の
主回路トランジスタ３をオンさせると上下のトランジス
タが遅れ時間Ｔｏｆｆだけ同時にオンとなシ短絡状態と
なるためトランジスタが破壊する。したがって、第６図
のＴａのように、トランジスタのオンさせるタイミング
を遅らせるオンディレィ時間Ｔａを設けることにより、
同一アームの上下のトランジスタが同時にオンすること
がないように配慮する必要が有シ、このだめに前記オン
ディレィ回路１が不可欠である。
述べる。前記第１の主回路トランジヌタ３ ヘ一７ ３と前記第２Ｃ主回路トランジスタ４は交互にオン、オ
フさせるが、そのスイッチング特性は、第６図のＴｏｆ
ｆで示すようにスイッチングの遅れがある。したがって
、前記第１の主回路トランジスタ３のオフと同時に、前
記第２の主回路トランジスタ４をオンさせたり、前記第
２の主回路トランジスタ４のオフと同時に、前記第１の
主回路トランジスタ３をオンさせると上下のトランジス
タが遅れ時間Ｔｏｆｆだけ同時にオンとなシ短絡状態と
なるためトランジスタが破壊する。したがって、第６図
のＴａのように、トランジスタのオンさせるタイミング
を遅らせるオンディレィ時間Ｔａを設けることにより、
同一アームの上下のトランジスタが同時にオンすること
がないように配慮する必要が有シ、このだめに前記オン
ディレィ回路１が不可欠である。
以上のように構成されたトランジスタインバータ装置に
ついて、以下にその動作について説明する。
ついて、以下にその動作について説明する。
前記波形発生部６より出力されるベース駆動信号が、前
記オンディレィ回路７にて一定のオンディレィ時間Ｔａ
を持ち、前記主回路トランジスタ群２を駆動する。前記
主回路トランジスタ群２は３相交流電圧を出力し、前記
モータ５を運転する。
記オンディレィ回路７にて一定のオンディレィ時間Ｔａ
を持ち、前記主回路トランジスタ群２を駆動する。前記
主回路トランジスタ群２は３相交流電圧を出力し、前記
モータ５を運転する。
発明が解決しようとする課題
しかし、従来の構成では、オンティレイ時間が一定であ
るため、主回路トランジスタのコレクタ。
るため、主回路トランジスタのコレクタ。
エミッタ間の飽和電圧が飽和状態の時でも必要以上のオ
ンディレィ時間が設けられていることになり、トランジ
スタインバータ装置の出力電流の歪が大きくなり、モー
タ効率が低下し、モータ騒音が増加するという問題点が
あった。
ンディレィ時間が設けられていることになり、トランジ
スタインバータ装置の出力電流の歪が大きくなり、モー
タ効率が低下し、モータ騒音が増加するという問題点が
あった。
本発明は、上記欠点に鑑み、主回路トランジスタのコレ
クタ、エミッタ間の飽和電圧に応じ最適のオンディレィ
時間に制御してやることにより、モータを効率よく、又
低騒音に運転するトランジスタインバータ装置を提供す
ることを目的としている。
クタ、エミッタ間の飽和電圧に応じ最適のオンディレィ
時間に制御してやることにより、モータを効率よく、又
低騒音に運転するトランジスタインバータ装置を提供す
ることを目的としている。
課題を解決するだめの手段
この目的を達成するために本発明のトランジスタ
タインバータ装置は、トランジスタインバータの主回路
を構成する主回路トランジスタと、前記主回路トランジ
スタのコレクタ、エミッタ間の飽和電、圧を検出する電
圧検知回路と、前記主回路トランジスタのベース駆動信
号を発生する波形発生部と、前記電圧検知回路の出力信
号によって、前記波形発生部のベース駆動信号に設けた
オンディレィ時間を変化させるオンディレィ時間制御回
路から構成されている。
を構成する主回路トランジスタと、前記主回路トランジ
スタのコレクタ、エミッタ間の飽和電、圧を検出する電
圧検知回路と、前記主回路トランジスタのベース駆動信
号を発生する波形発生部と、前記電圧検知回路の出力信
号によって、前記波形発生部のベース駆動信号に設けた
オンディレィ時間を変化させるオンディレィ時間制御回
路から構成されている。
作 用
本発明は、上記した（７〜成によって電圧検知回路が主
回路トランジスタのコレクタ、エミッタ間の飽和電圧を
検知し、飽和電圧に応じてオンディレィ時間制御回路が
波形全生部出力のベース駆動信号に設けたオンディレィ
時間を最適になるように制御するため、トランジスタイ
ンバータ装置の出力電流の歪を低減できる。
回路トランジスタのコレクタ、エミッタ間の飽和電圧を
検知し、飽和電圧に応じてオンディレィ時間制御回路が
波形全生部出力のベース駆動信号に設けたオンディレィ
時間を最適になるように制御するため、トランジスタイ
ンバータ装置の出力電流の歪を低減できる。
実施例
以上本発明の一実施例のトランジスタインバータ置につ
いて、図面を参照しながら説明する。
いて、図面を参照しながら説明する。
６ ′＼−７
第１図は本発明の一実施例におけるトランジスタインバ
ータ装置の概略構成図である。第１図において、１は整
流平滑回路、２は主回路トランジスタ群、３は第１の主
回路トランジスタ、４は第２の主回路トランジスタ、５
はモータ、６は波形発生部で以上は第４図の構成と同じ
ものであるため詳細な説明を省略する。７は電圧検知回
路で、前記第１の主回路トランジスタ３のコレクタ、エ
ミッタ間の飽和電圧（以下Ｖｃｅ と呼ぶ）を検知し
、第２図に示すように、ＶＣｅＫ応じた信号Ｖａを出力
する。８はオンディレィ時間制御回路であり、前記電圧
検知回路７の出力信号Ｖａを端子ａ、前記波形発生部６
のベース駆動信号を端子すにて入力し、表１に示すよう
に前記電圧検知回路の出力信号ＶａすなわちＶｃｅ
に応じたオンディレィ時間Ｔｄをベース駆動信号に設け
て端子Ｃより出力する。
ータ装置の概略構成図である。第１図において、１は整
流平滑回路、２は主回路トランジスタ群、３は第１の主
回路トランジスタ、４は第２の主回路トランジスタ、５
はモータ、６は波形発生部で以上は第４図の構成と同じ
ものであるため詳細な説明を省略する。７は電圧検知回
路で、前記第１の主回路トランジスタ３のコレクタ、エ
ミッタ間の飽和電圧（以下Ｖｃｅ と呼ぶ）を検知し
、第２図に示すように、ＶＣｅＫ応じた信号Ｖａを出力
する。８はオンディレィ時間制御回路であり、前記電圧
検知回路７の出力信号Ｖａを端子ａ、前記波形発生部６
のベース駆動信号を端子すにて入力し、表１に示すよう
に前記電圧検知回路の出力信号ＶａすなわちＶｃｅ
に応じたオンディレィ時間Ｔｄをベース駆動信号に設け
て端子Ｃより出力する。
以上のように構成されたトランジスタインパーク装置に
ついて、以下第１図、第２図、第３図を用いてその動作
を説明する。捷ず、前記電圧検知回路７は、第３図に示
すように前記主回路）・ランジメタ群２のコレクタ電流
に応じて変化する前記第１の主回路トランジスタ３のコ
レクタ、エミッタ間の飽和電圧Ｖｃｅ の関係を利用
し電圧検知という安価な回路構成により負荷の状態を検
知し、第２図に示すようにｖＣｅに応じた信号Ｖａ を
出力する。前記オンディレィ時間制御回路８は信号Ｖａ
を端子ａにて入力し、表１に示すようにＶｃｅ１≦Ｖａ
ならば、オンディレィ時間Ｔｄ１Ｖｃｅ１≦■Ｃｅ≦ｖ
２ならばオンディレィ時間Ｔｄ２、Ｖａ≧ｖ２ならばオ
ンディレィ時間Ｔｄ３を端子すにて入力した前記波形発
生部６のベース駆動信号に設けて、端子Ｃ，ｌ：、！７
出力する。したがって、前記主回路トランジスタ群２は
常に最適のオンディレィ時開存する駆動信号によって駆
動され、前記モーフの出力電流波形の歪が低減し効率も
向上および低騒音での運転が可能となる。
ついて、以下第１図、第２図、第３図を用いてその動作
を説明する。捷ず、前記電圧検知回路７は、第３図に示
すように前記主回路）・ランジメタ群２のコレクタ電流
に応じて変化する前記第１の主回路トランジスタ３のコ
レクタ、エミッタ間の飽和電圧Ｖｃｅ の関係を利用
し電圧検知という安価な回路構成により負荷の状態を検
知し、第２図に示すようにｖＣｅに応じた信号Ｖａ を
出力する。前記オンディレィ時間制御回路８は信号Ｖａ
を端子ａにて入力し、表１に示すようにＶｃｅ１≦Ｖａ
ならば、オンディレィ時間Ｔｄ１Ｖｃｅ１≦■Ｃｅ≦ｖ
２ならばオンディレィ時間Ｔｄ２、Ｖａ≧ｖ２ならばオ
ンディレィ時間Ｔｄ３を端子すにて入力した前記波形発
生部６のベース駆動信号に設けて、端子Ｃ，ｌ：、！７
出力する。したがって、前記主回路トランジスタ群２は
常に最適のオンディレィ時開存する駆動信号によって駆
動され、前記モーフの出力電流波形の歪が低減し効率も
向上および低騒音での運転が可能となる。
以上のように本実施例によれば、前記オンディレィ時間
制御回路８が、前記電圧検知回路７からの信号により、
Ｖｃｅ の電圧に応じたオンディレィ時間をベース駆
動信号に設けるため、前記主回路トランジスタ群２は常
に最適のオンディレィ時間を有する駆動信号によって駆
動されることとなる。この結果、トランジスタインバー
タ装置の出力電流の波形歪が低減されるため、効率の良
いかつ低騒音なトランジスタインバータ装置が安価な回
路構成である電圧検知回路にて実現されることとなる。
制御回路８が、前記電圧検知回路７からの信号により、
Ｖｃｅ の電圧に応じたオンディレィ時間をベース駆
動信号に設けるため、前記主回路トランジスタ群２は常
に最適のオンディレィ時間を有する駆動信号によって駆
動されることとなる。この結果、トランジスタインバー
タ装置の出力電流の波形歪が低減されるため、効率の良
いかつ低騒音なトランジスタインバータ装置が安価な回
路構成である電圧検知回路にて実現されることとなる。
なお、本発明は、この実施例に限ることなく複数の前記
電圧検知回路７にて前記主回路１−ランジスタ群２の検
知を行なった場合でも本発明の主旨９ ヘーノ を逸脱しない範囲で有効である。
電圧検知回路７にて前記主回路１−ランジスタ群２の検
知を行なった場合でも本発明の主旨９ ヘーノ を逸脱しない範囲で有効である。
発明の効果
以上のように本発明のトランジスタインバータ装置は、
トランジスタインバータの主回路を構成する主回路トラ
ンジスタと、前記主回路トランジスタのコレクタ、エミ
ッタ間の飽和電圧を検出する電圧検知回路と、前記主回
路トランジスタのベス駆動信号を発生する波形発生部と
、前記電圧検知回路の出力信号によって、前記波形発生
部のベース駆動信号に設けたオンディレィ時間を変化さ
せるオンディレィ時間制御回路から構成されることによ
シ、電圧検知回路が主回路トランジスタのコレクタ、エ
ミッタ間の飽和電圧を検知し、飽和電、圧に応じてオン
ディレィ時間制御回路が波形発生部出力のベース駆動信
号に設けたオンディレィ時間を最適になるように制御す
るため、常に最適のベース駆動信号にて駆動され、トラ
ンジスタインバータ装置の出力電流の歪を低減でき、モ
ーノを効率よく、又低騒音で運転できることとなる。
トランジスタインバータの主回路を構成する主回路トラ
ンジスタと、前記主回路トランジスタのコレクタ、エミ
ッタ間の飽和電圧を検出する電圧検知回路と、前記主回
路トランジスタのベス駆動信号を発生する波形発生部と
、前記電圧検知回路の出力信号によって、前記波形発生
部のベース駆動信号に設けたオンディレィ時間を変化さ
せるオンディレィ時間制御回路から構成されることによ
シ、電圧検知回路が主回路トランジスタのコレクタ、エ
ミッタ間の飽和電圧を検知し、飽和電、圧に応じてオン
ディレィ時間制御回路が波形発生部出力のベース駆動信
号に設けたオンディレィ時間を最適になるように制御す
るため、常に最適のベース駆動信号にて駆動され、トラ
ンジスタインバータ装置の出力電流の歪を低減でき、モ
ーノを効率よく、又低騒音で運転できることとなる。
またその回路構成もＶｃｅ 電圧検知という安価な１
〇 八−／ 構成で実現でき、その実用的効果はきわめて大なるもの
がある。
〇 八−／ 構成で実現でき、その実用的効果はきわめて大なるもの
がある。
第１図は本発明の一実施例におけるトランジスタインバ
ータ装置の概略構成図、第２図はコレクタ電流とＶｃｅ
の動作特性図、第３図は電圧検知回路の動作特性図、
第４図は従来のトランジスタインバータ装置の概略構成
図、第５図は第４図の主回路トランジスタのヌイソｆン
グ遅れのグイムチヤード、第６図は第４図のトランジス
タブリッジアームすなわち」ユニのトランジスタにおけ
る制御信号のオンディレィのタイムチャートである。 ３・・・・・・第１の主回路トランジスタ、４・・・・
・・第２の主回路トランジスタ、６・・・・・・波形発
生部、７・・・・・・電圧検知回路、８・・・・・・オ
ンディレィ時間制御回路。 代理人の氏名 弁理士 粟 野 重 孝 ほか１名図 ？＃１都信子 信号ンジスタ しカ Ｌツノ 図 ぶ史信号 、ｆ２．＞主ＭＪ蕗 トランシ”ズタ 、ｉｓ倍信 号４２９−
ータ装置の概略構成図、第２図はコレクタ電流とＶｃｅ
の動作特性図、第３図は電圧検知回路の動作特性図、
第４図は従来のトランジスタインバータ装置の概略構成
図、第５図は第４図の主回路トランジスタのヌイソｆン
グ遅れのグイムチヤード、第６図は第４図のトランジス
タブリッジアームすなわち」ユニのトランジスタにおけ
る制御信号のオンディレィのタイムチャートである。 ３・・・・・・第１の主回路トランジスタ、４・・・・
・・第２の主回路トランジスタ、６・・・・・・波形発
生部、７・・・・・・電圧検知回路、８・・・・・・オ
ンディレィ時間制御回路。 代理人の氏名 弁理士 粟 野 重 孝 ほか１名図 ？＃１都信子 信号ンジスタ しカ Ｌツノ 図 ぶ史信号 、ｆ２．＞主ＭＪ蕗 トランシ”ズタ 、ｉｓ倍信 号４２９−
Claims (1)
- トランジスタインバータの主回路を構成する主回路トラ
ンジスタと、前記主回路トランジスのコレクタ、エミッ
タ間飽和電圧の変化を検知する電圧検知回路と、前記主
回路トランジスタのベース駆動信号を発生する波形発生
部と、前記電圧検知回路の出力信号に応じて、前記波形
発生部の出力であるベース駆動信号に設けたオンディレ
ィ時間を変化させるオンディレィ時間制御回路とを備え
たことを特徴とするトランジスタインバータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63191422A JPH0241666A (ja) | 1988-07-29 | 1988-07-29 | トランジスタインバータ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63191422A JPH0241666A (ja) | 1988-07-29 | 1988-07-29 | トランジスタインバータ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0241666A true JPH0241666A (ja) | 1990-02-09 |
Family
ID=16274351
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63191422A Pending JPH0241666A (ja) | 1988-07-29 | 1988-07-29 | トランジスタインバータ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0241666A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009165209A (ja) * | 2007-12-28 | 2009-07-23 | Mabuchi Motor Co Ltd | 有ブラシｄｃモータのケース蓋組立体 |
| KR20210072091A (ko) | 2018-12-25 | 2021-06-16 | 히다치 아스테모 가부시키가이샤 | 완충기 |
| KR20220003072A (ko) | 2019-06-26 | 2022-01-07 | 히다치 아스테모 가부시키가이샤 | 완충기 |
| KR20230003196A (ko) | 2020-07-29 | 2023-01-05 | 히다치 아스테모 가부시키가이샤 | 완충기 |
| KR20230008789A (ko) | 2020-07-29 | 2023-01-16 | 히다치 아스테모 가부시키가이샤 | 완충기 |
| DE112021004065T5 (de) | 2020-07-29 | 2023-05-17 | Hitachi Astemo, Ltd. | Stoßdämpfer |
| KR20240042535A (ko) | 2021-12-24 | 2024-04-02 | 히다치 아스테모 가부시키가이샤 | 감쇠력 발생 장치 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6143792B2 (ja) * | 1980-08-22 | 1986-09-30 | Mitsubishi Electric Corp |
-
1988
- 1988-07-29 JP JP63191422A patent/JPH0241666A/ja active Pending
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| JPS6143792B2 (ja) * | 1980-08-22 | 1986-09-30 | Mitsubishi Electric Corp |
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| US8368280B2 (en) | 2007-12-28 | 2013-02-05 | Mabuchi Motor Co., Ltd. | Case lid assembly of DC motor with brush |
| KR20210072091A (ko) | 2018-12-25 | 2021-06-16 | 히다치 아스테모 가부시키가이샤 | 완충기 |
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| DE112020003042T5 (de) | 2019-06-26 | 2022-05-05 | Hitachi Astemo, Ltd. | Stossdämpfer |
| KR20230003196A (ko) | 2020-07-29 | 2023-01-05 | 히다치 아스테모 가부시키가이샤 | 완충기 |
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