JPH0238885A - 振動子アレイの駆動回路 - Google Patents
振動子アレイの駆動回路Info
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- JPH0238885A JPH0238885A JP19101588A JP19101588A JPH0238885A JP H0238885 A JPH0238885 A JP H0238885A JP 19101588 A JP19101588 A JP 19101588A JP 19101588 A JP19101588 A JP 19101588A JP H0238885 A JPH0238885 A JP H0238885A
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- 230000003111 delayed effect Effects 0.000 abstract description 4
- 230000002194 synthesizing effect Effects 0.000 abstract description 2
- 238000010276 construction Methods 0.000 abstract 1
- 239000000126 substance Substances 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 5
- 230000010355 oscillation Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000000737 periodic effect Effects 0.000 description 1
- 230000005855 radiation Effects 0.000 description 1
Landscapes
- Measurement Of Velocity Or Position Using Acoustic Or Ultrasonic Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、振動子アレイより放射する超音波ビームを
スキ４−ンさせるための駆動回路に関する。
スキ４−ンさせるための駆動回路に関する。
［従来の技術］
この種の駆動回路を第３図に示している。
発振回路Ｉからのクロックを分周器２にて所定のクロッ
クＣＫに分周し、その分周したクロックＣＫをカウンタ
ー３でカウントしており、そのカウント値が読み出し専
用メモリ（ＲＯＭ） ４の入力端子Ａ。−八〇に入力さ
れることにより、ＲＯＭ ４の所定のアドレスがアクセ
スされ、該ＲＯＭの出力端子０１〜０８にデータが出力
される。その読み出したデータ変化から多相周波信号を
得ていて、この多相周波信号を用いて各振動子で駆動す
る位相を制御することにより、振動子アレイより出力さ
れるビームの方向をスキャンさせている。５は、前記出
力端子Ｏ２〜０８に出力されたデータをラッチするラッ
チ回路であり、６は、ラッチ回路にラッチトリガを与え
るラッチパルス回路である。７は、１１０Ｍ４の上位ア
ドレスに対して予め設定する数値設定器である。
クＣＫに分周し、その分周したクロックＣＫをカウンタ
ー３でカウントしており、そのカウント値が読み出し専
用メモリ（ＲＯＭ） ４の入力端子Ａ。−八〇に入力さ
れることにより、ＲＯＭ ４の所定のアドレスがアクセ
スされ、該ＲＯＭの出力端子０１〜０８にデータが出力
される。その読み出したデータ変化から多相周波信号を
得ていて、この多相周波信号を用いて各振動子で駆動す
る位相を制御することにより、振動子アレイより出力さ
れるビームの方向をスキャンさせている。５は、前記出
力端子Ｏ２〜０８に出力されたデータをラッチするラッ
チ回路であり、６は、ラッチ回路にラッチトリガを与え
るラッチパルス回路である。７は、１１０Ｍ４の上位ア
ドレスに対して予め設定する数値設定器である。
第４図は、上記の回路における動作を示すタイムヂャー
トを示している。
トを示している。
［発明が解決しようとする課題］
ところで、アドレス指定からデータ出力までのアクセス
タイムには、ＲＯＭの特性で決まる限界があるため、多
相周波信号の位相データの設定分解能、ひいては振動子
アレイの駆動周波数（キャリア）そのものにも限界を与
えるという欠点がある。
タイムには、ＲＯＭの特性で決まる限界があるため、多
相周波信号の位相データの設定分解能、ひいては振動子
アレイの駆動周波数（キャリア）そのものにも限界を与
えるという欠点がある。
ここで、実回路における°位相データの設定分解能から
要求されるアクセスタイムを考える。
要求されるアクセスタイムを考える。
１５図に示した、振動子（Ｘ、〜Ｘ８）を間隔０．５λ
で一列に並べた振動子アレイにおいて、信号周波数７５
ＫＩ４２．中間周波数−４５５Ｋ Ｈｚ、スキャンピッ
チ２°としたときを例にとる。
で一列に並べた振動子アレイにおいて、信号周波数７５
ＫＩ４２．中間周波数−４５５Ｋ Ｈｚ、スキャンピッ
チ２°としたときを例にとる。
振動子Ｘ４に対する振動子Ｘ３の遅延ｆｆ１Ｄは、Ｄ＝
０．５λ・５ｉｎ２” 二〇’、０１７ λ ＝λ１５７ となり、位相量で表すと２π１５７となる。ここで、λ
は波長で、ｆλ＝Ｉ５００ｍ／ｓより、ｒ＝７５ＫＨｚ
のとき、λ＝２ｃｍとなる。又、局発周波数は、□ｉ
５５−７５＝３８０ＫＨｚとなり、位相データの設定部
、つまり、クロック周期は、＝４６．２０Ｓ（ナノセカ
ンド） 第６図は、各振動子を駆動する多相周波信号の位相関係
を示しており、振動子Ｘ４を基準とすると、振動子’Ａ
３．Ｘ２．ＸＩの順に４６．２ｎｓづつ位相を進め１、
逆に振動子Ｘｓ、Ｘ８．Ｘ７の順に位相を遅らせている
。
０．５λ・５ｉｎ２” 二〇’、０１７ λ ＝λ１５７ となり、位相量で表すと２π１５７となる。ここで、λ
は波長で、ｆλ＝Ｉ５００ｍ／ｓより、ｒ＝７５ＫＨｚ
のとき、λ＝２ｃｍとなる。又、局発周波数は、□ｉ
５５−７５＝３８０ＫＨｚとなり、位相データの設定部
、つまり、クロック周期は、＝４６．２０Ｓ（ナノセカ
ンド） 第６図は、各振動子を駆動する多相周波信号の位相関係
を示しており、振動子Ｘ４を基準とすると、振動子’Ａ
３．Ｘ２．ＸＩの順に４６．２ｎｓづつ位相を進め１、
逆に振動子Ｘｓ、Ｘ８．Ｘ７の順に位相を遅らせている
。
このようにクロック周期が４６゜２ｎｓのときには、第
４図に示したように、ＲＯＭ４のアクセスタイムＴＡは
４６．２ｎｓ以下であることが必要となる。しかるに、
ＥＰ−ＲＯＭのアクセスタイムは１５０〜２５０ｎｓで
あり、バイポーラＲＯＭのアクセスタイムは４５〜６５
ｎｓであるため、このような従来のＲＯＭでは上述した
駆動回路を実現不可能であった。
４図に示したように、ＲＯＭ４のアクセスタイムＴＡは
４６．２ｎｓ以下であることが必要となる。しかるに、
ＥＰ−ＲＯＭのアクセスタイムは１５０〜２５０ｎｓで
あり、バイポーラＲＯＭのアクセスタイムは４５〜６５
ｎｓであるため、このような従来のＲＯＭでは上述した
駆動回路を実現不可能であった。
この発明は、上述した問題点をなくすためになされたも
のであり、従来のＲＯＭでもってアクセスタイムを高速
にして位相データの設定分解能を向上ざＵ・た振動子ア
レイの駆動回路を提供することを目的とする。
のであり、従来のＲＯＭでもってアクセスタイムを高速
にして位相データの設定分解能を向上ざＵ・た振動子ア
レイの駆動回路を提供することを目的とする。
［課題を解決するための手段〕
この発明の振動子アレイの駆動回路は、ＲＯＭより読み
出したデータで作成した多相周波信号でもって振動子ア
レイの各振動子で駆動する位相を制御して放射する超音
波ビームをスキャンさせる振動子アレイの駆動回路にお
いて、 複数Ｎ個の上記ＲＯＭと、前記各ＲＯＭに対してアクセ
スするタイミングをそれぞれｌ／Ｎ周期づつ遅らせる遅
延手段とを具備して各ＲＯ〜１より読み出したデータ１
ｕ互を合成して多相周波信号を作成することを特徴とす
る。
出したデータで作成した多相周波信号でもって振動子ア
レイの各振動子で駆動する位相を制御して放射する超音
波ビームをスキャンさせる振動子アレイの駆動回路にお
いて、 複数Ｎ個の上記ＲＯＭと、前記各ＲＯＭに対してアクセ
スするタイミングをそれぞれｌ／Ｎ周期づつ遅らせる遅
延手段とを具備して各ＲＯ〜１より読み出したデータ１
ｕ互を合成して多相周波信号を作成することを特徴とす
る。
［作用コ
上記構成によれば、各ＲＯＭより読み出したデータは、
ｌ／Ｎ周期ずつずれているため、これらの各データを合
成すれば、周期を１／′Ｎとしたデータが得られ、ＲＯ
Ｍに対するアクセスタイムか等価的にｌ／Ｎの高速とな
る。
ｌ／Ｎ周期ずつずれているため、これらの各データを合
成すれば、周期を１／′Ｎとしたデータが得られ、ＲＯ
Ｍに対するアクセスタイムか等価的にｌ／Ｎの高速とな
る。
［実施例］
第１図は、この発明の振動子アレイの駆動回路の一実施
−ｊを示す回路図であり、第３図と同一の部分には同一
の符号を付している。
−ｊを示す回路図であり、第３図と同一の部分には同一
の符号を付している。
カウンター３の各出力端子Ｑ＋−Ｑａは、ＲＯ１ｖｉ１
１のアドレス入力端子Ａ。−Ａ５にそれぞれ入力される
とともに、遅延手段としてのラッチ回路１３を介して別
のＲＯＭＩ２のアドレス入力端子Ａｏ゛〜Ａ、゛にそれ
ぞれ接続される。又、カウンター３の出力端子Ｑ０は、
前記ラッチ回路１３のＴ端子に接続されるとともに、Ｒ
ＯＭＩＩ＋２のそれぞれのＣＳ、ＣＳ端子に接続されろ
。数社設定器７の各出力端子は、ＲＯＭｌ１１２のそれ
ぞれのアドレス入力端子１こ接続される。ＲＯＭ＋１．
１２のそれぞれの出力端子０．ないしｏ８は、同一端子
相互で接続され、そして各出力端子にはそれぞれラッチ
回路５が接続される。
１のアドレス入力端子Ａ。−Ａ５にそれぞれ入力される
とともに、遅延手段としてのラッチ回路１３を介して別
のＲＯＭＩ２のアドレス入力端子Ａｏ゛〜Ａ、゛にそれ
ぞれ接続される。又、カウンター３の出力端子Ｑ０は、
前記ラッチ回路１３のＴ端子に接続されるとともに、Ｒ
ＯＭＩＩ＋２のそれぞれのＣＳ、ＣＳ端子に接続されろ
。数社設定器７の各出力端子は、ＲＯＭｌ１１２のそれ
ぞれのアドレス入力端子１こ接続される。ＲＯＭ＋１．
１２のそれぞれの出力端子０．ないしｏ８は、同一端子
相互で接続され、そして各出力端子にはそれぞれラッチ
回路５が接続される。
上記の駆動回路における動作を第２図のタイムチャート
を参照して説明する。
を参照して説明する。
ＲＯＭＩＩのアドレス入力端子へ〇には、カウンター３
の出力端子Ｑ、が接続されているので、アドレスの読み
出し周期は、第３図の従来例の２倍になっており、ＲＯ
Ｍ１１の出ツＪ端子０．〜ｏ８からは、９２．４（＝４
６．２Ｘ２）ｎｓの周期で出力される。
の出力端子Ｑ、が接続されているので、アドレスの読み
出し周期は、第３図の従来例の２倍になっており、ＲＯ
Ｍ１１の出ツＪ端子０．〜ｏ８からは、９２．４（＝４
６．２Ｘ２）ｎｓの周期で出力される。
一方、カウンター３の出力端子Ｑ。がラッチ回路１３の
Ｔ端子に入力されているので、ＲＯＭ＋２のアドレス入
力端子Ａ。′〜Ａｓ’に入力される信号は、ＲＯＭ１１
のアドレス入力端子Ａ０〜Ａ５に人力される信号より半
周期遅れとなり、このＲＯＭ１２の各出力端子ｏ１〜０
８より出力されるデータらＲＯＭＩ １から出力される
データより半周期遅れで出力される。従って、ＲＯＭＩ
＋及びＲＯＭ＋２の各出力データを加算することにより
、第３図の回路構成で必要とされたアクセスタイム４６
、２ ｎｓ間隔でデータが出力されるようになる。
Ｔ端子に入力されているので、ＲＯＭ＋２のアドレス入
力端子Ａ。′〜Ａｓ’に入力される信号は、ＲＯＭ１１
のアドレス入力端子Ａ０〜Ａ５に人力される信号より半
周期遅れとなり、このＲＯＭ１２の各出力端子ｏ１〜０
８より出力されるデータらＲＯＭＩ １から出力される
データより半周期遅れで出力される。従って、ＲＯＭＩ
＋及びＲＯＭ＋２の各出力データを加算することにより
、第３図の回路構成で必要とされたアクセスタイム４６
、２ ｎｓ間隔でデータが出力されるようになる。
一方、ＲＯＭ１１．＋２のアクセスタイムは、９２．４
ｎｓ以下でよいので北述した従来のＲＯＭを適用できる
。尚、上記実施例ではＲＯＭを２個用いたが、ＮＩＩＵ
用いれば、アクセスタイムを等価的にｌ／Ｈにすること
ができる。
ｎｓ以下でよいので北述した従来のＲＯＭを適用できる
。尚、上記実施例ではＲＯＭを２個用いたが、ＮＩＩＵ
用いれば、アクセスタイムを等価的にｌ／Ｈにすること
ができる。
［発明の効果］
以上説明したように、この発明によれば、それぞれアク
セスのタイミングをずらしたＲＯＭを複数個用い、各Ｒ
ＯＭより出力されるデータを合成することにより、短い
周期で出力されるデータを得て、このデータより多相周
期信号を作成することにより、ＲＯＭのアクセスタイム
を等価的に早めたので、位相データの設定分解能を高め
ることができ、送受波のスキャンピッチを細かくできる
。
セスのタイミングをずらしたＲＯＭを複数個用い、各Ｒ
ＯＭより出力されるデータを合成することにより、短い
周期で出力されるデータを得て、このデータより多相周
期信号を作成することにより、ＲＯＭのアクセスタイム
を等価的に早めたので、位相データの設定分解能を高め
ることができ、送受波のスキャンピッチを細かくできる
。
第１図はこの発明の振動子アレイの駆動回路の１実施例
を示す回路図、第２図は、第１図の回路における動作を
示すタイムチャート、第３図は、振動子アレイの従来の
駆動回路図、第４図は、第３図の回路における動作を示
すタイムチャート、第５図は振動子アレイの各振動子に
おける遅延量を示す図、第６図は、各振動子に印加され
る信号を示すタイムチャートである。 Ｉ・・・発振回路、２・・・分周器、３・・・カウンタ
ー５・・・ラッチ回路、６・・・ラッチパルス回路、７
・・・数値設定器、１１．１２・・・ＲＯＭ、１３・・
・ラッチ回路。 特許出願人 古野電気株式会社 代理人 弁理士 青白 葆 外Ｉ２ 第 図 ダダＦ＠１ｍ［弓二二力 （川面５（詞ごυ 第 図 ４６．２７ＩＳ 第 図 第 図
を示す回路図、第２図は、第１図の回路における動作を
示すタイムチャート、第３図は、振動子アレイの従来の
駆動回路図、第４図は、第３図の回路における動作を示
すタイムチャート、第５図は振動子アレイの各振動子に
おける遅延量を示す図、第６図は、各振動子に印加され
る信号を示すタイムチャートである。 Ｉ・・・発振回路、２・・・分周器、３・・・カウンタ
ー５・・・ラッチ回路、６・・・ラッチパルス回路、７
・・・数値設定器、１１．１２・・・ＲＯＭ、１３・・
・ラッチ回路。 特許出願人 古野電気株式会社 代理人 弁理士 青白 葆 外Ｉ２ 第 図 ダダＦ＠１ｍ［弓二二力 （川面５（詞ごυ 第 図 ４６．２７ＩＳ 第 図 第 図
Claims (1)
- （１）ＲＯＭより読み出したデータで作成した多相周波
信号でもって振動子アレイの各振動子で駆動する位相を
制御して放射する超音波ビームをスキャンさせる振動子
アレイの駆動回路において、複数Ｎ個の上記ＲＯＭと、
前記各ＲＯＭに対してアクセスするタイミングをそれぞ
れ１／Ｎ周期づつ遅らせる遅延手段とを具備して各ＲＯ
Ｍより読み出したデータ相互を合成して多相周波信号を
作成することを特徴とする振動子アレイの駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19101588A JPH0238885A (ja) | 1988-07-28 | 1988-07-28 | 振動子アレイの駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19101588A JPH0238885A (ja) | 1988-07-28 | 1988-07-28 | 振動子アレイの駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0238885A true JPH0238885A (ja) | 1990-02-08 |
Family
ID=16267461
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19101588A Pending JPH0238885A (ja) | 1988-07-28 | 1988-07-28 | 振動子アレイの駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0238885A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS604327A (ja) * | 1983-06-22 | 1985-01-10 | Sony Tektronix Corp | デジタル・パタ−ン発生器 |
-
1988
- 1988-07-28 JP JP19101588A patent/JPH0238885A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS604327A (ja) * | 1983-06-22 | 1985-01-10 | Sony Tektronix Corp | デジタル・パタ−ン発生器 |
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