JPH023195B2 - - Google Patents
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- JPH023195B2 JPH023195B2 JP58051076A JP5107683A JPH023195B2 JP H023195 B2 JPH023195 B2 JP H023195B2 JP 58051076 A JP58051076 A JP 58051076A JP 5107683 A JP5107683 A JP 5107683A JP H023195 B2 JPH023195 B2 JP H023195B2
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- Japan
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- address
- read
- bit information
- image memory
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- Expired - Lifetime
Links
- 230000015654 memory Effects 0.000 claims description 26
- 230000003936 working memory Effects 0.000 claims description 19
- 238000010586 diagram Methods 0.000 description 7
- 238000000034 method Methods 0.000 description 5
- 101001132499 Homo sapiens RPA-related protein RADX Proteins 0.000 description 3
- 102100033967 RPA-related protein RADX Human genes 0.000 description 3
- 238000006073 displacement reaction Methods 0.000 description 1
Landscapes
- Image Processing (AREA)
- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
(イ) 産業上の利用分野
本発明は表示図形を45゜回転させた状態で表示
する事の出来る図形表示装置に関する。
する事の出来る図形表示装置に関する。
(ロ) 従来技術
CRT表示画面上に表示されている表示図形を
その図形の中心点を中心として右方向、或いは左
方向に45゜回転せしめる方法として次に記すもの
が存在している。
その図形の中心点を中心として右方向、或いは左
方向に45゜回転せしめる方法として次に記すもの
が存在している。
第１図Ａに示すように、Ｘ方向長（DX）、Ｙ
方向長（DY）、中心点（CX，CY）で表わされ
る矩形領域を第１図Ｂに示す如く右方向に45゜回
転させる場合を考える。
方向長（DY）、中心点（CX，CY）で表わされ
る矩形領域を第１図Ｂに示す如く右方向に45゜回
転させる場合を考える。
CRT画面上で第１図Ａに示す矩形領域に対
応する画像メモリ上の画情報を、画像メモリと
相対するワーキングメモリへ転送する。
応する画像メモリ上の画情報を、画像メモリと
相対するワーキングメモリへ転送する。
右45゜回転した場合の読み出しアドレス
（RXo，RYo）に対応する書込み開始アドレス
（WXo，WYo）を計算する。
（RXo，RYo）に対応する書込み開始アドレス
（WXo，WYo）を計算する。
ワーキングメモリから、アドレス（RXo，
RYo）に対応する画情報を読出し、画像メモ
リのアドレス（WXo，WYo）に対応するメモ
リに読出した画情報を書き込む。
RYo）に対応する画情報を読出し、画像メモ
リのアドレス（WXo，WYo）に対応するメモ
リに読出した画情報を書き込む。
第２図に示すように読出しアドレスを１から
順に100まで進め各々の読出しアドレスに対応
する書込アドレスを計算しワーキングメモリか
ら読出し、画像メモリへ書き込む。
順に100まで進め各々の読出しアドレスに対応
する書込アドレスを計算しワーキングメモリか
ら読出し、画像メモリへ書き込む。
以上述べた方法を用いることにより、任意の矩
形領域をその矩形の中心点を中心として右方向、
あるいは左方向に45゜回転さすことが可能である。
形領域をその矩形の中心点を中心として右方向、
あるいは左方向に45゜回転さすことが可能である。
この方法は読出アドレスに対応する書込みアド
レスを計算で求めて、回転処理を行なうものであ
るが、この方法によると、読出し領域のすべての
ビツトが書き込まれて、情報の欠落は起らない
が、第３図に示すように斜線で表わされている書
き込まれないビツトが発生する。
レスを計算で求めて、回転処理を行なうものであ
るが、この方法によると、読出し領域のすべての
ビツトが書き込まれて、情報の欠落は起らない
が、第３図に示すように斜線で表わされている書
き込まれないビツトが発生する。
(ハ) 発明の目的
本発明は上述した如き不都合を改善すべく為さ
れたものであつて、表示図形の中心点を中心とし
て、右方向あるいは左方向に45゜回転処理を行な
う場合に、読出領域のすべてのビツトを参照し、
情報の欠落を防ぐとともに、書込み領域に書込ま
れないビツトが発生しないように回転処理を行な
うことを目的とする。
れたものであつて、表示図形の中心点を中心とし
て、右方向あるいは左方向に45゜回転処理を行な
う場合に、読出領域のすべてのビツトを参照し、
情報の欠落を防ぐとともに、書込み領域に書込ま
れないビツトが発生しないように回転処理を行な
うことを目的とする。
(ニ) 発明の構成
本発明は、回転処理を行う表示領域に相対する
画像メモリ上の画情報を画像メモリと相対するワ
ーキングメモリへ転送する手段と、前記ワーキン
グメモリからビツト情報の読出しを開始する読出
し開始アドレスに対応する画像メモリの書込み開
始アドレスを算出する手段と、算出した書込み開
始アドレスから順次書込みアドレスを進め、各書
込みアドレスに対応する読出しアドレスを算出
し、ワーキングメモリの算出した読出しアドレス
からビツト情報を読出し、ワーキングメモリから
読出したビツト情報を、画像メモリの前記ビツト
情報を読出した読出しアドレスに対応する書込み
アドレスに示される位置へ書込む手段と、前記ワ
ーキングメモリから読出されないビツト情報とこ
の読出されないビツト情報に隣接するビツト情報
との論理和を採つて、読出されないビツト情報に
隣接するビツト情報を読出す読出しアドレスに対
応する画像メモリの書込みアドレスで示される位
置に、論理和を採つたビツト情報を書込む手段
と、に依つて構成されている。
画像メモリ上の画情報を画像メモリと相対するワ
ーキングメモリへ転送する手段と、前記ワーキン
グメモリからビツト情報の読出しを開始する読出
し開始アドレスに対応する画像メモリの書込み開
始アドレスを算出する手段と、算出した書込み開
始アドレスから順次書込みアドレスを進め、各書
込みアドレスに対応する読出しアドレスを算出
し、ワーキングメモリの算出した読出しアドレス
からビツト情報を読出し、ワーキングメモリから
読出したビツト情報を、画像メモリの前記ビツト
情報を読出した読出しアドレスに対応する書込み
アドレスに示される位置へ書込む手段と、前記ワ
ーキングメモリから読出されないビツト情報とこ
の読出されないビツト情報に隣接するビツト情報
との論理和を採つて、読出されないビツト情報に
隣接するビツト情報を読出す読出しアドレスに対
応する画像メモリの書込みアドレスで示される位
置に、論理和を採つたビツト情報を書込む手段
と、に依つて構成されている。
(ホ) 実施例
本発明を、第１図Ａに示されるＸ軸方向長
（DX）、Ｙ軸方向長（DY）を有する矩形領域を
矩形中心点（CX，CY）を中心として右方向45゜
回転させて表示する処理を例として以下に説明す
る。
（DX）、Ｙ軸方向長（DY）を有する矩形領域を
矩形中心点（CX，CY）を中心として右方向45゜
回転させて表示する処理を例として以下に説明す
る。
第４図は本発明装置の構成を示すブロツク図で
あつて、同図に於て、１０はCPUで本発明の各
動作の制御並びに判断を行う。１１，１２は
CPU１０からのアドレス及びビツトデータを入
力し、ワーキングメモリ１３並びに画像メモリ１
４の対応するアドレスにビツトデータを書込む第
１、第２の書込み回路、１５，１６はCPU１０
からアドレスを入力し、そのアドレスに対応する
ワーキングメモリ１３並びに画像メモリ１４から
ビツトデータを読出しCPU１０へ出力する読出
し回路、１７はCPU１０から指令される演算を
行い、その演算結果をCPU１０へ出力する演算
回路、１８はCPU１０から読出しビツトに近接
して読出される２ビツトのデータの論理和を採り
CPU１０へ出力するOR回路、１９はCPU１０か
ら直接読出し可能なデータが書込まれるレジスタ
群で、次の21個から成つている。
あつて、同図に於て、１０はCPUで本発明の各
動作の制御並びに判断を行う。１１，１２は
CPU１０からのアドレス及びビツトデータを入
力し、ワーキングメモリ１３並びに画像メモリ１
４の対応するアドレスにビツトデータを書込む第
１、第２の書込み回路、１５，１６はCPU１０
からアドレスを入力し、そのアドレスに対応する
ワーキングメモリ１３並びに画像メモリ１４から
ビツトデータを読出しCPU１０へ出力する読出
し回路、１７はCPU１０から指令される演算を
行い、その演算結果をCPU１０へ出力する演算
回路、１８はCPU１０から読出しビツトに近接
して読出される２ビツトのデータの論理和を採り
CPU１０へ出力するOR回路、１９はCPU１０か
ら直接読出し可能なデータが書込まれるレジスタ
群で、次の21個から成つている。
RSADX……読出し開始アドレス（Ｘ）
RSADY……読出し開始アドレス（Ｙ）′，
DX……Ｘ方向長、
DY……Ｙ方向長、
CENTX……矩形中心アドレス（Ｘ），
CENTY……矩形中心アドレス（Ｙ），
READX……読出し終了アドレス（Ｘ），
READY……読出し終了アドレス（Ｙ），
RADX……読出しアドレス（Ｘ），
RADY……読出しアドレス（Ｙ），
RADXC……算出読出しアドレス（Ｘ），
RADYC……算出読出しアドレス（Ｙ），
WSADX……書込み開始アドレス（Ｘ），
WSADY……書込み開始アドレス（Ｙ），
WADX……書込みアドレス（Ｘ），
WADY……書込みアドレス（Ｙ），
YE……OR処理判断フラグ、
WSF……書込み開始判断フラグ、
Ａ，Ｂ，Ｃ……ビツトレジスタ。
２０は画像メモリ１４に連つた表示制御回路
で、CRT２１で表示するに適した形態に信号処
理する。２２はCPU１０へ矩形情報を供給する
矩形情報発生回路である。
で、CRT２１で表示するに適した形態に信号処
理する。２２はCPU１０へ矩形情報を供給する
矩形情報発生回路である。
CPU１０は矩形情報発生回路２１から入力し
た矩形データにもとづき指定された矩形領域に相
対する画情報を画像メモリ１４から読出し、画像
メモリ１４と同一ビツト構成のワーキングメモリ
１３に書込む。CPU１０は矩形データより矩形
中心（CENTX，CENTY）を算出し、次に、そ
の矩形中心を中心として右45゜回転した時の読出
し開始アドレス（RXo，RYo）に対応する書込
開始アドレス（WXo，WYo）を算出する。画像
メモリ１４、ワーキングメモリ１３共にビツトの
大きさは１×１であると考える。第５図に示すよ
うに書込アドレスは１，２，３…98の順に進ま
せ、各々の書込アドレスに対応する読出しアドレ
スを算出し、算出した読出しアドレスに相対する
ビツト情報をワーキングメモリ１３からCPU１
０が読出し、画像メモリ１４に書込むが、算出読
出アドレスが第２図の１，２，３…100という読
出しアドレスシーケンスを読みとばした場合、例
えば２の次に４を算出した場合、読みとばされた
アドレス３がもう一度読出される可能性がないと
き、アドレス３とアドレス４のビツト情報の論理
和をOR回路１８で作成して書込アドレスに書込
む。
た矩形データにもとづき指定された矩形領域に相
対する画情報を画像メモリ１４から読出し、画像
メモリ１４と同一ビツト構成のワーキングメモリ
１３に書込む。CPU１０は矩形データより矩形
中心（CENTX，CENTY）を算出し、次に、そ
の矩形中心を中心として右45゜回転した時の読出
し開始アドレス（RXo，RYo）に対応する書込
開始アドレス（WXo，WYo）を算出する。画像
メモリ１４、ワーキングメモリ１３共にビツトの
大きさは１×１であると考える。第５図に示すよ
うに書込アドレスは１，２，３…98の順に進ま
せ、各々の書込アドレスに対応する読出しアドレ
スを算出し、算出した読出しアドレスに相対する
ビツト情報をワーキングメモリ１３からCPU１
０が読出し、画像メモリ１４に書込むが、算出読
出アドレスが第２図の１，２，３…100という読
出しアドレスシーケンスを読みとばした場合、例
えば２の次に４を算出した場合、読みとばされた
アドレス３がもう一度読出される可能性がないと
き、アドレス３とアドレス４のビツト情報の論理
和をOR回路１８で作成して書込アドレスに書込
む。
読みとばされたアドレスがもう一度読出される
かどうかの判断は以下のように行なつている。
かどうかの判断は以下のように行なつている。
算出読出しアドレスのＹ方向の変位は、行が変
わるごとに√２／２≒0.7づつ加算されていく。
従つて算出読出アドレスは小数点以下１ケタまで
求めそのＹアドレスの小数点以下１ケタが0.3〜
0.6の範囲にある場合は、読みとばされたアドレ
スはもう一度読出されることがないので、そのビ
ツト情報は、次の読出アドレスのビツト情報との
論理和が採られて書込まれる。
わるごとに√２／２≒0.7づつ加算されていく。
従つて算出読出アドレスは小数点以下１ケタまで
求めそのＹアドレスの小数点以下１ケタが0.3〜
0.6の範囲にある場合は、読みとばされたアドレ
スはもう一度読出されることがないので、そのビ
ツト情報は、次の読出アドレスのビツト情報との
論理和が採られて書込まれる。
上述の動作は第６図に示したフローチヤートか
ら詳細に理解されるであろう。尚このフローチヤ
ートに於て、 Ｒ（RADX，RADY）は、RADX，RADYに
対応するワーキングメモリ１３上の読込み
１ビツトデータ、 Ｗ（WADX，WADY）は、WADX，WADY
に対応する画像メモリ１４上への１ビツト
データの書込み、 を意味する。
ら詳細に理解されるであろう。尚このフローチヤ
ートに於て、 Ｒ（RADX，RADY）は、RADX，RADYに
対応するワーキングメモリ１３上の読込み
１ビツトデータ、 Ｗ（WADX，WADY）は、WADX，WADY
に対応する画像メモリ１４上への１ビツト
データの書込み、 を意味する。
このようにして読出し書込みを行う事に依つて
第２図に示した１，２，３，…100のビツト情報
が第７図に示した状態で画像メモリ１４に書込ま
れ、その書込み内容が表示制御回路２０を経て
CRT２１に供給され、右方向に45゜回転した矩形
をCRT２１で表示する事となる。
第２図に示した１，２，３，…100のビツト情報
が第７図に示した状態で画像メモリ１４に書込ま
れ、その書込み内容が表示制御回路２０を経て
CRT２１に供給され、右方向に45゜回転した矩形
をCRT２１で表示する事となる。
(ヘ) 発明の効果
本発明は以上の説明から明らかな如く、45゜回
転させた表示図形は元の図形のビツト情報を失う
事なく、またビツト情報の抜けが存在しないの
で、元図形情報との相似関係のずれの少い画情報
が得られ、忠実な形で図形を45゜回転させる事が
出来る。
転させた表示図形は元の図形のビツト情報を失う
事なく、またビツト情報の抜けが存在しないの
で、元図形情報との相似関係のずれの少い画情報
が得られ、忠実な形で図形を45゜回転させる事が
出来る。
第１図Ａ，Ｂは矩形図形の回転状況を示す説明
図、第２図は矩形図形読出しアドレスシーケンス
図、第３図は従来装置に依る右45゜回転矩形図、
第４図は本発明装置の構成を示すブロツク図、第
５図は本発明に依る右45゜回転矩形書込アドレス
シーケンス図、第６図は本発明装置の動作説明の
為のフローチヤート、第７図は本発明装置に依る
右45゜回転矩形図であつて、１０はCPU、１３は
ワーキングメモリ、１４は画像メモリ、１７は演
算回路、１８はOR回路、１９はレジスタ群、を
夫々示している。
図、第２図は矩形図形読出しアドレスシーケンス
図、第３図は従来装置に依る右45゜回転矩形図、
第４図は本発明装置の構成を示すブロツク図、第
５図は本発明に依る右45゜回転矩形書込アドレス
シーケンス図、第６図は本発明装置の動作説明の
為のフローチヤート、第７図は本発明装置に依る
右45゜回転矩形図であつて、１０はCPU、１３は
ワーキングメモリ、１４は画像メモリ、１７は演
算回路、１８はOR回路、１９はレジスタ群、を
夫々示している。
Claims (1)
- 【特許請求の範囲】 １ 表示図形を45゜回転させた状態で表示する事
の出来る図形表示装置に於て、 回転処理を行う表示領域に相対する画像メモリ
上の画情報を画像メモリと相対するワーキングメ
モリへ転送する手段と、 前記ワーキングメモリからビツト情報の読出し
を開始する読出し開始アドレスに対応する画像メ
モリの書込み開始アドレスを算出する手段と、 算出した書込み開始アドレスから順次書込みア
ドレスを進め、各書込みアドレスに対応する読出
しアドレスを算出し、ワーキングメモリの算出し
た読出しアドレスからビツト情報を読出し、ワー
キングメモリから読出したビツト情報を、画像メ
モリの前記ビツト情報を読出した読出しアドレス
に対応する書込みアドレスで示される位置へ書込
む手段と、 前記ワーキングメモリから読出されないビツト
情報とこの読出されないビツト情報に隣接するビ
ツト情報との論理和を採つて、読出されないビツ
ト情報に隣接するビツト情報を読出す読出しアド
レスに対応する画像メモリの書込みアドレスで示
される位置に、論理和を採つたビツト情報を書込
む手段と、 を備える事を特徴とした図形表示装置。 ２ 上記表示図形は矩形である事を特徴とした特
許請求の範囲第１項記載の図形表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58051076A JPS59176776A (ja) | 1983-03-26 | 1983-03-26 | 図形表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58051076A JPS59176776A (ja) | 1983-03-26 | 1983-03-26 | 図形表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59176776A JPS59176776A (ja) | 1984-10-06 |
| JPH023195B2 true JPH023195B2 (ja) | 1990-01-22 |
Family
ID=12876713
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58051076A Granted JPS59176776A (ja) | 1983-03-26 | 1983-03-26 | 図形表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59176776A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6238986A (ja) * | 1985-08-15 | 1987-02-19 | Fuji Electric Co Ltd | 画像デ−タの正規化装置 |
| JPS6256074A (ja) * | 1985-09-04 | 1987-03-11 | Canon Inc | 画像処理方法 |
-
1983
- 1983-03-26 JP JP58051076A patent/JPS59176776A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59176776A (ja) | 1984-10-06 |
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