JPH02308343A - マイクロプロセッサの障害検出通知方式 - Google Patents
マイクロプロセッサの障害検出通知方式Info
- Publication number
- JPH02308343A JPH02308343A JP1130540A JP13054089A JPH02308343A JP H02308343 A JPH02308343 A JP H02308343A JP 1130540 A JP1130540 A JP 1130540A JP 13054089 A JP13054089 A JP 13054089A JP H02308343 A JPH02308343 A JP H02308343A
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- JP
- Japan
- Prior art keywords
- microprocessor
- reset pulse
- timer
- alarm
- output
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 title claims abstract description 10
- 230000005856 abnormality Effects 0.000 abstract description 7
- 230000002159 abnormal effect Effects 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000012423 maintenance Methods 0.000 description 2
- 239000013256 coordination polymer Substances 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はマイクロプロセッサの障害検出通知方式に関す
る。
る。
従来、この種のマイクロプロセッサにおける障害検出方
式には、ソフトウェアに組み込まれた一定時間間隔で出
力されるタイマリセットパルスにより、マイクロプロセ
ッサリセットパルスを出力するウォッチドッグタイマを
周期的に初期化する手段を用い、異常時には、タイマリ
セットパルスが停止してウォッチドッグタイマの初期化
が行なわれないため、一定時間後にタイムアツプしてマ
イクロプロセッサリセットパルスが出力されるという動
作が行なわれていた。
式には、ソフトウェアに組み込まれた一定時間間隔で出
力されるタイマリセットパルスにより、マイクロプロセ
ッサリセットパルスを出力するウォッチドッグタイマを
周期的に初期化する手段を用い、異常時には、タイマリ
セットパルスが停止してウォッチドッグタイマの初期化
が行なわれないため、一定時間後にタイムアツプしてマ
イクロプロセッサリセットパルスが出力されるという動
作が行なわれていた。
上述した従来のマイクロプロセッサの障害検出方式は、
マイクロプロセッサへの外部入力の組合わせによってソ
フトウェアの暴走が生じるような障害に対してマイクロ
プロセッサの初期化と再スタートは行なわれるが、その
初期化と再スタートの動作が外部に報告されないので、
オペレータあるいは保守者はマイクロプロセッサが全く
問題無しに正常動作を続けているものと判断し、外部状
態の組合わせによる障害を認知できないという欠点があ
る。
マイクロプロセッサへの外部入力の組合わせによってソ
フトウェアの暴走が生じるような障害に対してマイクロ
プロセッサの初期化と再スタートは行なわれるが、その
初期化と再スタートの動作が外部に報告されないので、
オペレータあるいは保守者はマイクロプロセッサが全く
問題無しに正常動作を続けているものと判断し、外部状
態の組合わせによる障害を認知できないという欠点があ
る。
本発明のマイクロプロセッサの障害検出通知方式は、一
定時間間隔でタイマリセットパルスを出力するタイマリ
セットパルス出力手段と、ある一定時間以上前記タイマ
リセットパルスが入力されないときマイクロプロセッサ
リセットパルスを出力するウォッチドッグタイマ回路と
、前記マイクロプロセッサリセットパルスを保持するラ
ッチ回路と、このラッチ回路に保持された前記マイクロ
プロセッサリセットパルスを取り込んで警報を出力する
警報出力手段とを備えることを特徴とする。
定時間間隔でタイマリセットパルスを出力するタイマリ
セットパルス出力手段と、ある一定時間以上前記タイマ
リセットパルスが入力されないときマイクロプロセッサ
リセットパルスを出力するウォッチドッグタイマ回路と
、前記マイクロプロセッサリセットパルスを保持するラ
ッチ回路と、このラッチ回路に保持された前記マイクロ
プロセッサリセットパルスを取り込んで警報を出力する
警報出力手段とを備えることを特徴とする。
次に、本発明について図面を参照して説明する。
第1図は本発明のマイクロプロセッサの障害検出通知方
式の一実施例を示すブロック図である。
式の一実施例を示すブロック図である。
マイクロプロセッサ(以下MP)1は定常動作状態にお
いて周期的にタイマリセットパルス11を出力するソフ
トウェアを有している。何らかの外部異常により、MP
Iが異常状態に陥ると、タイマリセットパルス11の出
力が停止し、一定時間後にウォッチドッグタイマ回路(
以下WDT>2からマイクロプロセッサリセットパルス
12が出力される。マイクロプロセッサリセットパルス
12はアンゲート5を介してMPIを再スタートさせる
と同時に、ラッチ回路(以下LAT)3にマイクロプロ
セッサリセットパルスラッチ信号14として保持される
。再スタートしたMPIはソフトウェア内部の初期設定
を行なった後、マイクロプロセッサリセットパルスラッ
チ信号14を取り込んで、そのスタートが異常検出によ
るマイクロプロセッサリセットパルス12によるものと
判断すれば、マイクロプロセッサリセット警報15を自
らのソフトウェアによって出力した後で定常動作に入る
。
いて周期的にタイマリセットパルス11を出力するソフ
トウェアを有している。何らかの外部異常により、MP
Iが異常状態に陥ると、タイマリセットパルス11の出
力が停止し、一定時間後にウォッチドッグタイマ回路(
以下WDT>2からマイクロプロセッサリセットパルス
12が出力される。マイクロプロセッサリセットパルス
12はアンゲート5を介してMPIを再スタートさせる
と同時に、ラッチ回路(以下LAT)3にマイクロプロ
セッサリセットパルスラッチ信号14として保持される
。再スタートしたMPIはソフトウェア内部の初期設定
を行なった後、マイクロプロセッサリセットパルスラッ
チ信号14を取り込んで、そのスタートが異常検出によ
るマイクロプロセッサリセットパルス12によるものと
判断すれば、マイクロプロセッサリセット警報15を自
らのソフトウェアによって出力した後で定常動作に入る
。
なおパワー・オン・リセット回路(以下P0R)4はパ
ワー・オン・リセット信号13をLAT3およびアンゲ
ート5に出力する機能を有している。
ワー・オン・リセット信号13をLAT3およびアンゲ
ート5に出力する機能を有している。
以上説明したように本発明は、異常検出したときマイク
ロプロセッサリセットパルスによる再スタートをマイク
ロプロセッサ自らのソフトウェアにより認知して警報を
出力することにより、オペレータや保守者に異常状態の
発生を通知した後で定常動作に入るので、従来機能を損
なうこと゛なく信頼性と保守性とを向上させる効果があ
る。
ロプロセッサリセットパルスによる再スタートをマイク
ロプロセッサ自らのソフトウェアにより認知して警報を
出力することにより、オペレータや保守者に異常状態の
発生を通知した後で定常動作に入るので、従来機能を損
なうこと゛なく信頼性と保守性とを向上させる効果があ
る。
図面の簡単な説明
第1図は本発明のマイクロプロセッサの障害検出通知方
式の一実施例を示すブロック図である。
式の一実施例を示すブロック図である。
1・・・マイクロプロセッサ(MP)、2・・・ウォッ
チドッグタイマ回路(WDT) 、3・・・ラッチ回路
(LAT)、4・・・パワー・オン・リセット回路CP
OR)、5・・・アンドゲート、11・・・タイマリセ
ットパルス、12・・・マイクロプロセッサリセットパ
ルス、13・・・パワー・オン・リセット信号、14・
・・マイクロプロセッサリセットパルスラッチ信号、1
5・・・マイクロプロセッサリセット警報。
チドッグタイマ回路(WDT) 、3・・・ラッチ回路
(LAT)、4・・・パワー・オン・リセット回路CP
OR)、5・・・アンドゲート、11・・・タイマリセ
ットパルス、12・・・マイクロプロセッサリセットパ
ルス、13・・・パワー・オン・リセット信号、14・
・・マイクロプロセッサリセットパルスラッチ信号、1
5・・・マイクロプロセッサリセット警報。
Claims (1)
- 一定時間間隔でタイマリセットパルスを出力するタイマ
リセットパルス出力手段と、ある一定時間以上前記タイ
マリセットパルスが入力されないときマイクロプロセッ
サリセットパルスを出力するウォッチドッグタイマ回路
と、前記マイクロプロセッサリセットパルスを保持する
ラッチ回路と、このラッチ回路に保持された前記マイク
ロプロセッサリセットパルスを取り込んで警報を出力す
る警報出力手段とを備えることを特徴とするマイクロプ
ロセッサの障害検出通知方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1130540A JPH02308343A (ja) | 1989-05-23 | 1989-05-23 | マイクロプロセッサの障害検出通知方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1130540A JPH02308343A (ja) | 1989-05-23 | 1989-05-23 | マイクロプロセッサの障害検出通知方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02308343A true JPH02308343A (ja) | 1990-12-21 |
Family
ID=15036727
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1130540A Pending JPH02308343A (ja) | 1989-05-23 | 1989-05-23 | マイクロプロセッサの障害検出通知方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02308343A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009015435A (ja) * | 2007-07-02 | 2009-01-22 | Nippon Telegr & Teleph Corp <Ntt> | 異常検出方法及び処理装置 |
-
1989
- 1989-05-23 JP JP1130540A patent/JPH02308343A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009015435A (ja) * | 2007-07-02 | 2009-01-22 | Nippon Telegr & Teleph Corp <Ntt> | 異常検出方法及び処理装置 |
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