JPH02306356A - 多値ヘベルデータバス回路 - Google Patents
多値ヘベルデータバス回路Info
- Publication number
- JPH02306356A JPH02306356A JP12657689A JP12657689A JPH02306356A JP H02306356 A JPH02306356 A JP H02306356A JP 12657689 A JP12657689 A JP 12657689A JP 12657689 A JP12657689 A JP 12657689A JP H02306356 A JPH02306356 A JP H02306356A
- Authority
- JP
- Japan
- Prior art keywords
- data bus
- binary
- conversion circuit
- signal
- input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims abstract description 20
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Bus Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
この発明は、例えばファクシミリ装置などで使用される
マイクロプロセッサシステムにおけるデータバス回路に
関する。
マイクロプロセッサシステムにおけるデータバス回路に
関する。
[従来の技術]
従来、マイクロプロセッサシステムにおける代表的なデ
ータバスとしては、マイクロプロセッサと外部メモリと
の間を接続するアドレスデータバスやメモリリードライ
トバスがある。
ータバスとしては、マイクロプロセッサと外部メモリと
の間を接続するアドレスデータバスやメモリリードライ
トバスがある。
これらのデータバスを使用するデータバス回路では、’
OJ、’IJの2進データがrHJ。
OJ、’IJの2進データがrHJ。
r l、 、の2値信号に対応してそのままデータパス
コ−に入出力されている。すなわち、従来のデータバス
では、nビットのデータを入出力するためにn本の信号
線が必要となっている。
コ−に入出力されている。すなわち、従来のデータバス
では、nビットのデータを入出力するためにn本の信号
線が必要となっている。
[発明が解決しようとする課題]
上述した従来のデータバス回路では、nビット幅のデー
タバスを使用する場合、n本の信号線が必要となるほか
、n本の信号線に対応してn個のドライバーおよびレシ
ーバも必要となる。したがって、一度に大量の情報を入
出力するためにビット幅の大きなデータバスを使用した
場合。
タバスを使用する場合、n本の信号線が必要となるほか
、n本の信号線に対応してn個のドライバーおよびレシ
ーバも必要となる。したがって、一度に大量の情報を入
出力するためにビット幅の大きなデータバスを使用した
場合。
データバス回路の物量もそのデータバスのピッl−幅の
大きさに応じて増大して12まう欠点があった。
大きさに応じて増大して12まう欠点があった。
[課題を解決するための手段1
この発明の多値レベルデータバス回路は、n本の入力線
に入力された入力信号によって表現される2n通りの論
理状態を2n段階の論理レベル信号に変換してデータバ
スに出力する多値レベル変換回路と、データバスを介し
て入力した2n段階の論理しベル信号を元の2進2値信
号に変換してn本の出力線に出力する2値レベル変換回
路とを有している。
に入力された入力信号によって表現される2n通りの論
理状態を2n段階の論理レベル信号に変換してデータバ
スに出力する多値レベル変換回路と、データバスを介し
て入力した2n段階の論理しベル信号を元の2進2値信
号に変換してn本の出力線に出力する2値レベル変換回
路とを有している。
し作用コ
多値レベル変換回路によってnビットの2進2値信号は
2n段階の論理レベル信号に変換されてデータバスに出
力され、このデータバスを介して2n段階の論理レベル
信号を入力した2値レベル変換回路によって上記論理I
ノベル信号は元の2進2値信号に変換される。これによ
り、nビット・の2進2値信号を1本のデータバスで入
出力することができる。
2n段階の論理レベル信号に変換されてデータバスに出
力され、このデータバスを介して2n段階の論理レベル
信号を入力した2値レベル変換回路によって上記論理I
ノベル信号は元の2進2値信号に変換される。これによ
り、nビット・の2進2値信号を1本のデータバスで入
出力することができる。
[実施例]
次に、この発明の多値レベルデータバス回路について図
面を参照して説明する。
面を参照して説明する。
図はこの発明の一実施例を示すブロック図である。
図中、A、=Aヨはn本の信号線で構成されたデータバ
スに接続され、2進2値信号を入力するn本の入力線で
ある。Bl〜B、はn本の信号線で構成されたデータバ
スに接続され、2進2値信号を出力するn本の出力線で
ある61は入力線A、〜A、の入力信号によって表現さ
れる2n通りの論理状態を2n段階の論理レベル信号に
変換してデータバス2に出力する多値レベル変換回路で
ある。3はデータバス2を介して入力した2n段諧の論
理レベル信号を元の2進2値信号に変換してn本の出力
線81〜Bnに出力する2値レベル変換回路である。
スに接続され、2進2値信号を入力するn本の入力線で
ある。Bl〜B、はn本の信号線で構成されたデータバ
スに接続され、2進2値信号を出力するn本の出力線で
ある61は入力線A、〜A、の入力信号によって表現さ
れる2n通りの論理状態を2n段階の論理レベル信号に
変換してデータバス2に出力する多値レベル変換回路で
ある。3はデータバス2を介して入力した2n段諧の論
理レベル信号を元の2進2値信号に変換してn本の出力
線81〜Bnに出力する2値レベル変換回路である。
次に動作について説明する。
図において、n=4として以下の説明を行う。
すなわち、入力線A1〜A4から4ピツI・のデータが
多値レベル変換回路1に入力すると、この多値1ノベル
変換回路1は4ピツ1へのデータによって示される24
=16通りの論理状態に対応して16段階の相異なる電
位レベル(Er−Ets)を有する論理レベル信号を生
成l−でデータバス2に出力する。データバス2を介し
てこの16段階の論理レベル信号を入力した2値レベル
変換回路3は、その論理レベルが示す16通りの論理状
態に応じて元の2進2値信号を生成j−て出力線Bt
−B4に出力する。このようにして、4ビツトのデータ
を1本のデータバス2で入出力することができる。
多値レベル変換回路1に入力すると、この多値1ノベル
変換回路1は4ピツ1へのデータによって示される24
=16通りの論理状態に対応して16段階の相異なる電
位レベル(Er−Ets)を有する論理レベル信号を生
成l−でデータバス2に出力する。データバス2を介し
てこの16段階の論理レベル信号を入力した2値レベル
変換回路3は、その論理レベルが示す16通りの論理状
態に応じて元の2進2値信号を生成j−て出力線Bt
−B4に出力する。このようにして、4ビツトのデータ
を1本のデータバス2で入出力することができる。
[発明の効果]
以上説明したようにこの発明の多値レベル変換回路によ
れば、多値レベル変換回路によってnビットの2進2値
信号は2n段階の論理レベル信号に変換されてデータバ
スに出力され、このデータバスを介して2s段階の論理
レベル信号を入力した2値レベル変換回路によって上記
論理レベル信号は元の2進2値信号に変換される。これ
により、nビットの2進2値信号を1本のデータバスで
入出力することができるので、従来に比較してデータバ
スの本数を減らすことができる。したかって、ドライバ
およびレシーバなどの部品点数を最小限度に減らずこと
ができるため、回路規模のコンパクト化、および信頼性
の向上を図ることが可能となる。
れば、多値レベル変換回路によってnビットの2進2値
信号は2n段階の論理レベル信号に変換されてデータバ
スに出力され、このデータバスを介して2s段階の論理
レベル信号を入力した2値レベル変換回路によって上記
論理レベル信号は元の2進2値信号に変換される。これ
により、nビットの2進2値信号を1本のデータバスで
入出力することができるので、従来に比較してデータバ
スの本数を減らすことができる。したかって、ドライバ
およびレシーバなどの部品点数を最小限度に減らずこと
ができるため、回路規模のコンパクト化、および信頼性
の向上を図ることが可能となる。
図はこの発明の多値レベルデータバス回路の一実施例を
示すブロック図である。 1・・・多値レベル変換回路、2・・・データバス、3
・・・2値レベル変換回路、Al〜A、・・・入力線、
81〜Bゆ・・・出力線。
示すブロック図である。 1・・・多値レベル変換回路、2・・・データバス、3
・・・2値レベル変換回路、Al〜A、・・・入力線、
81〜Bゆ・・・出力線。
Claims (1)
- 【特許請求の範囲】 n本の入力線に入力された入力信号によって表現される
2^n通りの論理状態を2^n段階の論理レベル信号に
変換してデータバスに出力する多値レベル変換回路と、 データバスを介して入力した2^n段階の論理レベル信
号を元の2進2値信号に変換してn本の出力線に出力す
る2値レベル変換回路と を有することを特徴とする多値レベルデータバス回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12657689A JPH02306356A (ja) | 1989-05-22 | 1989-05-22 | 多値ヘベルデータバス回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12657689A JPH02306356A (ja) | 1989-05-22 | 1989-05-22 | 多値ヘベルデータバス回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02306356A true JPH02306356A (ja) | 1990-12-19 |
Family
ID=14938588
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12657689A Pending JPH02306356A (ja) | 1989-05-22 | 1989-05-22 | 多値ヘベルデータバス回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02306356A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010061723A (ja) * | 2008-09-02 | 2010-03-18 | Toppan Printing Co Ltd | 半導体メモリー装置 |
-
1989
- 1989-05-22 JP JP12657689A patent/JPH02306356A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010061723A (ja) * | 2008-09-02 | 2010-03-18 | Toppan Printing Co Ltd | 半導体メモリー装置 |
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