JPH02302109A - 増幅器 - Google Patents

増幅器

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Publication number
JPH02302109A
JPH02302109A JP12372589A JP12372589A JPH02302109A JP H02302109 A JPH02302109 A JP H02302109A JP 12372589 A JP12372589 A JP 12372589A JP 12372589 A JP12372589 A JP 12372589A JP H02302109 A JPH02302109 A JP H02302109A
Authority
JP
Japan
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complementary
trs
transistor
bases
whose
Prior art date
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Pending
Application number
JP12372589A
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English (en)
Inventor
Kunitsugu Tanaka
田中 国嗣
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP12372589A priority Critical patent/JPH02302109A/ja
Publication of JPH02302109A publication Critical patent/JPH02302109A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は増幅器に係シ、特に高周波広帯域増幅器に関す
る。
〔従来の技術] 従来、この種の増幅器特にプッシュプル型増幅器では、
それぞれのトランジスタのベースヲ入力端とし、エミッ
タをそれぞれ接地し、コレクタをそれぞれ出力端とし、
かつ入力端、出力端にはそれぞれトランス回路を用いて
インピーダンス変換する構造があった。
〔発明が解決しようとする課題〕
前述した従来の増幅器においては、トランジスタのトラ
ンス・コンダクタンス特性が非直線であり、ベース会エ
ミッタ接合の温度係数が大きい為、トランジスタの一方
が非導通(OFF )となシ、他方が導通(ON)とな
り、負荷に出力する領域でクロスオーバー歪みが発生す
るという欠点があった0 本発明の目的は、前記欠点が解決され、クロスオーバー
歪みを解消した増幅器を提供することにある。
〔課題を解決するための手段〕
本発明の増幅器の構成は、エミッタ同士を互いに接続し
て入力端とした第1の相補型巣1.第2トランジスタと
、これら第1の相補型巣1.第2トランジスタのコレク
タにベースがそれぞれ接続され、工jt夕が定電源に接
続され、かつコレクタ同士が互いに接続されて出力端と
した第2の相補型巣3.第4トランジスタと、前記第1
の相補型第1I第2トランジスタのベースにベースがそ
れぞれ接続され、エミッタがいずれも接地され、かつコ
レクタがそれぞれ抵抗を介して前記定電源に接続された
第3の相補型巣5.第6トランジスタとを備えたことを
特徴とする。
〔実施例〕
次に本発明を図面を用いて詳細に説明する。
第1図は本発明の第1の実施例の増幅器の等何回路を示
す回路図である。
第1図において、本実施例の増幅器は、IN人力鴻1が
第1の相補型トランジスタ10.20  の共通エミッ
タ12.22 に接続され、これらの相補型トランジス
タ10,20  のコレクタ13.22はそれぞれ第2
の相補型トランジスタ30.40のベース31.41 
 に接続される。第2の相補型トランジスタ30.40
  のエミッタ32.42は、それぞれ正の電源70、
及び負の電源80を介して接地されておシ、それぞれの
コレクタ33.43は、互いに接続されてOUT出力端
2になっている。また、エミッタ52.62  が互い
に接地され、ベース51.61  が、第1の相補型ト
ランジスタ10.20  のベース11,21  にそ
れぞれ接続され、この第1の相補型トランジスタ10.
20をベース接地型として動作させる第3の相補型l・
ランジスタ50.60  が設けられる。この第3の相
補型トランジスタ50.60のコレクタ53.63は、
それぞれ抵抗100,200を介して、正の電源70及
び負の電源80に接続される。また、コレクタ53.6
3は、ベース51.61とも接続されておシ、この第3
の相補型トランジスタ50゜60は、アイドリング電流
設定用ダイオードとして使用されている。
次に、第1図の増幅器の動作について説明する。
無信号電圧時には出力電流Icは、ChrzxIb〕で
決定される。但し、Ibは、トランジスタ30゜40の
ベース電流、hFK  は電流増幅率である。
また、Ibは電流ミラ一対を形成するトランジスタ10
−50.及び20−60  により決定される。
又、トランジスタ10−50.20−60.30−40
は、それぞれ互いに整合されているものとする。正の電
源〔+V〕 と負の電源〔−V]は、互いに同一の籠を
もつものとする。前記の様に設定されたIcの直はトラ
ンジスタのhFE が温度変化に対して小さいので、温
度に対して十分安定である。トランジスタ10と20の
接続形式は、入力信号に対し、ベース接地型として動作
し、入力インピーダンスは、10Ω繭後であり充分小さ
い。
入力端子1の正極性の信号が、トランジスタ10をオフ
、トランジスタ2(lオンにバイアスしようとすれば、
入力信号の大半がベース接地型トランジスタ20のコレ
クタを介してトランジスタ40のベースに流入し、出力
端子2にはトランジスタ40のコレクタからこのベース
電流のhFE倍の信号電流が流れる。入力端子1に負極
性の入力信号が供給される場合も同様である。ここで、
出力端子2以外の全ての回路部分において、電圧変動は
非常に少ない。また出力端子2における電圧変動は、使
用する負荷抵抗@や入力信号の振幅。
トランジスタ30.40  のhFE  の値等に依存
する。
1142図は本発明の第2の実施例の増幅器の等何回路
を示す回路図である。
第2図において、本実施例は、前記第1の実施例と異な
り、入出力間に負帰還抵抗300C挿入しているから、
入力端1の電流と増幅器の利得とが変えられるという利
点がある。この負帰還抵抗300以外は、第1図と同様
であり、その動作も前述したものと同様である。
前述した第1.第2の実施例の増幅器は、入力が第1の
相補型巣1.第2のトランジスタの共通エミッタに接続
され、これらの相補型巣1.第2のトランジスタのコレ
クタはそれぞれ第2の相補型トランジスタのベースに接
続される。これらの第2の相補型第3、第4のトランジ
スタは、エミ、り接地されてお9、それぞれのコレクタ
が互いに接続されて、出力端となる。また、エミッタが
互いに接地され、ベースが第1の相補型トランジスタの
ベースにそれぞれ接続され、この入力段の相補型トラン
ジスタをベース接地型として動作させる第3の相補型第
5、第6のトランジスタが設けられる。これらの第3の
相補型トランジスタは、アイドリンク電流設定用ダイオ
ードとして使用される。
〔発明の効果〕
以上説明したように、本発明は、クロスオーバー歪を大
巾に軽減し、安定した無信号特性を持ち、低い電源電圧
で動作し、曳好な利得帯域1積を持ち、しかも電源電圧
変動が出力端に現われないという効果があり、またトラ
ンスなどを使用せず、最小の部品による最適な動作をす
るという効果がある。
【図面の簡単な説明】
第1図は本発明の第1の実施例の増幅器の等価回路を示
す回路図、第2図は本発明の第2の実施例の増幅器の等
価回路図を示す回路図である。 1・・・・・・入力端、2・・・・・・出力端、10.
20  ・川・・第1の相補型トランジスタ、30.4
0  ・・・・・・第2の相補型トランジスタ、50.
 60  ・旧・・第3の相補型トランジスタ、11.
21  ・・・・・・第1の相補型トランジスタのベー
ス、  31. 41  ・川・・第2の相補型トラン
ジスタのベース、51.61  ・・・・・・第3の相
補型トランジスタのベース、12.22  ・・・・・
・第1の相補型トランジスタのエミッタ、32.42・
・・・・・第2の相補型トランジスタのエミッタ、52
゜62・・・・・・第3の相補型トランジスタのエミッ
タ、13.23  ・・・・・・第1の相補型トランジ
スタのコレ2I、33.43  ・・・・・・第2の相
補型トランジスタのコレクタ、53.63  ・川・・
第3の相補型トランジスタのコレクタ、70・・・・・
・正の電源端子、8゜・・・・・・負の電源端子、10
0,200,300・・・・・・抵抗器。

Claims (1)

    【特許請求の範囲】
  1. エミッタ同士を互いに接続して入力端とした第1の相補
    型第1、第2トランジスタと、これら第1の相補型第1
    、第2トランジスタのコレクタにベースがそれぞれ接続
    され、エミッタが定電源に接続され、かつコレクタ同士
    が互いに接続されて出力端とした第2の相補型第3、第
    4トランジスタと、前記第1の相補型第1、第2トラン
    ジスタのベースにベースがそれぞれ接続され、エミッタ
    がいずれも接地され、かつコレクタがそれぞれ抵抗を介
    して前記定電源に接続された第3の相補型第5、第6ト
    ランジスタとを備えたことを特徴とする増幅器。
JP12372589A 1989-05-16 1989-05-16 増幅器 Pending JPH02302109A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP12372589A JPH02302109A (ja) 1989-05-16 1989-05-16 増幅器

Applications Claiming Priority (1)

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JP12372589A JPH02302109A (ja) 1989-05-16 1989-05-16 増幅器

Publications (1)

Publication Number Publication Date
JPH02302109A true JPH02302109A (ja) 1990-12-14

Family

ID=14867819

Family Applications (1)

Application Number Title Priority Date Filing Date
JP12372589A Pending JPH02302109A (ja) 1989-05-16 1989-05-16 増幅器

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JP (1) JPH02302109A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5440273A (en) * 1994-06-02 1995-08-08 Analog Devices Inc. Rail-to-rail gain stage of an amplifier

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5069959A (ja) * 1973-05-07 1975-06-11

Patent Citations (1)

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