JPH02246283A - ホトダイオード用パッケージ - Google Patents

ホトダイオード用パッケージ

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Publication number
JPH02246283A
JPH02246283A JP1068095A JP6809589A JPH02246283A JP H02246283 A JPH02246283 A JP H02246283A JP 1068095 A JP1068095 A JP 1068095A JP 6809589 A JP6809589 A JP 6809589A JP H02246283 A JPH02246283 A JP H02246283A
Authority
JP
Japan
Prior art keywords
photodiode
external terminal
package
resistor
voltage
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1068095A
Other languages
English (en)
Inventor
Yasuki Mikamura
御神村 泰樹
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumitomo Electric Industries Ltd
Original Assignee
Sumitomo Electric Industries Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sumitomo Electric Industries Ltd filed Critical Sumitomo Electric Industries Ltd
Priority to JP1068095A priority Critical patent/JPH02246283A/ja
Publication of JPH02246283A publication Critical patent/JPH02246283A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched

Landscapes

  • Light Receiving Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 C産業上の利用分野〕 本発明は光フアイバ通信や光計測等を始めとするあらゆ
る分野に用いられるホトダイオード用のバラ勢−ジに関
するものである。
〔従来の技術〕
従来、この種のホトダイオード用のパッケージとしては
、例えば、第一5図に示されるパッケージングが完成さ
れる前の工程における状態のものがある。
チップ基体上に配置されたホトダイオード1のアノード
は外部端子2に接続され、カソードは外部端子3に接続
されており、側面にある外部端子2.3が露出されてホ
トダイオード1はパッケージジグされる。このようにパ
ッケージジグされたホトダイオード1は、例えば、第6
図に示される光受信回路に用いられる。
光受信回路はパッケージングされたホトダイオード1に
増幅器4および帰還抵抗11が接続されることにより構
成される。ホトダイオード1のカソードに接続された外
部端子3には正の電源電圧が印加され、ホトダイード1
に光が照射されるとこのホトダイオード1には光出力電
流が発生する。
発生した電流は外部端子2を介して増幅器4に入力され
、電圧に変換されて出力端子5に出力される。
〔発明が解決しようとする課題〕
このような光受信回路の光受信特性の重要な指標の1つ
にトランスインピーダンスがある。このトランスインピ
ーダンスは増幅器4に入力される電流と端子5に出力さ
れる電圧との比により表されるが、上記従来の構成をし
たホトダイオード用のパッケージにあっては、増幅器4
に入力される電流、つまり、ホトダイオード1に生じる
電流はパッケージを増幅器4に接続したままの状態では
測定することは出来ない。接続したままの状態で測定す
ることの可能なものは、照射される光の入力量と端子5
から出力される電圧だけである。このため、ホトダイオ
ード1を増幅器4に接続する前に、ホトダイオード1単
体でこの受光感度特性を測定する必要があり、このため
には特別の治具が必要とされ、パッケージに内蔵された
ホトダイオード1に生じる電流を測定するためには手間
がかかるという課題が有った。
′〔課題を解決するための手段〕 本発明はこのような課題を解消するためになされたもの
で、内蔵されたホトダイオードのアノードまたはカソー
ドに接続された第1の外部端子と、ホトダイオードと共
に内蔵された抵抗の一端とホトダイオードの他端との接
続点に接続された第2の外部端子と、抵抗の他端に接続
された第3の外部端子とを備えたものである。
〔作用〕
第1の外部端子と第3の外部端子との間に所定の電圧が
印加され、ホトダイオードに光が照射されて抵抗に光出
力電流が流れることにより、第2の外部端子と第3の外
部端子との間には光出力電流に応じた電圧が現れる。
〔実施例〕
第1図は本発明の一実施例によるパッケージのパッケー
ジングが完成される前の工程における状態の斜視図であ
る。
アルミナ等から成るチップ基体13には第1の外部端子
7.第2の外部端子9および第3の外部端子10が金メ
ツキ等により形成され、相互に電気的に絶縁されている
。外部端子9にはパッケージに内蔵されるホトダイオー
ド6がダイボンディングされており、このアノードは外
部端子7にワイヤボンディングされている。また、外部
端子9と外部端子10とに亘って抵抗8が接続され、ホ
トダイオード6と共にパッケージに内蔵される。
この抵抗8の一端とホトダイオード6のカソードとの接
続点は外部端子9に接続されている。この直方体形状の
チップ基体13は、例えば断面が2關X2m+s程度に
、長さが4 +n程度に形成され、チップ基体13上に
配置されたホトダイオード6および抵抗8は、側面にあ
る外部端子7,9.10が露出されてパッケージングさ
れる。そして、チップキャリア型のパッケージになる。
第2図はこ、のようにパッケージされた各素子を用いて
構成された光受信回路であり、第1図と同一部分につい
ては同符号を州いる。
ホトダイオード6のアノードが接続された外部端子、7
には増幅器11の入力端子が接続されへこの増幅器11
の出力は端子12に接続されている。
また、この増幅器11の入出力端子間には帰還抵抗Rf
が接続されている。
このように構成された光受信回路において、抵抗8の一
端に接続された外部端子10には正の電源電圧子vPD
が印加される。そして、ホトダイオード6に光が照射さ
れると、このホトダイオード6には光出力電流が生じて
増幅器11に入力される。増幅器11は入力された光出
力電流を電圧に変換して端子12に出力する。
本実施例によれば以下のようにして容易にトランスイン
ピーダンスを知ることが出来る。
まず、電圧vPDを外部端子10に印加しない状態で、
外部端子9,10間に適当な電圧を印加し、この端子間
に流れる電流を測定する。この電圧値および電流値を基
にして抵抗8の抵抗値を計算し、例えば、この抵抗値が
100[Ω]であったとする。そして、外部端子10に
電圧v 1例えばD +5[V]を印加し、強度が0 [dBm]の直流光を
ホトダイオード6に照射する。この状態で外部端子9.
10間における電圧降下を測定し、例えば、この電圧降
下が80 [mV]であったとすると、光出力電流は0
.8 [mA]になり、また、ホトダイオード、6の受
光感度は0.8 [A/Wlになる。従って、増幅器1
1に入力される電流値は0.8 [mA]になり、端子
12に出力される電圧値を測定することにより、ホトダ
イオード6がパッケージングされた状態で容易にトラン
スインピーダンスを知ることが出来る。
なお、この場合において、抵抗8における電圧降下80
[mV]によって5[v]の電圧vPDが+4.92 
[V]になってホトダイオード6に印加されても、ホト
ダイオード6の容量値や暗電流−等の電気的特性は変化
しないので実使用上なんら問題はない。
また、受光感度を測定する必要のない時には、外部端子
10を開放にしておいて外部端子9に電圧を印加するよ
うにしても良い。
第3図は本発明の他の一実施例によるパッケージのパッ
ケージングが完成される前の工程における状態の斜視図
であり、第1図と同一部分については同符号を用いる。
同図に示されたものは、第1図に示されたものに比較し
てホトダイオード6の向きが逆に接続された点が相違し
ている。すなわち、ホトダイオード6のカソードは外部
端子7に接続され、アノードは外部端子9および抵抗8
の一端に接続されている。これらも、側面にある外部端
子7,9.10が露出されてパッケージングされ、チッ
プキャリア型のパッケージになる。
第4図はこのようにパッケージされた各素子を用いて構
成された光受信回路であり、第3図と同一部分について
は同符号を用いる。本実施例による光受信回路も、前述
した実施例による光受信回路と同様にパッケージの外部
端子7が増幅器11に接続されることにより構成される
このように構成された光受信回路においては、抵抗8の
一端に接続された外部端子10には負の電源電圧−vP
Dが印加される。そして、ホトダイオード6に光が照射
されるとこのホトダイオード6には光出力電流が生じ、
前述した実施例と同様にして光出力電流は増幅され、増
幅された電圧が端子12に出力される。
本実施例においても容易に外部端子7,9゜10により
ホトダイオード6の光出力電流および受光特性が測定さ
れ、端子12における出力電圧を測定することにより、
ホトダイオード6がパッケージングされた状態で容易に
トランスインピーダンスを知ることが出来、前述した実
施例と同様な効果を奏する。
なお、上記各実施例においては本発明のパッケージをチ
ップキャリア型のものとして説明したがこれに限定され
ることはなく、例えば、TO−18等のキャンタイプの
パッケージを始めとしてその他のあらゆるパッケージに
適用することが出来、上記各実施例と同様な効果を奏す
る。
(発明の効果〕 以上説明したように本発明によれば、第1の外部端子と
第3の外部端子との間に所定の電圧が印加され、ホトダ
イオードに光が照射されて抵抗に光出力電流が流れるこ
とにより、第2の外部端子と第3の外部端子との間には
光出力電流に応じた電圧が現れる。
このため、パッケージングされたホトダイオードに生じ
る光出力電流を容易に測定することが出来るという効果
を有し、しかも、光受信特性の重要な指標の1つである
トランスインピーダンスをパッケージが接続されたまま
の状態で容易に知ることが出来るという効果も有する。
【図面の簡単な説明】
第1図は本発明の一実施例に係わるパッケージのパッケ
ージングの完成前の状態における斜視図、第2図は第1
図に示されるパッケージを用いて構成された光受信回路
図、第3図は本発明の他の一実施例に係わるパッケージ
のパッケージングの完成前の状態における斜視図、第4
図は第3図に示されるパッケージを用いて構成された光
受信回路図、第5図は従来のパッケージのパッケージン
グの完成前の状態における斜視図、第6図は第5図に示
されるパッケージを用いて構成された従来の光受信回路
図である。 6・・・ホトダイオード、 7゜ 9゜ 0・・・外部端子、 8・・・抵抗、 1・・・増幅器、 2・・・端子、 13・・・チ ツブ基体、 Rf・・・帰還抵抗。

Claims (1)

    【特許請求の範囲】
  1. 内蔵されたホトダイオードのアノードまたはカソードに
    接続された第1の外部端子と、このホトダイオードと共
    に内蔵された抵抗の一端と前記ホトダイオードの他端と
    の接続点に接続された第2の外部端子と、前記抵抗の他
    端に接続された第3の外部端子とを備えたことを特徴と
    するホトダイオード用パッケージ。
JP1068095A 1989-03-20 1989-03-20 ホトダイオード用パッケージ Pending JPH02246283A (ja)

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JP1068095A JPH02246283A (ja) 1989-03-20 1989-03-20 ホトダイオード用パッケージ

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