JPH0224554B2 - - Google Patents
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- Publication number
- JPH0224554B2 JPH0224554B2 JP52087413A JP8741377A JPH0224554B2 JP H0224554 B2 JPH0224554 B2 JP H0224554B2 JP 52087413 A JP52087413 A JP 52087413A JP 8741377 A JP8741377 A JP 8741377A JP H0224554 B2 JPH0224554 B2 JP H0224554B2
- Authority
- JP
- Japan
- Prior art keywords
- rom
- game
- storage device
- character
- games
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 3
- 230000006870 function Effects 0.000 description 1
- 230000004044 response Effects 0.000 description 1
Description
【発明の詳細な説明】
本発明はたとえばCRTデイスプレイ用信号発
生回路に関するものである。
生回路に関するものである。
家庭用テレビジヨン受像機を利用してゲームを
行うというホームビデオゲームが注目されてい
る。すなわち、ビデオゲーム装置は従来より遊戯
場等に設置して使用されているが、家庭用テレビ
ジヨン受像機に送信して画面に映像を表わし、さ
らには音声を出させてゲームを楽しむことができ
る装置が開発され始めたのは最近のことである。
行うというホームビデオゲームが注目されてい
る。すなわち、ビデオゲーム装置は従来より遊戯
場等に設置して使用されているが、家庭用テレビ
ジヨン受像機に送信して画面に映像を表わし、さ
らには音声を出させてゲームを楽しむことができ
る装置が開発され始めたのは最近のことである。
そして、ホームビデオゲームを楽しむための
CRTデイスプレイ用信号発生回路として第１図
に示す回路が知られている。
CRTデイスプレイ用信号発生回路として第１図
に示す回路が知られている。
この回路について以下簡単に説明する。１は
CPU（中央処理装置）で、通常の機能ブロツクの
ほか各種ゲームに共通なブログラムが書き込まれ
たROMを有する。２は実際に行う１つのゲーム
に特有なプログラムが書き込まれている。３は
CPU１及び上記ROM２の出力信号によつてコー
ド化信号を発生するコードゼネレータである。こ
のコードゼネレータ３は、各種キヤラクタ（英
字、漢字、数字、記号等）が書き込まれたROM
４から任意のキヤラクタをアクセスして、次段に
送出できるようにコード化された信号を発生す
る。ROM４には各種ゲームに必要とされるすべ
てのキヤラクタが記憶されており、コードゼネレ
ータ３の出力により指定されたキヤラクタをイン
タフエイス（TV−IF）５に送出し、さらにこの
インタフエイス５の出力を変調回路MOD６を介
してCRT（カソード・レイ・チユーブ）にビデオ
信号として送出するものである。この回路におい
て、ゲームの内容を変えるときはゲームに固有な
プログラムを記憶したROM２を交換するもの
で、複数種のROM２を用意しておけば、同数種
のゲームを楽しむことができる。
CPU（中央処理装置）で、通常の機能ブロツクの
ほか各種ゲームに共通なブログラムが書き込まれ
たROMを有する。２は実際に行う１つのゲーム
に特有なプログラムが書き込まれている。３は
CPU１及び上記ROM２の出力信号によつてコー
ド化信号を発生するコードゼネレータである。こ
のコードゼネレータ３は、各種キヤラクタ（英
字、漢字、数字、記号等）が書き込まれたROM
４から任意のキヤラクタをアクセスして、次段に
送出できるようにコード化された信号を発生す
る。ROM４には各種ゲームに必要とされるすべ
てのキヤラクタが記憶されており、コードゼネレ
ータ３の出力により指定されたキヤラクタをイン
タフエイス（TV−IF）５に送出し、さらにこの
インタフエイス５の出力を変調回路MOD６を介
してCRT（カソード・レイ・チユーブ）にビデオ
信号として送出するものである。この回路におい
て、ゲームの内容を変えるときはゲームに固有な
プログラムを記憶したROM２を交換するもの
で、複数種のROM２を用意しておけば、同数種
のゲームを楽しむことができる。
ところで、このようなCRTデイスプレイ用信
号発生回路においては、キヤラクタ記憶用ROM
４に記憶されたキヤラクタの種類しかCRTに描
くことができず、多くのゲームを楽しむようにす
るためにはキヤラクタ記憶用ROM４の記憶容量
を増大させる必要があり、それに対応してコード
ゼネレータ３に記憶しておくコードの量も増大す
る。また、将来出現する新しいゲームには本回路
を適用することが不可能となり得る。
号発生回路においては、キヤラクタ記憶用ROM
４に記憶されたキヤラクタの種類しかCRTに描
くことができず、多くのゲームを楽しむようにす
るためにはキヤラクタ記憶用ROM４の記憶容量
を増大させる必要があり、それに対応してコード
ゼネレータ３に記憶しておくコードの量も増大す
る。また、将来出現する新しいゲームには本回路
を適用することが不可能となり得る。
本発明はかかる問題を解決すべくなされたもの
で、その一つの目的はデイスプレイ用信号発生回
路に用いる記憶装置の記憶容量を小さくすること
にあり、他の目的はデイスプレイ用信号発生回路
の汎用性を高めることにある。
で、その一つの目的はデイスプレイ用信号発生回
路に用いる記憶装置の記憶容量を小さくすること
にあり、他の目的はデイスプレイ用信号発生回路
の汎用性を高めることにある。
上記目的を達成するための本発明の一実施態様
は、各種用途に共通なプログラムを記憶する記憶
回路とその他の機能ブロツクとを有する処理装
置、特定の用途に固有なプログラムとキヤラクタ
とを記憶する交換可能な記憶装置及び、上記処理
装置と上記記憶装置とによつて制御され、上記記
憶装置に保持されたキヤラクタを該記憶装置から
取り出してCRT上に表示させることを特徴とす
るものである。
は、各種用途に共通なプログラムを記憶する記憶
回路とその他の機能ブロツクとを有する処理装
置、特定の用途に固有なプログラムとキヤラクタ
とを記憶する交換可能な記憶装置及び、上記処理
装置と上記記憶装置とによつて制御され、上記記
憶装置に保持されたキヤラクタを該記憶装置から
取り出してCRT上に表示させることを特徴とす
るものである。
以下本発明を実施例により説明する。
第２図は本発明の一実施例に係るCRTデイス
プレイ用信号発生回路を示すブロツク図である。
プレイ用信号発生回路を示すブロツク図である。
１はCPU（中央処理装置）である。このCPUに
は演算回路、各種レジスタ等通常の機能ブロツク
のほか、各種ゲームに共通するプログラムを書き
込んだシステム・モニター用ROMすなわちパタ
ーンメモリコントロール用プログラム、キイコン
トロール用プログラムを書き込んだROMを包含
している。
は演算回路、各種レジスタ等通常の機能ブロツク
のほか、各種ゲームに共通するプログラムを書き
込んだシステム・モニター用ROMすなわちパタ
ーンメモリコントロール用プログラム、キイコン
トロール用プログラムを書き込んだROMを包含
している。
７は実際に行う一つのゲームに固有のゲームプ
ログラム、そのゲームに必要とされる文字、記号
等のキヤラクタコード及びキヤラクタ交換用コー
ドゼネレータが記憶されている。
ログラム、そのゲームに必要とされる文字、記号
等のキヤラクタコード及びキヤラクタ交換用コー
ドゼネレータが記憶されている。
そして、本発明ではキヤラクタ信号を発生する
ために専用のコードゼネレータを有していない。
あくまで、各ゲーム毎に用意されたROM７の中
にゲームに固有のコードゼネレータが存在してい
るにすぎない。
ために専用のコードゼネレータを有していない。
あくまで、各ゲーム毎に用意されたROM７の中
にゲームに固有のコードゼネレータが存在してい
るにすぎない。
８はROM７においてコード変換されたパター
ンが記憶されるパターンメモリで、リフレツシユ
メモリとしての機能する。ここで記憶されたパタ
ーンは、TVIF５，MOD６を介してCRTにビデ
オ信号送出すればCRT画面に描くことができる
パターンそのものである。５はリフレツシユ用パ
ターンメモリとテレビジヨン受像機との間に介在
するインターフエイスTVIFで、パターンメモリ
８からの読み出しとシリアル・データへの変換、
同期信号の生成、カラーコントロール等を行う。
６はTVIF５からの信号を受けて各搬送波で変調
する回路である。
ンが記憶されるパターンメモリで、リフレツシユ
メモリとしての機能する。ここで記憶されたパタ
ーンは、TVIF５，MOD６を介してCRTにビデ
オ信号送出すればCRT画面に描くことができる
パターンそのものである。５はリフレツシユ用パ
ターンメモリとテレビジヨン受像機との間に介在
するインターフエイスTVIFで、パターンメモリ
８からの読み出しとシリアル・データへの変換、
同期信号の生成、カラーコントロール等を行う。
６はTVIF５からの信号を受けて各搬送波で変調
する回路である。
このような本発明によれば、各ゲーム毎に取換
えるROM２中にそのゲームに固有のプログラム
とともにそのゲームに必要とされるキヤラクタに
ついてのコードゼネレータを置く方式であるか
ら、CRTデイスプレイ用信号回路の非交換部分
には各種ゲームに必要となるキヤラクタのコード
を用意しておく必要は全くない。したがつて、コ
ードゼネレータ用ROMのチツプサイズが大きく
なるという従来の問題は解決される。また、交換
用ROMさえ用意すればどのようなゲームでも楽
しむことができ、将来開発される新しいゲームに
も支障なく適用することができ、汎用性に優れる
のである。
えるROM２中にそのゲームに固有のプログラム
とともにそのゲームに必要とされるキヤラクタに
ついてのコードゼネレータを置く方式であるか
ら、CRTデイスプレイ用信号回路の非交換部分
には各種ゲームに必要となるキヤラクタのコード
を用意しておく必要は全くない。したがつて、コ
ードゼネレータ用ROMのチツプサイズが大きく
なるという従来の問題は解決される。また、交換
用ROMさえ用意すればどのようなゲームでも楽
しむことができ、将来開発される新しいゲームに
も支障なく適用することができ、汎用性に優れる
のである。
本発明は必ずしもゲーム用のものに限定される
ことなく、例えば教育用等にも用いることができ
るものであり、CRTデイスプレイ用信号発生回
路に一般的に適用できるものである。
ことなく、例えば教育用等にも用いることができ
るものであり、CRTデイスプレイ用信号発生回
路に一般的に適用できるものである。
第１図は従来例を示すブロツク線図、第２図は
本発明の一実施例を示すブロツク線図である。 １…CPU、２…ゲームに固有なプログラム内
蔵ROM、３…コードゼネレータ、４…ROM、
５…TVIF、６…MOD、７…ゲームに固有なプ
ログラム、キヤラクタ記憶用ROM、８…リフレ
ツシユ用パターンメモリ。
本発明の一実施例を示すブロツク線図である。 １…CPU、２…ゲームに固有なプログラム内
蔵ROM、３…コードゼネレータ、４…ROM、
５…TVIF、６…MOD、７…ゲームに固有なプ
ログラム、キヤラクタ記憶用ROM、８…リフレ
ツシユ用パターンメモリ。
Claims (1)
- １ 演算回路及び各種レジスタとともにシステ
ム・モニター用プログラムが書き込まれた第１記
憶装置を含む処理装置と、特定の用途に固有なプ
ログラムとデイスプレイ装置に直接に表示される
べきパターンにされたキヤラクタ情報とを固定記
憶するようにされ、かつ上記第１記憶装置とは独
立にされた交換可能な第２記憶装置とを設け、上
記処理装置と上記第２記憶装置とによる制御によ
つて上記第２記憶装置に保持された上記キヤラク
タ情報を上記第２記憶装置から取り出して上記デ
イスプレイ装置に表示させるようにしてなること
を特徴とするデイスプレイ用信号発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8741377A JPS5423331A (en) | 1977-07-22 | 1977-07-22 | Generating circuit for crt display signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8741377A JPS5423331A (en) | 1977-07-22 | 1977-07-22 | Generating circuit for crt display signal |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5423331A JPS5423331A (en) | 1979-02-21 |
| JPH0224554B2 true JPH0224554B2 (ja) | 1990-05-29 |
Family
ID=13914180
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8741377A Granted JPS5423331A (en) | 1977-07-22 | 1977-07-22 | Generating circuit for crt display signal |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5423331A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5772192A (en) * | 1980-10-23 | 1982-05-06 | Mitsubishi Electric Corp | Display unit |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4873042A (ja) * | 1971-12-27 | 1973-10-02 | ||
| JPS51113529A (en) * | 1975-03-12 | 1976-10-06 | Alpex Computer Corp | Display controller to be used together with television receiver |
-
1977
- 1977-07-22 JP JP8741377A patent/JPS5423331A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4873042A (ja) * | 1971-12-27 | 1973-10-02 | ||
| JPS51113529A (en) * | 1975-03-12 | 1976-10-06 | Alpex Computer Corp | Display controller to be used together with television receiver |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5423331A (en) | 1979-02-21 |
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