JPH02234447A - 半導体集積回路素子の接続方法 - Google Patents

半導体集積回路素子の接続方法

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JPH02234447A
JPH02234447A JP5534089A JP5534089A JPH02234447A JP H02234447 A JPH02234447 A JP H02234447A JP 5534089 A JP5534089 A JP 5534089A JP 5534089 A JP5534089 A JP 5534089A JP H02234447 A JPH02234447 A JP H02234447A
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JP
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Yoshihiko Nio
仁尾 吉彦
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体集積回路素子をプリント配線基板に接
続し搭載する半導体集積回路素子の接続方法に関する。
〔従来の技術〕
近年、エレクトロニクス機器の小型化に伴ない、半導体
集積回路素子(以下ICチップと言う)の高密度実装に
対する要請がなされており、とりわけ、ICチップとプ
リント配線基板との高密度実装が重要となっている。こ
の高密度実装法の一つとして、例えば、フリップチップ
ボンデイング法がある. 第2図(a)及び(b)は従来のICチップの接続方法
の一例を説明するための工程順に示したICチップとプ
リント配線基板の断面図である。
このICチップの接続方法は、まず、第2図(a)に示
すように、電極パッド2上にはんだバンブ3が形成され
たICチップ1と、このはんだバンプ3に対応して形成
された電極端子2aをもつプリント配線基板4とを向い
合せる。次に、第2図〈b)に示すように、ICチップ
1をプリント配線基板4に乗せ、加熱することによりは
んだバンブ3のはんだをリフローさせ、電極パッド2と
電極端子2aとを接続していた。
〔発明が解決しようとする課題〕
しかしながら、上述した従来のICチップの接続方法は
、はんだバンプの表面及び電極端子の表面がしばしば酸
化し接続が不能になるという問題がある.このため、接
続する前に、フラックス等を塗布し、この酸化膜を除去
する必要があった.しかし、このフラックス成分の残存
による接続性能の劣化、ICチップへの侵入によりアル
ミニウム配線の腐食、あるいはICの動作特性劣化とい
う重大な問題を起す欠点がある。さらに、隣接する接続
部が短絡しなりする製造上の欠点も有していた。
本発明の目的は、再現性良く、ICに対して悪影響を与
えないICチップの接続方法を提供することにある。
〔課題を解決するための手段〕
本発明の半導体集積回路素子の接続方法は、半導体集積
回路素子の電極パッドとこの電極パッドに対応するプリ
ント配線基板の電極端子とを溶融はんだで接続する半導
体集積回路素子の接続方法において、前記電極パッドあ
るいは前記電極端子上にの少なくとも一方に紫外線硬化
樹脂を塗布する工程と、前記電極パッドと前記電極端子
とを押圧し、溶融はんだで接続する工程と、前記工程に
より接続された部分に紫外線を照射し前記紫外線硬化樹
脂を硬化する工程とを含んで構成される。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図(a)〜(c)は本発明のICチップの接続方法
を説明するための工程順に示したICチップとプリント
配線基板の断面図である。この接続方法は、まず、第1
図(a)に示すように、ICチップ1の表面に、例えば
、C u / W / A Iの三層金属膜、その厚さ
は、それぞれ1.0μm、0.1μm、0.8μm、あ
るいはA u / N i /C u / A ]の四
層金属膜、その厚さは、それぞれ0.8μm,0.2μ
m.0.2am、1.0μmで形成された電極パッド2
にはんだバンプ3を形成する。ここで、このはんだバン
プ3の成分としては、例えば、鉛:63%、錫:37%
の共晶はんだ(融点=183℃》を用いたが、融点を所
望のものにするために、組成比をコントロール出来るこ
とは言うまでもない。
次に、表面を洗浄後、紫外線硬化樹脂5を電極パッド2
含めたICチップ1に塗布する。このことにより、はん
だバンプ3は密閉された状態になり、その表面は酸化さ
れることはない。次に、セラミック、ガラスエボキシ、
あるいはガラス等で製作されたプリント配線基板4上に
CuあるいはN i / C u等で形成された電極端
子2aに前述と同様に紫外線硬化樹脂5を塗布する。
次に、第1図(b)に示すように、ICチップ1をプリ
ント配線基板4の上に乗せ、錘を乗せて押圧力を与える
。次に、ICチップ1側より加熱し、例えば、250℃
程度にし、はんだをリフローさせ接続を行なう.このと
き、ICチップ1とプリント配線基板4を平行に保ちな
がら加圧し、ICチップ1とプリント配線基板4とを適
切な間隔に保つ必要がある。
次に、第1図(C)に示すように、高圧水銀灯により矢
印6の方向から紫外線を照射し、ICチップ1とプリン
ト配線基板4を接着固定するとともにはんだ接続部分の
固定を行なう。なお、プリント配線基板4がガラス基板
の場合は、矢印6aの方向から紫外線の照射を併用する
〔発明の効果〕
以上説明したように本発明のICチップの接続方法は、
接続表面が酸化等を起すことがないなめ、フラックスを
全く使用せずにはんだ接続が出来る。
すなわち、フラックスの悪影響がなく、構造上はんだブ
リッジも発生しない。同時に、樹脂による接続部の固定
と保護とが容易に実現される。また、補修のなめに、I
Cチップを交換する際も、溶剤により樹脂を溶解し、加
熱することにより、容易にICチップを取りはずすこと
が出来、再接続も簡単である。
このように、本発明のICチップの接続方法は、高密度
微細接続が確実に、容易に、信頼性良く実施出来るとい
う極めて顕著な効果が得られる。
【図面の簡単な説明】
第1図(a)〜(C)は本発明のICチップの接続方法
を説明するための工程順に示したICチップとプリント
配線基板の断面図、第2図(a)及び(b)は従来のI
Cチップの接続方法の一例を説明するための工程順に示
したICチップとプリント配線基板の断面図である。 1・・・ICチップ、2・・・電極パッド、2a・・・
電極端子、3・・・はんだバンプ、4・・・プリント配
線基板、5・・・紫外線硬化樹脂、6、6a・・・矢印

Claims (1)

    【特許請求の範囲】
  1. 半導体集積回路素子の電極パッドとこの電極パッドに対
    応するプリント配線基板の電極端子とを溶融はんだで接
    続する半導体集積回路素子の接続方法において、前記電
    極パッドあるいは前記電極端子上にの少なくとも一方に
    紫外線硬化樹脂を塗布する工程と、前記電極パッドと前
    記電極端子とを押圧し、溶融はんだで接続する工程と、
    前記工程により接続された部分に紫外線を照射し前記紫
    外線硬化樹脂を硬化する工程とを含んでいることを特徴
    とする半導体集積回路素子の接続方法。
JP5534089A 1989-03-07 1989-03-07 半導体集積回路素子の接続方法 Pending JPH02234447A (ja)

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Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0766242A (ja) * 1993-08-20 1995-03-10 Internatl Business Mach Corp <Ibm> 電子素子アセンブリおよび再加工方法
US5956605A (en) * 1996-09-20 1999-09-21 Micron Technology, Inc. Use of nitrides for flip-chip encapsulation
WO1999056312A1 (en) * 1998-04-27 1999-11-04 Alpha Metals, Inc. Flip chip with integrated flux, mask and underfill
EP0875935A3 (en) * 1997-04-28 2000-08-02 NEC Corporation Semiconductor device having a projecting electrode
US6229209B1 (en) 1995-02-23 2001-05-08 Matsushita Electric Industrial Co., Ltd. Chip carrier
CN113543517A (zh) * 2021-06-30 2021-10-22 青岛歌尔智能传感器有限公司 Sip模组与fpc的连接方法及电子产品

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5873126A (ja) * 1981-10-27 1983-05-02 Seiko Keiyo Kogyo Kk 半導体装置の実装方法
JPS62252946A (ja) * 1986-04-25 1987-11-04 Matsushita Electric Ind Co Ltd 半導体装置の製造方法
JPS63127541A (ja) * 1986-11-17 1988-05-31 Matsushita Electric Ind Co Ltd チップの接合方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5873126A (ja) * 1981-10-27 1983-05-02 Seiko Keiyo Kogyo Kk 半導体装置の実装方法
JPS62252946A (ja) * 1986-04-25 1987-11-04 Matsushita Electric Ind Co Ltd 半導体装置の製造方法
JPS63127541A (ja) * 1986-11-17 1988-05-31 Matsushita Electric Ind Co Ltd チップの接合方法

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0766242A (ja) * 1993-08-20 1995-03-10 Internatl Business Mach Corp <Ibm> 電子素子アセンブリおよび再加工方法
US6229209B1 (en) 1995-02-23 2001-05-08 Matsushita Electric Industrial Co., Ltd. Chip carrier
US6365499B1 (en) 1995-02-23 2002-04-02 Matsushita Electric Industrial Co., Ltd. Chip carrier and method of manufacturing and mounting the same
US6372547B2 (en) 1995-02-23 2002-04-16 Matsushita Electric Industrial Co., Ltd. Method for manufacturing electronic device with resin layer between chip carrier and circuit wiring board
US5956605A (en) * 1996-09-20 1999-09-21 Micron Technology, Inc. Use of nitrides for flip-chip encapsulation
US6528894B1 (en) 1996-09-20 2003-03-04 Micron Technology, Inc. Use of nitrides for flip-chip encapsulation
US6972249B2 (en) 1996-09-20 2005-12-06 Micron Technology, Inc. Use of nitrides for flip-chip encapsulation
EP0875935A3 (en) * 1997-04-28 2000-08-02 NEC Corporation Semiconductor device having a projecting electrode
WO1999056312A1 (en) * 1998-04-27 1999-11-04 Alpha Metals, Inc. Flip chip with integrated flux, mask and underfill
CN113543517A (zh) * 2021-06-30 2021-10-22 青岛歌尔智能传感器有限公司 Sip模组与fpc的连接方法及电子产品

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