JPH02198246A - セル交換装置 - Google Patents
セル交換装置Info
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- JPH02198246A JPH02198246A JP1016224A JP1622489A JPH02198246A JP H02198246 A JPH02198246 A JP H02198246A JP 1016224 A JP1016224 A JP 1016224A JP 1622489 A JP1622489 A JP 1622489A JP H02198246 A JPH02198246 A JP H02198246A
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- Japan
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- 239000000872 buffer Substances 0.000 claims abstract description 15
- 238000006243 chemical reaction Methods 0.000 claims description 8
- 238000005215 recombination Methods 0.000 claims description 3
- 230000006798 recombination Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
- H04L12/5601—Transfer mode dependent, e.g. ATM
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/10—Packet switching elements characterised by the switching fabric construction
- H04L49/104—Asynchronous transfer mode [ATM] switching fabrics
- H04L49/105—ATM switching elements
- H04L49/106—ATM switching elements using space switching, e.g. crossbar or matrix
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
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- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
- H04L12/5601—Transfer mode dependent, e.g. ATM
- H04L2012/5638—Services, e.g. multimedia, GOS, QOS
- H04L2012/5646—Cell characteristics, e.g. loss, delay, jitter, sequence integrity
- H04L2012/5649—Cell delay or jitter
-
- H—ELECTRICITY
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- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
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- H04L12/56—Packet switching systems
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
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- Mathematical Physics (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、固定長のセルを単位として情報の伝送を行う
セル交換装置に係わり、特に出線に対応させて時分割チ
ャネル多重構成された時分割線を入線ごとに持ち、周期
的に時分割線を選択する選択手段を出線ごとに持って、
所望の出線に各セルを自己ルーティング交換するセル交
換装置に関する。
セル交換装置に係わり、特に出線に対応させて時分割チ
ャネル多重構成された時分割線を入線ごとに持ち、周期
的に時分割線を選択する選択手段を出線ごとに持って、
所望の出線に各セルを自己ルーティング交換するセル交
換装置に関する。
セル交換装置は、情報とその所望の宛先を示したアドレ
ス等からなるセルを単位として交換を行っている。この
ようなセル交換装置で同一宛先の複数のセルが同時に人
力された場合の交換方法としては、（イ）ソーティング
回路網とルーティング回路網を組み合わせて、競合する
セルをルーティング回路網に再入力する方法（Ａ Ｗｉ
ｄｅｂａｎｄ旧ｇｉｔａｌ ５ｗ１ｔｃｈ” Ｐｒｏｃ
、 １９８４ Ｇｒｏｂｅｃｏｍｅ ［：ｏｎｆ、）や
、（ロ）バス形の入線から出線ごとに設けられたセルの
選択機能を持ったスイッチモジュールを用いて交換を行
う方法（“Ｔｈｅ Ｋｎｏｃｋｏｕｔ ５ｗ１ｔｃｈ：
Ｓｉｍｐｌｅ Ｍｏｄｕｌａｒ 八ｒｃｈｉｔｅｃ
ｔｕｒｅ ｆｏｒ ｌｌｉｇｈｐｅｒｆｏｒｍａｎ
ｃｅ Ｐａｃｈｅｔ ５ｗ１ｔｃｈ” Ｐｒｏｃ、ＩＳ
Ｓ ８７゜Ｍａｒｃｈ、 １９８７）等があった。
ス等からなるセルを単位として交換を行っている。この
ようなセル交換装置で同一宛先の複数のセルが同時に人
力された場合の交換方法としては、（イ）ソーティング
回路網とルーティング回路網を組み合わせて、競合する
セルをルーティング回路網に再入力する方法（Ａ Ｗｉ
ｄｅｂａｎｄ旧ｇｉｔａｌ ５ｗ１ｔｃｈ” Ｐｒｏｃ
、 １９８４ Ｇｒｏｂｅｃｏｍｅ ［：ｏｎｆ、）や
、（ロ）バス形の入線から出線ごとに設けられたセルの
選択機能を持ったスイッチモジュールを用いて交換を行
う方法（“Ｔｈｅ Ｋｎｏｃｋｏｕｔ ５ｗ１ｔｃｈ：
Ｓｉｍｐｌｅ Ｍｏｄｕｌａｒ 八ｒｃｈｉｔｅｃ
ｔｕｒｅ ｆｏｒ ｌｌｉｇｈｐｅｒｆｏｒｍａｎ
ｃｅ Ｐａｃｈｅｔ ５ｗ１ｔｃｈ” Ｐｒｏｃ、ＩＳ
Ｓ ８７゜Ｍａｒｃｈ、 １９８７）等があった。
このうち（イ）で示した交換方法では、セルの再投入時
にセルの順序が逆転するのを避けるために、複雑な処理
が必要であるという問題があった。
にセルの順序が逆転するのを避けるために、複雑な処理
が必要であるという問題があった。
また、同一情報を複数の出線に同時に出力する放送機能
の実現が困難であった。
の実現が困難であった。
また（口）で示した交換方法では、各出線ごとにスイッ
チを設ける必要があるため、ハードウェアの規模が大き
くなるという問題があった。
チを設ける必要があるため、ハードウェアの規模が大き
くなるという問題があった。
そこで本発明の目的は、同一宛先を持った複数のセルが
同時に人力された場合でも比較的簡単な回路構成で所望
の出線に出力することのできるセル交換装置を提供する
ことにある。
同時に人力された場合でも比較的簡単な回路構成で所望
の出線に出力することのできるセル交換装置を提供する
ことにある。
本発明のセル交換装置では、情報とこの情報が伝達され
るべき宛先を示すアドレスとを含んだビット長が固定さ
れたセルを用い、各セルごとに所望の宛先に情報が伝達
されるように交換する交換システムにおいて、出線に対
応させ時分割チャネル多重構成とした時分割線と、人力
されたセルを時分割線に出力するためのシリアル−パラ
レル変換手段と、各セルごとのアドレスを基にして所望
とする出線を認識し出力されるべき前記した時分割線上
のチャネル位置を指示するアドレスフィルタ手段と、こ
のアドレスフィルタ手段の指示によって各セルを時間軸
上で組み換えて時分割線上に出力する遅延バッファ等の
組換手段とを各入線ごとに具備し、各入線ごとの時分割
線上のセルを周期的に選択する選択手段と、選択された
セルを取り込むバッファ手段と、取り込まれたセルを出
線に出力するためのパラレル−シリアル変換手段とを出
線ごとに具備することを特徴とする。
るべき宛先を示すアドレスとを含んだビット長が固定さ
れたセルを用い、各セルごとに所望の宛先に情報が伝達
されるように交換する交換システムにおいて、出線に対
応させ時分割チャネル多重構成とした時分割線と、人力
されたセルを時分割線に出力するためのシリアル−パラ
レル変換手段と、各セルごとのアドレスを基にして所望
とする出線を認識し出力されるべき前記した時分割線上
のチャネル位置を指示するアドレスフィルタ手段と、こ
のアドレスフィルタ手段の指示によって各セルを時間軸
上で組み換えて時分割線上に出力する遅延バッファ等の
組換手段とを各入線ごとに具備し、各入線ごとの時分割
線上のセルを周期的に選択する選択手段と、選択された
セルを取り込むバッファ手段と、取り込まれたセルを出
線に出力するためのパラレル−シリアル変換手段とを出
線ごとに具備することを特徴とする。
すなわち本発明では、同一宛先を持った複数のセルが同
時に人力された場合でも、これらを時分割線上に組み換
えて出力した後に選択手段で出線ごとに選択することに
し、前記した目的を達成する。
時に人力された場合でも、これらを時分割線上に組み換
えて出力した後に選択手段で出線ごとに選択することに
し、前記した目的を達成する。
以下、実施例につき本発明の詳細な説明する。
第１図は本発明の一実施例におけるセル交換装置の構成
を表わしたものである。この実施例の装置では、入線数
がｎ１出線数がｍとなっている。
を表わしたものである。この実施例の装置では、入線数
がｎ１出線数がｍとなっている。
それぞれの入線１１〜Ｉ、、はシリアル−パラレル変換
器（Ｓ／Ｐ）１１．〜１１．の入力端に接続されており
、その出力側にはアドレスを認識するためのアドレスフ
ィルタ（ＡＦ）１２．〜１２、とセルを遅延させるため
の遅延バッファ（ＤＢ）１３、〜１３１．が設けられて
いる。遅延バッファＩＬ 〜１３．の出力は、それぞれ
時分割線１５１〜１５．．の一端に接続されている。こ
れら時分割線１５．〜１５１の他端は、全部でｍ個の選
択回路１６．−１６．の全部でｎ個の入力端子のうちの
対応するものにそれぞれ接続されている。各選択回路１
６．〜１６．の出力側には、バッファ（Ｂ）１７． 〜
１７．とパラレル−シリアル変換器（Ｐ／５）１８．〜
１８．が直列に配置されており、パラレル−シリアル変
換器１８１〜１８゜の出力側がそれぞれ対応する出線Ｏ
１〜０．に接続されている。
器（Ｓ／Ｐ）１１．〜１１．の入力端に接続されており
、その出力側にはアドレスを認識するためのアドレスフ
ィルタ（ＡＦ）１２．〜１２、とセルを遅延させるため
の遅延バッファ（ＤＢ）１３、〜１３１．が設けられて
いる。遅延バッファＩＬ 〜１３．の出力は、それぞれ
時分割線１５１〜１５．．の一端に接続されている。こ
れら時分割線１５．〜１５１の他端は、全部でｍ個の選
択回路１６．−１６．の全部でｎ個の入力端子のうちの
対応するものにそれぞれ接続されている。各選択回路１
６．〜１６．の出力側には、バッファ（Ｂ）１７． 〜
１７．とパラレル−シリアル変換器（Ｐ／５）１８．〜
１８．が直列に配置されており、パラレル−シリアル変
換器１８１〜１８゜の出力側がそれぞれ対応する出線Ｏ
１〜０．に接続されている。
第２図は、セルの時分割多重例を示したものである。同
図ａで示したようにアドレスと情報を含んだセルは、セ
ル長周期Ｔで伝送されてくる。これらのセルは、第１図
に示すシリアル−パラレル変換器１１に入力されてパラ
レルデータに変換される。
図ａで示したようにアドレスと情報を含んだセルは、セ
ル長周期Ｔで伝送されてくる。これらのセルは、第１図
に示すシリアル−パラレル変換器１１に入力されてパラ
レルデータに変換される。
第２図すは、この変換後の状態を表わしたもので、セル
長周期Ｔ内に最大ｍ個のセルが時分割多重化されるよう
に変換が行われている。このため、１つのセルの変換後
の周期ｔはセル長周期Ｔと次の（１）式の関係となる。
長周期Ｔ内に最大ｍ個のセルが時分割多重化されるよう
に変換が行われている。このため、１つのセルの変換後
の周期ｔはセル長周期Ｔと次の（１）式の関係となる。
Ｔ＝ｍ ｔ ・・・・・・（１
）時分割線１５．〜１５１．は、それぞれ第２図Ｃに示
したように、チャネル位置が出線Ｏ５〜Ｏ１にそれぞれ
対応したチャネル多重構成となっている。そして、各セ
ルに付加されているアドレスをアドレスフィルタ１２．
〜１２．が認識し、所望のアドレスに対応するチャネル
位置にそれぞれのセルを出力するように遅延バッファ１
３．〜１３゜の制御が行われる。なお、同一情報を複数
の出線０に同時に出力する場合には、所望の複数のチャ
ネル位置に同一情報を繰り返し出力するようにすればよ
い。
）時分割線１５．〜１５１．は、それぞれ第２図Ｃに示
したように、チャネル位置が出線Ｏ５〜Ｏ１にそれぞれ
対応したチャネル多重構成となっている。そして、各セ
ルに付加されているアドレスをアドレスフィルタ１２．
〜１２．が認識し、所望のアドレスに対応するチャネル
位置にそれぞれのセルを出力するように遅延バッファ１
３．〜１３゜の制御が行われる。なお、同一情報を複数
の出線０に同時に出力する場合には、所望の複数のチャ
ネル位置に同一情報を繰り返し出力するようにすればよ
い。
ｍ個の選択回路１６．〜１６．は、周期ｔごとに順次時
分割線１５．〜１５．を選択していくことで、自己の出
線０に対応するセルを対応するバッファ１７に取り込ん
でいく。
分割線１５．〜１５．を選択していくことで、自己の出
線０に対応するセルを対応するバッファ１７に取り込ん
でいく。
第３図は、時分割線間のチャネル位相関係を表わしたも
のである。それぞれの時分割線１５．〜１５、について
同図（Ａ）に示したような位相関係が設定された場合、
選択回路１６．−１６．は第３図（Ｂ）に示したような
タイミングで時分割線１５．〜１５．を順次選択するこ
とになる。
のである。それぞれの時分割線１５．〜１５、について
同図（Ａ）に示したような位相関係が設定された場合、
選択回路１６．−１６．は第３図（Ｂ）に示したような
タイミングで時分割線１５．〜１５．を順次選択するこ
とになる。
第４図は、時分割線間のチャネル位相関係の他の例を表
わしたものである。このように時分割線１５、〜１５Ｉ
、に対する出線０．−０．の配置関係を組み換えること
も可能である。
わしたものである。このように時分割線１５、〜１５Ｉ
、に対する出線０．−０．の配置関係を組み換えること
も可能である。
以上説明した一連の動作によって、同一の宛先をもった
複数のセルが各入線から入力された場合でも、競合によ
る廃棄が生じたり、複雑な処理を要したり、あるいは順
序が逆転する等の不都合を生じることなく、所望の出線
にこれを出力することができる。更に、同一情報を複数
の出線に同時に交換出力する放送機能も本実施例で容易
に実現することができる。
複数のセルが各入線から入力された場合でも、競合によ
る廃棄が生じたり、複雑な処理を要したり、あるいは順
序が逆転する等の不都合を生じることなく、所望の出線
にこれを出力することができる。更に、同一情報を複数
の出線に同時に交換出力する放送機能も本実施例で容易
に実現することができる。
このように、本発明によれば出線に対応させた時分割多
重構成となった時分割線と、シリアル−パラレル変換手
段、アドレスフィルタ手段および組換手段を各入線ごと
に具備させ、周期的に各時分割線上のセルを選択する選
択手段と、選択されたセルを取り込むバッファ手段とを
各出線ごとに具備させたので、同一宛先を持った複数の
セルが同時に入力された場合であっても、競合によるセ
ルの廃棄を行う必要がなく、所望の出線に出力すること
ができる。更に本発明では同一情報を複数の出線に同時
に出力することが容易に実現できるという長所もある。
重構成となった時分割線と、シリアル−パラレル変換手
段、アドレスフィルタ手段および組換手段を各入線ごと
に具備させ、周期的に各時分割線上のセルを選択する選
択手段と、選択されたセルを取り込むバッファ手段とを
各出線ごとに具備させたので、同一宛先を持った複数の
セルが同時に入力された場合であっても、競合によるセ
ルの廃棄を行う必要がなく、所望の出線に出力すること
ができる。更に本発明では同一情報を複数の出線に同時
に出力することが容易に実現できるという長所もある。
図面は本発明の一実施例を説明するためのもので、この
うち第１図はセル交換装置の概要を示すブロック図、第
２図はセルの時分割多重例を示した説明図、第３図（Ａ
）は時分割線間のチャネル位相関係を表わしたタイミン
グ図、同図（Ｂ）は時分割線の選択のタイミングを示す
タイミング図、第４図は時分割線間のチャネル位相関係
の他の例を示すタイミング図である。 １１・・・・・・シリアル−パラレル変換器、１２・・
・・・・アドレスフィルタ、 １３・・・・・・遅延バッファ、１５・・・・・・時分
割線、１６・・・・・・選択回路、１７・・・・・・バ
ッファ、１８・・・・・・パラレル−シリアル変換器。 出 願 人 日本電気株式会社 代 理 人 弁理士 山内梅雄 第２図
うち第１図はセル交換装置の概要を示すブロック図、第
２図はセルの時分割多重例を示した説明図、第３図（Ａ
）は時分割線間のチャネル位相関係を表わしたタイミン
グ図、同図（Ｂ）は時分割線の選択のタイミングを示す
タイミング図、第４図は時分割線間のチャネル位相関係
の他の例を示すタイミング図である。 １１・・・・・・シリアル−パラレル変換器、１２・・
・・・・アドレスフィルタ、 １３・・・・・・遅延バッファ、１５・・・・・・時分
割線、１６・・・・・・選択回路、１７・・・・・・バ
ッファ、１８・・・・・・パラレル−シリアル変換器。 出 願 人 日本電気株式会社 代 理 人 弁理士 山内梅雄 第２図
Claims (1)
- 【特許請求の範囲】 情報とこの情報が伝達されるべき宛先を示すアドレスと
を含んだビット長が固定されたセルを用い、各セルごと
に所望の宛先に情報が伝達されるように交換する交換シ
ステムにおいて、 出線に対応させ時分割チャネル多重構成とした時分割線
と、入力されたセルを時分割線に出力するためのシリア
ル−パラレル変換手段と、各セルごとのアドレスを基に
して所望とする出線を認識し出力されるべき前記時分割
線上のチャネル位置を指示するアドレスフィルタ手段と
、このアドレスフィルタ手段の指示によって各セルを時
間軸上で組み換えて前記時分割線上に出力する組換手段
とを各入線ごとに具備し、 各入線ごとの時分割線上のセルを周期的に選択する選択
手段と、選択されたセルを取り込むバッファ手段と、取
り込まれたセルを出線に出力するためのパラレル−シリ
アル変換手段とを出線ごとに具備することを特徴とする
セル交換装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1622489A JPH0758963B2 (ja) | 1989-01-27 | 1989-01-27 | セル交換装置 |
| US07/471,276 US5046064A (en) | 1989-01-27 | 1990-01-26 | Packet switching system |
| DE69019541T DE69019541T2 (de) | 1989-01-27 | 1990-01-26 | Zellenvermittlungssystem. |
| EP90300858A EP0380368B1 (en) | 1989-01-27 | 1990-01-26 | Cell switching system |
| CA002008666A CA2008666C (en) | 1989-01-27 | 1990-01-26 | Packet switching system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1622489A JPH0758963B2 (ja) | 1989-01-27 | 1989-01-27 | セル交換装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02198246A true JPH02198246A (ja) | 1990-08-06 |
| JPH0758963B2 JPH0758963B2 (ja) | 1995-06-21 |
Family
ID=11910567
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1622489A Expired - Lifetime JPH0758963B2 (ja) | 1989-01-27 | 1989-01-27 | セル交換装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5046064A (ja) |
| EP (1) | EP0380368B1 (ja) |
| JP (1) | JPH0758963B2 (ja) |
| CA (1) | CA2008666C (ja) |
| DE (1) | DE69019541T2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| FI85319C (fi) * | 1990-06-21 | 1992-03-25 | Valtion Teknillinen | Kopplingselement. |
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| SE515177C2 (sv) * | 1992-06-01 | 2001-06-25 | Ericsson Telefon Ab L M | Kvadratisk väljararkitektur |
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