JPH02184096A - 電子回路基板 - Google Patents
電子回路基板Info
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Classifications
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- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0213—Electrical arrangements not otherwise provided for
- H05K1/0216—Reduction of cross-talk, noise or electromagnetic interference
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/4673—Application methods or materials of intermediate insulating layers not specially adapted to any one of the previous methods of adding a circuit layer
- H05K3/4676—Single layer compositions
Landscapes
- Production Of Multi-Layered Print Wiring Board (AREA)
- Shielding Devices Or Components To Electric Or Magnetic Fields (AREA)
- Structure Of Printed Boards (AREA)
Abstract
め要約のデータは記録されません。
Description
その表面に表面実装部品が搭載され、外部からの電磁波
ノイズや内蔵の電子回路から外部への電磁波ノイズがシ
ールドされ、更に、その内部に設けた信号線間の干渉が
抑制されるようにした電子回路基板に関するものである
。
等の電子部品の集積度は相当に高度になってきている1
例えば、自動車や各種産業用機器等においては、種々の
電子機器が搭載されており、また、前記電子部品の動作
も高速化している。このために、前記の産業用機器等に
設置される電子機器においては、その安全上の観点から
、機器外部の電磁波ノイズによる影響がないように、そ
のシールドを確実にすることが要請されている。また、
各種のデジタル回路やアナログ回路についても、マイク
ロコンピュータ技術やセンサ技術の発達にともない、よ
り高速な動作が可能にされているが、これらの高速信号
回路は他の電子回路からの干渉を特に受けやすく、この
ために、デジタル線路についても適当なシールドなどを
行って、他の電子回路との間での干渉や回路パターン間
での相互干渉などを防止することが必要とされる。
図である。この第3図において、絶縁基板(11)と、
その上面の第1基板(12)および下面の第2基板(1
3)とによる所定の電子回路基板(50)が、いわゆる
>Rプリント配線板として構成されている。
のパターンを有する第1内層導体回路網(16)が設定
されており、また、絶縁基板(11)と第2基板(13
)との間にも、所望のパターンを有する第2内層導体回
路1jlJ (17)が設定されている。そして、この
電子回路基板(50)の適所には、層毎の導体回路網相
互間の導通のための第1スルーホール(18)と、この
ような導通機能に加えて、後述の導体ピン(25)を挿
通するための第2スルーポール(19)とが設けられて
いる。第1基板(12)の上面には第1外層導体(14
)が設けられており、また、第211s板(13)の下
面には第2外層導体(15)が設けられている。各種の
表面実装用部品(21)は第1半田部(22)によって
第1基板(12)の上面適所に固着されており、また、
キャップ(23)も第2半田部(24)によって第1基
板(12)の上面適所に固着されて、前記表面実装用部
品(21)を保護する機能を果たしている。
)を有する導体ピン(25)は、第2基板(13)の下
面部から第2スルーホール(19)に挿通されて、第3
半田部(27)により固着されている。
5)は、それぞれに、第1基板(12)の上面および第
2基板(13)の下面を殆ど覆うように設けられており
、このために、外部に設けられた各種の電子回路と電子
回路基板(50)の内部に設けられた多柱の電子回路と
の間での干渉の生起が防止されることになる。
にはクロストークと呼ばれるものであって、信号線の結
合容量の影響で引き起こされるものである。そして、こ
のようなりロストークの発生を防止するためには、信号
線間に低誘電率の物質を介在させたり、または、当該信
号線と接地面との距離を小さくすることで、相応の効果
が生じるものではあるが、上記従来例においては、プリ
ント配線板を構成する基板の厚みや誘電率を制御するこ
とができず、このために、前記の結合容量が大きくなっ
て信号の相互干渉が生じ易くなり、結果的に使用機器の
動作上の信頼性が低下することがある。
よれば、プリント配線板を構成する基板の厚みや誘電率
を制御することができず、このために、電子部品を実装
する従来の電子回路基板における外部からのノイズや内
部で発生するノイズに対する電磁シールド対策は不溝足
であるという問題点があった。
になされたものであって、その目的とするところは、簡
単な構成を有しており、従来技術を充分に利用・発展さ
せることが可能であって、必要な?1ltlaシールド
が確実に施された、表面実装用品川の電子回路基板を提
供することにある。
等によって実装され、その裏面側に他の基板に接続する
ための導体ピンが1nえられるようにした、多層の基板
からなる電子回路基板であって:前記多層の基板は、厚
みが大きくかつ低誘電率の材料からなる内部の基板と、
この上下に配置された、厚みが小さくかつ高誘電率の材
料かへなる外部の基板とからなり; 各眉間には内層導
体回路網が設けられており;また、その上下両面には外
層導体部が設けられているものである。
層導体部は、シールド部としての作用をするとともに、
電源導体としての作用もする。
てiy#Iに説明する。
例示図である。この第1図において、絶縁基板(11^
)と、その上面の第1基板(12^)および下面の第2
基板(13^)とによる所定の電子回路基板(50^)
が、いわゆる多層プリント配線板として構成されている
。
^)および第2基板(13^)の厚みに比べて相当に大
きくされている。この相違点を除けば、この実施例と前
述の従来例との間に構成上の相違点はない、 なお、絶
縁基板(11^)としては低誘電率のトリアジンが使用
され、第1基板(12Δ)および第2基板(13^)と
しては高誘電率のエポキシが使用されている。
の斜視図である。この第2図において、表面実装部品用
シールド・パッケージ(100)を構成するものは、電
子回路基板(50^)の上面の第1外層導体(14)以
外の適所に設けられた各種の表面実装部品(21)と、
これらを覆うように設けられた保護・封止用またはシー
ルド用のキャップ(23)、および、適当なマザーボー
ド(図示されない)に接続させるために、電子回路基板
(50^)の下面に設けられた導体ピン(25)である
。
れるものである。
面銅箔)OlIll)に、通常のサブトラクティブ法に
より第1、第2内層導体回路網(16)、(17)を形
成してから、ガラス−ポリイミド・プリプレグ(0,1
am厚)(厚み18μ−の銅箔骨)をプレス法により張
り合わせて、電子回路基板〈50^)を形成する。この
電子回路基板(50^)に、第1、第2内層導体回路網
(16)、〈17)のパターンの相互導通のための第1
スルーホール(18)を形成する。更に、前記の相互導
通に加えて、電源供給や導体ピン(25)の挿入のため
の第2スルーホール(19)を形成する。
形成してから、第1、第2外層導体部(14)、(15
)を形成する。かくして、所望の多層プリント配線板で
ある電子回路基板(50^)を得る。ここに、第1、第
2外層導体部(14)、(15)は、各種電子部品等の
接続用端子部やスルーホールの設置部を除き、電子回路
基板の全表面を覆うものであり、また、これは電源ライ
ンとしても使用できるものである。
路基板(50^)の第2スルーホール(19)に、半田
メツキを施したコバール製の導体ピン(25)を高融点
半11デイツプ法により固定して、目的とする表面実装
部品用シールド・パッケージ(ioo)を得ることがで
きた。
に半田によって固定した。かくして、多層プリント配線
板としての電子回路基板(50^)の電源ラインでもあ
る第1、第2外層導体部(14)、(15)で囲まれた
構成の、シールド効果の高い表面実装部品用シールド・
パッケージ(100)が得られた。
ールド・パッケージは、 「その表面側に表面実装等によって実装され、その裏面
側に他の基板に接続するための導体ピンが備えられるよ
うにした、多層の基板からなる電子回路基板であって、
:前記多層の基板は、厚みが大きくかつ低誘電率の材料
からなる内部の基板と、この上下に配置された、厚みが
小さくかつ高誘電率の材料からなる外部の基板とからな
り;各層間には内層導体回路網が設けられており;また
、その上下両面には外層導体部が設けられている1 という特徴的な構成のものであり、このように簡単な構
成でありながr2、従来からの課題を確実に解決した電
子回路基板が提供される。
れた電子回路基板を用いることで、マザ−ボード上での
デジタル回路やアナログ回路の混在を可能にし、その内
部での信号線の干渉を抑制してその信頼性を改善し、電
磁波ノイズが大きい劣悪な環境下でも有効に動作する表
面実装部品用シールド・パッケージを簡単に実現するこ
とができる。
号伝達用の導体パターンが、多層プリント配線板の電源
ラインである外層導体で囲まれた構成のものであるため
に、外部からこの電子回路基板への電磁波ノイズの侵入
や、この電子回路基板から外部への電磁波ノイズの放射
を防止することができ、また、この電子回路基板上の信
号線間の干渉を抑制することもできる7従って、ある所
望の電子回路を構成するときに、この発明に係る電子回
路基板に電磁波ノイズの敏感な回路を収納したり、電磁
波ノイズを放射しやすい高周波回路を収納したりして全
体的な電子回路を構成することにより、局所的なシール
ドまたはアイソレーションが実現して、その回路動作を
安定化するとともに、電子回路の信頼性を大幅に向上さ
せることができる。
しての金属箔で覆われた状態にされていれば、その耐水
性や耐候性も大幅に向上することにもなる。
上記実施例に表面実装用部品を実装した状態の斜視図、
第3図は、従来例の断面例示図である。 11.11A:中心絶縁基板、 12.12A:第1絶縁基板、 13.13A:第2絶縁基板、 50.50A=電子回路基板 (多層プリント配線板)、 14:第1外層導体部(電源ライン)、15:第2外層
導体部(電源ライン)、16:第1内層導体回路網、 17:第2内層導体回路網、 18:第1スルーホール、 19 : 21 : 22 : 23 : 24 : 25 : 26 : 27 : 図中、 第2スルーホール、 表面実装部品、 第1半田部、 キャップ、 第2半田部、 導体ピン、 鍔状係止部、 第3半田部、 表面実装部品用シールド・パッケージ。 同一の符号は、同一または相当の部分を第 1 図 第 2図 第 3図
Claims (1)
- (1)その表面側に表面実装等によって実装され、その
裏面側に他の基板に接続するための導体ピンが備えられ
るようにした、多層の基板からなる電子回路基板であっ
て、: 前記多層の基板は、厚みが大きくかつ低 誘電率の材料からなる内部の基板と、この上下に配置さ
れた、厚みが小さくかつ高誘電率の材料からなる外部の
基板とからなり; 各層間には内層導体回路網が設けられて おり;また、 その上下両面には外層導体部が設けられ ていて; 前記外層導体部はシールド部として作用 するとともに、電源導体としても作用することを特徴と
する電子回路基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1002754A JP2793824B2 (ja) | 1989-01-11 | 1989-01-11 | 電子回路基板 |
Applications Claiming Priority (1)
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Publications (2)
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---|---|
JPH02184096A true JPH02184096A (ja) | 1990-07-18 |
JP2793824B2 JP2793824B2 (ja) | 1998-09-03 |
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ID=11538133
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1002754A Expired - Lifetime JP2793824B2 (ja) | 1989-01-11 | 1989-01-11 | 電子回路基板 |
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---|---|
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- 1989-01-11 JP JP1002754A patent/JP2793824B2/ja not_active Expired - Lifetime
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JP2793824B2 (ja) | 1998-09-03 |
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