JPH02180042A - 半導体装置用パッケージ - Google Patents
半導体装置用パッケージInfo
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- JPH02180042A JPH02180042A JP33498888A JP33498888A JPH02180042A JP H02180042 A JPH02180042 A JP H02180042A JP 33498888 A JP33498888 A JP 33498888A JP 33498888 A JP33498888 A JP 33498888A JP H02180042 A JPH02180042 A JP H02180042A
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- 229910052751 metal Inorganic materials 0.000 claims abstract description 38
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- H01—ELECTRIC ELEMENTS
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
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-
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- H01L2924/1517—Multilayer substrate
-
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/30—Technical effects
- H01L2924/301—Electrical effects
- H01L2924/30107—Inductance
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は高周波用の半導体チップを搭載するのに好適の
半導体装置用パッケージに関する。
半導体装置用パッケージに関する。
[従来の技術]
第5図は従来の高周波半導体装置用パッケージを示す平
面図、第6図は第5図のVI−VI線による断面図であ
る。
面図、第6図は第5図のVI−VI線による断面図であ
る。
放熱板5の中央部にはダイアタッチ金属板6が設置され
ており、放熱板5の周縁部には矩形の開口部を有するセ
ラミック基板1か、その開口部をタイアタッチ金属板6
に嵌合して設置されている。
ており、放熱板5の周縁部には矩形の開口部を有するセ
ラミック基板1か、その開口部をタイアタッチ金属板6
に嵌合して設置されている。
セラミック基板1の上面の内周縁部には複数個のインナ
ーリード2かパターン形成されており、また、その外周
縁部には複数個の外部リード接続部3が形成されている
。このインナーリート2及び外部リード接続部3は共に
印刷により同時に形成されたものであり、相互に電気的
に接続されている。また、外部リード接続部3上には側
方に延出したリードフレーム7がろう付けされている。
ーリード2かパターン形成されており、また、その外周
縁部には複数個の外部リード接続部3が形成されている
。このインナーリート2及び外部リード接続部3は共に
印刷により同時に形成されたものであり、相互に電気的
に接続されている。また、外部リード接続部3上には側
方に延出したリードフレーム7がろう付けされている。
外部リード接続部3の形成領域を除くセラミック基板1
の外周縁部には、枠状の凸部を有するセラミック枠基板
4が積層されている。このセラミック枠基板4はインナ
ーリード2を絶縁保護すると共に、その上面が後述する
半導体デツプ12の封止用キャップ(図示せず)を搭載
するための搭載部となるものである。
の外周縁部には、枠状の凸部を有するセラミック枠基板
4が積層されている。このセラミック枠基板4はインナ
ーリード2を絶縁保護すると共に、その上面が後述する
半導体デツプ12の封止用キャップ(図示せず)を搭載
するための搭載部となるものである。
従来の高周波半導体装置用パッケージは上述の如く構成
されている。そして、半導体チップ12はダイアタッチ
金属板6の中央部に、その電極13の形成面を上方に向
けて固着される。その後、ボンディングワイヤ16によ
り半導体チップ12の電極13とインナーリード2とが
接続される。
されている。そして、半導体チップ12はダイアタッチ
金属板6の中央部に、その電極13の形成面を上方に向
けて固着される。その後、ボンディングワイヤ16によ
り半導体チップ12の電極13とインナーリード2とが
接続される。
次に、従来の高周波半導体装置用パッケージの製造方法
について説明する。
について説明する。
先ず、セラミック基板1の上面にタングステンペースト
を所定の形状に印刷してインナーリード2及び外部リー
ド接続部3を形成する。その後、このセラミック基板1
上にセラミック枠基板4を積層し、セラミック枠基板4
の凸部の上面の全面にタングステンペーストを印刷によ
り被着する。
を所定の形状に印刷してインナーリード2及び外部リー
ド接続部3を形成する。その後、このセラミック基板1
上にセラミック枠基板4を積層し、セラミック枠基板4
の凸部の上面の全面にタングステンペーストを印刷によ
り被着する。
また、セラミック基板1の下金面にもタングステンペー
ストを印刷する。
ストを印刷する。
次に、このセラミック枠基板4が積層されたセラミック
基板1を、温度が1500乃至1600℃の酸化雰囲気
中で焼成する。これにより、タングステンペーストとセ
ラミックとが反応し、タングステンペーストが被着され
た箇所がメタライズ化される。
基板1を、温度が1500乃至1600℃の酸化雰囲気
中で焼成する。これにより、タングステンペーストとセ
ラミックとが反応し、タングステンペーストが被着され
た箇所がメタライズ化される。
その後、このメタライズ化された各部にニッケル(Ni
)をめっきする。
)をめっきする。
次いて、セラミック基板1に放熱板5、ダイアタッチ金
属板6及びリードフレーム7を夫々所定の領域にAg−
Cuろう材によりろう付けする。
属板6及びリードフレーム7を夫々所定の領域にAg−
Cuろう材によりろう付けする。
その後、インナーリード等のメタライス化された各部、
放熱板5、ダイアタッチ金属板6及びリードフレーム7
にニッケル(Ni)及び金(Au)をめっきする。これ
により、従来の高周波半導体装置用パッケージか完成す
る。
放熱板5、ダイアタッチ金属板6及びリードフレーム7
にニッケル(Ni)及び金(Au)をめっきする。これ
により、従来の高周波半導体装置用パッケージか完成す
る。
[発明が解決しようとする課題]
しかしながら、従来の高周波半導体装置用パッケージは
、インナーリード2から外部リード接続部3までの間の
配線パターンのインダクタンスLが大きいという欠点が
ある。これは、この配線パターンが印刷により形成され
るため、厚さが10乃至20μmと極めて薄いためであ
る。
、インナーリード2から外部リード接続部3までの間の
配線パターンのインダクタンスLが大きいという欠点が
ある。これは、この配線パターンが印刷により形成され
るため、厚さが10乃至20μmと極めて薄いためであ
る。
矩形導体の自己インダクタンスしは下記(1)式で表す
近似式により近似できる。
近似式により近似できる。
但し、
(;導体長
W、導体幅
t:導体厚
である。
この(1)式から明らかなように、配線パターンの厚さ
(1)が薄いと自己インダクタンスLは大きくなる。こ
のため、従来、周波数が3GHzを超える高周波領域て
はパッケージの配線パターン間の共振によりクロストー
ク特性が急激に劣化するという問題点がある。
(1)が薄いと自己インダクタンスLは大きくなる。こ
のため、従来、周波数が3GHzを超える高周波領域て
はパッケージの配線パターン間の共振によりクロストー
ク特性が急激に劣化するという問題点がある。
本発明はかかる問題点に鑑みてなされたものであって、
配線パターンのインダクタンスを低減し、高周波領域に
おけるクロストーク特性が優れた半導体装置用パッケー
ジを提供することを目的とする。
配線パターンのインダクタンスを低減し、高周波領域に
おけるクロストーク特性が優れた半導体装置用パッケー
ジを提供することを目的とする。
[課題を解決するための手段]
本発明に係る半導体装置用パッケージは、セラミック基
板上にパターン形成された複数個のインナーリードと、
このインナーリードに対応する形状を有し対応するイン
ナーリード上に夫々接合された複数個の金属リードとを
有することを特徴とする。
板上にパターン形成された複数個のインナーリードと、
このインナーリードに対応する形状を有し対応するイン
ナーリード上に夫々接合された複数個の金属リードとを
有することを特徴とする。
[作用]
本発明においては、セラミック基板上に形成された各イ
ンナーリードの上に金属リードが接続されている。これ
により、パッケージの配線パターン部の厚さが従来に比
して著しく厚くなるため、配線パターン部の自己インダ
クタンスが著しく減少する。このため、高周波領域にお
いても極めて良好なりロストーク特性を有する半導体装
置用パッケージを得ることができる。
ンナーリードの上に金属リードが接続されている。これ
により、パッケージの配線パターン部の厚さが従来に比
して著しく厚くなるため、配線パターン部の自己インダ
クタンスが著しく減少する。このため、高周波領域にお
いても極めて良好なりロストーク特性を有する半導体装
置用パッケージを得ることができる。
[実施例]
次に、本発明の実施例について添付の図面を参照して説
明する。
明する。
第1図は本発明の第1の実施例を示す平面図、第2図は
第1図の■−■線による断面図である。
第1図の■−■線による断面図である。
本実施例が従来と異なる点はインナーリード上に金属リ
ードかろう付けされていることにあり、その他の構造は
基本的には従来と同様であるので、第1図及び第2図に
おいて第5図及び第6図と同一物には同一符号を付して
その詳しい説明は省略する。
ードかろう付けされていることにあり、その他の構造は
基本的には従来と同様であるので、第1図及び第2図に
おいて第5図及び第6図と同一物には同一符号を付して
その詳しい説明は省略する。
上述の如く、本実施例に係る高周波半導体装置用パッケ
ージにおいては、インナーリード2上に、このインナー
リード2と同一のパターン形状を有する金属リード8が
Ag−Cuろう材によりろう付けされている。従って、
ダイアタッチ金属板6上に搭載される半導体チップ12
の電極13はホンディングワイヤ14により金属リード
8と接続される。
ージにおいては、インナーリード2上に、このインナー
リード2と同一のパターン形状を有する金属リード8が
Ag−Cuろう材によりろう付けされている。従って、
ダイアタッチ金属板6上に搭載される半導体チップ12
の電極13はホンディングワイヤ14により金属リード
8と接続される。
また、本実施例に係る高周波半導体装置用パッケージの
製造方法は従来と略々同様であり、セラミック基板1に
放熱板5、ダイアタッチ金属板6及びリードフレーム7
をAg−Cuろう材によりろう付けするときに、同時に
、メタライズ化されているインナーリード2上に、この
インナーリード2と同一形状の金属リード8をろう付け
する。
製造方法は従来と略々同様であり、セラミック基板1に
放熱板5、ダイアタッチ金属板6及びリードフレーム7
をAg−Cuろう材によりろう付けするときに、同時に
、メタライズ化されているインナーリード2上に、この
インナーリード2と同一形状の金属リード8をろう付け
する。
その後、従来と同様に、メタライズ化された各印刷パタ
ーン、放熱板5、ダイアタッチ金属板6及びリードフレ
ーム7と共に、金属リード8にもニッケル及び金をめっ
きする。これにより、本実施例に係る高周波半導体装置
用パッケージが完成する。
ーン、放熱板5、ダイアタッチ金属板6及びリードフレ
ーム7と共に、金属リード8にもニッケル及び金をめっ
きする。これにより、本実施例に係る高周波半導体装置
用パッケージが完成する。
本実施例において、セラミック基板1及びセラミック枠
基板4の比誘電率が10である場合、インナーリード2
から外部リード接続部3までの間のインダクタンスしは
約2.5nHであり、共振周波数f。は約5.2GHz
である。また、周波数が3GHzにおける対向ピン間ク
ロストークは一60dBである。
基板4の比誘電率が10である場合、インナーリード2
から外部リード接続部3までの間のインダクタンスしは
約2.5nHであり、共振周波数f。は約5.2GHz
である。また、周波数が3GHzにおける対向ピン間ク
ロストークは一60dBである。
一方、金属リード8がない従来の高周波半導体装置用パ
ッケージにおいては、インナーリードがら外部リード接
続部までの間のインダクタンスは4、OnHであり、共
振周波数foは4 、3GHzである。
ッケージにおいては、インナーリードがら外部リード接
続部までの間のインダクタンスは4、OnHであり、共
振周波数foは4 、3GHzである。
また、周波数が3GHzにおける対向ピン間クロス1−
一りは一45dBである。
一りは一45dBである。
このように、本実施例に係る高周波半導体装置用パッケ
ージは、従来に比してインダクタンスが極めて小さく、
共振周波数が極めて高いと共に、クロストーク特性も著
しく改善される。
ージは、従来に比してインダクタンスが極めて小さく、
共振周波数が極めて高いと共に、クロストーク特性も著
しく改善される。
第3図は本発明の第2の実施例を示ず平面図、第4図は
第3図のIV−IV線による断面図である。
第3図のIV−IV線による断面図である。
本実施例が従来と異なる点はインナーリード上に半導体
チップ近傍まで延出した金属リードが配置されているこ
とにあり、その他の構造は基本的には従来と同様である
ので、第3図及び第4図において第5図及び第6図と同
一物には同一符号を付してその詳しい説明は省略する。
チップ近傍まで延出した金属リードが配置されているこ
とにあり、その他の構造は基本的には従来と同様である
ので、第3図及び第4図において第5図及び第6図と同
一物には同一符号を付してその詳しい説明は省略する。
上述の如く、本実施例においては、インナーリード2上
にろう付けされている金属リード9は、ダイアタッチ金
属板6上に固着される半導体チップ12の近傍まで延出
している。そして、ボンディングワイヤ15は、この金
属リード9の先端部と半導体チップ12の電極13とを
接続する。
にろう付けされている金属リード9は、ダイアタッチ金
属板6上に固着される半導体チップ12の近傍まで延出
している。そして、ボンディングワイヤ15は、この金
属リード9の先端部と半導体チップ12の電極13とを
接続する。
本実施例に係る高周波半導体装置用パッケージの製造方
法は従来と略々同様てあり、半導体チップ12をAu−
8i又はAu−3b等のろう材によりダイアタッチ金属
板6に固着した後、金属リード9をインナーリード2上
にA Ll −S n又はPb−3n等のろう材で接着
する。その後、半導体チップ12の電極14と金属リー
ド9の先端とをボンディングワイヤ15で接続する。
法は従来と略々同様てあり、半導体チップ12をAu−
8i又はAu−3b等のろう材によりダイアタッチ金属
板6に固着した後、金属リード9をインナーリード2上
にA Ll −S n又はPb−3n等のろう材で接着
する。その後、半導体チップ12の電極14と金属リー
ド9の先端とをボンディングワイヤ15で接続する。
半導体チップ12をダイアタッチ金属板6上に固着する
ときには、半導体チップ12とダイアタッチ金属板6と
の間の前記接合材料が両者とよくなじむようにこすり合
わせる振幅運動が必要である。従って、半導体チップ1
2をタイアタッチ金属板6上に固着する前に金属リード
9が内側へ延出して取付けられていると、この振幅運動
を十分に行うことができない。このため、本実施例に係
る高周波半導体装置用パッケージにおいては、半導体チ
ップ12をダイアタッチ金属板6上に固着した後に、イ
ンナーリード2上に金属リート9を取付ける。
ときには、半導体チップ12とダイアタッチ金属板6と
の間の前記接合材料が両者とよくなじむようにこすり合
わせる振幅運動が必要である。従って、半導体チップ1
2をタイアタッチ金属板6上に固着する前に金属リード
9が内側へ延出して取付けられていると、この振幅運動
を十分に行うことができない。このため、本実施例に係
る高周波半導体装置用パッケージにおいては、半導体チ
ップ12をダイアタッチ金属板6上に固着した後に、イ
ンナーリード2上に金属リート9を取付ける。
このため、半導体チップ12を搭載する前のパッケージ
の構造は従来と同様てあり、従来のパッケージ製造工程
の途中に工程を増す必要がない。
の構造は従来と同様てあり、従来のパッケージ製造工程
の途中に工程を増す必要がない。
また、本実施例においてはボンディングワイヤ部分を含
むインタ゛クタスが低減されるため、第1の実施例に比
して更に一層クロストーク特性が向上する。
むインタ゛クタスが低減されるため、第1の実施例に比
して更に一層クロストーク特性が向上する。
[発明の効果]
以上説明したように本発明によれば、インナーリード上
に金属リードが接続されているなめ、半導体装置用パッ
ケージの配線パターン部のインタクタスを極めて小さく
てきる。これにより、共振周波数が高く、高周波領域に
おいても優れたクロストーク特性を有する半導体装置用
パッケージを得ることかできる。
に金属リードが接続されているなめ、半導体装置用パッ
ケージの配線パターン部のインタクタスを極めて小さく
てきる。これにより、共振周波数が高く、高周波領域に
おいても優れたクロストーク特性を有する半導体装置用
パッケージを得ることかできる。
第1図は本発明の第1の実施例を示す平面図、第2図は
第1図の■−■線による断面図、第、3図は本発明の第
2の実施例を示す平面図、第4図は第3図のIV−IV
線による断面図、第5図は従来の高周波半導体装置用パ
ッケージを示す平面図、第6図は第5図のVl−Vl線
による断面図である。 1;セラミック基板、2;インナーリード、3;外部リ
ード接続部、4:セラミック枠基板、5;放熱板、6;
タイアタッチ金属板、7;リードフレーム、8,9.金
属リード、12;半導体チップ、13:電極、14,1
5,16;ボンデインクワイヤ
第1図の■−■線による断面図、第、3図は本発明の第
2の実施例を示す平面図、第4図は第3図のIV−IV
線による断面図、第5図は従来の高周波半導体装置用パ
ッケージを示す平面図、第6図は第5図のVl−Vl線
による断面図である。 1;セラミック基板、2;インナーリード、3;外部リ
ード接続部、4:セラミック枠基板、5;放熱板、6;
タイアタッチ金属板、7;リードフレーム、8,9.金
属リード、12;半導体チップ、13:電極、14,1
5,16;ボンデインクワイヤ
Claims (1)
- (1)セラミック基板上にパターン形成された複数個の
インナーリードと、このインナーリードに対応する形状
を有し対応するインナーリード上に夫々接合された複数
個の金属リードとを有することを特徴とする半導体装置
用パッケージ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP33498888A JPH02180042A (ja) | 1988-12-30 | 1988-12-30 | 半導体装置用パッケージ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP33498888A JPH02180042A (ja) | 1988-12-30 | 1988-12-30 | 半導体装置用パッケージ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02180042A true JPH02180042A (ja) | 1990-07-12 |
Family
ID=18283470
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP33498888A Pending JPH02180042A (ja) | 1988-12-30 | 1988-12-30 | 半導体装置用パッケージ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02180042A (ja) |
-
1988
- 1988-12-30 JP JP33498888A patent/JPH02180042A/ja active Pending
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