JPH02149006A - 信号の電子的レベル調整用回路装置 - Google Patents
信号の電子的レベル調整用回路装置Info
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- JPH02149006A JPH02149006A JP1260332A JP26033289A JPH02149006A JP H02149006 A JPH02149006 A JP H02149006A JP 1260332 A JP1260332 A JP 1260332A JP 26033289 A JP26033289 A JP 26033289A JP H02149006 A JPH02149006 A JP H02149006A
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- 239000003990 capacitor Substances 0.000 claims abstract description 11
- 238000003199 nucleic acid amplification method Methods 0.000 claims abstract description 11
- 230000003247 decreasing effect Effects 0.000 claims abstract 2
- 230000009467 reduction Effects 0.000 abstract description 6
- 238000000034 method Methods 0.000 abstract description 3
- 230000008569 process Effects 0.000 abstract description 3
- 230000003068 static effect Effects 0.000 abstract 1
- 230000005236 sound signal Effects 0.000 description 5
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- 238000010586 diagram Methods 0.000 description 3
- 240000006829 Ficus sundaica Species 0.000 description 1
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- 238000010168 coupling process Methods 0.000 description 1
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
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- H03G1/00—Details of arrangements for controlling amplification
- H03G1/04—Modifications of control circuit to reduce distortion caused by control
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- Two-Way Televisions, Distribution Of Moving Picture Or The Like (AREA)
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- Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)
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- Television Receiver Circuits (AREA)
- Details Of Television Scanning (AREA)
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ディジタル制御可能なＣＭＯＳスイッチによ
り不連続ステップで、信号のレベルを電子的に調整する
だめの回路装置に関する。
り不連続ステップで、信号のレベルを電子的に調整する
だめの回路装置に関する。
従来の技術
この種のスイッチは、その所要空間が小さくて済み、安
価に実軸することができるため、ますますオーディオ装
置に使用されている。高価なオーディオ装置、例えばＣ
Ｄプレーヤ、ディジタルオーディオテープ装置、および
集積化した高価なノイズ低減装置を有するテープ装置で
はＳ／Ｎ比が９０ｄＢ以上に達する。非常に低い歪み係
数が特にディジタル音声記録の際に得られる。しかしハ
イファイ装置に対してこのように最適設計された上記の
データも、弱点箇所（不良品質発生部）がこのデータを
再び台無しにしてしまえばほとんど意味をなさない。こ
のような弱点箇所は公知の種類の電子的音量調整器およ
びＣＭＯＳスイッチである。これらは例えば、オーディ
オ信号の音量をステップ状に調整する際クリックノイズ
を惹起し、このクリックノイズは特にオーディオ信号の
低周波数領域に甚しい障害として発生する。クリックノ
イズを惹起せず、しかも歪みおよびＳ／Ｎ比に関する要
求も満たすようなスイッチは現在のところ入手不可能で
ある。
価に実軸することができるため、ますますオーディオ装
置に使用されている。高価なオーディオ装置、例えばＣ
Ｄプレーヤ、ディジタルオーディオテープ装置、および
集積化した高価なノイズ低減装置を有するテープ装置で
はＳ／Ｎ比が９０ｄＢ以上に達する。非常に低い歪み係
数が特にディジタル音声記録の際に得られる。しかしハ
イファイ装置に対してこのように最適設計された上記の
データも、弱点箇所（不良品質発生部）がこのデータを
再び台無しにしてしまえばほとんど意味をなさない。こ
のような弱点箇所は公知の種類の電子的音量調整器およ
びＣＭＯＳスイッチである。これらは例えば、オーディ
オ信号の音量をステップ状に調整する際クリックノイズ
を惹起し、このクリックノイズは特にオーディオ信号の
低周波数領域に甚しい障害として発生する。クリックノ
イズを惹起せず、しかも歪みおよびＳ／Ｎ比に関する要
求も満たすようなスイッチは現在のところ入手不可能で
ある。
発明が解決しようとする課題
本発明の課題は、この種のクリックノイズを有するスイ
ッチを、障害の発生することなくハイファイ機器に対し
ても使用可能なように改善することである。
ッチを、障害の発生することなくハイファイ機器に対し
ても使用可能なように改善することである。
実施例
以下本発明を実施例およびその作用につき図面を用いて
説明する。
説明する。
第１図にはＳにより電子スイッチ（ＣＭＯＳ 技術）が
示されている。ＣＭＯＳスイッチの入力側Ｅにはオーデ
ィオ信号Ａｓが印加され、オーディオ信号はこのスイッ
チにより例えばｌ ｄＢステップで可変にして出力側Ａ
にて取出される。
示されている。ＣＭＯＳスイッチの入力側Ｅにはオーデ
ィオ信号Ａｓが印加され、オーディオ信号はこのスイッ
チにより例えばｌ ｄＢステップで可変にして出力側Ａ
にて取出される。
信号Ａｓをステップ状に変化させるために、調整時にパ
ルスエを送出する増分発生器工Ｇが用いられる。パルス
エは各操作装置に応じて信号をＢＣＤコードで形成し、
この信号によりスイッチＳが制御される。出力側Ａには
、信号ＡＳのｄＢステップでの電圧跳躍が生じる。既に
上に述べたようにこの跳躍は特に信号Ａｓの低周波領域
では不快に可聴されてしまう。従ってスイッチＳに次の
ような装置Ｒが接続されている。
ルスエを送出する増分発生器工Ｇが用いられる。パルス
エは各操作装置に応じて信号をＢＣＤコードで形成し、
この信号によりスイッチＳが制御される。出力側Ａには
、信号ＡＳのｄＢステップでの電圧跳躍が生じる。既に
上に述べたようにこの跳躍は特に信号Ａｓの低周波領域
では不快に可聴されてしまう。従ってスイッチＳに次の
ような装置Ｒが接続されている。
すなわち、出力信号Ａｓをその変化と反対方向で、しか
も、スイッチＳにより形成されたステップに相応する大
きさで制御する装置が接続されている。仮定したように
、スイッチＳが入力信号を１ｄＢだけ変化させると、装
置Ｒは同様にスイッチＳの出力信号を同様に１ｄＢだけ
、しかし反対方向に制御する。信号を高め制御する際、
スイッチＳの＋ｉ ｄＢの各ステップにて、装置Ｒはス
テップの開始時に−ｉ ｄＢに切換わる。装置Ｒ１は、
この調整度から連続的に減少して、設定可能な時定数後
に［１ｄＢになるよう信号を制御する。それにより、こ
の［１ｄＢの時点からスイッチＳにより調整される全ス
テップが有効となり得る。この過程は第２図に示されて
いる。第２図ａは時点ｔＱで１ ｄＢだけ高められた値
に調整されるオーディオ信号ＡＳを示す。この信号跳躍
は不快なりリックを再生装置内で発生さす。第２図すは
、スイッチＳの出力信号のステップ状の信号跳躍を示す
。第２図Ｃは、信号跳躍を補償する装置Ｒが開始時に一
１ｄＢに調整された様子を示す。装置Ｒは連続的に値０
に減少するよう自動的に減少制御され、その結果時定数
Ｔ後の時点ｔ１では全ステップが作用し得る。
も、スイッチＳにより形成されたステップに相応する大
きさで制御する装置が接続されている。仮定したように
、スイッチＳが入力信号を１ｄＢだけ変化させると、装
置Ｒは同様にスイッチＳの出力信号を同様に１ｄＢだけ
、しかし反対方向に制御する。信号を高め制御する際、
スイッチＳの＋ｉ ｄＢの各ステップにて、装置Ｒはス
テップの開始時に−ｉ ｄＢに切換わる。装置Ｒ１は、
この調整度から連続的に減少して、設定可能な時定数後
に［１ｄＢになるよう信号を制御する。それにより、こ
の［１ｄＢの時点からスイッチＳにより調整される全ス
テップが有効となり得る。この過程は第２図に示されて
いる。第２図ａは時点ｔＱで１ ｄＢだけ高められた値
に調整されるオーディオ信号ＡＳを示す。この信号跳躍
は不快なりリックを再生装置内で発生さす。第２図すは
、スイッチＳの出力信号のステップ状の信号跳躍を示す
。第２図Ｃは、信号跳躍を補償する装置Ｒが開始時に一
１ｄＢに調整された様子を示す。装置Ｒは連続的に値０
に減少するよう自動的に減少制御され、その結果時定数
Ｔ後の時点ｔ１では全ステップが作用し得る。
時点ｔ２で新たなステップが形成される。同じ時点で装
置Ｈの一１ｄＢへの調整が行われる。第２図ｄは装置Ｒ
の出力側における信号経過を示す。第２図ｅ、 ｆお
よびｇは、第２図ａの信号表示上に参照記号なして、装
置の反対方向の作用を示す。
置Ｈの一１ｄＢへの調整が行われる。第２図ｄは装置Ｒ
の出力側における信号経過を示す。第２図ｅ、 ｆお
よびｇは、第２図ａの信号表示上に参照記号なして、装
置の反対方向の作用を示す。
第６図には本発明の技術的実施例が示されている。Ｓに
より再び、信号ＡＳのディジタルレベル調整のためのＣ
ＭＯＳスイッチが示されている。信号ＡｓはＣＭＯＳス
イッチに入力増幅器■および結合コンデンサを介して供
給される。
より再び、信号ＡＳのディジタルレベル調整のためのＣ
ＭＯＳスイッチが示されている。信号ＡｓはＣＭＯＳス
イッチに入力増幅器■および結合コンデンサを介して供
給される。
ＣＭＯＳスイッチは公知のように抵抗Ｒ８と接続されて
おり、これら抵抗は増分発生器Ｉ（）によりＢＣＤ入力
側に印加される情報に応じて０Ｎ−ＯＦＦ接続される。
おり、これら抵抗は増分発生器Ｉ（）によりＢＣＤ入力
側に印加される情報に応じて０Ｎ−ＯＦＦ接続される。
その結果、ＣＭＯＳスイッチＳの出力側Ａにて、例えば
１ｄＢの不連続ステップの出力信号が取り出される。こ
の信号は装置Ｒに設けられた演算増幅器ｏｐの非反転入
力側に送出され、演算増幅器の出力側Ｏは負帰還抵抗Ｒ
Ｇを介して負帰還接続されている。演算増幅器ｏｐの反
転入力側には２つの並列接続された分岐が接続されてお
り、それらによって、ＣＭＯＳスイッチによるステップ
状レベル変化の際の信号上昇ないし信号下降がそれぞれ
惹起される。一方の分岐は抵抗Ｒ１を有し、この抵抗は
電子スイッチＦ１のドレイン−ソース区間を介して基準
電位に接続される。電子スイッチＦ１のデート電極は一
方で時限素子Ｒ２＋ ｃ ２を介して基準電位に接続
され、他方でスイッチ段Ｔ１を介して正の電位に切換え
可能である。他方の分岐は抵抗Ｒ４を有し、この抵抗は
別の電子スイッチＦ２のドレイン−ソース区間を介して
基準電位に接続される。電子スイッチＦ２のデート電極
は一方で抵抗Ｒ３を介して正の電位に接続され、他方で
コンデンサＣ３を介して基準電位に接続される。抵抗Ｒ
３とコンデンサＣ３は別の時限素子を形成する。コンデ
ンサＣ３に並列にスイッチ段Ｔ２が接続されている。
１ｄＢの不連続ステップの出力信号が取り出される。こ
の信号は装置Ｒに設けられた演算増幅器ｏｐの非反転入
力側に送出され、演算増幅器の出力側Ｏは負帰還抵抗Ｒ
Ｇを介して負帰還接続されている。演算増幅器ｏｐの反
転入力側には２つの並列接続された分岐が接続されてお
り、それらによって、ＣＭＯＳスイッチによるステップ
状レベル変化の際の信号上昇ないし信号下降がそれぞれ
惹起される。一方の分岐は抵抗Ｒ１を有し、この抵抗は
電子スイッチＦ１のドレイン−ソース区間を介して基準
電位に接続される。電子スイッチＦ１のデート電極は一
方で時限素子Ｒ２＋ ｃ ２を介して基準電位に接続
され、他方でスイッチ段Ｔ１を介して正の電位に切換え
可能である。他方の分岐は抵抗Ｒ４を有し、この抵抗は
別の電子スイッチＦ２のドレイン−ソース区間を介して
基準電位に接続される。電子スイッチＦ２のデート電極
は一方で抵抗Ｒ３を介して正の電位に接続され、他方で
コンデンサＣ３を介して基準電位に接続される。抵抗Ｒ
３とコンデンサＣ３は別の時限素子を形成する。コンデ
ンサＣ３に並列にスイッチ段Ｔ２が接続されている。
回路は次のように動作する。すなわち、それぞれのスイ
ッチＦ１またはＦ２のデートが正の際に導通制御される
。別の導通型式では勿論、電位は反対方向でなければな
らない。スイッチ段Ｔ１とＴ２はそれぞれレベル変化の
開始時に、ＣＭＯＳスイッチＳの出力側に短時間接続さ
れる。
ッチＦ１またはＦ２のデートが正の際に導通制御される
。別の導通型式では勿論、電位は反対方向でなければな
らない。スイッチ段Ｔ１とＴ２はそれぞれレベル変化の
開始時に、ＣＭＯＳスイッチＳの出力側に短時間接続さ
れる。
この過程はマイクロプロセッサμＰを介しソフトウェア
で行うことができる。これは次のように行われる。すな
わち、パルス１１ないし工２により、例えばレベル低減
の場合はスイッチ段Ｔ１が、レベル上昇の場合はスイッ
チ段Ｔ２が短時間操作されるようにして行われる。スイ
ッチ段Ｔ１とＴ２はここでは単に象徴的にトラン装置只
の静止状態では、スイッチＦ１が高抵抗であり、スイッ
チＦ２が低抵抗である。その結果演算増幅器ｏｐは抵抗
Ｒ（）とＲ４により定められた、例えば＋ｉｄＢの増幅
度を有する。この増幅度がスイッチＳのステップ幅に相
応する。
で行うことができる。これは次のように行われる。すな
わち、パルス１１ないし工２により、例えばレベル低減
の場合はスイッチ段Ｔ１が、レベル上昇の場合はスイッ
チ段Ｔ２が短時間操作されるようにして行われる。スイ
ッチ段Ｔ１とＴ２はここでは単に象徴的にトラン装置只
の静止状態では、スイッチＦ１が高抵抗であり、スイッ
チＦ２が低抵抗である。その結果演算増幅器ｏｐは抵抗
Ｒ（）とＲ４により定められた、例えば＋ｉｄＢの増幅
度を有する。この増幅度がスイッチＳのステップ幅に相
応する。
出力（ｔｉｌｌ Ａでレベルがステップ状に上昇する際
、スイッチ段Ｔ２は短時間閉成され、それにより時限素
子Ｒ３／Ｃ３のコンデンサＣ３が放電すれる。スイッチ
Ｆ２は高抵抗となり、それにより演算増幅器ＯＰの増幅
度は低減される。低減は抵抗ＲＧにより次のように調整
される。すなわち、増幅度低減がレベル上昇のステップ
の大きさに相応し、従ってレベル上昇が＋１ｃｌＢから
Ｑ ｄＢに補償されるよう調整される。時限素子Ｒ３／
Ｃ３により設定された時定数の経過後、スイッチＦ２は
再び低抵抗となり、その結果演算増幅器ＯＰの増幅度は
再び＋１ｄＢとなる。
、スイッチ段Ｔ２は短時間閉成され、それにより時限素
子Ｒ３／Ｃ３のコンデンサＣ３が放電すれる。スイッチ
Ｆ２は高抵抗となり、それにより演算増幅器ＯＰの増幅
度は低減される。低減は抵抗ＲＧにより次のように調整
される。すなわち、増幅度低減がレベル上昇のステップ
の大きさに相応し、従ってレベル上昇が＋１ｃｌＢから
Ｑ ｄＢに補償されるよう調整される。時限素子Ｒ３／
Ｃ３により設定された時定数の経過後、スイッチＦ２は
再び低抵抗となり、その結果演算増幅器ＯＰの増幅度は
再び＋１ｄＢとなる。
出力側Ａのレベルがステップ状に低減される際、スイッ
チ段Ｔ１は短時間閉成される。それによりコンデンサＣ
２に充電され友スイッチＦ１は低抵抗になる。それによ
り抵抗Ｒ１は抵抗Ｒ４に並列に接続され、基準電位に対
する全並 抵抗が減少する。ＲＧのＲ１，Ｒ４１’列回路に対する
分圧比は、演算増幅器○Ｐの増幅度が１ｄＢ高められて
＋２ ｄＢとなるように調整する。
チ段Ｔ１は短時間閉成される。それによりコンデンサＣ
２に充電され友スイッチＦ１は低抵抗になる。それによ
り抵抗Ｒ１は抵抗Ｒ４に並列に接続され、基準電位に対
する全並 抵抗が減少する。ＲＧのＲ１，Ｒ４１’列回路に対する
分圧比は、演算増幅器○Ｐの増幅度が１ｄＢ高められて
＋２ ｄＢとなるように調整する。
コンデンサＣ２は抵抗Ｒ２を介して放電され、その結果
時定数Ｒ２Ｃ２後にスイッチＦ１は再び高抵抗となり、
それにより演算増幅器ｏｐは再び、抵抗ＲＧ、Ｒ４によ
り設定された＋１ｄＢの増幅度に達する。
時定数Ｒ２Ｃ２後にスイッチＦ１は再び高抵抗となり、
それにより演算増幅器ｏｐは再び、抵抗ＲＧ、Ｒ４によ
り設定された＋１ｄＢの増幅度に達する。
装置Ｒは第６図に示した以外にも構成し得ることを指摘
しておく。重要なことは装置がスイッチＳに起因するス
テップをまず補償し、補償を常時減少して再び中止する
ということである。
しておく。重要なことは装置がスイッチＳに起因するス
テップをまず補償し、補償を常時減少して再び中止する
ということである。
本発明をそれぞれｉ ｄＢのステップの例について説明
したが、ステップが別の大きさを有する場合でも本発明
を適用することができる。ステップが補償されるように
相応して装置Ｒを構成する。
したが、ステップが別の大きさを有する場合でも本発明
を適用することができる。ステップが補償されるように
相応して装置Ｒを構成する。
発明の効果
本発明によυ、Ｓ／Ｎ比を低下することなく、音量調整
時のクリックノイズが抑圧される。
時のクリックノイズが抑圧される。
第１図は本発明によるブロック回路図、第２図ｆｉ ％
ｇは本発明の詳細な説明するだめの線久第６図は本発
明の詳細な回路実施例図である。
ｇは本発明の詳細な説明するだめの線久第６図は本発
明の詳細な回路実施例図である。
Claims (1)
- 【特許請求の範囲】 １、デイジタル制御可能なＣＭＯＳスイッチにより不連
続ステップで、信号のレベルを電子的に調整するための
回路装置において、 ＣＭＯＳスイッチ（Ｓ）に、補償量を形成する装置（Ｒ
）が接続されており、当該補償量によつて、ＣＭＯＳス
イッチにより形成されたデイジタルステツプがまず補償
され、次いで所定の時定数に従つて当該補償量が連続的
に減少して、不連続ステップが完全に作用状態におかれ
ることを特徴とする、信号の電子的レベル調整用回路装
置。 ２、前記装置（Ｒ）は演算増幅器（ＯＰ）を有し、該演
算増幅器の非反転入力側にはスイッチ段（Ｓ）からの信
号が供給され、該演算増幅器の出力側（Ｏ）は抵抗（Ｒ
Ｇ）を介して反転入力側と接続されており、該反転入力
側は抵抗（Ｒ４）を介して、該抵抗に直列に接続された
スイッチ（Ｆ２）によりアース電位に接続され、その際
電子スイッチ（Ｆ２）は休止状態で導通するようバイア
スされており、抵抗（Ｒ４）と抵抗（ＲＧ）とは、演算
増幅器（ＯＰ）がスイツチステツプの増幅度を有するよ
うに設定されている請求項１記載の装置。 ３、バイアス電圧（＋）は抵抗（Ｒ３）を介して電子ス
イッチ（Ｆ２）の制御電極に印加されており、該制御電
極はコンデンサ（Ｃ３）を介して基準電位に接続されて
おり、該コンデンサ（Ｃ３）はスイッチ（Ｔ２）により
橋絡可能である請求項２記載の回路装置。 ４、抵抗（Ｒ４）に対し並列かつ電子スイッチ（Ｆ１）
に対し直列に抵抗（Ｒ１）がアース電位に接続され、そ
の際電子スイッチ（Ｆ１）は休止状態では高抵抗であり
、電子スイッチ（Ｆ１）の制御電極は、抵抗（Ｒ２）を
有するコンデンサ（Ｃ２）の並列回路を介してアース電
位に接続されており、前記制御電極はスイッチ（Ｔ１）
によつて短時間、電子スイッチ（Ｆ１）を導通状態に切
換えるバイアス電圧（＋）に接続可能である請求項２記
載の回路装置。 ５、時限素子（Ｒ２，Ｃ２；Ｒ３，Ｃ３）の時定数は次
のように選定されている、すなわち該時定数は、スイッ
チ段（Ｓ）を制御する増分発生器（ＩＧ）の２つの順次
連続するパルスの時間的間隔よりも小さく選定されてい
る請求項１から４までのいずれか１項記載の回路装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE3834143.3 | 1988-10-07 | ||
| DE3834143A DE3834143A1 (de) | 1988-10-07 | 1988-10-07 | Schaltungsanordnung zur verstellung der groesse eines signals |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02149006A true JPH02149006A (ja) | 1990-06-07 |
Family
ID=6364597
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1260332A Pending JPH02149006A (ja) | 1988-10-07 | 1989-10-06 | 信号の電子的レベル調整用回路装置 |
Country Status (6)
| Country | Link |
|---|---|
| EP (1) | EP0364711B1 (ja) |
| JP (1) | JPH02149006A (ja) |
| KR (1) | KR0142208B1 (ja) |
| AT (1) | ATE101462T1 (ja) |
| DE (2) | DE3834143A1 (ja) |
| HK (1) | HK183996A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2720633B1 (fr) * | 1994-06-06 | 1996-07-05 | Oreal | Composition de teinture d'oxydation des fibres kératiniques comprenant la 2-(BETHA-hydroxyéthyl) paraphénylènediamine, la 2-méthylrésorcine et le 3-aminophénol, et procédé de teinture utilisant une telle composition. |
| DE19527338B4 (de) * | 1995-07-26 | 2005-04-21 | Sgs-Thomson Microelectronics Gmbh | Lautstärkenregler für ein Audiogerät |
| KR102532469B1 (ko) | 2018-11-19 | 2023-05-12 | 엘지전자 주식회사 | 무선 전력 전송 장치 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3006628A1 (de) * | 1980-02-22 | 1981-08-27 | Robert Bosch Gmbh, 7000 Stuttgart | Vorrichtung zur unterdrueckung von knackgeraeuschen beim umschalten von elektrischen signalen |
| DE3008033A1 (de) * | 1980-03-03 | 1981-09-10 | Robert Bosch Gmbh, 7000 Stuttgart | Vorrichtung zur unterdrueckung von knackgeraeuschen beim umschalten elektrischer signale |
| US4742312A (en) * | 1987-05-22 | 1988-05-03 | Delco Electronics Corporation | Power limiting audio amplifier temperature protection circuit |
-
1988
- 1988-10-07 DE DE3834143A patent/DE3834143A1/de not_active Withdrawn
-
1989
- 1989-09-02 AT AT89116240T patent/ATE101462T1/de not_active IP Right Cessation
- 1989-09-02 EP EP89116240A patent/EP0364711B1/de not_active Expired - Lifetime
- 1989-09-02 DE DE89116240T patent/DE58906938D1/de not_active Expired - Fee Related
- 1989-10-06 JP JP1260332A patent/JPH02149006A/ja active Pending
- 1989-10-07 KR KR1019890014495A patent/KR0142208B1/ko not_active IP Right Cessation
-
1996
- 1996-10-03 HK HK183996A patent/HK183996A/xx not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| DE58906938D1 (de) | 1994-03-24 |
| KR0142208B1 (ko) | 1998-07-15 |
| KR900007181A (ko) | 1990-05-09 |
| EP0364711B1 (de) | 1994-02-09 |
| HK183996A (en) | 1996-10-11 |
| EP0364711A1 (de) | 1990-04-25 |
| ATE101462T1 (de) | 1994-02-15 |
| DE3834143A1 (de) | 1990-04-12 |
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