JPH02143494A - 両面実装用多層プリント配線基板 - Google Patents
両面実装用多層プリント配線基板Info
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- JPH02143494A JPH02143494A JP29763888A JP29763888A JPH02143494A JP H02143494 A JPH02143494 A JP H02143494A JP 29763888 A JP29763888 A JP 29763888A JP 29763888 A JP29763888 A JP 29763888A JP H02143494 A JPH02143494 A JP H02143494A
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- wiring
- board
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- Granted
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- 230000008439 repair process Effects 0.000 abstract description 4
- 238000000034 method Methods 0.000 abstract 1
- 230000004048 modification Effects 0.000 abstract 1
- 238000012986 modification Methods 0.000 abstract 1
- 239000004020 conductor Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 210000004907 gland Anatomy 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0296—Conductive pattern lay-out details not covered by sub groups H05K1/02 - H05K1/0295
- H05K1/0298—Multilayer circuits
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/14—Structural association of two or more printed circuits
- H05K1/141—One or more single auxiliary printed circuits mounted on a main printed circuit, e.g. modules, adapters
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/22—Secondary treatment of printed circuits
- H05K3/225—Correcting or repairing of printed circuits
Landscapes
- Production Of Multi-Layered Print Wiring Board (AREA)
- Structure Of Printed Boards (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は両面実装用多層プリント配線基板、特に配線基
板の両面に第2の配線基板を搭載する両面実装用多層プ
リント配線基板に関する。
板の両面に第2の配線基板を搭載する両面実装用多層プ
リント配線基板に関する。
従来のこの種の多層プリント配線基板において、配線基
板の部分的な製造不良および配線変更に対しては、配線
基板上に布線を行うことにより対応するのが一般的であ
った。
板の部分的な製造不良および配線変更に対しては、配線
基板上に布線を行うことにより対応するのが一般的であ
った。
しかし、配線基板の両面に第2の配線基板を実装した場
合、中心の配線基板の場合には、表面に配線変更および
修理のための布線を行う領域を確保することは非常に難
しい場合が多くなってきている。
合、中心の配線基板の場合には、表面に配線変更および
修理のための布線を行う領域を確保することは非常に難
しい場合が多くなってきている。
本発明の表面実装用多層配線プリント基板は、配線基板
の両面に第2の配線基板を搭載する両面実装用多層プリ
ント配線基板において、両端にスルーホールおよび実装
用パッドを持つ信号配線パターンを前記配線基板の内層
に複数本設け、前記信号配線パターンが接続された実装
用パッドには前記第2の配線基板の未使用ピンを割り当
てておくことを特徴とする。
の両面に第2の配線基板を搭載する両面実装用多層プリ
ント配線基板において、両端にスルーホールおよび実装
用パッドを持つ信号配線パターンを前記配線基板の内層
に複数本設け、前記信号配線パターンが接続された実装
用パッドには前記第2の配線基板の未使用ピンを割り当
てておくことを特徴とする。
次に、本発明について図面を参照して説明する。
第1図(A)は本発明の一実施例を示す部分断面図、第
2図(B)は部品実装状態を示す断面図である。
2図(B)は部品実装状態を示す断面図である。
第1図(A)において、101は両面実装用の多層プリ
ント配線基板、105は内層信号層であり、その中の1
05aはスルーホール102a。
ント配線基板、105は内層信号層であり、その中の1
05aはスルーホール102a。
102bに接続されている。スルーホール102a、1
02bは導体パターン104を介してそれぞれ実装用パ
ッド103a、103bに接続されている。
02bは導体パターン104を介してそれぞれ実装用パ
ッド103a、103bに接続されている。
第1図(B)は第1図(A)に示した多層プリント配線
基板(以下配線基板と記す)101の両面に配線基板1
06を実装した状態を示す断面図であり、107は配線
基板106の入出力ピン、108は配線基板106に搭
載されたLSIを示している。
基板(以下配線基板と記す)101の両面に配線基板1
06を実装した状態を示す断面図であり、107は配線
基板106の入出力ピン、108は配線基板106に搭
載されたLSIを示している。
第1図(B)では、特に図示していないが、多層プリン
ト配線基板101,106共に内層に信号層を持ち、配
線基板101の表裏に実装された配線基板106に搭載
されている各LS1108の間は、配線基板101,1
06の内層信号パターンおよび配線基板106の入出力
ピン107を介して相互に接続される。
ト配線基板101,106共に内層に信号層を持ち、配
線基板101の表裏に実装された配線基板106に搭載
されている各LS1108の間は、配線基板101,1
06の内層信号パターンおよび配線基板106の入出力
ピン107を介して相互に接続される。
配線基板101内の信号パターンに断線があった場合、
配線基板101は両面に配線基板106が実装されてい
るため布線を行うことが難しい。
配線基板101は両面に配線基板106が実装されてい
るため布線を行うことが難しい。
しかし、配線基板101内に内層信号N 105 aが
用意されており、また実装パッド103a。
用意されており、また実装パッド103a。
103bと入出力ピン107a、107bを介して配線
基板101の表裏に実装された配線基板106間は接続
されている。従って、入出力ピン107a、107bを
他との接続のない独立ピンとしておくことにより、配線
基板106内で布線を行うことにより、配線基板101
内の断線を配線基板101上で布線することなく修理す
ることが可能となる。
基板101の表裏に実装された配線基板106間は接続
されている。従って、入出力ピン107a、107bを
他との接続のない独立ピンとしておくことにより、配線
基板106内で布線を行うことにより、配線基板101
内の断線を配線基板101上で布線することなく修理す
ることが可能となる。
本発明は、以上のような構成を採用することにより、中
心の配線基板における配線変更、修理を該基板上で布線
を行うことなく実現することが可能となる。
心の配線基板における配線変更、修理を該基板上で布線
を行うことなく実現することが可能となる。
第1図は本発明の一実施例を示す断面図である。
101.106・・・多層プリント配線基板、102・
・・スルーホール、103・・・実装パッド、104・
・・導体パターン、105・・・内層信号層、107・
・・入出力ピン、108・・・LSI。 第 1 口(、,4) /l1)7−−−り2層ブ・ルFム己腺裏)反10”1
−−−スルーホー1し 705−一一大襞用l\”、−/l− 704−*ネ・バフーレ 105−−・内層信号層
・・スルーホール、103・・・実装パッド、104・
・・導体パターン、105・・・内層信号層、107・
・・入出力ピン、108・・・LSI。 第 1 口(、,4) /l1)7−−−り2層ブ・ルFム己腺裏)反10”1
−−−スルーホー1し 705−一一大襞用l\”、−/l− 704−*ネ・バフーレ 105−−・内層信号層
Claims (1)
- 【特許請求の範囲】 配線基板の両面に第2の配線基板を搭載する両面実装用
多層プリント配線基板において、 両端にスルーホールおよび実装用パッドを持つ信号配線
パターンを前記配線基板の内層に複数本設け、前記信号
配線パターンが接続された実装用パッドには前記第2の
配線基板の未使用ピンを割り当てておくことを特徴とす
る両面実装用多層プリント配線基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP29763888A JP2541643B2 (ja) | 1988-11-24 | 1988-11-24 | 両面実装用多層プリント配線基板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP29763888A JP2541643B2 (ja) | 1988-11-24 | 1988-11-24 | 両面実装用多層プリント配線基板 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH02143494A true JPH02143494A (ja) | 1990-06-01 |
JP2541643B2 JP2541643B2 (ja) | 1996-10-09 |
Family
ID=17849170
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP29763888A Expired - Fee Related JP2541643B2 (ja) | 1988-11-24 | 1988-11-24 | 両面実装用多層プリント配線基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2541643B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06302718A (ja) * | 1993-03-08 | 1994-10-28 | Internatl Business Mach Corp <Ibm> | 容量性負荷が低い接合構造を有する電子構造体 |
-
1988
- 1988-11-24 JP JP29763888A patent/JP2541643B2/ja not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06302718A (ja) * | 1993-03-08 | 1994-10-28 | Internatl Business Mach Corp <Ibm> | 容量性負荷が低い接合構造を有する電子構造体 |
Also Published As
Publication number | Publication date |
---|---|
JP2541643B2 (ja) | 1996-10-09 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |