JPH0197133A - 電源保護装置 - Google Patents
電源保護装置Info
- Publication number
- JPH0197133A JPH0197133A JP62251924A JP25192487A JPH0197133A JP H0197133 A JPH0197133 A JP H0197133A JP 62251924 A JP62251924 A JP 62251924A JP 25192487 A JP25192487 A JP 25192487A JP H0197133 A JPH0197133 A JP H0197133A
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- JP
- Japan
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- voltage
- circuit
- power supply
- switch circuit
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Links
- 230000001012 protector Effects 0.000 title 1
- 238000001514 detection method Methods 0.000 claims description 21
- 238000010586 diagram Methods 0.000 description 5
- 239000003990 capacitor Substances 0.000 description 2
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Landscapes
- Measurement Of Current Or Voltage (AREA)
- Protection Of Static Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は規定電圧範囲外の入力電圧が印加された場合
に、機器本体に電源電圧が印加されるのを阻止する電源
保護装置に関する。
に、機器本体に電源電圧が印加されるのを阻止する電源
保護装置に関する。
海外共通仕様の電気機器においては、外国の電源事情の
相異から程々の電圧範囲において使用し得るように入力
電圧切換タップ等が設けられている。
相異から程々の電圧範囲において使用し得るように入力
電圧切換タップ等が設けられている。
しかし、誤って規定以上の高電圧を印加して様器本体を
破損したシ、逆に、規定以下の低圧を印加して正常に動
作しないためシステムの動作に支障が生じることがある
。
破損したシ、逆に、規定以下の低圧を印加して正常に動
作しないためシステムの動作に支障が生じることがある
。
この発明は機器本体に規定範囲内の電源電圧が印加され
ない場合には、電源入力回路のスイッチが閉じられるの
を阻止する電源保護装置を得ることを目的とする。゛ 〔問題点を解決するための手段〕 この発明に係る電源保護装置は、電源電圧を様器本体に
印加するスイッチ回路と、機器本体に印加される電源電
圧が規定電圧範囲の下限値を超えたとき、第１の検出信
号を出力する第１の電圧検出回路と、入力電源電圧が規
定電圧範囲の上限値を超えたとき第２の検出信号を出力
する第２の電圧検出回路と、第１の検出信号が出力され
ておシ第２の検出信号が出力されていない場合のみ上記
スイッチ回路を閉成するように制御するスイッチ回路制
御手段とを備えたものである。
ない場合には、電源入力回路のスイッチが閉じられるの
を阻止する電源保護装置を得ることを目的とする。゛ 〔問題点を解決するための手段〕 この発明に係る電源保護装置は、電源電圧を様器本体に
印加するスイッチ回路と、機器本体に印加される電源電
圧が規定電圧範囲の下限値を超えたとき、第１の検出信
号を出力する第１の電圧検出回路と、入力電源電圧が規
定電圧範囲の上限値を超えたとき第２の検出信号を出力
する第２の電圧検出回路と、第１の検出信号が出力され
ておシ第２の検出信号が出力されていない場合のみ上記
スイッチ回路を閉成するように制御するスイッチ回路制
御手段とを備えたものである。
この発明に係る第１ｊ第２の電圧検出回路は、機器本体
に印加される電源電圧が、規定電圧範囲内であるか否か
を検出する。スイッチ回路制御手段は、第１．第２の電
圧検出回路の検出信号にもとづいて、規定電圧範囲内で
ある場合だけスイッチ回路を閉成させて様器本体に電源
電圧を印加させるようにスイッチ回路の動作を制御する
。
に印加される電源電圧が、規定電圧範囲内であるか否か
を検出する。スイッチ回路制御手段は、第１．第２の電
圧検出回路の検出信号にもとづいて、規定電圧範囲内で
ある場合だけスイッチ回路を閉成させて様器本体に電源
電圧を印加させるようにスイッチ回路の動作を制御する
。
以下、この発明の一実施例を図について説明する。
ｔｇ１図はこの実施例の回路図、第２図はこの実施例の
スイッチ回路制御手段における動作のフロー図で、（１
）はＡＣコンセント、（２）は・主電源スイッチ、（３
）は整流回路で整流器Ｒｅ １と整流電解コンデンサ
Ｃ１で構成される。（４）はＡＣ入力を整流回路（３）
に印加するスイッチ回路で、リレーＲＹと、リレーＲＹ
駆動トランジスタＴｒと、検眼ダイオードＤと、ドライ
ブ抵抗Ｒ１２とで構成される。
スイッチ回路制御手段における動作のフロー図で、（１
）はＡＣコンセント、（２）は・主電源スイッチ、（３
）は整流回路で整流器Ｒｅ １と整流電解コンデンサ
Ｃ１で構成される。（４）はＡＣ入力を整流回路（３）
に印加するスイッチ回路で、リレーＲＹと、リレーＲＹ
駆動トランジスタＴｒと、検眼ダイオードＤと、ドライ
ブ抵抗Ｒ１２とで構成される。
（５）は機器本体、（６）はバックアップ電源回路で、
バックアップトランスＢＴと、整流器Ｒｅ ２と、整流
電解コンデンサＣ２とで構成される。（７ａ）は第１の
電圧検出回路で、第１のコンパレータと、抵抗Ｒ１〜Ｒ
７とで構成され、ＡＣ入力電圧が１２０Ｖ以上になった
とき第１の検出信号を出力する。（７ｂ °）は第２の
電圧検出回路で、第２のコンパレータ（９）と、抵抗Ｒ
１〜Ｒ４およびＲ８−Ｒ１０とで構成され、ＡＣ入力電
圧が８０Ｖ以上になったとき第２の検出信号を出力する
。（１０）はマイクロコンピュータ（以下、「ＣＰＵ」
という）で、スイッチ回路（４）の開閉を制御するスイ
ッチ回路制御手段を構成する。（１１）はＣＰＵの電源
ヌイツチ、Ｒ１１，ツェナダイオードＺＤは、スイッチ
回路（４）のＴｒおよびＣＰＵ（１０）に定電圧ＶＤＤ
を印加する。
バックアップトランスＢＴと、整流器Ｒｅ ２と、整流
電解コンデンサＣ２とで構成される。（７ａ）は第１の
電圧検出回路で、第１のコンパレータと、抵抗Ｒ１〜Ｒ
７とで構成され、ＡＣ入力電圧が１２０Ｖ以上になった
とき第１の検出信号を出力する。（７ｂ °）は第２の
電圧検出回路で、第２のコンパレータ（９）と、抵抗Ｒ
１〜Ｒ４およびＲ８−Ｒ１０とで構成され、ＡＣ入力電
圧が８０Ｖ以上になったとき第２の検出信号を出力する
。（１０）はマイクロコンピュータ（以下、「ＣＰＵ」
という）で、スイッチ回路（４）の開閉を制御するスイ
ッチ回路制御手段を構成する。（１１）はＣＰＵの電源
ヌイツチ、Ｒ１１，ツェナダイオードＺＤは、スイッチ
回路（４）のＴｒおよびＣＰＵ（１０）に定電圧ＶＤＤ
を印加する。
つぎに、この実施例の動作を説明する。
まず、ステップ１（以下、 「ＳＩＪのように略記する
）で主電源スイッチ（２）を閉じると、第１゜第２の電
圧検出回路（７ａ ） ｓ （７ｂ ）にバックアップ
電源回路（６）から駆動電圧が印加され、同時にＣＰＵ
（１０）およびスイッチ回路（４）に一定電圧の駆動電
圧ＶＤＤが印加され、同時にＣＰＵ（１０）のＣＰ端子
はｒＬＪから「Ｈ」に変わる。第１のコンパレータ（８
）は、ＡＣ電圧が１２０Ｖ以上の場合に出力レベルがｒ
ＬＪからｒＨＪＫ変わるように構成されておシ、第２の
コンパレータ（９）ハ、ＡＣ電圧が８０■以上の場合に
出力レベμがｒＬＪからｒＨＪに変わるように構成され
ているので、ＣＰＵ（１０）の入力１および入力２は、
第３図に示すように変化する。ＣＰＵ（１０）はＳ２で
この人力１，２のレベμを読みとＤ、Ｓｓで入力１゜２
の組合せがいずれの電圧範囲であるかを弁別し、両人力
１，２が共にｒＬＪｒＬＪｔたは「■」「Ｈ」である場
合にはＳ４に進んでＣＰＵ（１０）のＰＡ８Ａ８端子Ｌ
Ｊのままでスイッチ回路（４）を開の状態のままとする
。
）で主電源スイッチ（２）を閉じると、第１゜第２の電
圧検出回路（７ａ ） ｓ （７ｂ ）にバックアップ
電源回路（６）から駆動電圧が印加され、同時にＣＰＵ
（１０）およびスイッチ回路（４）に一定電圧の駆動電
圧ＶＤＤが印加され、同時にＣＰＵ（１０）のＣＰ端子
はｒＬＪから「Ｈ」に変わる。第１のコンパレータ（８
）は、ＡＣ電圧が１２０Ｖ以上の場合に出力レベルがｒ
ＬＪからｒＨＪＫ変わるように構成されておシ、第２の
コンパレータ（９）ハ、ＡＣ電圧が８０■以上の場合に
出力レベμがｒＬＪからｒＨＪに変わるように構成され
ているので、ＣＰＵ（１０）の入力１および入力２は、
第３図に示すように変化する。ＣＰＵ（１０）はＳ２で
この人力１，２のレベμを読みとＤ、Ｓｓで入力１゜２
の組合せがいずれの電圧範囲であるかを弁別し、両人力
１，２が共にｒＬＪｒＬＪｔたは「■」「Ｈ」である場
合にはＳ４に進んでＣＰＵ（１０）のＰＡ８Ａ８端子Ｌ
Ｊのままでスイッチ回路（４）を開の状態のままとする
。
他方、入力１が「Ｌ」、入力２がｒＨＪの場合はＳ、に
進んでＣＰＵ（１０）のＰＡ３端子をｒＨＪとし、スイ
ッチ回路（４）を閉成させる。この給米、整流回路（３
）にＡＣ［圧が印加され、機器本体（５）に整流回路（
３）の出力電圧が印加される。
進んでＣＰＵ（１０）のＰＡ３端子をｒＨＪとし、スイ
ッチ回路（４）を閉成させる。この給米、整流回路（３
）にＡＣ［圧が印加され、機器本体（５）に整流回路（
３）の出力電圧が印加される。
このように、との実り例では、ＡＣ電圧が８０Ｖ〜１２
０ｖの範囲内である場合だけ機器本体（５）に駆動電圧
が印加され、ＡＣ電源の還定を誤った場合には機器本体
（５）に駆動電圧が印加されないので、機器本体（５）
が破損することがなく、また機器本体（５）の誤動作に
よシ他の機器に損傷を与えることが防止できる。
０ｖの範囲内である場合だけ機器本体（５）に駆動電圧
が印加され、ＡＣ電源の還定を誤った場合には機器本体
（５）に駆動電圧が印加されないので、機器本体（５）
が破損することがなく、また機器本体（５）の誤動作に
よシ他の機器に損傷を与えることが防止できる。
なお、上記実施例では、ＡＣ入力電源を整流して機器本
体（５）に印加する構成を示したが、ＡＣ￥ｇ。
体（５）に印加する構成を示したが、ＡＣ￥ｇ。
圧をその一！ま印加する場合、トランスで減圧して印加
する場合のいずれにも同様に適用できることはいうまで
もない。
する場合のいずれにも同様に適用できることはいうまで
もない。
この発明は以上説明したように、入力電源電圧が当該機
器本体に印加する規定電圧範囲の上限値を超えているか
否かを検出する第１の電圧検出回路と、当該規定電圧ね
囲の下限値を超えているか否かを検出する第２の電圧検
出回路と、両型圧検出回路の検出信号から当該入力電源
電圧が規定電圧範囲内であるか否かを弁別し、規定電圧
範囲内である場合のみ機器本体に駆動電圧を印加するよ
うに構成したものであるから、誤って規定範囲外の入力
電源に接続した場合には機器本体に駆動電圧が印加され
ることのない電源保護装置が得られる効果がある。
器本体に印加する規定電圧範囲の上限値を超えているか
否かを検出する第１の電圧検出回路と、当該規定電圧ね
囲の下限値を超えているか否かを検出する第２の電圧検
出回路と、両型圧検出回路の検出信号から当該入力電源
電圧が規定電圧範囲内であるか否かを弁別し、規定電圧
範囲内である場合のみ機器本体に駆動電圧を印加するよ
うに構成したものであるから、誤って規定範囲外の入力
電源に接続した場合には機器本体に駆動電圧が印加され
ることのない電源保護装置が得られる効果がある。
第１図はごの発明の一実施例の回路図、第２図はこの実
施例のＣＰＵにおける処理のフロー図、第３図は第１．
第２のコンパレータの入力ＡＣ電圧に対する出力特性を
示す図表である。 （２）・・・主電源スイッチ、（４）・・・スイッチ回
路、（６）・・・バックアップ電源、（７ａ）・・・第
１の電圧検出回路、（７ｂ）・・・第２の電圧検出回路
、（１０）・・・マイクロコンピュータ。
施例のＣＰＵにおける処理のフロー図、第３図は第１．
第２のコンパレータの入力ＡＣ電圧に対する出力特性を
示す図表である。 （２）・・・主電源スイッチ、（４）・・・スイッチ回
路、（６）・・・バックアップ電源、（７ａ）・・・第
１の電圧検出回路、（７ｂ）・・・第２の電圧検出回路
、（１０）・・・マイクロコンピュータ。
Claims (1)
- （１）、電源入力回路と機器本体との間に挿入されたス
イッチ回路と、このスイッチ回路に印加される入力電源
電圧が所定の上限値を超えたとき第１の検出信号を出力
する第１の電圧検出回路と、上記入力電源電圧が所定の
下限値を超えたとき第２の検出信号を出力する第２の電
圧検出回路と、上記第２の検出信号が出力されかつ上記
第１の検出信号が出力されていない場合のみ上記スイッ
チ回路を閉成させるスイッチ回路制御手段とを備えてな
る電源保護装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62251924A JPH0197133A (ja) | 1987-10-05 | 1987-10-05 | 電源保護装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62251924A JPH0197133A (ja) | 1987-10-05 | 1987-10-05 | 電源保護装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0197133A true JPH0197133A (ja) | 1989-04-14 |
Family
ID=17229996
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62251924A Pending JPH0197133A (ja) | 1987-10-05 | 1987-10-05 | 電源保護装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0197133A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE4024311A1 (de) * | 1989-07-31 | 1991-02-07 | Toshiba Kawasaki Kk | Bilderzeugungsgeraet mit abnehmbarer fixiereinheit |
| JPH0434828U (ja) * | 1990-07-13 | 1992-03-24 | ||
| EP1003046A1 (en) * | 1998-11-20 | 2000-05-24 | Nec Corporation | Voltage detecting circuit |
| JP2005024502A (ja) * | 2003-07-03 | 2005-01-27 | Nec Micro Systems Ltd | 電源電圧検出回路及び半導体集積回路装置 |
| JP2007151254A (ja) * | 2005-11-25 | 2007-06-14 | Matsushita Electric Ind Co Ltd | 電源制御装置 |
| JP2014138504A (ja) * | 2013-01-17 | 2014-07-28 | Canon Inc | 電源装置及び画像形成装置 |
-
1987
- 1987-10-05 JP JP62251924A patent/JPH0197133A/ja active Pending
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE4024311A1 (de) * | 1989-07-31 | 1991-02-07 | Toshiba Kawasaki Kk | Bilderzeugungsgeraet mit abnehmbarer fixiereinheit |
| JPH0434828U (ja) * | 1990-07-13 | 1992-03-24 | ||
| EP1003046A1 (en) * | 1998-11-20 | 2000-05-24 | Nec Corporation | Voltage detecting circuit |
| US6222398B1 (en) | 1998-11-20 | 2001-04-24 | Nec Corporation | Voltage detecting circuit |
| JP2005024502A (ja) * | 2003-07-03 | 2005-01-27 | Nec Micro Systems Ltd | 電源電圧検出回路及び半導体集積回路装置 |
| JP2007151254A (ja) * | 2005-11-25 | 2007-06-14 | Matsushita Electric Ind Co Ltd | 電源制御装置 |
| JP2014138504A (ja) * | 2013-01-17 | 2014-07-28 | Canon Inc | 電源装置及び画像形成装置 |
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