JPH0187454U - - Google Patents
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- JPH0187454U JPH0187454U JP18306987U JP18306987U JPH0187454U JP H0187454 U JPH0187454 U JP H0187454U JP 18306987 U JP18306987 U JP 18306987U JP 18306987 U JP18306987 U JP 18306987U JP H0187454 U JPH0187454 U JP H0187454U
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- JP
- Japan
- Prior art keywords
- data memory
- command control
- check code
- control signal
- memory check
- Prior art date
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- Pending
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- 230000004044 response Effects 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
Description
第１図は本考案の全体図であり、第２図は実施
例１の動作を説明するためのフローチヤートであ
り、第３図は実施例２の動作を説明するためのフ
ローチヤートである。
主な参照番号、１……命令制御回路、２……デ
ータメモリチエツクコード生成回路、３……デー
タメモリ、４……ＥＥＰＲＯＭ、５……データメ
モリチエツクコードとＥＥＰＲＯＭ比較回路、６
……スタンバイ・モード設定命令制御信号、７…
…スタンバイ・モード解除命令制御信号。
FIG. 1 is an overall diagram of the present invention, FIG. 2 is a flowchart for explaining the operation of the first embodiment, and FIG. 3 is a flowchart for explaining the operation of the second embodiment. Main reference numbers: 1...Instruction control circuit, 2...Data memory check code generation circuit, 3...Data memory, 4...EEPROM, 5...Data memory check code and EEPROM comparison circuit, 6...
...Standby mode setting command control signal, 7...
...Standby mode release command control signal.
Claims (1)
ンバイ・モード設定命令制御信号とスタンバイ・
モード解除命令制御信号によりデータメモリの内
容を読んでデータメモリのチエツクコードを生成
するデータメモリチエツクコード生成回路と、ス
タンバイ・モード設定命令制御信号によりデータ
メモリチエツクコードを書き込むＥＥＰＲＯＭと
、スタンバイ・モード解除命令制御信号によりデ
ータメモリチエツクコードとＥＥＰＲＯＭの内容
を比較してデータメモリチエツクコードとＥＥＰ
ＲＯＭの内容が一致か不一致かの信号を出力する
データメモリチエツクコードとＥＥＰＲＯＭ比較
回路を有するシングルチツプマイクロコンピユー
タのデータメモリ保持検出装置。 A command control circuit, a standby mode setting command control signal from this command control circuit, and a standby mode setting command control signal from the command control circuit.
A data memory check code generation circuit that reads the contents of data memory and generates a data memory check code in response to a mode release command control signal, an EEPROM that writes a data memory check code in response to a standby mode setting command control signal, and a standby mode release circuit. The data memory check code is compared with the contents of the EEPROM by the command control signal, and the data memory check code and the EEPROM are compared.
A data memory holding and detecting device for a single-chip microcomputer having a data memory check code and an EEPROM comparison circuit that output a signal indicating whether the contents of the ROM match or do not match.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18306987U JPH0187454U (en) | 1987-11-30 | 1987-11-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18306987U JPH0187454U (en) | 1987-11-30 | 1987-11-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0187454U true JPH0187454U (en) | 1989-06-09 |
Family
ID=31474502
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18306987U Pending JPH0187454U (en) | 1987-11-30 | 1987-11-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0187454U (en) |
-
1987
- 1987-11-30 JP JP18306987U patent/JPH0187454U/ja active Pending
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