JPH0150029B2 - - Google Patents
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- Publication number
- JPH0150029B2 JPH0150029B2 JP7377682A JP7377682A JPH0150029B2 JP H0150029 B2 JPH0150029 B2 JP H0150029B2 JP 7377682 A JP7377682 A JP 7377682A JP 7377682 A JP7377682 A JP 7377682A JP H0150029 B2 JPH0150029 B2 JP H0150029B2
- Authority
- JP
- Japan
- Prior art keywords
- register
- disk
- address
- pickup
- optical head
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000003287 optical effect Effects 0.000 claims description 16
- 230000003247 decreasing effect Effects 0.000 claims 1
- 101710162371 Dihydroxy-acid dehydratase 1 Proteins 0.000 description 3
- 238000013459 approach Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000003321 amplification Effects 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
- 238000000252 photodiode array detection Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B21/00—Head arrangements not specific to the method of recording or reproducing
- G11B21/02—Driving or moving of heads
- G11B21/08—Track changing or selecting during transducing operation
- G11B21/081—Access to indexed tracks or parts of continuous track
Landscapes
- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
- Moving Of Head For Track Selection And Changing (AREA)
Description
【発明の詳細な説明】
本発明はデイスクプレーヤに係り、特にビデオ
デイスクやデジタルオーデオデイスク（以下
DADと記す）の所望トラツク位置より直ちに再
生し得る様にしたデイスクプレーヤの頭出し装置
に関する。
デイスクやデジタルオーデオデイスク（以下
DADと記す）の所望トラツク位置より直ちに再
生し得る様にしたデイスクプレーヤの頭出し装置
に関する。
従来、光ビツクアツプを用いたDAD等では信
号となる基本的な音声又はビデオなどの変調され
た信号の他に、曲番等に対応するナンバーと曲の
頭からの時間などのデータが記録されているた
め、プレーヤにて、自由にそのデータを取り出し
目的の位置の頭出しができる。しかしここで１曲
の長さがまちまちであつたり、線速度が一定に記
録されていたりするデイスクでは目的の位置が予
測できず、再生してみないと解らないため、デイ
スクの始めから少しずつビツクアツプを進めて何
度もデータを読み取り、所定位置に近づける必要
があつた。この為にビツクアツプの移動速度を上
げても、分解の精度を一定に保たなければならな
いためにデータの続み取り回数が増加し、読み取
り時間が掛かる為に頭出し完了までに多くの時間
を費す欠点があつた。
号となる基本的な音声又はビデオなどの変調され
た信号の他に、曲番等に対応するナンバーと曲の
頭からの時間などのデータが記録されているた
め、プレーヤにて、自由にそのデータを取り出し
目的の位置の頭出しができる。しかしここで１曲
の長さがまちまちであつたり、線速度が一定に記
録されていたりするデイスクでは目的の位置が予
測できず、再生してみないと解らないため、デイ
スクの始めから少しずつビツクアツプを進めて何
度もデータを読み取り、所定位置に近づける必要
があつた。この為にビツクアツプの移動速度を上
げても、分解の精度を一定に保たなければならな
いためにデータの続み取り回数が増加し、読み取
り時間が掛かる為に頭出し完了までに多くの時間
を費す欠点があつた。
本発明は叙上の欠点に鑑み成されたものであ
り、ビツクアツプを所定位置へ移動させるに際し
てデータの読み取り回数を少くして目的位置に素
速く移動させ様とすることを目的とするものであ
る。
り、ビツクアツプを所定位置へ移動させるに際し
てデータの読み取り回数を少くして目的位置に素
速く移動させ様とすることを目的とするものであ
る。
上記の目的を達成させるために本発明ではビツ
クアツプによりデイスクの始めから順次データを
取り出して、比較するのではなく、ビツクアツプ
の移動距離を正逆方向を含めて順次半分の距離づ
つ減少させることによつて目的の位置に収斂させ
る様に成したものである。
クアツプによりデイスクの始めから順次データを
取り出して、比較するのではなく、ビツクアツプ
の移動距離を正逆方向を含めて順次半分の距離づ
つ減少させることによつて目的の位置に収斂させ
る様に成したものである。
以下本発明の一実施例を図面について詳記す
る。第１図Ａ，Ｂは本発明のデイスク部分とビツ
クアツプ部分の平面図及び側面図を示すもので再
生用のDAD１の下面には情報を再生するための
ビツクアツプ即ち光ヘツド２を有し、該光ヘツド
２はアーム２ａの先端に取り付けられ、他端はモ
ータ３の軸に枢着されてモータ３の回動と共にモ
ータ軸を中心に光ヘツド２はDAD１の輻方向に
移動する様に成されている。モータ軸には第２図
に示す様なコード盤４が取り付けられ、該コード
盤に設けた情報をフオトインタラプタ等の光検出
器５で検出する様に成されている。
る。第１図Ａ，Ｂは本発明のデイスク部分とビツ
クアツプ部分の平面図及び側面図を示すもので再
生用のDAD１の下面には情報を再生するための
ビツクアツプ即ち光ヘツド２を有し、該光ヘツド
２はアーム２ａの先端に取り付けられ、他端はモ
ータ３の軸に枢着されてモータ３の回動と共にモ
ータ軸を中心に光ヘツド２はDAD１の輻方向に
移動する様に成されている。モータ軸には第２図
に示す様なコード盤４が取り付けられ、該コード
盤に設けた情報をフオトインタラプタ等の光検出
器５で検出する様に成されている。
上記コード盤に設けた情報はコード盤４の回転
に伴つてパルスが得られる様に多数のスリツト６
が設けられている。光ヘツド２の移動に対して８
ビツトの分解能が要求されるとすれば２５６スリ
ツト以上が定所回転角の内に設けられなければな
らない、又光ヘツド２がデイスク１の始めの位置
に対応した所にスタート位置を示すスリツト等の
マーク７を設ける様に成す。
に伴つてパルスが得られる様に多数のスリツト６
が設けられている。光ヘツド２の移動に対して８
ビツトの分解能が要求されるとすれば２５６スリ
ツト以上が定所回転角の内に設けられなければな
らない、又光ヘツド２がデイスク１の始めの位置
に対応した所にスタート位置を示すスリツト等の
マーク７を設ける様に成す。
上述の如き構成に於いての頭出しを行なうため
の系統図を第３図について詳記する。
の系統図を第３図について詳記する。
上記光検出器５によつて得られたパルスをアツ
プタウンカウンタ回路８に加え該アツプタウンカ
ウンタ回路８の出力がヘツド位置に対応する様に
する。
プタウンカウンタ回路８に加え該アツプタウンカ
ウンタ回路８の出力がヘツド位置に対応する様に
する。
上記アツプタウンカウンタ回路８の出力と移動
位置を指令するレジスタ１０の出力を比較器９に
与えて、上記両出力のずれに対応したデータをデ
ジタルアナログ変換回路１１（以下Ｄ／Ａと記
す）によりアナログ変換し、Ｄ／Ａ１１の出力は
増巾器１２を通して上記した光ヘツド２の載置さ
れたアーム２ａを回転させるモータ３に加えられ
る。
位置を指令するレジスタ１０の出力を比較器９に
与えて、上記両出力のずれに対応したデータをデ
ジタルアナログ変換回路１１（以下Ｄ／Ａと記
す）によりアナログ変換し、Ｄ／Ａ１１の出力は
増巾器１２を通して上記した光ヘツド２の載置さ
れたアーム２ａを回転させるモータ３に加えられ
る。
この様にすることで光ヘツド２はレジスタ１０
で与えられたデータ位置に移動される。今光ヘツ
ド２がデイスク１の一方のスタート位置にいるも
のとする。この時コード盤４のスタート位置用の
スリツトを通してスタートマークが得られる。
で与えられたデータ位置に移動される。今光ヘツ
ド２がデイスク１の一方のスタート位置にいるも
のとする。この時コード盤４のスタート位置用の
スリツトを通してスタートマークが得られる。
上述のスタート用パルスを端子T3に加える。
更に所望のデイスク位置に対応した指令アドレス
１７をコンパレータ１８に与えるスタート用指令
パルス（第４図イ）を与えることでレジスタ１０
にはデイスク１の記録帯域の略々中央に対応する
中心のデータがセツトされる。こゝでレジスタ１
０が８ビツトのものであれば1.0.0.0.0.0.0.がセツ
トされる。この状態を第４図ロに示す、上記レジ
スタの指令によりヘツドは移動し、カウンタ回路
８の第４図ハのデータと同一に成ると差動比較回
路９の出力は一致パルス発生回路１３に与えら
れ、該一致パルス発生回路はコンパレータとモノ
ステイブルマルチバイブレータを組み合せて構成
させることが出来て一定巾のバルスが第４図ニの
様に出力される。第４図ニに示される一定巾のバ
ルスはデータ読み取り指令として端子T1に加え
られる。端子T1は図示せざるも光ヘツドのデイ
スク読み取り回路を動作させ、デイスク上のアド
レスを読み取る。デイスク上のアドレスが読み取
られると再生アドレスレジスタ１６にそのアドレ
スが加えられてコンパレータ１８に加える。
更に所望のデイスク位置に対応した指令アドレス
１７をコンパレータ１８に与えるスタート用指令
パルス（第４図イ）を与えることでレジスタ１０
にはデイスク１の記録帯域の略々中央に対応する
中心のデータがセツトされる。こゝでレジスタ１
０が８ビツトのものであれば1.0.0.0.0.0.0.がセツ
トされる。この状態を第４図ロに示す、上記レジ
スタの指令によりヘツドは移動し、カウンタ回路
８の第４図ハのデータと同一に成ると差動比較回
路９の出力は一致パルス発生回路１３に与えら
れ、該一致パルス発生回路はコンパレータとモノ
ステイブルマルチバイブレータを組み合せて構成
させることが出来て一定巾のバルスが第４図ニの
様に出力される。第４図ニに示される一定巾のバ
ルスはデータ読み取り指令として端子T1に加え
られる。端子T1は図示せざるも光ヘツドのデイ
スク読み取り回路を動作させ、デイスク上のアド
レスを読み取る。デイスク上のアドレスが読み取
られると再生アドレスレジスタ１６にそのアドレ
スが加えられてコンパレータ１８に加える。
該コンパレータ１８は指令アドレスと上記再生
アドレスを比較して指令アドレスより再生アドレ
スが大きければ信号を出力してゲート回路２０に
加える該ゲート回路２０には読み取り指令パルス
が与えられているので該読み取り指令でゲート回
路２０を開いて第４図ホを出力させる。
アドレスを比較して指令アドレスより再生アドレ
スが大きければ信号を出力してゲート回路２０に
加える該ゲート回路２０には読み取り指令パルス
が与えられているので該読み取り指令でゲート回
路２０を開いて第４図ホを出力させる。
一方、スタート指令信号イによつてシフトレジ
スタ１５の一端だけを１とし他を０と成し、更に
読み取り指令パルスニを所定時間遅延させるため
に遅延回路１４に加えた出力パルスで上記シフト
レジスタ１５をシフトさせる。
スタ１５の一端だけを１とし他を０と成し、更に
読み取り指令パルスニを所定時間遅延させるため
に遅延回路１４に加えた出力パルスで上記シフト
レジスタ１５をシフトさせる。
上記シフトレジスタの最初の一段を除いた次の
段以下の出力をレジスタ１０の読み取りクロツク
として入力する。上記遅延回路の遅延量はコンパ
レータ９の値が正しく比較した時間に対応させて
あり、この時の大小をレジスタ１０に取り込む。
第４図の例で上記シフトレジスタ１５とレジスタ
１０の関係を説明すると、先づ一致パルス発生回
路１３より一定巾の一致パルスが出力されると、
該一致パルスによつてシフトレジスタ１５の０番
のレジスタにセツトされていた１の信号は１番の
レジスタに移り、１番のレジスタから出力された
パルスはレジスタ１０の１段目にコンパレータの
情報を書き込む、第４図の場合は目標の位置まで
の距離が大きいので１が再度書かれて第２段に１
をセツトする、これにより1.1.0.0.0.0.0.0のアドレ
ス位置へ光ヘツド２は移動する。ここで再び一致
パルスニを発生させてレジスタ１０の２段目をセ
ツトする。この時２段用のレジスタが０であれば
次の３段目をセツトさせる。
段以下の出力をレジスタ１０の読み取りクロツク
として入力する。上記遅延回路の遅延量はコンパ
レータ９の値が正しく比較した時間に対応させて
あり、この時の大小をレジスタ１０に取り込む。
第４図の例で上記シフトレジスタ１５とレジスタ
１０の関係を説明すると、先づ一致パルス発生回
路１３より一定巾の一致パルスが出力されると、
該一致パルスによつてシフトレジスタ１５の０番
のレジスタにセツトされていた１の信号は１番の
レジスタに移り、１番のレジスタから出力された
パルスはレジスタ１０の１段目にコンパレータの
情報を書き込む、第４図の場合は目標の位置まで
の距離が大きいので１が再度書かれて第２段に１
をセツトする、これにより1.1.0.0.0.0.0.0のアドレ
ス位置へ光ヘツド２は移動する。ここで再び一致
パルスニを発生させてレジスタ１０の２段目をセ
ツトする。この時２段用のレジスタが０であれば
次の３段目をセツトさせる。
この様に順次セツトを繰り返し最終的には目的
のアドレス位置に近づき８ビツト目が成立すると
第４図ヘに示す終了パルスは遅延回路１９を通し
てエンド端子T2に与えられる。
のアドレス位置に近づき８ビツト目が成立すると
第４図ヘに示す終了パルスは遅延回路１９を通し
てエンド端子T2に与えられる。
この様に本発明の構成では８回の比較のみでデ
イスクの情報領域の半径内を1/256の精度で目的
の位置に近づけることが出来る。
イスクの情報領域の半径内を1/256の精度で目的
の位置に近づけることが出来る。
この様な位置まで近接すれば再生トラツクにサ
ーボを掛けて精度よく目的位置に光ヘツドを持ち
来たすことが可能と成る。
ーボを掛けて精度よく目的位置に光ヘツドを持ち
来たすことが可能と成る。
即ち従来と同じ様に再生トラツクサーボをかけ
ながらヘツドによつてトラツクを算えて飛ばすな
どして最終補正を行なう様にすればよい。トラツ
クを飛ばしながら頭出しする方法は毎秒数百トラ
ツクは移動し得るので始めに1/256の精度で近づ
いていれば目的位置の頭出し時間を最少に抑える
ことが可能である。
ながらヘツドによつてトラツクを算えて飛ばすな
どして最終補正を行なう様にすればよい。トラツ
クを飛ばしながら頭出しする方法は毎秒数百トラ
ツクは移動し得るので始めに1/256の精度で近づ
いていれば目的位置の頭出し時間を最少に抑える
ことが可能である。
上記実施例ではヘツド位置をコード盤によつて
求めたが、コード盤の代りにデイスク上のトラツ
ク数をカウントしたり光ヘツドを等速で移動さ
せ、その時間によつて位置を求める様にする等の
手段を用いてもよい。又光ヘツドをスタート時に
デイスクの一端に配設したが始めからデイスクの
情報記録領域半径の真中に配する様にすればサー
チ回数をより少くすることが可能である。
求めたが、コード盤の代りにデイスク上のトラツ
ク数をカウントしたり光ヘツドを等速で移動さ
せ、その時間によつて位置を求める様にする等の
手段を用いてもよい。又光ヘツドをスタート時に
デイスクの一端に配設したが始めからデイスクの
情報記録領域半径の真中に配する様にすればサー
チ回数をより少くすることが可能である。
本発明は叙上の如く構成したので数少ない読み
取り回数で目標の位置を検出することが出来るた
めに頭出し時間を減少させることが出来るもので
ある。
取り回数で目標の位置を検出することが出来るた
めに頭出し時間を減少させることが出来るもので
ある。
第１図Ａは本発明のデイスクと光ヘツドの関係
を示す平面図、第１図Ｂは第１図Ａの側面図、第
２図は第１図に示すコード盤の平面図、第３図は
本発明の頭出し装置を示す系統図、第４図は第３
図の動作説明用の波形図である。 図中５は光検出器、８はアツプタウンカウンタ
回路、９は差動比較回路、１０はレジスタ、１１
はＤ／Ａ、１２は増巾回路、１３は一致パルス発
生回路、１５はシフトレジスタ、１８はコンパレ
ータ、１４，１９は遅延回路である。
を示す平面図、第１図Ｂは第１図Ａの側面図、第
２図は第１図に示すコード盤の平面図、第３図は
本発明の頭出し装置を示す系統図、第４図は第３
図の動作説明用の波形図である。 図中５は光検出器、８はアツプタウンカウンタ
回路、９は差動比較回路、１０はレジスタ、１１
はＤ／Ａ、１２は増巾回路、１３は一致パルス発
生回路、１５はシフトレジスタ、１８はコンパレ
ータ、１４，１９は遅延回路である。
Claims (1)
- １ デイスク内に予め記録された時間や曲番等の
アドレス情報を読み取つて指定アドレス位置に光
ヘツド等のビツクアツプを移動させる様にして成
るデイスクプレーヤに於いて、上記指定アドレス
と再生アドレスを一回比較する毎に該ビツクアツ
プの移動量を順次1/2づゝ減少させた時の比較出
力によつて移動方向を定めて指定アドレスに近づ
ける様にして成ることを特徴とするデイスクプレ
ーヤ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7377682A JPS58189873A (ja) | 1982-04-30 | 1982-04-30 | デイスクプレ−ヤ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7377682A JPS58189873A (ja) | 1982-04-30 | 1982-04-30 | デイスクプレ−ヤ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58189873A JPS58189873A (ja) | 1983-11-05 |
| JPH0150029B2 true JPH0150029B2 (ja) | 1989-10-26 |
Family
ID=13527937
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7377682A Granted JPS58189873A (ja) | 1982-04-30 | 1982-04-30 | デイスクプレ−ヤ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58189873A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS615331A (ja) * | 1984-06-06 | 1986-01-11 | Fujitsu Ltd | デイスク装置 |
-
1982
- 1982-04-30 JP JP7377682A patent/JPS58189873A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58189873A (ja) | 1983-11-05 |
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