JPH0140999B2 - - Google Patents

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JPH0140999B2
JPH0140999B2 JP59163987A JP16398784A JPH0140999B2 JP H0140999 B2 JPH0140999 B2 JP H0140999B2 JP 59163987 A JP59163987 A JP 59163987A JP 16398784 A JP16398784 A JP 16398784A JP H0140999 B2 JPH0140999 B2 JP H0140999B2
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JP
Japan
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liquid crystal
waveform
bias ratio
voltage
ratio
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JP59163987A
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JPS6142690A (ja
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Tetsuo Murata
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Sharp Corp
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Sharp Corp
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    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
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    • G09G3/3611Control of matrices with row and column drivers
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    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
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    • G09G2320/0209Crosstalk reduction, i.e. to reduce direct or indirect influences of signals directed to a certain pixel of the displayed image on other pixels of said image, inclusive of influences affecting pixels in different frames or fields or sub-images which constitute a same image, e.g. left and right images of a stereoscopic display

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Description

【発明の詳細な説明】
<技術分野> 本発明は液晶表示素子の駆動方法に関するもの
で、特に、液晶印加電圧波形のバイアス比を電圧
平均化法における理論的最適バイアス比よりも大
きくする構成とすることによつて、ドツトマトリ
ツクス型液晶表示素子等の高デユーテイ駆動時に
於けるコントラストむらを低減させたことを特徴
とする、液晶表示素子の駆動方法を提供するもの
である。 <従来技術> 液晶表示素子は容量性負荷であり、更に、表示
部分と液晶駆動用LSIとの間には、LSIのオン抵
抗、基板上の抵抗、液晶表示素子内の透明導電膜
の抵抗等、様々な抵抗が存在する。このために、
個々の表示点における印加電圧波形は、液晶層の
容量Cと、電極配線等の抵抗(R)のために、液
晶印加電圧波形を加える時の充放電電流によつて
駆動波形そのものが歪む。 以下に、上記現象について簡単に説明する。 第2図に示すようにR―C―E直列回路と考え
る。t=0でスイツチを投入する場合のCの両端
の電圧υを求めると、以下の式のようになる。 Ri+1/C∫idt=E (但し、iは電流値) i=dq/dt (但し、qはCに蓄積される電荷量) 上式二式より、 Rdq/dt+1/Cq=E この微分方程式の解は、以下のようになる。 t=0のとき、q=0であるから A=−CE したがつて、qは、 上記Cの端子電圧υを図で示すと第3図のように
なる。 液晶表示素子と、その駆動回路は、等価的にR
―C―E直列回路と考えられるので、各表示点に
於ける液晶表示素子の端子電圧も歪みが生じるわ
けである。その様子を第4図に示す。 液晶印加電圧波形には、表示する内容によつて
第5図に示すように、低周波波形1と高周波波形
2とが存在する。液晶印加電圧波形が歪んだ場合
第4図から明らかなように、高周波波形の方が低
周波波形より電圧実効値の低下率が大きい。その
結果、高周波波形が印加されている表示点は、低
周波波形が印加されている表示点より、コントラ
ストが低なる。ドツトマトリツクス型液晶表示素
子の場合、これが表示パターンのコントラストの
むらとなつて現われる。 従来の液晶表示素子は、上記高周波波形歪みに
よるコントラストむらがよく見られ、表示品位の
上から問題になることが多かつた。 <発明の目的> それ故に、本発明の目的は、上記のコントラス
トむらを低減し、表示品位を向上させることにあ
る。 <発明の構成> 本発明の液晶表示素子駆動方法は、液晶表示素
子を電圧平均化法により駆動するものに於て、バ
イアス比を理論的最適バイアス比より大きくする
構成とすることによつて、上記コントラストむら
の低減化をはかり、以て表示品位を向上させたこ
とを特徴とするものである。 第6図に液晶印加波形(オン波形)の一例を示
す、斜線部分が波形歪みの影響を受け、コントラ
ストむらの主な原因となる部分である。この部分
の波形値は、電源電圧Vopとバイアス比nの値に
より決まる。 さて、液晶印加電圧波形の最適バイアス比ns
は、デユーテイ比Dより求められる。最適バイア
ス比とは、デユーテイ比を固定した場合、オン波
形、オフ波形の実効値の比が最大となるバイアス
比である。 最適バイアス比の計算式を以下に示す。 オン波形実効値 オフ波形実効値 オン・オフ波形実効値比 n=1+√Dのとき、aの値は最大となる。こ
の時のバイアス比が波形歪みを考慮に入れない時
の最適バイアス比である。 最適バイアス比ns=1+√D……(5) (但し、D=デユーテイ比) ここで、バイアス比を最適バイアス比より更に
大きくした場合を考える。(2)式より、バイアス比
を大きくすると、Vopも大きくなければ、液晶に
必要なオン電圧の実効値を加えられない。 バイアス比を大きくすると、同じオン実効値を
加えた場合、コントラストむらの原因となる第6
図の斜線部の非選択波形波高値は小さくなり、波
形歪みによる電圧実効値の減少率は小さくなる。
((1)式より、波形歪みの電圧値υ(=E−υ)は、
【式】であり、波高値Eに比例す る)。 したがつて、コントラストむらの原因となる第
6図の斜線部非選択波形の波形歪みの実効値に与
える影響は、バイアス比を上げることにより緩和
される。但し、バイアス比を理論的最適バイアス
比((5)式)より大きくすると、aすなわち
Vonrms/Voffrms比が小さくなり、電源電圧
Vopが高くなるので、必要以上にバイアス比を大
きくすることは好ましくない。実用上は理論的最
適バイアス比の1.2〜4倍程度が望ましい(実験
により確認)。 第1図に、従来の方法(バイアス比n=最適バ
イアス比nsに設定)による液晶印加電圧波形1
と、本発明の方法(バイアス比na=最適バイアス
比nsの1.2〜4倍)による液晶印加電圧波形2と
を示す。 <実施例> 1/200デユーテイ駆動の場合、理論的最適バ
イアス比は約15.1であるが、実験では1/24バイ
アスの方がコントラストむらは事実上無視し得る
程度に低減した。1/200デユーテイ1/15.1バ
イアス、1/24バイアスの値を(2)、(3)、(4)式に代
入して各数値の比較をして、1/24バイアスでも
表示の品位、電圧レベルが実用範囲にあることを
示すと分かり易い。 本発明の方法は、特に高デユーテイの場合に有
効で、波形歪みの影響は液晶表示素子電極配線抵
抗、駆動回路のインピーダンス、液晶層の容量値
及び駆動周波数等が複雑に関係するので、バイア
ス比は実際の表示品位を見ながらオン・オフコン
トラストとコントラストむらの両方を見比べて実
験により決定することが望ましい。 <発明の効果> 一般に液晶表示素子の各表示部は向かい合つた
一対の透明電極と誘電体である液晶層から成る平
行平板コンデンサを形成しており、また、これら
の表示部に電圧を印加するための導体部も抵抗値
が10Ω/口〜数100Ω/口の透明電極であり構造
上、波形歪みの原因となるC―R積分回路の形に
ならざるを得ない。 従来は、この波形歪みの原因を除去するために
透明電極の抵抗値を小さくすることが必要であ
り、このために透明電極の膜厚増大によるコスト
アツプが不可避であつた。 本発明によれば、透明電極の抵抗を小さくしな
くとも、波形歪みによるコントラストむらを低減
でき、良好な表示を与える、きわめて有用な駆動
方式を得ることができるものである。
【図面の簡単な説明】
第1図は従来の駆動方法による液晶印加電圧波
形と本発明の駆動方法による液晶印加電圧波形と
を示す波形図、第2図はR―C―E直列回路を示
す回路図、第3図は、第2図に於けるCの両端の
電圧υの時間変化を示す電圧曲線図、第4図は液
晶印加電圧波形に於ける波形歪みの様子を示す波
形図、第5図は低周波の液晶印加電圧波形と高周
波の液晶印加電圧波形とを示す波形図、第6図は
液晶印加電圧波形を示す波形図である。

Claims (1)

    【特許請求の範囲】
  1. 1 液晶表示素子を電圧平均化法により駆動する
    ものに於て、バイアス比を理論的最適バイアス比
    より大きくすることによつて、コントラストむら
    を低減させたことを特徴とする、液晶表示素子の
    駆動方法。
JP59163987A 1984-08-03 1984-08-03 液晶表示素子の駆動方法 Granted JPS6142690A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP59163987A JPS6142690A (ja) 1984-08-03 1984-08-03 液晶表示素子の駆動方法
US07/134,597 US4824211A (en) 1984-08-03 1987-12-18 Method of driving a liquid crystal display device

Applications Claiming Priority (1)

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JP59163987A JPS6142690A (ja) 1984-08-03 1984-08-03 液晶表示素子の駆動方法

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JPS6142690A JPS6142690A (ja) 1986-03-01
JPH0140999B2 true JPH0140999B2 (ja) 1989-09-01

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