JPH01286179A - 記録媒体の信号処理装置 - Google Patents
記録媒体の信号処理装置Info
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- JPH01286179A JPH01286179A JP11561088A JP11561088A JPH01286179A JP H01286179 A JPH01286179 A JP H01286179A JP 11561088 A JP11561088 A JP 11561088A JP 11561088 A JP11561088 A JP 11561088A JP H01286179 A JPH01286179 A JP H01286179A
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- Japan
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- 238000012545 processing Methods 0.000 claims abstract description 34
- 238000012937 correction Methods 0.000 claims abstract description 30
- 230000003287 optical effect Effects 0.000 abstract description 13
- 238000012546 transfer Methods 0.000 abstract description 12
- 230000002950 deficient Effects 0.000 abstract description 4
- 208000011580 syndromic disease Diseases 0.000 description 12
- 238000000034 method Methods 0.000 description 8
- 238000010586 diagram Methods 0.000 description 4
- 238000011084 recovery Methods 0.000 description 2
- 238000011094 buffer selection Methods 0.000 description 1
- 238000012790 confirmation Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
１丘立１
本発明は記録媒体の信号処理装置に間し、特に記録再生
可能な光ディスクの信号処理装置に関するもめである。
可能な光ディスクの信号処理装置に関するもめである。
直未韮且
記録再生可能な光ディスクの信号処理装置では、記録す
べきデータに対してエラー訂正コード（ＥＣＣ）を付加
し、インタリーブ処理を施して光デイスク媒体上に当該
データの記録を行っている。
べきデータに対してエラー訂正コード（ＥＣＣ）を付加
し、インタリーブ処理を施して光デイスク媒体上に当該
データの記録を行っている。
よって、エラー訂正コードを付加する機能や、エラー訂
正を行うためのシンドロームを生成するシンドローム生
成機能をマイクロプロセッサを用いて実現している。
正を行うためのシンドロームを生成するシンドローム生
成機能をマイクロプロセッサを用いて実現している。
第４図はこの様な光デイスク信号処理装置の従来例を示
すシステムブロック図である０図において、ホストシス
テムｌからの書込みデータはホストインク・フェース制
御回路２を経由してバスマネージャ回路１４へ送られる
。マイクロプロセッサ１３はバスマネージャ回路１４に
対してデータの転送方向、転送バイト数、バッファアド
レス等を指示する。
すシステムブロック図である０図において、ホストシス
テムｌからの書込みデータはホストインク・フェース制
御回路２を経由してバスマネージャ回路１４へ送られる
。マイクロプロセッサ１３はバスマネージャ回路１４に
対してデータの転送方向、転送バイト数、バッファアド
レス等を指示する。
データバッファ回路３へ蓄えられたデータは再びバスマ
ネージャ回路１４を通りシンドロームジエネレータ回路
１５へ転送されエラー訂正コード生成に使用される。エ
ラー訂正コードが付加されたデータは変復調回路５、フ
ォーマット制御回路６及びドライブインタフェイス制御
回路７を経てドライブ装置８へ送られる。
ネージャ回路１４を通りシンドロームジエネレータ回路
１５へ転送されエラー訂正コード生成に使用される。エ
ラー訂正コードが付加されたデータは変復調回路５、フ
ォーマット制御回路６及びドライブインタフェイス制御
回路７を経てドライブ装置８へ送られる。
読取り命令の場合、マイクロプロセッサ１３はドライブ
インタフェイス制御回路７によりドライブ装置８ヘヘツ
ドの移動命令を退出後、フォーマット制御回路６と変復
調回路５とを使用してヘッドの位置決めを行い、バスマ
ネージャ回路１４に対してデータ転送方向の指示を行い
データをデータバッファ３へ格納する。シンドロームジ
ェネレータ回路１０はシンドロームの演算結果をマイク
ロプロセッサ１３へ報告する。
インタフェイス制御回路７によりドライブ装置８ヘヘツ
ドの移動命令を退出後、フォーマット制御回路６と変復
調回路５とを使用してヘッドの位置決めを行い、バスマ
ネージャ回路１４に対してデータ転送方向の指示を行い
データをデータバッファ３へ格納する。シンドロームジ
ェネレータ回路１０はシンドロームの演算結果をマイク
ロプロセッサ１３へ報告する。
マイクロプロセッサ１３は読取りデータにおけるエラー
の有無をシンドローム演算結果を利用して調べ、エラー
があればシンドロームを用いて誤りパターン及び誤り位
置の計算を実行する。この計算はエラーシンボル数が多
い程時間を要し、よってエラー訂正可能レベルの欠陥デ
ータ数であっても、連続したデータ読取り動作が困難と
なる。
の有無をシンドローム演算結果を利用して調べ、エラー
があればシンドロームを用いて誤りパターン及び誤り位
置の計算を実行する。この計算はエラーシンボル数が多
い程時間を要し、よってエラー訂正可能レベルの欠陥デ
ータ数であっても、連続したデータ読取り動作が困難と
なる。
この様に、従来の光デイスク信号処理装置では、エラー
訂正コードの発生とシンドロームの生成のみをシンドロ
ームジェネレータ回路にて行い、エラー訂正処理はマイ
クロプロセッサのソフトウェアによって処理しているの
で、エラーシンボル数が増加すると処理速度が極端に低
下するという欠点を有している。このことは、光デイス
ク装置の場合、従来の磁気ディスク装置とは相違し、媒
体自身のエラー発生の確率が極端に高く、数シンボルの
エラー発生確率が高いので、光ディスクを使用するうえ
で大きな欠点となっている。
訂正コードの発生とシンドロームの生成のみをシンドロ
ームジェネレータ回路にて行い、エラー訂正処理はマイ
クロプロセッサのソフトウェアによって処理しているの
で、エラーシンボル数が増加すると処理速度が極端に低
下するという欠点を有している。このことは、光デイス
ク装置の場合、従来の磁気ディスク装置とは相違し、媒
体自身のエラー発生の確率が極端に高く、数シンボルの
エラー発生確率が高いので、光ディスクを使用するうえ
で大きな欠点となっている。
九肌曵１皇
そこで、本発明はこの様な従来のものの欠点を解決すべ
くなされたものであって、その目的とするところは、光
ディスクの様にエラー発生率が大なる記録媒体において
エラーシンボル数が多い欠陥データに対しても連続デー
タ処理を可能とした記録媒体の信号処理装置を提供する
ことにある。
くなされたものであって、その目的とするところは、光
ディスクの様にエラー発生率が大なる記録媒体において
エラーシンボル数が多い欠陥データに対しても連続デー
タ処理を可能とした記録媒体の信号処理装置を提供する
ことにある。
１１Ω旦羞
本発明によれば、エラー訂正コードを付加し、記録媒体
上にインタリープ処理を施してデータを記録することに
よりバースト誤りを訂正可能としてなるデータ処理シス
テムにおける記録媒体信号処理装置であって、この処理
装置全体を制御する第１のプロセッサ手段と、エラー訂
正回路及びインタリーブ処理制御回路の動作を前記第１
のプロセッサ手段の指示により制御する第２のプロセッ
サ手段と、前記エラー訂正回路のエラー訂正のための演
算処理を実行する第３のプロセッサ手段とを含むことを
特徴とする記録媒体信号処理装置が得られる。
上にインタリープ処理を施してデータを記録することに
よりバースト誤りを訂正可能としてなるデータ処理シス
テムにおける記録媒体信号処理装置であって、この処理
装置全体を制御する第１のプロセッサ手段と、エラー訂
正回路及びインタリーブ処理制御回路の動作を前記第１
のプロセッサ手段の指示により制御する第２のプロセッ
サ手段と、前記エラー訂正回路のエラー訂正のための演
算処理を実行する第３のプロセッサ手段とを含むことを
特徴とする記録媒体信号処理装置が得られる。
衷豊贋
以下に本発明の実施例を図面を用いて詳細に説明する。
第１図は本発明の実施例のシステムブロック図であり、
第４図と同等部分は同一符号により示している。第２図
は第１図のブロックの書込み処理のフローであり、第３
図は同じく読出し処理のフローである。これ等第１図〜
第３図を参照しつつ第１図の実施例を説明する。ホスト
インタフェイス相部回路２はホストシステム１よりデー
タバス１０１を介して書込み命令を受取ると、その命令
はデータバス１０２を通して第１マイクロプロセツサ１
３へ転送される。第１マイクロプロセツサ１３はホスト
システム１からのデータを受取るべくホストインタフェ
イス制御回路２とデータバッファ回路３とを設定する。
第４図と同等部分は同一符号により示している。第２図
は第１図のブロックの書込み処理のフローであり、第３
図は同じく読出し処理のフローである。これ等第１図〜
第３図を参照しつつ第１図の実施例を説明する。ホスト
インタフェイス相部回路２はホストシステム１よりデー
タバス１０１を介して書込み命令を受取ると、その命令
はデータバス１０２を通して第１マイクロプロセツサ１
３へ転送される。第１マイクロプロセツサ１３はホスト
システム１からのデータを受取るべくホストインタフェ
イス制御回路２とデータバッファ回路３とを設定する。
書込みデータはインタフェイス制御回路２を通して第１
データバッファ回路３内に蓄えられる。
データバッファ回路３内に蓄えられる。
第１マイクロプロセツサ１３は第１データバッファ回１
１８３にデータ格納済みであることを確認後、ドライブ
インタフェイス制御回路７を通してドライブ装置８の状
態が書込み可能状態であることをチエツクする。書込み
可能状態であれば、ドライブインタフェイス制御回路７
を通してドライブ装ｆｆ８へヘッドを移動するよう指示
する。規定の位置へのシーク動作（ヘッドの移動）の確
認はフォーマット制御回路６及び変復調回路５よりのデ
ータを利用して第１マイクロプロセツサ１３にて行われ
る。
１８３にデータ格納済みであることを確認後、ドライブ
インタフェイス制御回路７を通してドライブ装置８の状
態が書込み可能状態であることをチエツクする。書込み
可能状態であれば、ドライブインタフェイス制御回路７
を通してドライブ装ｆｆ８へヘッドを移動するよう指示
する。規定の位置へのシーク動作（ヘッドの移動）の確
認はフォーマット制御回路６及び変復調回路５よりのデ
ータを利用して第１マイクロプロセツサ１３にて行われ
る。
第１マイクロプロセツサ１３は第２マイクロプロセツサ
１１へ第１データバッファ回路内のデータに対してエラ
ー訂正コード生成を指示する。第２マイクロプロセツサ
１１はバスセレクト回路４を切替えて、第１データバッ
ファ回路３内のデータを第２データバッファ回路１２へ
転送すると共に第３マイクロプロセツサ９にエラー訂正
コードの演算を指示する。第２データバッファ回路１２
ヘデータが格納されると、第３マイクロプロセツサ９は
シンドローム・乗除算回路１０を利用してエラー訂正コ
ードを生成する。第２マイクロプロセツサ１１は第３マ
イクロプロセツサがエラー訂正コードの生成を完了した
ことを確認して、第１マイクロプロセツサ１３へ報告す
る。第１マイクロプロセツサ１３はフォーマット制御回
路６、変復調回路５及びドライブインタフェイス制御回
路７を使用して、所定のセクタにヘッドを位置決めして
、書込みデータを変復調回路５で変調しつつフォーマッ
ト制御回路６でセクタフォーマット形式に変換し、ドラ
イブインタフェイス制御回路７を迦してドライブ装置８
へ書込みデータを転送する。
１１へ第１データバッファ回路内のデータに対してエラ
ー訂正コード生成を指示する。第２マイクロプロセツサ
１１はバスセレクト回路４を切替えて、第１データバッ
ファ回路３内のデータを第２データバッファ回路１２へ
転送すると共に第３マイクロプロセツサ９にエラー訂正
コードの演算を指示する。第２データバッファ回路１２
ヘデータが格納されると、第３マイクロプロセツサ９は
シンドローム・乗除算回路１０を利用してエラー訂正コ
ードを生成する。第２マイクロプロセツサ１１は第３マ
イクロプロセツサがエラー訂正コードの生成を完了した
ことを確認して、第１マイクロプロセツサ１３へ報告す
る。第１マイクロプロセツサ１３はフォーマット制御回
路６、変復調回路５及びドライブインタフェイス制御回
路７を使用して、所定のセクタにヘッドを位置決めして
、書込みデータを変復調回路５で変調しつつフォーマッ
ト制御回路６でセクタフォーマット形式に変換し、ドラ
イブインタフェイス制御回路７を迦してドライブ装置８
へ書込みデータを転送する。
次に、読取り命令をホストシステム１よりホストインタ
フェイス制御回路２を介して受信した場合は、第１マイ
クロプロセツサ１３で命令を解析し、ドライブインタフ
ェイス制御回路７を通してドライブ装置８の状態をチエ
ツクし、読込み可能であればドライブ装置８にヘッドの
位置決めを指示する。
フェイス制御回路２を介して受信した場合は、第１マイ
クロプロセツサ１３で命令を解析し、ドライブインタフ
ェイス制御回路７を通してドライブ装置８の状態をチエ
ツクし、読込み可能であればドライブ装置８にヘッドの
位置決めを指示する。
フォーマット制御回路６と変復調回路５とを使用してヘ
ッドの位置決めを確認後、第１マイクロプロセツサ１３
は第２マイクロプロセツサ１１に対して読取りデータの
エラー訂正動作を指示する。
ッドの位置決めを確認後、第１マイクロプロセツサ１３
は第２マイクロプロセツサ１１に対して読取りデータの
エラー訂正動作を指示する。
第２マイクロプロセツサ１１は第３マイクロプロセツサ
９に対してエラー訂正演算の開始を指示し、バスセレク
ト回路４を制御して読取りデータを第２データバッフ１
回路１２へ転送する。
９に対してエラー訂正演算の開始を指示し、バスセレク
ト回路４を制御して読取りデータを第２データバッフ１
回路１２へ転送する。
第３マイクロプロセツサ９はシンドローム・乗除算回路
１０を使用してエラー訂正演算を行い結果を第２マイク
ロプロセツサ１°１へ報告する。このときデータの正常
性をチエツクするＣＲＣ演算結果もあわせて報告する。
１０を使用してエラー訂正演算を行い結果を第２マイク
ロプロセツサ１°１へ報告する。このときデータの正常
性をチエツクするＣＲＣ演算結果もあわせて報告する。
第２マイクロプロセツサはデータのインタリーブを元に
回復する制御を実行し、エラー訂正後のデータを第１デ
ータバッファ回路３へ転送する。第１マイクロプロセツ
サ１３は第２マイクロプロセツサ１１よりデータ転送の
完了を報告されると、エラーの有無のチエツクを行い正
常であればホストインクフェイス制御回路２を起動して
ポストシステム１ヘデータを転送する。
回復する制御を実行し、エラー訂正後のデータを第１デ
ータバッファ回路３へ転送する。第１マイクロプロセツ
サ１３は第２マイクロプロセツサ１１よりデータ転送の
完了を報告されると、エラーの有無のチエツクを行い正
常であればホストインクフェイス制御回路２を起動して
ポストシステム１ヘデータを転送する。
第２マイクロプロセツサよりエラーの報告を受取ると、
第１マイクロプロセツサ１３はエラーの回復処理のため
交替セクタ、交替トラック処理を実行する。この交替処
理に関しては、各セクタの情報管理及び位置決めは第１
マイクロプロセツサ１３で行い、各セクタのインタリー
ブ処理及びデータバッファのセレクト処理は第２マイク
ロプロセツサで行い、エラー訂正演算処理を第３マイク
ロプロセツサで実行する。第２．３図に以上説明した書
込み処理及び読取り処理の概略フローチャートを示して
いる。
第１マイクロプロセツサ１３はエラーの回復処理のため
交替セクタ、交替トラック処理を実行する。この交替処
理に関しては、各セクタの情報管理及び位置決めは第１
マイクロプロセツサ１３で行い、各セクタのインタリー
ブ処理及びデータバッファのセレクト処理は第２マイク
ロプロセツサで行い、エラー訂正演算処理を第３マイク
ロプロセツサで実行する。第２．３図に以上説明した書
込み処理及び読取り処理の概略フローチャートを示して
いる。
以上述べた構成にすることにより、従来よりもエラー訂
正速度を向上でき、データ処理速度の高速な光デイスク
処理装置を可能としいているのである。
正速度を向上でき、データ処理速度の高速な光デイスク
処理装置を可能としいているのである。
１呪ゑ夏１
叙上の如く、本発明によれば、ホストインタフェイスや
ドライブインタフェイスの各制御、更には交替処理制御
等のシステム全体の制御を行う第１プロセツサの他に、
インタリーブ制御やエラー訂正制御のための第２プロセ
ツサ、更にはエラー訂正演算のための第３プロセツサを
用い、プロセッサの各機能分担を図るようにしたので、
エラーシンボル数が多い光デイスク媒体等の欠陥データ
に対しても連続データの処理が可能となるという効果が
ある。
ドライブインタフェイスの各制御、更には交替処理制御
等のシステム全体の制御を行う第１プロセツサの他に、
インタリーブ制御やエラー訂正制御のための第２プロセ
ツサ、更にはエラー訂正演算のための第３プロセツサを
用い、プロセッサの各機能分担を図るようにしたので、
エラーシンボル数が多い光デイスク媒体等の欠陥データ
に対しても連続データの処理が可能となるという効果が
ある。
第１図は本発明の実施例のブロック図、第２図は実施例
の書込み処理を示すフローチャート、第３図は実施例の
読取り処理を示すフローチャート・第４図は従来の光デ
イスク信号処理装置のシステムブロック図である。 主要部分の符号の説明 ９．１１．１３・・・・・・マイクロプロセッサ１０・
・・・・・シンドロームジェネレータ・乗除算回路
の書込み処理を示すフローチャート、第３図は実施例の
読取り処理を示すフローチャート・第４図は従来の光デ
イスク信号処理装置のシステムブロック図である。 主要部分の符号の説明 ９．１１．１３・・・・・・マイクロプロセッサ１０・
・・・・・シンドロームジェネレータ・乗除算回路
Claims (1)
- （１）エラー訂正コードを付加し、記録媒体上にインタ
リーブ処理を施してデータを記録することによりバース
ト誤りを訂正可能としてなるデータ処理システムにおけ
る記録媒体信号処理装置であって、この処理装置全体を
制御する第１のプロセッサ手段と、エラー訂正回路及び
インタリーブ処理制御回路の動作を前記第１のプロセッ
サ手段の指示により制御する第２のプロセッサ手段と、
前記エラー訂正回路のエラー訂正のための演算処理を実
行する第３のプロセッサ手段とを含むことを特徴とする
記録媒体信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63115610A JP2504119B2 (ja) | 1988-05-12 | 1988-05-12 | 記録媒体の信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63115610A JP2504119B2 (ja) | 1988-05-12 | 1988-05-12 | 記録媒体の信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01286179A true JPH01286179A (ja) | 1989-11-17 |
| JP2504119B2 JP2504119B2 (ja) | 1996-06-05 |
Family
ID=14666907
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63115610A Expired - Lifetime JP2504119B2 (ja) | 1988-05-12 | 1988-05-12 | 記録媒体の信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2504119B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0675491A2 (en) * | 1994-03-28 | 1995-10-04 | Hitachi, Ltd. | Control unit of disk apparatus |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6331071A (ja) * | 1986-07-24 | 1988-02-09 | Sony Corp | 光デイスク記録再生装置 |
-
1988
- 1988-05-12 JP JP63115610A patent/JP2504119B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6331071A (ja) * | 1986-07-24 | 1988-02-09 | Sony Corp | 光デイスク記録再生装置 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0675491A2 (en) * | 1994-03-28 | 1995-10-04 | Hitachi, Ltd. | Control unit of disk apparatus |
| EP0675491A3 (en) * | 1994-03-28 | 1995-10-25 | Hitachi, Ltd. | Control unit of disk apparatus |
| US5606468A (en) * | 1994-03-28 | 1997-02-25 | Hitachi, Ltd. | Plural diverse processors for control of a disk apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2504119B2 (ja) | 1996-06-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080402 Year of fee payment: 12 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090402 Year of fee payment: 13 |
|
| EXPY | Cancellation because of completion of term | ||
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090402 Year of fee payment: 13 |