JPH01142467A - 多チヤネル電流出力装置 - Google Patents
多チヤネル電流出力装置Info
- Publication number
- JPH01142467A JPH01142467A JP62301354A JP30135487A JPH01142467A JP H01142467 A JPH01142467 A JP H01142467A JP 62301354 A JP62301354 A JP 62301354A JP 30135487 A JP30135487 A JP 30135487A JP H01142467 A JPH01142467 A JP H01142467A
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- 238000003745 diagnosis Methods 0.000 abstract description 4
- 238000000034 method Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
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- Measuring Instrument Details And Bridges, And Automatic Balancing Devices (AREA)
- Measurement Of Current Or Voltage (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は多チャネル電流出力装置に関し、特に出力電流
を診断する装置に関するものである。
を診断する装置に関するものである。
従来の多チャネル電流出力装置の一例を第３図に示す。
第３図において、Ａ１〜Ａｎは電流出力回路、２１〜Ｚ
ｎはゼロ調整ボリューム、８１〜Ｓｎはスパン調整ボリ
ューム、Ｔ１〜Ｔｎは電流出力端子である。このように
、第３図に示す装置においては、各出力チャネル毎にゼ
ロ調整ボリューム、スパン調整ボリュームがあり、各チ
ャネル毎に出力電流測定を行ないながら調整する必要が
あった。
ｎはゼロ調整ボリューム、８１〜Ｓｎはスパン調整ボリ
ューム、Ｔ１〜Ｔｎは電流出力端子である。このように
、第３図に示す装置においては、各出力チャネル毎にゼ
ロ調整ボリューム、スパン調整ボリュームがあり、各チ
ャネル毎に出力電流測定を行ないながら調整する必要が
あった。
従来の多チャネル電流出力装置の他の例を第４図に示す
。第４図において、Ａは各電流出力回路Ａ１〜Ａｎに調
整信号ａを出力する調整用出力回路、Ｔは調整用出力端
子、Ｔ１〜Ｔｎは電流出力端子、２はゼロ調整ボリュー
ム、Ｓはスパン調整ボリュームである。第４図に示す装
置は調整用出力端子Ｔを持ち、調整用出力のゼロ、スパ
ン調整のみで調整するものであるが、各電流出力回路Ａ
１〜Ａｎのゼロ、スパン調整状態については、０％出力
値および１００％出力値を実際に各電流出力回路Ａ１〜
Ａｎから出力し、その出力を外部に接続した測定器で測
定して診断する必要があった。
。第４図において、Ａは各電流出力回路Ａ１〜Ａｎに調
整信号ａを出力する調整用出力回路、Ｔは調整用出力端
子、Ｔ１〜Ｔｎは電流出力端子、２はゼロ調整ボリュー
ム、Ｓはスパン調整ボリュームである。第４図に示す装
置は調整用出力端子Ｔを持ち、調整用出力のゼロ、スパ
ン調整のみで調整するものであるが、各電流出力回路Ａ
１〜Ａｎのゼロ、スパン調整状態については、０％出力
値および１００％出力値を実際に各電流出力回路Ａ１〜
Ａｎから出力し、その出力を外部に接続した測定器で測
定して診断する必要があった。
このように従来の多チャネル電流出力装置においては各
電流出力回路毎に出力電流を測定しており、診断に多く
の手間と時間を必要とした。
電流出力回路毎に出力電流を測定しており、診断に多く
の手間と時間を必要とした。
このような問題点を解決するために本発明は、１つのＤ
／Ａ変換器の出力が順次定周期的に接続される複数のサ
ンプルホールド回路と、調整用アナログ出力回路と、調
整用出力増減設定スイッチと、複数のサンプルホールド
回路の出力側に接続されコモン端子に出力をシャントす
るスイッチと、複数のサンプルホールド回路の出力電流
を計測する出力電流計測手段と、全体を制御するＣＰＵ
とを備え、調整時、調整用出力増減設定スイッチの増減
指令がＣＰＵに入力し、ＣＰＵはＤ／Ａ変換器の入力値
を増減指令に応じて変化させ、Ｄ／Ａ変換器の出力を調
整用アナログ出力回路に出力し、目標出力電流値に対応
するＤ／Ａ変換器の入力デジタル値を調整設定値として
不揮発性メモリに記憶し、複数のサンプルホールド回路
の出力側を負荷に対してシャントして調整設定値による
調整目標出力電流を出力し、出力電流計測手段によりサ
ンプルホールド回路から成る電流出力回路の出力電流を
計測して電流出力回路を診断するようにしたものである
。
／Ａ変換器の出力が順次定周期的に接続される複数のサ
ンプルホールド回路と、調整用アナログ出力回路と、調
整用出力増減設定スイッチと、複数のサンプルホールド
回路の出力側に接続されコモン端子に出力をシャントす
るスイッチと、複数のサンプルホールド回路の出力電流
を計測する出力電流計測手段と、全体を制御するＣＰＵ
とを備え、調整時、調整用出力増減設定スイッチの増減
指令がＣＰＵに入力し、ＣＰＵはＤ／Ａ変換器の入力値
を増減指令に応じて変化させ、Ｄ／Ａ変換器の出力を調
整用アナログ出力回路に出力し、目標出力電流値に対応
するＤ／Ａ変換器の入力デジタル値を調整設定値として
不揮発性メモリに記憶し、複数のサンプルホールド回路
の出力側を負荷に対してシャントして調整設定値による
調整目標出力電流を出力し、出力電流計測手段によりサ
ンプルホールド回路から成る電流出力回路の出力電流を
計測して電流出力回路を診断するようにしたものである
。
本発明による装置においては、各チャネル毎に出力電流
を測定する必要はない。
を測定する必要はない。
第１図は本発明に係わる多チャネル電流出力装置の一実
施例を示す回路図である。第１図において、１はＣＰＵ
、２はメモリ、３は不揮発性読書可能メモリ、４はデー
タバス、５はＤ／Ａ変換器、６および８はアナログマル
チプレクサ、７はＡ／Ｄ変換器、９は調整用出力増減設
定スイッチ、１０は調整選択スイッチ、１１は調整設定
スイッチ、９ ａ 〜９ ｃはスイッチ９の接点、１０
ａと１０ｂはスイッチ１０の接点、ｌｌａと１１１１ｉ
はスイッチ１１の接点、１２は接点レシーバ、１３は出
力シャントスイッチＳＷＩ〜ＳＷｎを制御する制御信号
すを出力するレジスタ、Ｂは目標出力電流を出力する調
整用アナログ出力回路としてのサンプルホールド回路、
８１〜Ｂｎは電流出力回路を構成するサンプルホールド
回路（Ｓ／Ｈ回路）、ＴＣはコモン端子、Ｔは調整中の
出力電流を観測するための調整用出力端子、Ｔ１〜Ｔｎ
は電流出力端子、Ｒ１−Ｒｎは電流センス抵抗、ＴＤは
電源端子である。なお、電流センス抵抗Ｒ１〜Ｒｎとア
ナログマルチプレクサ８とＡ／Ｄ変換器７とは出力電流
計測手段を構成する。
施例を示す回路図である。第１図において、１はＣＰＵ
、２はメモリ、３は不揮発性読書可能メモリ、４はデー
タバス、５はＤ／Ａ変換器、６および８はアナログマル
チプレクサ、７はＡ／Ｄ変換器、９は調整用出力増減設
定スイッチ、１０は調整選択スイッチ、１１は調整設定
スイッチ、９ ａ 〜９ ｃはスイッチ９の接点、１０
ａと１０ｂはスイッチ１０の接点、ｌｌａと１１１１ｉ
はスイッチ１１の接点、１２は接点レシーバ、１３は出
力シャントスイッチＳＷＩ〜ＳＷｎを制御する制御信号
すを出力するレジスタ、Ｂは目標出力電流を出力する調
整用アナログ出力回路としてのサンプルホールド回路、
８１〜Ｂｎは電流出力回路を構成するサンプルホールド
回路（Ｓ／Ｈ回路）、ＴＣはコモン端子、Ｔは調整中の
出力電流を観測するための調整用出力端子、Ｔ１〜Ｔｎ
は電流出力端子、Ｒ１−Ｒｎは電流センス抵抗、ＴＤは
電源端子である。なお、電流センス抵抗Ｒ１〜Ｒｎとア
ナログマルチプレクサ８とＡ／Ｄ変換器７とは出力電流
計測手段を構成する。
スイッチ９の接点９ａは増加指令の接点、接点９ｂは無
指令の接点、９Ｃは減少指令の接点であり、スイッチ１
０の接点１０ａは０％指令の接点、１０ｂは１００％指
令の接点であり、スイッチ１１のＩｌａは調整オフ指令
の接点、ｌｌｂは調整オン指令の接点である。各スイッ
チ９〜１１の設定は、操作者の判断により、又は調整用
出力端子Ｔの出力電流値を見て行なわれる。
指令の接点、９Ｃは減少指令の接点であり、スイッチ１
０の接点１０ａは０％指令の接点、１０ｂは１００％指
令の接点であり、スイッチ１１のＩｌａは調整オフ指令
の接点、ｌｌｂは調整オン指令の接点である。各スイッ
チ９〜１１の設定は、操作者の判断により、又は調整用
出力端子Ｔの出力電流値を見て行なわれる。
次に、このように構成された装置の動作について第１図
および第２図を用いて説明する。ＣＰＵ１はスイッチ１
１が調整指令状態すなわちオン状態であるか否かを周期
的に確認し、調整指令状態であれば第２図に示すルーチ
ンを実行する。第２図のフローチャートにおいて、まず
、出力シャントスイッチＳＷＩ〜ＳＷｎを制御信号すに
よりオンする（ステップ２１）０次にＣＰＵ１はゼロ調
整の選択か否かを判断しくステップ２２、調整選択スイ
ッチ１０がオフであればゼ・口調整選択である）、ゼロ
調整であればステップ２３へ移行する。
および第２図を用いて説明する。ＣＰＵ１はスイッチ１
１が調整指令状態すなわちオン状態であるか否かを周期
的に確認し、調整指令状態であれば第２図に示すルーチ
ンを実行する。第２図のフローチャートにおいて、まず
、出力シャントスイッチＳＷＩ〜ＳＷｎを制御信号すに
よりオンする（ステップ２１）０次にＣＰＵ１はゼロ調
整の選択か否かを判断しくステップ２２、調整選択スイ
ッチ１０がオフであればゼ・口調整選択である）、ゼロ
調整であればステップ２３へ移行する。
このとき操作者は調整用出力端子Ｔの出力電流値を見て
、調整用出力増減設定スイッチ９により、増加指令又は
減少指令を選択する。続いて、ｃｐＵｌは増加指令か減
少指令かを判断しくステップ２３．２５）、増加指令で
あれば０％出力データを増加しくステップ２４）、減少
指令であればＯ％出力データを減少する（ステップ２６
）。増加又は減少したＯ％出力データはメモリ２に記憶
される。この増加又は減少したθ％出力データは調整設
定値であり、この調整設定値に対応するサンプルホール
ド回路Ｂの出力値が調整目標出力電流値である。
、調整用出力増減設定スイッチ９により、増加指令又は
減少指令を選択する。続いて、ｃｐＵｌは増加指令か減
少指令かを判断しくステップ２３．２５）、増加指令で
あれば０％出力データを増加しくステップ２４）、減少
指令であればＯ％出力データを減少する（ステップ２６
）。増加又は減少したＯ％出力データはメモリ２に記憶
される。この増加又は減少したθ％出力データは調整設
定値であり、この調整設定値に対応するサンプルホール
ド回路Ｂの出力値が調整目標出力電流値である。
次に、メモリ２に記憶されたＯ％出力データを調整用出
力端子Ｔおよび各電流センス抵抗Ｒ１〜Ｒｎに出力する
（ステップ２７）。この出力されたＯ％出力データはア
ナログマルチプレクサ８およびＡ／Ｄ変換器７を介して
ＣＰＵＩに取り込まれ、その値が正常か否か判断される
（ステップ２８）。正常であればステップ３６へ移行し
、調整状態か否かを判断し、調整状態であればステップ
２２へ移行して再度各自力チャネルを診断する。
力端子Ｔおよび各電流センス抵抗Ｒ１〜Ｒｎに出力する
（ステップ２７）。この出力されたＯ％出力データはア
ナログマルチプレクサ８およびＡ／Ｄ変換器７を介して
ＣＰＵＩに取り込まれ、その値が正常か否か判断される
（ステップ２８）。正常であればステップ３６へ移行し
、調整状態か否かを判断し、調整状態であればステップ
２２へ移行して再度各自力チャネルを診断する。
調整状態でない場合はステップ３７へ移行し、補正され
たＯ％出力データ、１００％データおよび調整用補正デ
ータを不揮発性読書可能メモリ３に書き込み（ステップ
３７）、出力シャントスイッチＳＷＩ〜ＳＷｎをオフと
してこのルーチンを終了する（ステップ３８）、ステッ
プ２８で出力電流が異常の場合はその出力電流値をＣＰ
ＵＩに報告してこのルーチンを終了する（ステップ３５
）。
たＯ％出力データ、１００％データおよび調整用補正デ
ータを不揮発性読書可能メモリ３に書き込み（ステップ
３７）、出力シャントスイッチＳＷＩ〜ＳＷｎをオフと
してこのルーチンを終了する（ステップ３８）、ステッ
プ２８で出力電流が異常の場合はその出力電流値をＣＰ
ＵＩに報告してこのルーチンを終了する（ステップ３５
）。
次に、ステップ２２でゼロ調整選択でない場合の動作に
ついて述べる。この場合もθ％小出力場合と同様に、操
作者は調整用出力端子Ｔの出力電流値を見て、調整用出
力増減設定スイッチ９により、増加指令又は減少指令を
選択する。続いて、ＣＰＵＩは増加指令か減少指令かを
判断しくステ・ノブ２９．３１）、増加指令であれば１
００％出力データを増加しくステップ３０）、減少指令
であれば１００％出力データを減少する（ステップ３２
）。増加又は減少した１００％出力データはメモリ２に
記憶される。次にステップ３３へ移行するが、ステップ
３３およびステップ３４はステップ２７およびステップ
２８と同様の動作であるのでその説明を省略する。また
、ステップ３６以後の動作もゼロ調整選択の場合と同様
であるのでその説明を省略する。
ついて述べる。この場合もθ％小出力場合と同様に、操
作者は調整用出力端子Ｔの出力電流値を見て、調整用出
力増減設定スイッチ９により、増加指令又は減少指令を
選択する。続いて、ＣＰＵＩは増加指令か減少指令かを
判断しくステ・ノブ２９．３１）、増加指令であれば１
００％出力データを増加しくステップ３０）、減少指令
であれば１００％出力データを減少する（ステップ３２
）。増加又は減少した１００％出力データはメモリ２に
記憶される。次にステップ３３へ移行するが、ステップ
３３およびステップ３４はステップ２７およびステップ
２８と同様の動作であるのでその説明を省略する。また
、ステップ３６以後の動作もゼロ調整選択の場合と同様
であるのでその説明を省略する。
以上説明したように本発明は、出力電流計測手段により
出力電流を計測して電流出力回路を診断するようにした
ことにより、出力電流値と基準値との比較を自動的に行
なうことができるので、各電流出力回路毎に出力電流を
測定する必要がなく、診断に多くの手間と時間を必要と
しな（なるという効果がある。
出力電流を計測して電流出力回路を診断するようにした
ことにより、出力電流値と基準値との比較を自動的に行
なうことができるので、各電流出力回路毎に出力電流を
測定する必要がなく、診断に多くの手間と時間を必要と
しな（なるという効果がある。
第１図は本発明に係わる多チャネル電流出力装置の一実
施例を示す回路図、第２図はその動作を説明するための
フローチャート、第３図および第４図は従来の多チャネ
ル電流出力装置を示す系統図である。 １・・・ｃｐｕ、２・・・メモリ、３・・・不揮発性読
書可能メモリ、４・・・データバス、５・・・Ｄ／Ａ変
換器、６．８・・・アナログマルチプレクサ、７・・・
Ａ／Ｄ変換器、９・・・調整用出力増減設定スイッチ、
１ｏ・・・調整選択スイッチ、１１・・・調整設定スイ
ッチ、９ａ 〜９ｃ、ｌｏａ、１０ｂ、ｌｌａ、ｌｌｂ
・−・接点、１２・・・接点レシーバ、１３・・・レジ
スタ、ＳＷ１〜ＳＷｎ・・・出力シャントスイッチ、Ｂ
、Ｂ１〜Ｂｎ・・・サンプルホールド回路、ＴＣ・・・
コモン端子、Ｔ・・・調整用出力端子、Ｔ１〜Ｔｎ・・
・電流出力端子、Ｒ１−Ｒｎ・・・電流センス抵抗、Ｔ
Ｄ・・・電源端子。
施例を示す回路図、第２図はその動作を説明するための
フローチャート、第３図および第４図は従来の多チャネ
ル電流出力装置を示す系統図である。 １・・・ｃｐｕ、２・・・メモリ、３・・・不揮発性読
書可能メモリ、４・・・データバス、５・・・Ｄ／Ａ変
換器、６．８・・・アナログマルチプレクサ、７・・・
Ａ／Ｄ変換器、９・・・調整用出力増減設定スイッチ、
１ｏ・・・調整選択スイッチ、１１・・・調整設定スイ
ッチ、９ａ 〜９ｃ、ｌｏａ、１０ｂ、ｌｌａ、ｌｌｂ
・−・接点、１２・・・接点レシーバ、１３・・・レジ
スタ、ＳＷ１〜ＳＷｎ・・・出力シャントスイッチ、Ｂ
、Ｂ１〜Ｂｎ・・・サンプルホールド回路、ＴＣ・・・
コモン端子、Ｔ・・・調整用出力端子、Ｔ１〜Ｔｎ・・
・電流出力端子、Ｒ１−Ｒｎ・・・電流センス抵抗、Ｔ
Ｄ・・・電源端子。
Claims (1)
- １つのＤ／Ａ変換器の出力が順次定周期的に接続され
る複数のサンプルホールド回路と、調整用アナログ出力
回路と、調整用出力増減設定スイッチと、前記複数のサ
ンプルホールド回路の出力側に接続されコモン端子に出
力をシャントするスイッチと、前記複数のサンプルホー
ルド回路の出力電流を計測する出力電流計測手段と、全
体を制御するＣＰＵとを備え、調整時、前記調整用出力
増減設定スイッチの増減指令が前記ＣＰＵに入力し、前
記ＣＰＵは前記Ｄ／Ａ変換器の入力値を前記増減指令に
応じて変化させ、前記Ｄ／Ａ変換器の出力を前記調整用
アナログ出力回路に出力し、目標出力電流値に対応する
前記Ｄ／Ａ変換器の入力デジタル値を調整設定値として
不揮発性メモリに記憶し、前記複数のサンプルホールド
回路の出力側を負荷に対してシャントして前記調整設定
値による調整目標出力電流を出力し、前記出力電流計測
手段により前記サンプルホールド回路から成る電流出力
回路の出力電流を計測して前記電流出力回路を診断する
ことを特徴とする多チャネル電流出力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62301354A JPH01142467A (ja) | 1987-11-28 | 1987-11-28 | 多チヤネル電流出力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62301354A JPH01142467A (ja) | 1987-11-28 | 1987-11-28 | 多チヤネル電流出力装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01142467A true JPH01142467A (ja) | 1989-06-05 |
Family
ID=17895855
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62301354A Pending JPH01142467A (ja) | 1987-11-28 | 1987-11-28 | 多チヤネル電流出力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01142467A (ja) |
-
1987
- 1987-11-28 JP JP62301354A patent/JPH01142467A/ja active Pending
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