JPH01129417A - 半導体素子における微細パターンの形成方法 - Google Patents
半導体素子における微細パターンの形成方法Info
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- JPH01129417A JPH01129417A JP62287288A JP28728887A JPH01129417A JP H01129417 A JPH01129417 A JP H01129417A JP 62287288 A JP62287288 A JP 62287288A JP 28728887 A JP28728887 A JP 28728887A JP H01129417 A JPH01129417 A JP H01129417A
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Classifications
-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F7/00—Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
- G03F7/004—Photosensitive materials
- G03F7/09—Photosensitive materials characterised by structural details, e.g. supports, auxiliary layers
- G03F7/095—Photosensitive materials characterised by structural details, e.g. supports, auxiliary layers having more than one photosensitive layer
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- Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
- Photosensitive Polymer And Photoresist Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
この発明は、IC(集積回路) 、LSI (大規模
集積口FIs)等における回路パターンを形成する半導
体素子における微細パターンの形成方法に関するもので
ある。
集積口FIs)等における回路パターンを形成する半導
体素子における微細パターンの形成方法に関するもので
ある。
(従来の技術)
半導体素子の微細パターンの形成技術に関しては、昭和
62年1月、沖電気研究開発第133号Vol 54.
No、 1 rサブミクロン領域におけるパターン形
成技術」 (ベージ85.86)に記載されている。
62年1月、沖電気研究開発第133号Vol 54.
No、 1 rサブミクロン領域におけるパターン形
成技術」 (ベージ85.86)に記載されている。
IC,LSIにおける微細パターンの形成方法として多
層レジスト法がある。この方法は異種のレジストを重ね
た構造を用い、下層レジストによる下地基板の平坦化、
あるいは低反射化の効果により上層レジストのパターン
形成における解像度を上げ、それによって微細パターン
の形成を可能にしようという技術である。
層レジスト法がある。この方法は異種のレジストを重ね
た構造を用い、下層レジストによる下地基板の平坦化、
あるいは低反射化の効果により上層レジストのパターン
形成における解像度を上げ、それによって微細パターン
の形成を可能にしようという技術である。
多層レジスト法には、上層レジストパターンを下層レジ
ストに転写する方法により、Deep UV(以下、必
要に応じて遠紫外光と記す)−括露光法とRIE法があ
る。
ストに転写する方法により、Deep UV(以下、必
要に応じて遠紫外光と記す)−括露光法とRIE法があ
る。
このうち、Deep UV−括露光法は下層レジストに
Deep UV光に対する感光性を持つレジストを用
い、上層のレジストパターンをマスクとしてD8epU
V光の一括露光により下層レジストに上層レジストのパ
ターンを転写する。
Deep UV光に対する感光性を持つレジストを用
い、上層のレジストパターンをマスクとしてD8epU
V光の一括露光により下層レジストに上層レジストのパ
ターンを転写する。
第2図にDeep UV光による一括露光法を用いた2
層レジスト法の代表例を示す。ここに示した例は、上層
レジストにUV光(以下、必要に応じて紫外光と記す)
に対するポジ型レジストを、下層にDeep UV光に
対するポジ型レジストを用いた2層レジストプロセスの
例である。
層レジスト法の代表例を示す。ここに示した例は、上層
レジストにUV光(以下、必要に応じて紫外光と記す)
に対するポジ型レジストを、下層にDeep UV光に
対するポジ型レジストを用いた2層レジストプロセスの
例である。
まず、第2図fa)に示すSi基板1上に、第2図fb
lに示すように下層レジスト2を形成し、次いで、第2
図(clに示すように下層し・シスト2上に上層レジス
ト3を形成する。このとき、下層レジスト2上に上層レ
ジスト3を直接積、)すると、その界面において、混合
層(以下、インタレイヤという)4が形成される。
lに示すように下層レジスト2を形成し、次いで、第2
図(clに示すように下層し・シスト2上に上層レジス
ト3を形成する。このとき、下層レジスト2上に上層レ
ジスト3を直接積、)すると、その界面において、混合
層(以下、インタレイヤという)4が形成される。
このように、土石レジスト3、下層レジスト2を形成し
た後、第2図(d)のように、マスク5を介してUV光
6によるホトリソグラフィーにより、第2図fe)のよ
うにレジスト3のパターンを形成する。
た後、第2図(d)のように、マスク5を介してUV光
6によるホトリソグラフィーにより、第2図fe)のよ
うにレジスト3のパターンを形成する。
次に、第2図(f)に示すように、インタレイヤ4の部
分を酸素プラズマ、または等方的な現像により取り除く
。
分を酸素プラズマ、または等方的な現像により取り除く
。
次に、第2図(g)に示すように上層レジスト3のパタ
ーンをマスクとしてDeep UV光7を用いてDee
p UV−一括露光法により、下層レジスト2に上層レ
ジスト3のパターンを転写する。
ーンをマスクとしてDeep UV光7を用いてDee
p UV−一括露光法により、下層レジスト2に上層レ
ジスト3のパターンを転写する。
次に、第2図(h)に示すように、下層レジストを現像
し、最終のレジストパターンを得る。
し、最終のレジストパターンを得る。
(発明が解決しようとする問題点)
しかし、以上のプロセスでは、現像プロセスを2回行わ
なければならず、工程が複雑であるという欠点かあ一1
t二。
なければならず、工程が複雑であるという欠点かあ一1
t二。
この発明は前記従来技術がもっている問題点のうち、工
程が?!碓であるという点について解決した半導体素子
における微細パターンの形成方法を提供するものである
。
程が?!碓であるという点について解決した半導体素子
における微細パターンの形成方法を提供するものである
。
(問題点を解決するための手段)
この発明は、半導体素子における微細パターンの形成方
法において、下地基板上に遠紫外に感光する下層レジス
トを形成した後に紫外光に感光性□ をもちかつ遠紫外光に対して不透明化する材料を含んだ
高分子膜を上層に形成する工程と、紫外光により露光を
行って上層の高分子膜を遠紫外光に対して透明な領域と
不透明な領域とを形成した後遠紫外先による一括露光を
行う工程とを導入したものである。
法において、下地基板上に遠紫外に感光する下層レジス
トを形成した後に紫外光に感光性□ をもちかつ遠紫外光に対して不透明化する材料を含んだ
高分子膜を上層に形成する工程と、紫外光により露光を
行って上層の高分子膜を遠紫外光に対して透明な領域と
不透明な領域とを形成した後遠紫外先による一括露光を
行う工程とを導入したものである。
(作 用)
この発明によれば、半導体素子における微細パターンの
形成方法に以上のような工程を導入したので、上層の高
分子膜形成後にマスクを介して紫外光を照射すると、高
分子膜は紫外光が照射された部分が遠紫外光に対して不
透明になり、紫外光が照射されない部分は透明のままで
あり、次に遠紫外光の一括露光後に高分子膜を除去する
と、インタレイヤ、下層レジストの現像は連続的に行え
、したがって前記問題点を除去できろ。
形成方法に以上のような工程を導入したので、上層の高
分子膜形成後にマスクを介して紫外光を照射すると、高
分子膜は紫外光が照射された部分が遠紫外光に対して不
透明になり、紫外光が照射されない部分は透明のままで
あり、次に遠紫外光の一括露光後に高分子膜を除去する
と、インタレイヤ、下層レジストの現像は連続的に行え
、したがって前記問題点を除去できろ。
(実 施 例)
以下、この発明の半導体素子における微細パターンの形
成方法の実施例について図面に基づき説明する。第1図
(a)ないし第1図fhlはその一実施例の工程断面図
である。
成方法の実施例について図面に基づき説明する。第1図
(a)ないし第1図fhlはその一実施例の工程断面図
である。
この実施例では、下層のレジストとしてクロロメチル化
ポリスチレン(以下CMSという)を、上層の高分子と
1ノてジフヱニルナイトロンを含む高分子(例えばゼネ
ラル・エレクトリック社製CEM。
ポリスチレン(以下CMSという)を、上層の高分子と
1ノてジフヱニルナイトロンを含む高分子(例えばゼネ
ラル・エレクトリック社製CEM。
以下CEMという)を用いた例について説明する。
まず、第1図(、)に示すように、下地基板11上にD
aep UV光に感光する下層レジスト12であるCM
Sを回転塗布法により形成する。
aep UV光に感光する下層レジスト12であるCM
Sを回転塗布法により形成する。
次に、130°以下の温度で加熱処理をホットプレート
上またはオーブン中で行う。
上またはオーブン中で行う。
次に、第1図(b)に示すように、インタレイヤ13と
してポリビニルアルコール膜(以下、PVA膜という)
を形成するため、PVAの5%水溶液を用い、回転塗布
法によりPVA膜を形成する。
してポリビニルアルコール膜(以下、PVA膜という)
を形成するため、PVAの5%水溶液を用い、回転塗布
法によりPVA膜を形成する。
次に、第1図ic>に示すようにCEM膜14を回転塗
布法により形成する。以上の塗布の過程において、各膜
厚は、CMSは1.5 μm以下、PVAは0.271
m以下、CEMは1μm以下の膜厚になるようにする。
布法により形成する。以上の塗布の過程において、各膜
厚は、CMSは1.5 μm以下、PVAは0.271
m以下、CEMは1μm以下の膜厚になるようにする。
次に、第1図(diに示すように、UV光16によりマ
スク15を用いて上層のCEM膜にマスクパターンの転
写を行う。この操作により、CEM膜14はUV光16
が照射された部分はDeep UV光17 (第1図(
e))に対して不透明になり、UV光16が照射されな
い部分1よりeep UV光17に対しては透明のまま
である。
スク15を用いて上層のCEM膜にマスクパターンの転
写を行う。この操作により、CEM膜14はUV光16
が照射された部分はDeep UV光17 (第1図(
e))に対して不透明になり、UV光16が照射されな
い部分1よりeep UV光17に対しては透明のまま
である。
次に、第1図telに示すようにDeep UV光17
の一括露光を行う。このDeep UV光17の波長と
しては、200〜250μmのDeep UV光を用い
る。
の一括露光を行う。このDeep UV光17の波長と
しては、200〜250μmのDeep UV光を用い
る。
I:λ上の過程において、Deep LIV光17の照
射は、エネルギとしては200mjを越えない程度の露
光量で行う。
射は、エネルギとしては200mjを越えない程度の露
光量で行う。
次に、第1図ff)に示すように、上層のCEMlli
14をアニソールまたはキシレン、またはエチルベンゼ
ンなどの芳香族系溶媒により除去する。除去の方法とし
ては、パドルもしくはスプレーにより30 sec 〜
1m1n程度行う。
14をアニソールまたはキシレン、またはエチルベンゼ
ンなどの芳香族系溶媒により除去する。除去の方法とし
ては、パドルもしくはスプレーにより30 sec 〜
1m1n程度行う。
次に、スピンドライもしくはN2ブローにより乾燥させ
た後、インタレイヤ13のPVAを水により第1図(g
)に示すように除去する。このときの方法としてはCE
M膜14の除去と同様に行う。
た後、インタレイヤ13のPVAを水により第1図(g
)に示すように除去する。このときの方法としてはCE
M膜14の除去と同様に行う。
次にスピンドライもしくはN2ブローにより水を乾燥さ
せた後、第1図(hlに示すように下層レジスト12の
CMSの現像を行う。このときの現像方法は、単層レジ
ストの場合の現像方法に準じて行う。例えば、イソアミ
ルアセテートとエチルセルソルブアセテートの混合液を
用い、デイツプもしくはスプレー現像により現像する。
せた後、第1図(hlに示すように下層レジスト12の
CMSの現像を行う。このときの現像方法は、単層レジ
ストの場合の現像方法に準じて行う。例えば、イソアミ
ルアセテートとエチルセルソルブアセテートの混合液を
用い、デイツプもしくはスプレー現像により現像する。
(発明の効果)
以上詳細に説明したように、この発明によれば、Des
p UV光に感光するレジストを下層に、UV光に対し
て感光性をもちかっUV光に感光することによりI)s
ap UV光に対し不透明化する材料を含んだ高分子膜
を上層に用いてパターン形成を行うようにしたので、2
層レジストゴロセスの従来の方法に比べ、現像処理は1
回で済み、また、インタレイヤの除去操作も必要ないの
で、工程が簡単になる。
p UV光に感光するレジストを下層に、UV光に対し
て感光性をもちかっUV光に感光することによりI)s
ap UV光に対し不透明化する材料を含んだ高分子膜
を上層に用いてパターン形成を行うようにしたので、2
層レジストゴロセスの従来の方法に比べ、現像処理は1
回で済み、また、インタレイヤの除去操作も必要ないの
で、工程が簡単になる。
また、インタレイヤ、上Mの高分子膜の形成ハ連続的に
行えるとともに上層の高分子膜の除去、インタレイヤの
除去および下層レジストの現像は連続的に膜表面に除去
液まI:は現像液を供給することにより行えるので、こ
の方法を実行するために必要な装置の構成は従来の方法
よりも単純化することが可能である。
行えるとともに上層の高分子膜の除去、インタレイヤの
除去および下層レジストの現像は連続的に膜表面に除去
液まI:は現像液を供給することにより行えるので、こ
の方法を実行するために必要な装置の構成は従来の方法
よりも単純化することが可能である。
さらに、回路パターンの転写は上層のLJV感光性の高
分子膜により行われるので、従来の多層レジストの場合
と同様に、ド地基板による平坦化あるいは低反射化の効
果により、実用解像度の向上が図れる。
分子膜により行われるので、従来の多層レジストの場合
と同様に、ド地基板による平坦化あるいは低反射化の効
果により、実用解像度の向上が図れる。
第1図(11)ないし第1図fhlばこの発明の半導体
素子における微細パターンの形成方法の一実施例の工程
断面図、第2図ia)ないし第2図(h)は従来の遠紫
外光−括露光法による半導体素子における微細パターン
の形成方法の工程断面図である。 11・・下地基板、12・下層レジスト、13・・・イ
ンタレイヤ、14・・・CEMp、16・・・UV光、
17 ・Deep UV光。 本をj%+工1律価a 第1図 (a) [ビ=====「==で===Fトハ
l第2図
素子における微細パターンの形成方法の一実施例の工程
断面図、第2図ia)ないし第2図(h)は従来の遠紫
外光−括露光法による半導体素子における微細パターン
の形成方法の工程断面図である。 11・・下地基板、12・下層レジスト、13・・・イ
ンタレイヤ、14・・・CEMp、16・・・UV光、
17 ・Deep UV光。 本をj%+工1律価a 第1図 (a) [ビ=====「==で===Fトハ
l第2図
Claims (1)
- 【特許請求の範囲】 (a)下地基板上に遠紫外光に対して感光する下層レジ
ストの形成後水溶性ポリマのインタレイヤを介して紫外
光に対して感光性をもちかつ紫外光に感光することによ
り遠紫外光に対して不透明化する材料を含んだ光分子膜
を上層に形成する工程と、 (b)紫外光の露光を行って上記高分子膜に遠紫外光に
対して透明な領域と不透明な領域とを形成する工程と、 (c)遠紫外光による一括露光を行った後上記上層の高
分子膜を除去する工程と、 (d)上記インタレイヤ除去後上記下層レジストを現像
する工程と、 よりなる半導体素子における微細パターンの形成方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62287288A JPH01129417A (ja) | 1987-11-16 | 1987-11-16 | 半導体素子における微細パターンの形成方法 |
US07/271,301 US5024919A (en) | 1987-11-16 | 1988-11-15 | Process for forming fine pattern in semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62287288A JPH01129417A (ja) | 1987-11-16 | 1987-11-16 | 半導体素子における微細パターンの形成方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01129417A true JPH01129417A (ja) | 1989-05-22 |
Family
ID=17715451
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62287288A Pending JPH01129417A (ja) | 1987-11-16 | 1987-11-16 | 半導体素子における微細パターンの形成方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US5024919A (ja) |
JP (1) | JPH01129417A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007503730A (ja) * | 2003-05-12 | 2007-02-22 | マイクロン・テクノロジー・インコーポレーテッド | スピンオンフォトパターン形成性中間層誘電性材料の使用及びそれを利用する中間半導体素子構造体 |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3362797B2 (ja) | 1993-04-30 | 2003-01-07 | 東洋紡績株式会社 | 印刷原版用感光性樹脂積層体 |
DE4440230C2 (de) * | 1993-11-10 | 1999-03-18 | Hyundai Electronics Ind | Verfahren zur Bildung feiner Strukturen eines Halbleiterbauelements |
GB2291207B (en) * | 1994-07-14 | 1998-03-25 | Hyundai Electronics Ind | Method for forming resist patterns |
EP1860499B1 (de) | 1997-11-03 | 2015-02-11 | SPGPrints B.V. | Verfahren zum Herstellen einer Druckform |
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