JP7364670B2 - 共有のワードラインアンダードライブ制御を有するヘッダレスワードラインドライバ - Google Patents
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Description
Claims (12)
- 装置であって、
ワードライン入力信号を受信し、ワードラインドライバ出力信号をワードラインに供給するワードラインドライバ回路と、
ワードラインアンダードライブ回路と、を備え、
前記ワードラインドライバ回路は、前記ワードラインドライバ出力信号に結合された第1の通電端子と、第1のノードに結合された第2の通電端子と、を有するトランジスタを含み、
前記トランジスタのゲートは、前記ワードライン入力信号に結合されており、前記トランジスタは、前記ワードラインがアサートされている間、前記ワードラインから前記第1のノードへの経路を提供し、
前記ワードラインアンダードライブ回路は、前記第1のノードと接地ノードとの間に結合されており、前記ワードラインの電圧を低減させ、
前記ワードラインアンダードライブ回路は、前記第1のノードと前記接地ノードとの間に並列に結合された複数のプルダウントランジスタを含み、
前記ワードラインアンダードライブ回路の前記複数のプルダウントランジスタのうち1つ以上のプルダウントランジスタは、前記複数のプルダウントランジスタのうち少なくとも他のプルダウントランジスタとサイズが異なる、
装置。 - 前記トランジスタ及び前記プルダウントランジスタは、高閾値電圧デバイスである、
請求項1の装置。 - 複数のワードラインを複数のメモリセルに供給する、前記ワードラインドライバ回路を含む複数のワードラインドライバ回路を備え、
前記複数のワードラインドライバ回路は、前記第1のノードにおいて前記プルダウントランジスタに結合されている、
請求項1の装置。 - 前記プルダウントランジスタのゲートにそれぞれ供給される複数の制御信号であって、前記制御信号に従って、オンになるプルダウントランジスタの数を変化させる、複数の制御信号を備える、
請求項1の装置。 - 前記トランジスタはPMOSトランジスタであり、前記プルダウントランジスタはPMOSトランジスタである、
請求項1又は2の装置。 - 前記ワードラインドライバ回路はインバータを含む、
請求項1又は2の装置。 - ワードライン入力信号をワードラインドライバ回路に供給し、ワードラインドライバ出力信号を前記ワードラインドライバ回路からワードラインに供給することと、
前記ワードラインがアサートされている間、トランジスタがオンになり、前記ワードラインがデアサートされている間、前記トランジスタがオフになる、前記ワードライン入力信号を前記トランジスタのゲートに供給することと、
前記トランジスタと接地ノードとの間に結合された複数のプルダウントランジスタを有するワードラインアンダードライブ回路を含む経路を、前記ワードラインがアサートされている間、前記ワードラインから前記トランジスタを介して前記接地ノードまで提供することによって、前記ワードラインの電圧を低減することと、
前記ワードラインアンダードライブ回路内の前記複数のプルダウントランジスタのうち、前記複数のプルダウントランジスタの各々に供給される複数のゲート制御信号に従ってオンにされるプルダウントランジスタの数を変化させることによって、前記ワードラインの電圧を調整することであって、前記複数のプルダウントランジスタのうちオンにされる1つ以上のプルダウントランジスタは、前記ワードラインアンダードライブ回路内の前記複数のプルダウントランジスタのうち少なくとも他のプルダウントランジスタとサイズが異なる、ことと、を含む、
方法。 - 他のドライバ回路の他のトランジスタを介する経路を、他のワードラインから前記接地ノードまでの他のワードラインのために提供することであって、前記経路は、前記ワードラインアンダードライブ回路を含み、これにより、前記他のワードラインがアサートされている間、前記他のワードラインの電圧を低減する、ことを含む、
請求項7の方法。 - 前記トランジスタ及び前記ワードラインアンダードライブ回路のプルダウントランジスタは、高閾値電圧デバイスである、
請求項7の方法。 - 前記ワードラインアンダードライブ回路を使用して、第2のワードラインの第2のワードライン電圧を低減することを含む、
請求項7の方法。 - 前記第2のワードライン及び前記ワードラインのうち何れかのみを一度にアサートすることを含む、
請求項10の方法。 - 前記ワードラインドライバ回路が、前記ワードライン入力信号を反転して、前記ワードラインドライバ出力信号を生成することを含む、
請求項7の方法。
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