JP7242633B2 - 半導体装置、および半導体装置の作製方法 - Google Patents

半導体装置、および半導体装置の作製方法 Download PDF

Info

Publication number
JP7242633B2
JP7242633B2 JP2020505554A JP2020505554A JP7242633B2 JP 7242633 B2 JP7242633 B2 JP 7242633B2 JP 2020505554 A JP2020505554 A JP 2020505554A JP 2020505554 A JP2020505554 A JP 2020505554A JP 7242633 B2 JP7242633 B2 JP 7242633B2
Authority
JP
Japan
Prior art keywords
layer
metal oxide
region
insulating layer
film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2020505554A
Other languages
English (en)
Other versions
JPWO2019175708A5 (ja
JPWO2019175708A1 (ja
Inventor
健一 岡崎
正美 神長
健輔 吉住
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Publication of JPWO2019175708A1 publication Critical patent/JPWO2019175708A1/ja
Publication of JPWO2019175708A5 publication Critical patent/JPWO2019175708A5/ja
Priority to JP2023035911A priority Critical patent/JP2023060293A/ja
Application granted granted Critical
Publication of JP7242633B2 publication Critical patent/JP7242633B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/7869Thin film transistors, i.e. transistors with a channel being at least partly a thin film having a semiconductor body comprising an oxide semiconductor material, e.g. zinc oxide, copper aluminium oxide, cadmium stannate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • H01L21/02271Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H01L21/02274Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition in the presence of a plasma [PECVD]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/265Bombardment with radiation with high-energy radiation producing ion implantation
    • H01L21/2654Bombardment with radiation with high-energy radiation producing ion implantation in AIIIBV compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/265Bombardment with radiation with high-energy radiation producing ion implantation
    • H01L21/266Bombardment with radiation with high-energy radiation producing ion implantation using masks
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film
    • H01L29/78645Thin film transistors, i.e. transistors with a channel being at least partly a thin film with multiple gate
    • H01L29/78648Thin film transistors, i.e. transistors with a channel being at least partly a thin film with multiple gate arranged on opposing sides of the channel
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/0217Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon nitride not containing oxygen, e.g. SixNy or SixByNz
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
    • H10K59/10OLED displays
    • H10K59/12Active-matrix OLED [AMOLED] displays
    • H10K59/131Interconnections, e.g. wiring lines or terminals
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10KORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
    • H10K59/80Constructional details
    • H10K59/87Passivation; Containers; Encapsulations
    • H10K59/873Encapsulations

Description

本発明の一態様は、半導体装置に関する。本発明の一態様は、表示装置に関する。本発明の一態様は、半導体装置、または表示装置の作製方法に関する。
なお、本発明の一態様は、上記の技術分野に限定されない。本明細書等で開示する本発明の一態様の技術分野としては、半導体装置、表示装置、発光装置、蓄電装置、記憶装置、電子機器、照明装置、入力装置、入出力装置、それらの駆動方法、又はそれらの製造方法、を一例として挙げることができる。半導体装置は、半導体特性を利用することで機能しうる装置全般を指す。
トランジスタに適用可能な半導体材料として、金属酸化物を用いた酸化物半導体が注目されている。例えば、特許文献1では、複数の酸化物半導体層を積層し、当該複数の酸化物半導体層の中で、チャネルとなる酸化物半導体層がインジウム及びガリウムを含み、且つインジウムの割合をガリウムの割合よりも大きくすることで、電界効果移動度(単に移動度、またはμFEという場合がある)を高めた半導体装置が開示されている。
半導体層に用いることのできる金属酸化物は、スパッタリング法などを用いて形成できるため、大型の表示装置を構成するトランジスタの半導体層に用いることができる。また、多結晶シリコンや非晶質シリコンを用いたトランジスタの生産設備の一部を改良して利用することが可能なため、設備投資を抑えられる。また、金属酸化物を用いたトランジスタは、非晶質シリコンを用いた場合に比べて高い電界効果移動度を有するため、駆動回路を設けた高性能の表示装置を実現できる。
また、特許文献2には、ソース領域およびドレイン領域に、アルミニウム、ホウ素、ガリウム、インジウム、チタン、シリコン、ゲルマニウム、スズ、および鉛からなる群のうちの少なくとも一種をドーパントとして含む低抵抗領域を有する酸化物半導体膜が適用された薄膜トランジスタが開示されている。
特開2014-7399号公報 特開2011-228622号公報
本発明の一態様は、電気特性の良好な半導体装置を提供することを課題の一とする。または、電気特性の安定した半導体装置を提供することを課題の一とする。または、信頼性の高い半導体装置を提供することを課題の一とする。または、信頼性の高い表示装置を提供することを課題の一とする。
なお、これらの課題の記載は、他の課題の存在を妨げるものではない。なお、本発明の一態様は、これらの課題の全てを解決する必要はないものとする。なお、これら以外の課題は、明細書、図面、請求項などの記載から抽出することが可能である。
本発明の一態様は、半導体層と、第1の絶縁層と、第1の導電層と、を有する半導体装置である。第1の絶縁層は、半導体層上に設けられる。第1の導電層は、第1の絶縁層上に設けられる。半導体層は、第1の導電層及び第1の絶縁層と重なる第1の領域と、第1の導電層とは重ならず、第1の絶縁層と重なる第2の領域と、第1の導電層及び第1の絶縁層の両方と重ならない第3の領域と、を有する。半導体層は、金属酸化物を含む。第2の領域及び第3の領域は、第1の元素を含む。第1の元素は、ホウ素、リン、アルミニウム、及びマグネシウムから選ばれる一以上の元素である。また第1の元素は、酸素と結合した状態で存在する。
また、本発明の他の一態様は、半導体層と、第1の絶縁層と、第2の絶縁層と、第1の導電層と、を有する半導体装置である。第1の絶縁層は、半導体層上に設けられる。第1の導電層は、第1の絶縁層上に設けられる。第2の絶縁層は、半導体層、第1の絶縁層、及び第1の導電層上に設けられる。半導体層は、第1の導電層及び第1の絶縁層と重なる第1の領域と、第1の導電層とは重ならず、第1の絶縁層と重なる第2の領域と、第2の絶縁層と接する第3の領域と、を有する。半導体層は、金属酸化物を含む。第2の絶縁層は、第1の絶縁層よりも水素を多く含む。第2の領域及び第3の領域は、第1の元素を含む。また、第1の元素は、ホウ素、リン、アルミニウム、及びマグネシウムから選ばれる一以上の元素である。また、第1の元素は、酸素と結合した状態で存在する。
本発明の一態様は、半導体層と、第1の絶縁層と、第2の絶縁層と、第1の導電層と、を有する、半導体装置である。第1の絶縁層は、半導体層上に設けられる。第1の導電層は、第1の絶縁層上に設けられる。第2の絶縁層は、半導体層、第1の絶縁層、及び第1の導電層上に設けられる。半導体層は、第1の導電層及び第1の絶縁層と重なる第1の領域と、第1の導電層とは重ならず、第1の絶縁層と重なる第2の領域と、第2の絶縁層と接する第3の領域と、を有する。また半導体層は、金属酸化物を含む。第2の絶縁層は、アルミニウム、チタン、タンタル、タングステン、クロム、またはルテニウムから選ばれる一以上の元素と、窒素とを含む。第2の領域及び第3の領域は、第1の元素を含み、当該第1の元素は、ホウ素、リン、アルミニウム、及びマグネシウムから選ばれる一以上の元素である。また、第1の元素は、酸素と結合した状態で存在する。
また、上記において、第1の絶縁層は、第1の導電層及び第1の領域と重なる第4の領域と、第2の領域と重なる第5の領域と、を有することが好ましい。このとき、第5の領域は、第1の元素を含むことが好ましい。このとき、第5の領域において、第1の元素は、酸素と結合した状態で存在することが好ましい。
また、上記において、第1の絶縁層は、酸化物を含み、第2の絶縁層は、窒化物を含むことが好ましい。
また、上記において、第1の絶縁層は、第1の導電層の側面よりも突出した部分を有し、平面視において、第1の導電層の端部は、第1の絶縁層の端部よりも内側に位置することが好ましい。
また、上記において、第2の絶縁層は、第1の導電層の上面及び側面、第1の絶縁層の上面及び側面、並びに第3の領域の上面及び側面に接することが好ましい。
また、上記において、第2の導電層と、第3の絶縁層と、をさらに有することが好ましい。このとき、第3の絶縁層は、第2の導電層を覆って設けられ、半導体層は、第3の絶縁層上に設けられ、第2の導電層は、第3の絶縁層を介して半導体層、第1の絶縁層、及び第1の導電層と重畳する部分を有することが好ましい。
また、本発明の他の一態様は、半導体装置の作製方法であって、金属酸化物を含む半導体層を形成する第1の工程と、半導体層上に、酸化物を含む第1の絶縁膜と、第1の導電膜とを形成する第2の工程と、第1の導電膜及び第1の絶縁膜をエッチングして、第1の導電層と、当該第1の導電層の側面よりも突出した部分を有する第1の絶縁層とを形成すると共に、半導体層の、第1の絶縁層に覆われない部分を形成する第3の工程と、第1の導電層をマスクとして、第1の絶縁層及び半導体層中に第1の元素を供給する第4の工程と、半導体層の、第1の絶縁層に覆われない部分に、水素を供給する第5の工程と、を有する。また、上記第1の元素は、ホウ素、リン、アルミニウム、またはマグネシウムであることが好ましい。
また、上記第4の工程において、第1の元素は、プラズマイオンドーピング法またはイオン注入法を用いて供給されることが好ましい。
また、上記第5の工程において、半導体層の、前記第1の絶縁層に覆われない部分に接して、水素を含む第2の絶縁層をプラズマCVD法により成膜した後に、加熱処理を行なうことにより、半導体層に水素を供給することが好ましい。
また、本発明の他の一態様は、半導体装置の作製方法であって、金属酸化物を含む半導体層を形成する第1の工程と、半導体層上に、酸化物を含む第1の絶縁膜と、第1の導電膜とを形成する第2の工程と、第1の導電膜及び第1の絶縁膜をエッチングして、第1の導電層と、当該第1の導電層の側面よりも突出した部分を有する第1の絶縁層とを形成すると共に、半導体層の、第1の絶縁層に覆われない部分を形成する第3の工程と、第1の導電層をマスクとして、第1の絶縁層及び半導体層中に第1の元素を供給する第4の工程と、半導体層の、第1の絶縁層に覆われない部分に接して、第1の層を形成した後に、加熱処理を行なう第5の工程と、を有する。また、上記第1の元素は、ホウ素、リン、アルミニウム、またはマグネシウムである。また、上記第1の層は、アルミニウム、チタン、タンタル、タングステン、クロム、またはルテニウムから選ばれる一以上の元素と、窒素とを含むことが好ましい。
また、上記第4の工程において、第1の元素は、プラズマイオンドーピング法またはイオン注入法を用いて供給されることが好ましい。
また、上記において、加熱処理は、窒素を含む雰囲気下において、200℃以上450℃以下の温度で行うことが好ましい。
本発明の一態様によれば、電気特性の良好な半導体装置を提供できる。または、電気特性の安定した半導体装置を提供できる。または、信頼性の高い半導体装置を提供できる。または、信頼性の高い表示装置を提供できる。
なお、これらの効果の記載は、他の効果の存在を妨げるものではない。なお、本発明の一態様は、必ずしも、これらの効果の全てを有する必要はない。なお、これら以外の効果は、明細書、図面、請求項などの記載から抽出することが可能である。
半導体装置の構成例。 半導体装置の構成例。 半導体装置の作製方法を説明する図。 半導体装置の作製方法を説明する図。 半導体装置の作製方法を説明する図。 半導体装置の作製方法を説明する図。 半導体装置の作製方法を説明する図。 半導体装置の作製方法を説明する図。 表示装置の上面図。 表示装置の断面図。 表示装置の断面図。 表示装置の断面図。 表示装置の断面図。 表示装置のブロック図及び回路図。 表示装置の回路図及びタイミングチャート。 表示モジュールの構成例。 電子機器の構成例。 電子機器の構成例。 電子機器の構成例。 電子機器の構成例。 金属酸化物膜のシート抵抗。 金属酸化物膜のシート抵抗。
以下、実施の形態について図面を参照しながら説明する。ただし、実施の形態は多くの異なる態様で実施することが可能であり、趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は、以下の実施の形態の記載内容に限定して解釈されるものではない。
また、本明細書で説明する各図において、各構成要素の大きさ、層の厚さ、または領域は、明瞭化のために誇張されている場合がある。
また、本明細書にて用いる「第1」、「第2」、「第3」という序数詞は、構成要素の混同を避けるために付したものであり、数的に限定するものではない。
また、本明細書において、「上に」、「下に」などの配置を示す語句は、構成要素同士の位置関係を、図面を参照して説明するために、便宜上用いている。また、構成要素同士の位置関係は、各構成要素を描写する方向に応じて適宜変化するものである。従って、明細書で説明した語句に限定されず、状況に応じて適切に言い換えることができる。
また、本明細書等において、トランジスタが有するソースとドレインの機能は、異なる極性のトランジスタを採用する場合や、回路動作において電流の方向が変化する場合などには入れ替わることがある。このため、ソースやドレインの用語は、入れ替えて用いることができるものとする。
なお、本明細書等において、トランジスタのチャネル長方向とは、ソース領域とドレイン領域間を最短距離で結ぶ直線に平行な方向のうちの1つをいう。すなわち、チャネル長方向は、トランジスタがオン状態のときに半導体層を流れる電流の方向のうちの1つに相当する。また、チャネル幅方向とは、当該チャネル長方向に直交する方向をいう。なお、トランジスタの構造や形状によっては、チャネル長方向及びチャネル幅方向は1つに定まらない場合がある。
また、本明細書等において、「電気的に接続」には、「何らかの電気的作用を有するもの」を介して接続されている場合が含まれる。ここで、「何らかの電気的作用を有するもの」は、接続対象間での電気信号の授受を可能とするものであれば、特に制限を受けない。例えば、「何らかの電気的作用を有するもの」には、電極や配線をはじめ、トランジスタなどのスイッチング素子、抵抗素子、インダクタ、キャパシタ、その他の各種機能を有する素子などが含まれる。
また、本明細書等において、「膜」という用語と、「層」という用語とは、互いに入れ替えることが可能である。例えば、「導電層」や「絶縁層」という用語は、「導電膜」や「絶縁膜」という用語に相互に交換することが可能な場合がある。
また、本明細書等において、特に断りがない場合、オフ電流とは、トランジスタがオフ状態(非導通状態、遮断状態、ともいう)にあるときのドレイン電流をいう。オフ状態とは、特に断りがない場合、nチャネル型トランジスタでは、ゲートとソースの間の電圧Vgsがしきい値電圧Vthよりも低い(pチャネル型トランジスタでは、Vthよりも高い)状態をいう。
本明細書等において、表示装置の一態様である表示パネルは表示面に画像等を表示(出力)する機能を有するものである。したがって表示パネルは出力装置の一態様である。
また、本明細書等では、表示パネルの基板に、例えばFPC(Flexible Printed Circuit)もしくはTCP(Tape Carrier Package)などのコネクターが取り付けられたもの、または基板にCOG(Chip On Glass)方式等によりICが実装されたものを、表示パネルモジュール、表示モジュール、または単に表示パネルなどと呼ぶ場合がある。
なお、本明細書等において、表示装置の一態様であるタッチパネルは表示面に画像等を表示する機能と、表示面に指やスタイラスなどの被検知体が触れる、押圧する、または近づくことなどを検出するタッチセンサとしての機能と、を有する。したがってタッチパネルは入出力装置の一態様である。
タッチパネルは、例えばタッチセンサ付き表示パネル(または表示装置)、タッチセンサ機能つき表示パネル(または表示装置)とも呼ぶことができる。タッチパネルは、表示パネルとタッチセンサパネルとを有する構成とすることもできる。または、表示パネルの内部または表面にタッチセンサとしての機能を有する構成とすることもできる。
また、本明細書等では、タッチパネルの基板に、コネクターやICが実装されたものを、タッチパネルモジュール、表示モジュール、または単にタッチパネルなどと呼ぶ場合がある。
(実施の形態1)
本実施の形態では、本発明の一態様の半導体装置、表示装置、およびその作製方法について説明する。
本発明の一態様は、被形成面上に、チャネルが形成される半導体層と、半導体層上にゲート絶縁層(第1の絶縁層ともいう)と、ゲート絶縁層上にゲート電極として機能する導電層(第1の導電層ともいう)と、を有するトランジスタである。半導体層は、半導体特性を示す金属酸化物(以下、酸化物半導体ともいう)を含んで構成されることが好ましい。
ゲート絶縁層は、半導体層の上面の一部を覆って設けられることが好ましい。また、ゲート電極は、その端部がゲート絶縁層の端部よりも内側に位置するように設けられていることが好ましい。言い換えると、ゲート絶縁層は、少なくとも半導体層上において、ゲート電極の端部よりも外側に突出した部分を有することが好ましい。
半導体層は、ゲート電極及びゲート絶縁層と重なる第1の領域と、ゲート絶縁層と重なり、且つゲート電極と重ならない第2の領域と、ゲート電極及びゲート絶縁層の両方と重ならない第3の領域を有する。第1の領域は、チャネル形成領域として機能する領域である。第3の領域は、第1の領域よりも低抵抗な領域であり、ソース領域またはドレイン領域として機能する領域である。また第2の領域は、第1の領域よりも低抵抗であり、第3の領域よりも高抵抗な領域であることが好ましい。
第2の領域は、第3の領域に含まれるキャリア供給源が、チャネル形成領域である第1の領域に拡散することを防ぐためのバッファ領域として機能することができる。第2の領域を設けることで、チャネル形成領域である第1の領域のキャリア濃度を極めて低いものとすることができる。また、第2の領域は、LDD(Lightly Doped Drain)領域として機能してもよい。
ここで、第2の領域及び第3の領域には、金属酸化物中の酸素と結合し、金属酸化物中に酸素欠損を生じうる元素(第1の元素ともいう)が含まれることが好ましい。このような元素としては、例えばホウ素、リン、アルミニウム、マグネシウム、シリコン等を好適に用いることができる。当該元素は、半導体層中において、酸素と結合した状態で存在することがより好ましい。
第2の領域及び第3の領域中の当該元素は、金属酸化物中の酸素と結合するため、金属酸化物中に酸素欠損が生じる。この酸素欠損と、膜中に含まれる水素とが結合することで、キャリア供給源となるため、第2の領域及び第3の領域は、第1の領域よりも低抵抗な状態となる。さらに、第3の領域は、第2の領域よりも、当該元素の濃度が高いことが好ましい。これにより、第3の領域を、第2の領域よりも低抵抗な状態とすることができる。
また、ゲート絶縁層のうち、第2の領域と接する部分、すなわち、ゲート電極と重畳しない部分にも、上記第1の元素が含まれることが好ましい。また、ゲート絶縁層のうち、チャネル形成領域と接する部分、すなわち、ゲート電極と重畳する部分には、第1の元素が添加されていないことが好ましい。
半導体層の上面に接して酸化物を含むゲート絶縁層が設けられた状態で、加熱処理を行うことで、ゲート絶縁層から放出される酸素を半導体層に供給することができる。これにより、半導体層中の酸素欠損を補填することができ、信頼性の高いトランジスタを実現することができる。
一方、第2の領域に酸素が供給されると、キャリア密度が低減し、電気抵抗が上昇してしまう場合がある。しかしながら本発明の一態様では、ゲート絶縁層の第2の領域に接する部分には上述した第1の元素が添加されている。加熱により酸素を放出しうる酸化物膜に、上述した第1の元素を添加することにより、放出される酸素の量を低減することができる。その結果、ゲート絶縁層から第2の領域に酸素が供給されることが抑制され、第2の領域は電気抵抗が低い状態を維持することができる。
このような構成とすることで、酸素欠損が十分に低減され、キャリア密度の極めて低いチャネル形成領域と、電気抵抗の極めて低いソース領域及びドレイン領域と、その間に、LDD領域と、を備え、電気特性に優れ、且つ信頼性の高い半導体装置を実現することができる。
このようなトランジスタは、例えばゲート電極をマスクに用いて、ゲート絶縁層及び半導体層に対して、上述した第1の元素を供給する処理を行った後、加熱処理を行うことで作製することができる。
このとき、第1の元素の供給は、プラズマイオンドーピング法またはイオン注入法により行うことがより好ましい。これらの方法は、イオンを添加する深さを調整しやすいため、ゲート絶縁層と半導体層とを含む領域を狙って、イオンを添加することが容易となる。
また、第1の元素を添加する際、半導体層のゲート絶縁層側の領域、または、半導体層とゲート絶縁層との界面近傍の第1の元素の濃度が最も高くなるように、イオンの供給条件を設定することが好ましい。これにより、一度の工程で半導体層とゲート絶縁層の両方に適切な濃度の第1の元素を添加することができる。また、ゲート絶縁層の第2の領域に近い部分に第1の元素の濃度の高い領域を形成することで、この部分の酸素の拡散性が効果的に低下し、ゲート絶縁層中の酸素が第2の領域側に拡散することをより効果的に抑制することができる。さらに、第3の領域上にはゲート絶縁層が設けられていないため、第3の領域に高い濃度で第1の元素が添加され、より抵抗化することで、低抵抗領域とソース電極またはドレイン電極との接触抵抗をより低くすることが可能となる。
また、上述のように、第1の元素として酸素と結合しやすい元素を用いた場合、第1の元素は半導体層中の酸素と結合した状態で存在する。すなわち、第1の元素が半導体層中の酸素を奪うことで、半導体層中に酸素欠損が生じ、当該酸素欠損と膜中の水素と結合することでキャリアが生成される。さらに半導体層中の第1の元素は酸化した状態で安定に存在するため、作製工程中にかかる熱などで脱離することなく、安定して低抵抗領域を実現できる。例えば400℃以上、600℃以上、または800℃以上の温度が作製工程中にかかったとしても、安定な低抵抗領域を維持することができる。
また、ゲート絶縁層として酸化物を含む絶縁膜を用いることが好ましい。さらに、ゲート絶縁層中には、加熱により脱離する酸素(過剰酸素ともいう)が含まれることが好ましい。このとき、ゲート絶縁層中の第1の元素は、ゲート絶縁層中の過剰酸素と結合した状態で存在する。過剰酸素と第1の元素とが結合して安定化することで、第1の元素が添加された領域では、加熱を行ってもほとんど酸素が脱離しない状態、または酸素が拡散しにくい状態となる。これにより、ゲート絶縁層から第2の領域に酸素が供給されることによる高抵抗化を防ぎつつ、チャネル形成領域(第1の領域)には酸素が供給されることにより、酸素欠損を低減できる。その結果、電気特性が良好で、信頼性の高いトランジスタを実現できる。
第1の元素は、半導体層中、及びゲート絶縁層中の酸素と結合して安定化する元素を用いることが好ましい。例えば酸化物が標準状態において固体で存在しうる元素を用いることが好ましい。特に好ましい元素としては、希ガス、水素以外の典型非金属元素、典型金属元素、及び遷移金属元素から選択することができる。特に、ホウ素、リン、アルミニウム、マグネシウム、シリコン等を用いることが好ましい。
ところで、シリコンの薄膜またはバルクに対してドーパントを供給してシリコンをn型化、またはp型化させる技術が知られている。この技術はドナーまたはアクセプタとなるドーパントを、シリコン原子のサイトに置換することで、キャリア密度を制御する方法である。例えば、シリコン中のリンやヒ素はドナーとして機能するためn型の導電性を付与することができ、シリコン中のホウ素やアルミニウムはアクセプタとして機能するためp型の導電性を付与することができる。このように、シリコンではドーパントの種類に応じて、導電性の極性をも制御することができる。
一方、本発明の一態様では、第1の元素は金属酸化物中の酸素を引き抜くことで膜中に酸素欠損を生じさせるように作用し、その酸素欠損と膜中の水素とが結合して、キャリアが生成する。したがって、第1の元素自体が金属酸化物中でドナーやアクセプタとして振る舞うことは要求されない。例えば、ホウ素やアルミニウムなどの、シリコンではアクセプタとして機能する元素であっても、リンなどと同様に、金属酸化物にn型の導電性を付与させることができる。このような点で、第1の元素に求められる機能は、シリコンにおけるドーパントに求められる機能とは全く異なるものである。
また、第3の領域は、第1の領域及び第2の領域よりも水素を多く含むことが好ましい。これにより、第3の領域を、第2の領域よりもさらに低抵抗な状態とすることができる。また、第3の領域に多く水素が含まれていても、第2の領域が設けられることで、第1の領域に水素が拡散してしまうことを効果的に抑制することができる。これにより、チャネル形成領域はキャリア密度が極めて低く、ソース領域及びドレイン領域は極めて低抵抗な状態となるため、電気特性に優れたトランジスタを実現できる。
第3の領域に水素を供給する方法としては、例えば、水素を含む膜(第2の絶縁層ともいう)を第3の領域上に接して設け、その状態で加熱処理を行なうことが好ましい。このとき、第2の領域の上面に接して第1の絶縁層が設けられ、第2の領域と第2の絶縁層とが接しない構成となるため、第2の領域の水素濃度を、第3の領域よりも低くすることができる。
または、ゲート電極をマスクとして、イオンドーピング法やイオン注入法、水素を含む雰囲気下における加熱処理などの方法により、半導体層に水素を供給してもよい。その場合であっても、第2の領域上には第1の絶縁層が設けられるため、第2の領域中に供給される水素の濃度を、第3の領域よりも低くすることができる。
すなわち、第2の領域は、第3の領域よりも第1の元素の濃度が低い領域であり、且つ、酸素欠損の量が少ない領域であり、且つ、水素の濃度が低い領域であるため、第2の領域は、第3の領域よりもキャリア濃度が低く、高抵抗な領域であるといえる。
または、第3の領域は、当該第3の領域を覆って、第1の層を形成した状態で加熱処理を施すことで、低抵抗化された領域であることが好ましい。
第1の層としては、アルミニウム、チタン、タンタル、タングステン、クロム、及びルテニウムなどの金属元素の少なくとも一を含む膜を用いることができる。特に、アルミニウム、チタン、タンタル、及びタングステンの少なくとも一を含むことが好ましい。または、これら金属元素の少なくとも一を含む窒化物、またはこれら金属元素の少なくとも一を含む酸化物を好適に用いることができる。
例えば、窒化アルミニウム膜、窒化アルミニウムチタン膜、窒化チタン膜などの窒化物膜や、酸化アルミニウムチタン膜などの酸化物膜などを好適に用いることができる。または、タングステン膜、チタン膜などの金属膜を用いてもよい。
例えば窒化アルミニウムチタン膜を用いる場合、組成式がAlTiN(xは0より大きく3以下の実数)、または組成式がAlTi(xは0より大きく2以下の実数、yは0より大きく4以下の実数)を満たす膜を用いることがより好ましい。
また、加熱処理の温度は高いほど第3の領域の低抵抗化が促進されるため好ましい。加熱処理の温度は、ゲート電極の耐熱性などを考慮して決定すればよい。例えば、150℃以上500℃以下、好ましくは200℃以上450℃以下、より好ましくは250℃以上450℃以下、さらに好ましくは300℃以上400℃以下の温度とすることができる。例えば加熱処理の温度を350℃程度とすることで、大型のガラス基板を用いた生産設備で歩留り良く半導体装置を生産することができる。
第3の領域に第1の層を接して設けた状態で、加熱処理を行うことで、第3の領域中の酸素が第1の層に吸引され、第3の領域中に酸素欠損を多く形成することができる。これにより、極めて低抵抗な第3の領域を形成することができる。一方、第2の領域上には第1の絶縁層が設けられ、第1の層と第2の領域は直接接しないため、第1の層に酸素が直接吸引されることはない。その結果、第2の領域よりも極めて低抵抗な第3の領域を形成することができる。
このように形成された第3の領域は、後の処理で高抵抗化しにくいといった特徴を有する。例えば、酸素を含む雰囲気下での加熱処理や、酸素を含む雰囲気下での成膜処理などを行っても、第3の領域の導電性が損なわれる恐れがないため、電気特性が良好で、且つ信頼性の高いトランジスタを実現できる。
また、加熱処理を経た後の第1の層が導電性を有する場合には、加熱処理後に第1の層を除去することが好ましい。一方、第1の層が絶縁性を有する場合には、これを残存させることで第1の層を保護絶縁膜(第2の絶縁層)として機能させることができる。
特に、上述した窒化アルミニウム膜、または窒化アルミニウムチタン膜は絶縁性に優れた膜であるため、残存させることが好ましい。
以下では、より具体的な例について、図面を参照して説明する。
[構成例1]
図1(A)は、トランジスタ100の上面図であり、図1(B)は、図1(A)に示す一点鎖線A1-A2における切断面の断面図に相当し、図1(C)は、図1(A)に示す一点鎖線B1-B2における切断面の断面図に相当する。なお、図1(A)において、トランジスタ100の構成要素の一部(保護絶縁層等)を省略して図示している。また、一点鎖線A1-A2方向はチャネル長方向、一点鎖線B1-B2方向はチャネル幅方向に相当する。また、トランジスタの上面図については、以降の図面においても図1(A)と同様に、構成要素の一部を省略して図示するものとする。
トランジスタ100は、基板102上に設けられ、絶縁層103、半導体層108、絶縁層110、金属酸化物層114、導電層112、絶縁層116、絶縁層118等を有する。島状の半導体層108は、絶縁層103上に設けられる。絶縁層110は、絶縁層103の上面の一部、及び半導体層108の上面の一部を覆って設けられる。金属酸化物層114と導電層112は、絶縁層110上にこの順に積層して設けられ、半導体層108と重畳する部分を有する。また金属酸化物層114と導電層112は、平面視において、絶縁層110の端部よりも内側に位置するように設けられている。絶縁層116は、導電層112の上面及び側面、金属酸化物層114の側面、絶縁層110の上面及び側面、半導体層108の上面及び側面、並びに絶縁層103の上面を覆って設けられている。絶縁層118は、絶縁層116を覆って設けられている。
導電層112の一部は、ゲート電極として機能する。絶縁層110の一部は、ゲート絶縁層として機能する。トランジスタ100は、半導体層108上にゲート電極が設けられる、いわゆるトップゲート型のトランジスタである。
また、図1(A)、(B)に示すように、トランジスタ100は、絶縁層118上に導電層120a及び導電層120bを有していてもよい。導電層120a及び導電層120bはソース電極またはドレイン電極として機能する。導電層120a及び導電層120bは、それぞれ絶縁層118及び絶縁層116に設けられた開口部141aまたは開口部141bを介して、後述する領域108Nに電気的に接続される。
半導体層108は、金属酸化物を含むことが好ましい。
例えば半導体層108は、インジウムと、M(Mは、ガリウム、アルミニウム、シリコン、ホウ素、イットリウム、スズ、銅、バナジウム、ベリリウム、チタン、鉄、ニッケル、ゲルマニウム、ジルコニウム、モリブデン、ランタン、セリウム、ネオジム、ハフニウム、タンタル、タングステン、またはマグネシウムから選ばれた一種または複数種)と、亜鉛と、を有すると好ましい。特にMはアルミニウム、ガリウム、イットリウム、またはスズから選ばれた一種または複数種とすることが好ましい。
特に、半導体層108として、インジウム、ガリウム、及び亜鉛を含む酸化物を用いることが好ましい。
半導体層108は、組成の異なる層、または結晶性の異なる層、または不純物濃度の異なる層を積層した積層構造としてもよい。
導電層112、及び金属酸化物層114は、上面形状が互いに概略一致するように加工されている。
なお、本明細書等において「上面形状が概略一致」とは、積層した層と層との間で少なくとも輪郭の一部が重なることをいう。例えば、上層と下層とが、同一のマスクパターン、または一部が同一のマスクパターンにより加工された場合を含む。ただし、厳密には輪郭が重なり合わず、上層の輪郭が下層の輪郭の内側に位置することや、上層の輪郭が下層の輪郭の外側に位置することもあり、この場合も「上面形状が概略一致」という。
絶縁層110と導電層112との間に位置する金属酸化物層114は、絶縁層110に含まれる酸素が導電層112側に拡散することを防ぐバリア膜として機能する。さらに金属酸化物層114は、導電層112に含まれる水素や水が絶縁層110側に拡散することを防ぐバリア膜としても機能する。金属酸化物層114は、例えば少なくとも絶縁層110よりも酸素及び水素を透過しにくい材料を用いることができる。
金属酸化物層114により、導電層112にアルミニウムや銅などの酸素を吸引しやすい金属材料を用いた場合であっても、絶縁層110から導電層112へ酸素が拡散することを防ぐことができる。また、導電層112が水素を含む場合であっても、導電層112から絶縁層110を介して半導体層108へ水素が拡散することを防ぐことができる。その結果、半導体層108のチャネル形成領域におけるキャリア密度を極めて低いものとすることができる。
金属酸化物層114としては、絶縁性材料または導電性材料を用いることができる。金属酸化物層114が絶縁性を有する場合には、ゲート絶縁層の一部として機能する。一方、金属酸化物層114が導電性を有する場合には、ゲート電極の一部として機能する。
金属酸化物層114として、酸化シリコンよりも誘電率の高い絶縁性材料を用いることが好ましい。特に、酸化アルミニウム膜、酸化ハフニウム膜、またはハフニウムアルミネート膜等を用いると、駆動電圧を低減できるため好ましい。
金属酸化物層114として、例えば酸化インジウム、インジウムスズ酸化物(ITO)、またはシリコンを含有したインジウムスズ酸化物(ITSO)などの、導電性酸化物を用いることもできる。特にインジウムを含む導電性酸化物は、導電性が高いため好ましい。
金属酸化物層114として、半導体層108と同一の元素を一以上含む酸化物材料を用いることが好ましい。特に、上記半導体層108に適用可能な酸化物半導体材料を用いることが好ましい。このとき、金属酸化物層114として、半導体層108と同じスパッタリングターゲットを用いて形成した金属酸化物膜を適用することで、装置を共通化できるため好ましい。
または、半導体層108と金属酸化物層114の両方に、インジウム及びガリウムを含む金属酸化物材料を用いる場合、半導体層108よりもガリウムの組成(含有割合)が高い材料を用いると、酸素に対するブロッキング性をより高めることができるため好ましい。このとき、半導体層108には、金属酸化物層114よりもインジウムの組成が高い材料を用いることで、トランジスタ100の電界効果移動度を高めることができる。
また、金属酸化物層114は、スパッタリング装置を用いて形成すると好ましい。例えば、スパッタリング装置を用いて酸化物膜を形成する場合、酸素ガスを含む雰囲気で形成することで、絶縁層110や半導体層108中に好適に酸素を添加することができる。
半導体層108は、絶縁層110を介して導電層112と重なる、チャネル形成領域を有する。また、半導体層108は、当該チャネル形成領域を挟む一対の領域108Lと、その外側に一対の領域108Nとを有する。領域108Lは、半導体層108のうち、絶縁層110と重なり、且つ導電層112とは重ならない領域である。また、領域108Nは、半導体層108のうち、導電層112及び絶縁層110のいずれにも重ならない領域であって、絶縁層116と接する領域である。
領域108L及び領域108Nは、チャネル形成領域よりも低抵抗な領域、キャリア濃度が高い領域、酸素欠陥密度の高い領域、不純物濃度の高い領域、またはn型である領域ともいうことができる。また、領域108Nは、領域108Lよりも低抵抗な領域、キャリア濃度が高い領域、酸素欠陥密度の高い領域、不純物濃度の高い領域、またはn型である領域ともいうことができる。
領域108L及び領域108Nは、不純物元素(第1の元素)を含む領域である。当該不純物元素としては、例えば水素、ホウ素、炭素、窒素、フッ素、リン、硫黄、ヒ素、アルミニウム、マグネシウムまたは希ガスなどが挙げられる。なお、希ガスの代表例としては、ヘリウム、ネオン、アルゴン、クリプトン、及びキセノン等がある。特に、ホウ素、リン、マグネシウム、またはアルミニウムを含むことが好ましい。またこれら元素を2以上含んでいてもよい。
領域108Nは、領域108Lよりも上記不純物の濃度が高い領域を有していてもよい。また、領域108Nは、領域108Lよりも深い位置に、不純物濃度のピークを有していてもよい。
半導体層108のチャネル形成領域に接する絶縁層103と絶縁層110には、酸化物膜を用いることが好ましい。例えば、酸化シリコン膜、酸化窒化シリコン膜、酸化アルミニウム膜などの酸化物膜を用いることができる。これにより、トランジスタ100の作製工程における熱処理などで、絶縁層103や絶縁層110から脱離した酸素を半導体層108のチャネル形成領域に供給し、半導体層108中の酸素欠損を低減することができる。
絶縁層110の端部の一部は、半導体層108上に位置している。絶縁層110は、導電層112と重畳し、ゲート絶縁層として機能する領域と、導電層112と重ならない部分(すなわち、領域108Lと重なる部分)とを有する。
絶縁層110は、導電層112と重ならない領域に、上述した不純物元素を含む領域110dを有する。領域110dは、少なくとも領域108Lとの界面近傍に位置している。また、図1(B)、(C)に示すように、領域110dは、半導体層108のチャネル形成領域と接する部分には設けられていないことが好ましい。
また、絶縁層103は、導電層112と重畳しない領域において、絶縁層110との界面近傍、及び絶縁層116との界面近傍に、上述した不純物元素を含む領域103dを有している。なお図示しないが、領域103dは、領域108Nや領域108Lとの界面近傍にも設けられていてもよい。このとき、領域108Nや領域108Lと重畳する部分の不純物濃度は、絶縁層110または絶縁層116と接する部分よりも低い濃度となる。
ここで、領域108Lにおける不純物濃度は、絶縁層110に近いほど濃度が高くなるような濃度勾配を有することが好ましい。これにより、領域108L全体に亘って均一な濃度とした場合に比べて、領域108L内の不純物元素の総量を低くできるため、作製工程中の熱などの影響によりチャネル形成領域に拡散しうる不純物の量を低く保つことができる。
また領域108Nも同様の濃度勾配を有していてもよい。これにより、領域108Nの上部ほど低抵抗となるため、導電層120a(または導電層120b)との接触抵抗をより効果的に低減することができる。
また、領域110dにおける不純物濃度は、半導体層108に近いほど濃度が高くなるような濃度勾配を有することが好ましい。加熱により酸素を放出可能な酸化物膜を適用した絶縁層110において、上述した不純物元素が添加された領域110dでは、他の領域に比べて酸素の放出を抑えることができる。そのため、絶縁層110の領域108Lとの界面近傍に位置する領域110dは、酸素に対するブロッキング層として機能し、領域108Lに供給される酸素を効果的に低減することができる。
後述するように、領域108L、領域108N及び領域110dに不純物元素を添加する処理は、導電層112をマスクとして行うことができる。これにより、領域108L、領域108N、及び領域110dを自己整合的に形成することができる。また、このとき、領域108L上には絶縁層110が設けられるため、領域108Nと領域108Lとでは、深さ方向における不純物の濃度勾配のプロファイルが異なる場合がある。
なお、図1(B)、(C)等では、不純物濃度の高い部分を誇張して示すために、絶縁層110及び絶縁層103中の一部に、領域110dまたは領域103dとしてハッチングパターンを付して図示しているが、実際には絶縁層110及び絶縁層103の厚さ方向全体に亘って上記不純物元素が含まれていてもよい。
領域108N、領域108L及び領域110dはそれぞれ、不純物濃度が、1×1019atoms/cm以上、1×1023atoms/cm以下、好ましくは5×1019atoms/cm以上、5×1022atoms/cm以下、より好ましくは1×1020atoms/cm以上、1×1022atoms/cm以下である領域を含むことが好ましい。また、領域108Lは、絶縁層110の領域110dよりも、不純物濃度が高い部分を有すると、領域108Lの電気抵抗をより効果的に低抵抗化できるため好ましい。また領域108Nは、領域108Lよりも、不純物濃度が高い部分を有することがより好ましい。
領域108L、領域108N及び領域110dに含まれる不純物の濃度は、例えば二次イオン質量分析法(SIMS:Secondary Ion Mass Spectrometry)や、X線光電子分光法(XPS:X-ray Photoelectron Spectroscopy)等の分析法により分析することができる。XPS分析を用いる場合には、表面側または裏面側からのイオンスパッタリングとXPS分析を組み合わせることで、深さ方向の濃度分布を知ることができる。
また、領域108L及び領域108Nにおいて、不純物元素は酸化した状態で存在していることが好ましい。例えば不純物元素としてホウ素、リン、マグネシウム、アルミニウム、シリコンなどの酸化しやすい元素を用いることが好ましい。このような酸化しやすい元素は、半導体層108中の酸素と結合して酸化した状態で安定に存在しうるため、後の工程で高い温度(例えば400℃以上、600℃以上、または800℃以上)がかかった場合であっても、脱離することが抑制される。また、不純物元素が半導体層108中の酸素を奪うことで、領域108L及び領域108N中に多くの酸素欠損が生成される。この酸素欠損と、膜中の水素とが結合することでキャリア供給源となるため、領域108L及び領域108Nは極めて低抵抗な状態となる。
なお、後の工程で高い温度がかかる処理を行なう際、外部や領域108L及び領域108Nの近傍の膜から多量の酸素が領域108L及び領域108Nに供給されてしまうと、抵抗が上昇してしまう場合がある。そのため、高い温度のかかる処理を行なう際には、酸素に対するバリア性の高い絶縁層116で半導体層108を覆った状態で処理することが好ましい。
また、領域110dにおいても、不純物元素は酸化した状態で存在していることが好ましい。このような酸化しやすい元素は、絶縁層110中の酸素と結合して酸化した状態で安定に存在しうるため、後の工程で高い温度がかかった場合でも脱離することが抑制される。また特に絶縁層110中に加熱により脱離しうる酸素(過剰酸素ともいう)が含まれる場合には、当該過剰酸素と不純物元素とが結合して安定化するため、領域110dから領域108Lへ酸素が供給されることを抑制することができる。また、酸化した状態の不純物元素が含まれる領域110dは、酸素が拡散しにくい状態となるため、領域110dよりも上部から当該領域110dを介して領域108Lに酸素が供給されることも防ぐことができる。
例えば、不純物元素としてホウ素を用いた場合、領域108L及び領域108N及び領域110dに含まれるホウ素は酸素と結合した状態で存在しうる。このことは、XPS分析において、B結合に起因するスペクトルピークが観測されることで確認できる。また、XPS分析において、ホウ素元素が単体で存在する状態に起因するスペクトルピークが観測されない、または測定下限のバックグラウンドノイズに埋もれる程度にまでピーク強度が極めて小さくなる。
絶縁層116は、半導体層108の領域108Nに接して設けられている。
絶縁層116は、領域108Nに対する水素の供給源として機能する。例えば、絶縁層116は、加熱により水素を放出する膜であることが好ましい。このような絶縁層116を領域108Nに接して設け、絶縁層116の形成後に加熱処理を行なうことで、領域108Nに水素を供給して低抵抗化させることができる。
絶縁層116は、成膜の際に用いる成膜ガスに、水素元素を含むガスを用いて成膜される膜であることが好ましい。これにより、絶縁層116の成膜時にも、領域108Nに水素を効果的に供給することができる。
絶縁層116としては、例えば、窒化シリコン、窒化酸化シリコン、酸化窒化シリコン、窒化アルミニウム、窒化酸化アルミニウムなどの絶縁膜を用いることができる。
領域108Nは、上述のように不純物元素が添加されることで酸素欠損を多く含む状態である。したがって、半導体層108中に含まれる水素に加えて、絶縁層116からさらに水素を供給することで、よりキャリア密度を高めることができる。
一方、領域108Lは、絶縁層110が間に存在することで絶縁層116と接しないため、領域108Nよりも供給される水素は少ない。さらに、不純物濃度も領域108Nよりも低いため、領域108Lは、領域108Nよりも高抵抗な状態とすることができる。
または、領域108Nに接する絶縁層116としては、窒化物を含む絶縁膜を用いることができる。領域108Nに接して窒化物を含む絶縁層116を設けることで、領域108Nの導電性をより高める効果を奏する。さらに、領域108Nに絶縁層116が接した状態で加熱処理を行なうことで、より低抵抗化が促進されるため好ましい。
絶縁層116に適用できる窒化物としては、例えば窒化シリコンや窒化ガリウムなどの半導体材料の窒化物、または窒化アルミニウムなどの金属窒化物を用いることが特に好ましい。例えば、窒化シリコンは、水素や酸素に対するブロッキング性を有するため、外部から半導体層への水素の拡散と、半導体層から外部への酸素の脱離の両方を防ぐことができ、信頼性の高いトランジスタを実現できる。
また、金属窒化物を用いる場合、アルミニウム、チタン、タンタル、タングステン、クロム、またはルテニウムの窒化物を用いることが好ましい。特に、アルミニウムまたはチタンを含むことが特に好ましい。例えば、アルミニウムをスパッタリングターゲットに用い、成膜ガスとして窒素を含むガスを用いた反応スパッタリング法により形成した窒化アルミニウム膜は、成膜ガスの全流量に対する窒素ガスの流量を適切に制御することで、極めて高い絶縁性と、水素や酸素に対する極めて高いブロッキング性とを兼ね備えた膜とすることができる。そのため、このような金属窒化物を含む絶縁膜を、半導体層に接して設けることで、半導体層を低抵抗化できるだけでなく、半導体層から外部へ酸素が拡散すること、及び半導体層へ水素が拡散することを好適に防ぐことができる。
金属窒化物として、窒化アルミニウムを用いた場合、当該窒化アルミニウムを含む絶縁層の厚さを5nm以上とすることが好ましい。このように薄い膜であっても、水素及び酸素に対する高いブロッキング性と、半導体層の低抵抗化の機能とを両立できる。なお、当該絶縁層の厚さはどれだけ厚くてもよいが、生産性を考慮し、500nm以下、好ましくは200nm以下、より好ましくは50nm以下とすることが好ましい。
絶縁層116に窒化アルミニウム膜を用いる場合、組成式がAlN(xは0より大きく2以下の実数、好ましくは、xは0.5より大きく1.5以下の実数)を満たす膜を用いることが好ましい。これにより、絶縁性に優れ、且つ熱伝導性に優れた膜とすることができるため、トランジスタ100を駆動したときに生じる熱の放熱性を高めることができる。
または、絶縁層116として、窒化アルミニウムチタン膜、窒化チタン膜などを用いることができる。
このような絶縁層116を領域108Nに接して設けることで、絶縁層116が領域108N中の酸素を吸引し、領域108N中に酸素欠損を形成させることができる。またこのとき、絶縁層116に金属酸化物を含む膜を用いた場合、絶縁層116と領域108Nとの間に、絶縁層116に含まれる金属元素(例えばアルミニウム)の酸化物を含む層が形成される場合がある。
ここで、半導体層108として、インジウムを含む金属酸化物膜を用いた場合、領域108Nの絶縁層116側の界面近傍に、酸化インジウムが析出した領域、または、インジウム濃度の高い領域が形成されている場合がある。このような領域の存在は、例えば、X線光電子分光法(XPS:X-ray Photoelectron Spectroscopy)等の分析法で観測できる場合がある。
このように、領域108Nは、領域108Lに比べて酸素欠損を多く含む領域とすることができるため、領域108Lよりも低抵抗化した領域とすることができる。さらに、絶縁層116として金属酸化物を含む絶縁膜を用いることで、領域108Nの絶縁層116側の界面近傍には導電性の高い酸化インジウムが析出した領域が形成され、さらに低抵抗な領域とすることができる。
絶縁層118は、トランジスタ100を保護する保護層として機能する。絶縁層118としては、例えば、酸化物または窒化物などの無機絶縁材料を用いることができる。より具体的な例としては、窒化シリコン、窒化酸化シリコン、酸化窒化シリコン、酸化アルミニウム、酸化窒化アルミニウム、窒化アルミニウム、酸化ハフニウム、ハフニウムアルミネートなどの無機絶縁材料を用いることができる。また、絶縁層118を平坦化層として用いることもできる。その場合、絶縁層118として有機樹脂材料を用いることができる。
なお、ここでは保護層として絶縁層116と絶縁層118の積層構造とする場合を示したが、絶縁層118は不要であれば設けなくてもよい。また、絶縁層118を2層以上の積層構造としてもよい。
ここで、半導体層108について、及び半導体層108中に形成されうる酸素欠損について説明する。
半導体層108のチャネル形成領域に形成される酸素欠損は、トランジスタ特性に影響を与えるため問題となる。例えば、半導体層108中に酸素欠損が形成されると、該酸素欠損に水素が結合し、キャリア供給源となりうる。チャネル形成領域中にキャリア供給源が生成されると、トランジスタ100の電気特性の変動、代表的にはしきい値電圧のシフトが生じる。したがって、チャネル形成領域においては、酸素欠損が少ないほど好ましい。
そこで、本発明の一態様においては、半導体層108のチャネル形成領域近傍の絶縁膜、具体的には、チャネル形成領域の上方に位置する絶縁層110、及び下方に位置する絶縁層103が、酸化物膜を含む構成である。作製工程中の熱などにより絶縁層103及び絶縁層110からチャネル形成領域へ酸素を移動させることで、チャネル形成領域中の酸素欠損を低減することが可能となる。
また、半導体層108は、Mに対するInの原子数比が1より大きい領域を有すると好ましい。Inの含有率が大きいほど、トランジスタの電界効果移動度を向上させることができる。
ここで、In、Ga、Znを含む金属酸化物の場合、Inと酸素の結合力は、Gaと酸素の結合力よりも弱いため、Inの含有率が大きい場合には、金属酸化物膜中に酸素欠損が形成されやすい。また、Gaに代えて、上記Mで示す金属元素を用いた場合でも同様の傾向がある。金属酸化物膜中に酸素欠損が多く存在すると、トランジスタの電気特性の低下や、信頼性の低下が生じる。
しかしながら本発明の一態様では、金属酸化物を含む半導体層108のチャネル形成領域中に極めて多くの酸素を供給できるため、Inの含有率の大きな金属酸化物材料を用いることが可能となる。これにより、極めて高い電界効果移動度と、安定した電気特性と、高い信頼性とを兼ね備えたトランジスタを実現することができる。
例えば、Mに対するInの原子数比が1.5以上、または2以上、または3以上、または3.5以上、または4以上である金属酸化物を、好適に用いることができる。
特に、半導体層108のIn、M、及びZnの原子数の比を、In:M:Zn=4:2:3またはその近傍とすることが好ましい。または、In、M、及びZnの原子数の比を、In:M:Zn=5:1:6またはその近傍とすると好ましい。また、半導体層108の組成として、半導体層108のIn、M、及びZnの原子数の比を概略等しくしてもよい。すなわち、In、M、及びZnの原子数の比が、In:M:Zn=1:1:1またはその近傍の材料を含んでいてもよい。
例えば、上記の電界効果移動度が高いトランジスタを、ゲート信号を生成するゲートドライバに用いることで、額縁幅の狭い(狭額縁ともいう)表示装置を提供することができる。また、上記の電界効果移動度が高いトランジスタを、ソースドライバ(特に、ソースドライバが有するシフトレジスタの出力端子に接続されるデマルチプレクサ)に用いることで、表示装置に接続される配線数が少ない表示装置を提供することができる。
なお、半導体層108が、Mに対するInの原子数比が1より大きい領域を有していても、半導体層108の結晶性が高い場合、電界効果移動度が低くなる場合がある。半導体層108の結晶性としては、例えば、X線回折(XRD:X-Ray Diffraction)を用いて分析する、あるいは、透過型電子顕微鏡(TEM:Transmission Electron Microscope)を用いて分析することで解析できる。
ここで、半導体層108のチャネル形成領域は、不純物濃度を低く、欠陥準位密度を低く(酸素欠損を少なく)することにより、膜中のキャリア密度を低くすることができる。このような金属酸化物膜を半導体層のチャネル形成領域に用いたトランジスタは、しきい値電圧がマイナスとなる電気特性(ノーマリーオンともいう。)になることが少ない。また、このような金属酸化物膜を用いたトランジスタは、オフ電流が著しく小さい特性を得ることができる。
半導体層108に結晶性の高い金属酸化物膜を用いると、半導体層108の加工時や、絶縁層110の成膜時のダメージを抑制することができ、信頼性の高いトランジスタを実現できる。一方、半導体層108に結晶性の比較的低い金属酸化物膜を用いることで、電気伝導性が向上し、電界効果移動度の高いトランジスタを実現できる。
半導体層108としては、後述するCAAC(c-axis aligned crystal)構造を有する金属酸化物膜、nc(nano crystal)構造を有する金属酸化物膜、またはCAAC構造とnc構造とが混在した金属酸化物膜を用いることが好ましい。
また、半導体層108が、2層以上の積層構造を有していてもよい。
例えば、組成の異なる2以上の金属酸化物膜を積層した半導体層108を用いることができる。例えば、In-M-Zn酸化物を用いた場合に、In、M、及びZnの原子数の比が、In:M:Zn=5:1:6、In:M:Zn=4:2:3、In:M:Zn=1:1:1、In:M:Zn=2:2:1、In:M:Zn=1:3:4、In:M:Zn=1:3:2、またはそれらの近傍であるスパッタリングターゲットで形成する膜のうち、2以上を積層して用いることが好ましい。
また、結晶性の異なる2以上の金属酸化物膜を積層した半導体層108を用いることができる。その場合、同じ酸化物ターゲットを用い、成膜条件を異ならせることで、大気に触れることなく連続して形成されることが好ましい。
このとき、半導体層108として、nc構造を有する金属酸化物膜と、CAAC構造を有する金属酸化物膜の積層構造とすることができる。または、nc構造を有する金属酸化物膜と、nc構造を有する金属酸化物膜の積層構造としてもよい。なお、半導体層108a及び半導体層108bに好適に用いることのできる金属酸化物の機能、または材料の構成については、後述するCAC(Cloud-Aligned Composite)の記載を援用することができる。
例えば、先に形成する第1の金属酸化物膜の成膜時の酸素流量比を、後に形成する第2の金属酸化物膜の成膜時の酸素流量比よりも小さくする。または、第1の金属酸化物膜の成膜時に、酸素を流さない条件とする。これにより、第2の金属酸化物膜の成膜時に、酸素を効果的に供給することができる。また、第1の金属酸化物膜は第2の金属酸化物膜よりも結晶性が低く、電気伝導性の高い膜とすることができる。一方、上部に設けられる第2の金属酸化物膜を第1の金属酸化物膜よりも結晶性の高い膜とすることで、半導体層108の加工時や、絶縁層110の成膜時のダメージを抑制することができる。
より具体的には、第1の金属酸化物膜の成膜時の酸素流量比を、0%以上50%未満、好ましくは0%以上30%以下、より好ましくは0%以上20%以下、代表的には10%とする。また第2の金属酸化物膜の成膜時の酸素流量比を、50%以上100%以下、好ましくは60%以上100%以下、より好ましくは80%以上100%以下、さらに好ましくは90%以上100%以下、代表的には100%とする。また、第1の金属酸化物膜と第2の金属酸化物膜とで、成膜時の圧力、温度、電力等の条件を異ならせてもよいが、酸素流量比以外の条件を同じとすることで、成膜工程にかかる時間を短縮することができるため好ましい。
このような構成とすることで、電気特性に優れ、且つ信頼性の高いトランジスタ100を実現できる。
[構成例2]
以下では、上記構成例1と一部の構成が異なるトランジスタの構成例について説明する。なお、以下では、上記構成例1と重複する部分は説明を省略する場合がある。また、以下で示す図面において、上記構成例1と同様の機能を有する部分についてはハッチングパターンを同じくし、符号を付さない場合もある。
図2(A)は、トランジスタ100Aの上面図であり、図2(B)はトランジスタ100Aのチャネル長方向の断面図であり、図2(C)はトランジスタ100Aのチャネル幅方向の断面図である。
トランジスタ100Aは、基板102と絶縁層103との間に導電層106を有する点で、構成例1と主に相違している。導電層106は半導体層108のチャネル形成領域及び領域108Lと、導電層112と重畳する領域を有する。
トランジスタ100Aにおいて、導電層106は、第1のゲート電極(ボトムゲート電極ともいう)としての機能を有し、導電層112は、第2のゲート電極(トップゲート電極ともいう)としての機能を有する。また、絶縁層103の一部は第1のゲート絶縁層として機能し、絶縁層110の一部は、第2のゲート絶縁層として機能する。
半導体層108の、導電層112及び導電層106の少なくとも一方と重畳する部分は、チャネル形成領域として機能する。なお以下では説明を容易にするため、半導体層108の導電層112と重畳する部分をチャネル形成領域と呼ぶ場合があるが、実際には導電層112と重畳せずに、導電層106と重畳する部分(領域108Lや領域108Nを含む部分)にもチャネルが形成しうる。
また、図2(A)、(C)に示すように、導電層106は、金属酸化物層114、絶縁層110、及び絶縁層103に設けられた開口部142を介して、導電層112と電気的に接続されていてもよい。これにより、導電層106と導電層112には、同じ電位を与えることができる。
導電層106は、導電層112、導電層120a、または導電層120bと同様の材料を用いることができる。特に導電層106に銅を含む材料を用いると、配線抵抗を低減できるため好ましい。また、導電層106にタングステンやモリブデンなどの高融点金属を含む材料を用いると、後の工程において高い温度で処理を行なうことができる。
また、図2(A)、(C)に示すように、チャネル幅方向において、導電層112及び導電層106が、半導体層108の端部よりも外側に突出していることが好ましい。このとき、図2(C)に示すように、半導体層108のチャネル幅方向の全体が、絶縁層110と絶縁層103を介して、導電層112と導電層106に覆われた構成となる。
このような構成とすることで、半導体層108を一対のゲート電極によって生じる電界で、電気的に取り囲むことができる。このとき特に、導電層106と導電層112に同じ電位を与えることが好ましい。これにより、半導体層108にチャネルを誘起させるための電界を効果的に印加できるため、トランジスタ100Aのオン電流を増大させることができる。そのため、トランジスタ100Aを微細化することも可能となる。
なお、導電層112と導電層106とを接続しない構成としてもよい。このとき、一対のゲート電極の一方に定電位を与え、他方にトランジスタ100Aを駆動するための信号を与えてもよい。このとき、一方の電極に与える電位により、トランジスタ100Aを他方の電極で駆動する際のしきい値電圧を制御することもできる。
以上が、構成例2についての説明である。
[作製方法例]
以下では、本発明の一態様の半導体装置の作製方法について、図面を参照して説明する。ここでは、上記構成例で例示したトランジスタ100Aを例に挙げて説明する。
なお、半導体装置を構成する薄膜(絶縁膜、半導体膜、導電膜等)は、スパッタリング法、化学気相堆積(CVD:Chemical Vapor Deposition)法、真空蒸着法、パルスレーザー堆積(PLD:Pulsed Laser Deposition)法、原子層堆積(ALD:Atomic Layer Deposition)法等を用いて形成することができる。CVD法としては、プラズマ化学気相堆積(PECVD:Plasma Enhanced CVD)法や、熱CVD法などがある。また、熱CVD法のひとつに、有機金属化学気相堆積(MOCVD:Metal Organic CVD)法がある。
また、半導体装置を構成する薄膜(絶縁膜、半導体膜、導電膜等)は、スピンコート、ディップ、スプレー塗布、インクジェット、ディスペンス、スクリーン印刷、オフセット印刷、ドクターナイフ法、スリットコート、ロールコート、カーテンコート、ナイフコート等の方法により形成することができる。
また、半導体装置を構成する薄膜を加工する際には、フォトリソグラフィ法等を用いて加工することができる。それ以外に、ナノインプリント法、サンドブラスト法、リフトオフ法などにより薄膜を加工してもよい。また、メタルマスクなどの遮蔽マスクを用いた成膜方法により、島状の薄膜を直接形成してもよい。
フォトリソグラフィ法としては、代表的には以下の2つの方法がある。一つは、加工したい薄膜上にレジストマスクを形成して、エッチング等により当該薄膜を加工し、レジストマスクを除去する方法である。もう一つは、感光性を有する薄膜を成膜した後に、露光、現像を行って、当該薄膜を所望の形状に加工する方法である。
フォトリソグラフィ法において、露光に用いる光は、例えばi線(波長365nm)、g線(波長436nm)、h線(波長405nm)、またはこれらを混合させた光を用いることができる。そのほか、紫外線やKrFレーザ光、またはArFレーザ光等を用いることもできる。また、液浸露光技術により露光を行ってもよい。また、露光に用いる光として、極端紫外(EUV:Extreme Ultra-violet)光やX線を用いてもよい。また、露光に用いる光に換えて、電子ビームを用いることもできる。極端紫外光、X線または電子ビームを用いると、極めて微細な加工が可能となるため好ましい。なお、電子ビームなどのビームを走査することにより露光を行う場合には、フォトマスクは不要である。
薄膜のエッチングには、ドライエッチング法、ウェットエッチング法、サンドブラスト法などを用いることができる。
図3乃至図6の各図には、トランジスタ100Aの作製工程の各段階におけるチャネル長方向及びチャネル幅方向の断面を並べて示している。
〔導電層106の形成〕
基板102上に導電膜を成膜し、これをエッチングにより加工して、第1のゲート電極として機能する導電層106を形成する。
〔絶縁層103の形成〕
続いて、基板102及び導電層106を覆って絶縁層103を形成する(図3(A))。絶縁層103は、PECVD法、ALD法、スパッタリング法等を用いて形成することができる。
絶縁層103を形成した後に、絶縁層103に対して酸素を供給する処理を行なってもよい。例えば、酸素雰囲気下でのプラズマ処理または加熱処理などを行うことができる。または、プラズマイオンドーピング法やイオン注入法などにより、絶縁層103に酸素を供給してもよい。
〔半導体層108の形成〕
続いて、絶縁層103上に金属酸化物膜を成膜し、これを加工することにより島状の半導体層108を形成する(図3(B))。
金属酸化物膜は、金属酸化物ターゲットを用いたスパッタリング法により形成することが好ましい。
また、金属酸化物膜を成膜する際に、酸素ガス、不活性ガス(例えば、ヘリウムガス、アルゴンガス、キセノンガスなど)を混合させてもよい。なお、金属酸化物膜を成膜する際の成膜ガス全体に占める酸素ガスの割合(以下、酸素流量比ともいう)が高いほど、金属酸化物膜の結晶性を高めることができ、信頼性の高いトランジスタを実現できる。一方、酸素流量比が低いほど、金属酸化物膜の結晶性が低くなり、オン電流が高められたトランジスタとすることができる。
半導体層108を積層構造とする場合、同じスパッタリングターゲットを用いて同じ成膜室で連続して成膜することで、界面を良好なものとすることができるため好ましい。特に、各金属酸化物膜の成膜条件として、成膜時の圧力、温度、電力等の条件を異ならせてもよいが、酸素流量比以外の条件を同じとすることで、成膜工程にかかる時間を短縮することができるため好ましい。また、異なる組成の金属酸化物膜を積層する場合には、大気に暴露することなく、連続して成膜することが好ましい。
金属酸化物膜は、CAAC構造を有する金属酸化物膜、nc構造を有する金属酸化物膜、またはCAAC構造とnc構造とが混在した金属酸化物膜となるように、成膜条件を設定することが好ましい。なお、成膜される金属酸化物膜がCAAC構造となる成膜条件、及びnc構造となる成膜条件は、それぞれ使用するスパッタリングターゲットの組成によって異なるため、その組成に応じて、基板温度や酸素流量比の他、圧力や電力などを適宜設定すればよい。
また、金属酸化物膜の成膜条件としては、基板温度を室温以上450℃以下、好ましくは基板温度を室温以上300℃以下、より好ましくは室温以上200℃以下、さらに好ましくは室温以上140℃以下とすればよい。例えば基板102に大型のガラス基板や、樹脂基板を用いた場合には、基板温度を室温以上140℃未満とすると、生産性が高くなり好ましい。また、基板温度を室温とする、または意図的に加熱しない状態で、金属酸化物膜を成膜することで、結晶性を低くすることができる。
また、金属酸化物膜を成膜する前に、絶縁層103の表面に吸着した水や水素、有機物等を脱離させるための処理や、絶縁層103中に酸素を供給する処理を行うことが好ましい。例えば、減圧雰囲気下にて70℃以上200℃以下の温度で加熱処理を行うことができる。または、酸素を含む雰囲気下におけるプラズマ処理を行ってもよい。また、一酸化窒素ガスを含む雰囲気下におけるプラズマ処理を行うと、絶縁層103の表面の有機物を好適に除去することができる。このような処理の後、絶縁層103の表面を大気に暴露することなく、連続して金属酸化物膜を成膜することが好ましい。
金属酸化物膜の加工には、ウェットエッチング法及びドライエッチング法のいずれか一方または双方を用いればよい。このとき、半導体層108と重ならない絶縁層103の一部がエッチングされ、薄くなる場合がある。
また、金属酸化物膜の成膜後、または半導体層108に加工した後、金属酸化物膜または半導体層108中の水素または水を除去するために加熱処理を行ってもよい。加熱処理の温度は、代表的には、150℃以上基板の歪み点未満、または250℃以上450℃以下、または300℃以上450℃以下とすることができる。
加熱処理は、希ガス、または窒素を含む雰囲気で行うことができる。または、当該雰囲気で加熱した後、酸素を含む雰囲気で加熱してもよい。なお、上記加熱処理の雰囲気に水素、水などが含まれないことが好ましい。該加熱処理は、電気炉、RTA装置等を用いることができる。RTA装置を用いることで、加熱処理時間を短縮することができる。
〔絶縁膜110f、金属酸化物膜114fの形成〕
続いて、絶縁層103及び半導体層108を覆って、絶縁膜110fと金属酸化物膜114fを形成する。
絶縁膜110fは、後に絶縁層110となる膜である。絶縁膜110fとしては、例えば酸化シリコン膜または酸化窒化シリコン膜などの酸化物膜を、プラズマ化学気相堆積装置(PECVD装置、または単にプラズマCVD装置という)を用いて形成することが好ましい。また、マイクロ波を用いたPECVD法を用いて形成してもよい。
金属酸化物膜114fは、後に金属酸化物層114となる膜である。金属酸化物膜114fは、例えば酸素を含む雰囲気下でスパッタリング法により形成することが好ましい。これにより、金属酸化物膜114fの成膜時に絶縁膜110fに酸素を供給することができる。
金属酸化物膜114fを、上記半導体層108の場合と同様の金属酸化物を含む酸化物ターゲットを用いたスパッタリング法により形成する場合には、上記方法を援用することができる。
金属酸化物膜114fは、成膜ガスに酸素を用い、金属ターゲットを用いた反応性スパッタリング法により形成してもよい。金属ターゲットにアルミニウムを用いた場合には、酸化アルミニウム膜を成膜することができる。
金属酸化物膜114fの成膜時に、成膜装置の成膜室内に導入する成膜ガスの全流量に対する酸素流量の割合(酸素流量比)、または成膜室内の酸素分圧が高いほど、絶縁膜110f中に供給される酸素を増やすことができる。酸素流量比または酸素分圧は、例えば50%以上100%以下、好ましくは65%以上100%以下、より好ましくは80%以上100%以下、さらに好ましくは90%以上100%以下とする。特に、酸素流量比100%とし、酸素分圧を100%にできるだけ近づけることが好ましい。
このように、酸素を含む雰囲気下でスパッタリング法により金属酸化物膜114fを形成することにより、金属酸化物膜114fの成膜時に、絶縁膜110fへ酸素を供給するとともに、絶縁膜110fから酸素が脱離することを防ぐことができる。その結果、絶縁膜110fに極めて多くの酸素を閉じ込めることができる。そして、後の加熱処理によって、半導体層108のチャネル形成領域に多くの酸素が供給され、チャネル形成領域中の酸素欠損を低減でき、信頼性の高いトランジスタを実現できる。
また、金属酸化物膜114fの形成後に、加熱処理を行うことで、絶縁膜110fから半導体層108に酸素を供給してもよい。加熱処理は、窒素、酸素、希ガスのうち一以上を含む雰囲気下にて、200℃以上400℃以下の温度で行うことができる。
続いて、金属酸化物膜114f、絶縁膜110f、及び絶縁層103の一部をエッチングすることで、導電層106に達する開口を形成する。これにより、後に形成する導電層112と導電層106とを、当該開口を介して電気的に接続することができる。
〔導電膜112fの形成〕
続いて、金属酸化物膜114f上に、導電層112となる導電膜112fを成膜する(図3(C))。導電膜112fは、金属または合金のスパッタリングターゲットを用いたスパッタリング法により成膜することが好ましい。
〔絶縁層110、金属酸化物層114、導電層112の形成〕
続いて、導電膜112f上にレジストマスク115を形成する。その後、レジストマスク115に覆われていない領域において、異方性のエッチング法を用いて導電膜112f、金属酸化物膜114f、及び絶縁膜110fをエッチングする(図4(A))。
導電膜112f、金属酸化物膜114f、及び絶縁膜110fのエッチングは、同じエッチング条件により同時にエッチングしてもよいし、異なるエッチング条件または手法を用いて、少なくとも2回に分けてエッチングしてもよい。例えば、導電膜112fと金属酸化物膜114fを先にエッチングし、続いて異なるエッチング条件で絶縁膜110fをエッチングすることで、半導体層108へのエッチングのダメージを低減することができる。
ここで、レジストマスク115は、絶縁層110となる領域上に形成されることが好ましい。
続いて、等方性のエッチング法を用いて、導電膜112fと金属酸化物膜114fの側面をエッチングして、端面を後退させる(サイドエッチングともいう)。これにより、平面視において、端部が絶縁層110の端部よりも内側に位置する導電層112と、金属酸化物層114を形成することができる(図4(B))。
ここで、導電膜112fと金属酸化物膜114fのエッチングには、半導体層108及び絶縁層103をできるだけエッチングしない条件または手法を選択することが好ましい。ここで、導電膜112fと金属酸化物膜114fのサイドエッチングの際に、レジストマスク115を除去した状態で行ってもよいが、レジストマスク115を残しておくことにより、導電層112が薄膜化することなく、側面のみエッチングすることができるため好ましい。
なお、ここでは金属酸化物膜114fを、導電膜112fと同様にサイドエッチングする方法について説明したが、導電膜112fのみサイドエッチングしてもよい。このとき、金属酸化物層114は、絶縁層110と同様に、導電層112と重畳しない領域を有する構成となる。
導電層112及び金属酸化物層114の形成後、レジストマスク115を除去する。
〔不純物元素の供給処理(領域108Lの形成)〕
続いて、導電層112をマスクとして、絶縁層110及び半導体層108に不純物元素140を供給(添加、または注入ともいう)する処理を行ない、領域108L、領域110d、及び領域103dを形成する(図5(A))。このとき半導体層108及び絶縁層110のうち、導電層112と重畳する領域には、導電層112がマスクとなり不純物元素140は供給されない。
不純物元素140の供給は、プラズマイオンドーピング法、またはイオン注入法を好適に用いることができる。これらの方法は、深さ方向の濃度プロファイルを、イオンの加速電圧とドーズ量等により、高い精度で制御することができる。プラズマイオンドーピング法を用いることで、生産性を高めることができる。また質量分離を用いたイオン注入法を用いることで、供給される不純物元素の純度を高めることができる。
不純物元素140の供給処理において、半導体層108と絶縁層110との界面、または半導体層108中の界面に近い部分、または絶縁層110中の当該界面に近い部分が、最も高い濃度となるように、処理条件を制御することが好ましい。これにより、一度の処理で半導体層108と絶縁層110の両方に、最適な濃度の不純物元素140を供給することができる。
不純物元素140としては、水素、ホウ素、炭素、窒素、フッ素、リン、硫黄、ヒ素、アルミニウム、マグネシウム、シリコン、または希ガスなどが挙げられる。なお、希ガスの代表例としては、ヘリウム、ネオン、アルゴン、クリプトン、及びキセノン等がある。特に、ホウ素、リン、アルミニウム、マグネシウム、またはシリコンを用いることが好ましい。
不純物元素140の原料ガスとしては、上記不純物元素を含むガスを用いることができる。ホウ素を供給する場合、代表的にはBガスやBFガスなどを用いることができる。またリンを供給する場合には、代表的にはPHガスを用いることができる。また、これらの原料ガスを希ガスで希釈した混合ガスを用いてもよい。
その他、原料ガスとして、CH、N、NH、AlH、AlCl、SiH、Si、F、HF、H、(CMg、及び希ガス等を用いることができる。また、イオン源は気体に限られず、固体や液体を加熱して気化させたものを用いてもよい。
不純物元素140の添加は、絶縁層110及び半導体層108の組成や密度、厚さなどを考慮して、加速電圧やドーズ量などの条件を設定することで制御することができる。
例えば、イオン注入法またはプラズマイオンドーピング法でホウ素の添加を行う場合、加速電圧は例えば5kV以上100kV以下、好ましくは7kV以上70kV以下、より好ましくは10kV以上50kV以下の範囲とすることができる。またドーズ量は、例えば1×1013ions/cm以上1×1017ions/cm以下、好ましくは1×1014ions/cm以上5×1016ions/cm以下、より好ましくは1×1015ions/cm以上3×1016ions/cm以下の範囲とすることができる。
また、イオン注入法またはプラズマイオンドーピング法でリンの添加を行う場合、加速電圧は、例えば10kV以上100kV以下、好ましくは30kV以上90kV以下、より好ましくは40kV以上80kV以下の範囲とすることができる。またドーズ量は、例えば1×1013ions/cm以上1×1017ions/cm以下、好ましくは1×1014ions/cm以上5×1016ions/cm以下、より好ましくは1×1015ions/cm以上3×1016ions/cm以下の範囲とすることができる。
なお、不純物元素140の供給方法としてはこれに限られず、例えばプラズマ処理や、加熱による熱拡散を利用した処理などを用いてもよい。プラズマ処理の場合、添加する不純物元素を含むガス雰囲気にてプラズマを発生させて、プラズマ処理を行うことによって、不純物元素を添加することができる。上記プラズマを発生させる装置としては、ドライエッチング装置、アッシング装置、プラズマCVD装置、高密度プラズマCVD装置等を用いることができる。
ここで、絶縁層110を介して領域108Lに不純物元素140を添加すると同時に、絶縁層110に覆われない領域(後の領域108Nとなる領域)にも、不純物元素140が添加される。この領域では、領域108Lに比べて不純物元素140の濃度が高い場合がある。また、深さ方向における不純物元素140の濃度勾配のプロファイルが、領域108Lとは異なる場合がある。
〔絶縁層116、領域108Nの形成〕
続いて、半導体層108の露出した領域に、水素を供給する処理を行なう。ここでは、半導体層108の露出した領域に接して、水素を含む絶縁層116を成膜することで水素を供給する(図5(B))。
絶縁層116は、水素を含む成膜ガスを用いたプラズマCVD法により形成することが好ましい。例えば、シランガスとアンモニアガスとを含む成膜ガスを用いて、窒化シリコン膜を成膜する。シランガスに加えてアンモニアガスを用いることで、膜中に多くの水素を含有させることができる。また、成膜時においても、半導体層108の露出した部分に水素を供給することが可能となる。
絶縁層116の成膜後に、加熱処理を行なうことで、絶縁層116から放出される水素の一部を、半導体層108の一部に供給することが好ましい。加熱処理は、窒素、酸素、希ガスのうち一以上を含む雰囲気下にて、150℃以上450℃以下、好ましくは200℃以上400℃以下の温度で行うことが好ましい。
このように水素を供給することで、半導体層108中に極めて低抵抗な領域108Nを形成することができる。領域108Nは、領域108Lよりもキャリア濃度の高い領域、酸素欠損量の多い領域、水素濃度の高い領域、または、不純物濃度の高い領域とも言うことができる。
または、絶縁層116及び領域108Nは、以下の方法により形成してもよい。
まず、半導体層108の露出した領域に接して、絶縁層116を形成する。
絶縁層116として、アルミニウム、チタン、タンタル、タングステン、クロム、及びルテニウムなどの金属元素の少なくとも一を含む膜を成膜する。特に、アルミニウム、チタン、タンタル、及びタングステンの少なくとも一を含むことが好ましい。また特に、これら金属元素の少なくとも一を含む窒化物、またはこれら金属元素の少なくとも一を含む酸化物を好適に用いることができる。絶縁層116として、窒化アルミニウムチタン膜、窒化チタン膜、窒化アルミニウム膜などの窒化物膜、酸化アルミニウムチタン膜などの酸化物膜などを好適に用いることができる。
ここで、絶縁層116は、成膜ガスに窒素ガスまたは酸素ガスを用いたスパッタリング法により形成することが好ましい。これにより、成膜ガスの流量を制御することにより、膜質の制御が容易となる。
続いて、加熱処理を行う。加熱処理により、半導体層108の絶縁層116と接する領域が低抵抗化し、半導体層108中に低抵抗な領域108Nが形成される。
加熱処理は、窒素または希ガスなどの不活性ガス雰囲気で行うことが好ましい。加熱処理の温度は高いほど好ましいが、基板102、導電層106、導電層112等の耐熱性を考慮した温度とすることができる。例えば、120℃以上500℃以下、好ましくは150℃以上450℃以下、より好ましくは200℃以上400℃以下、さらに好ましくは250℃以上400℃以下の温度とすることができる。例えば加熱処理の温度を350℃程度とすることで、大型のガラス基板を用いた生産設備で歩留り良く半導体装置を生産することができる。
なおここでは絶縁層116を除去しないため、加熱処理は絶縁層116の形成後であればどの段階で行ってもよい。また上記加熱処理は、他の加熱処理または熱の係る工程と兼ねてもよい。
加熱処理により、半導体層108中の酸素が絶縁層116に引き抜かれることにより酸素欠損が生成される。当該酸素欠損と、半導体層108中の水素とが結合することによりキャリア濃度が高まり、絶縁層116と接する領域108Nが低抵抗化される。
または、加熱処理により、絶縁層116に含まれる金属元素が半導体層108中に拡散することにより、半導体層108の一部が合金化し、低抵抗化される場合もある。
または、絶縁層116に含まれる窒素や水素、若しくは加熱処理の雰囲気に含まれる窒素などが、加熱処理により半導体層108中に拡散することで、絶縁層116と接する領域108Nが低抵抗化する場合もある。
このような複合的な作用により低抵抗化された半導体層108の領域108Nは、極めて安定な低抵抗な領域となる。このように形成された領域108Nは、例えば後の工程で酸素が供給される処理が行われたとしても、高抵抗化しにくいといった特徴を有する。
なお、ここでは、領域108Nを形成するための層として、絶縁性を有する絶縁層116を用いる例について説明したが、領域108Nとなる領域に接して、導電性を有する膜を形成することで、領域108Nを形成してもよい。このとき、領域108Nの形成後に、当該導電性を有する膜を酸化または窒化させて絶縁化して、絶縁層116とすることが好ましい。または、領域108Nの形成後に当該膜を除去し、絶縁層116を設けない構成としてもよい。
以上により、領域108Nを形成することができる。
また、上述した加熱処理を行なうことで、領域108L及び領域108Nを、より安定して低抵抗な状態とすることができる。例えば、上記温度で加熱処理を行うことにより、不純物元素140が適度に拡散して局所的に均一化され、理想的な不純物元素の濃度勾配を有する領域108L、領域108N、及び領域110dが形成されうる。なお、加熱処理の温度が高すぎる(例えば500℃以上)と、領域108Lから不純物元素140がチャネル形成領域内にまで拡散し、トランジスタの電気特性や信頼性の悪化を招く恐れがある。
また、領域108L及び領域108Nに不純物元素140を供給する際に、半導体層108や絶縁層110に生じた欠陥を、加熱処理によって修復できる場合もある。
また、加熱処理により、絶縁層110から半導体層108のチャネル形成領域に酸素を供給することができる。このとき、絶縁層110の突出部には、領域108Lとの界面近傍に、不純物元素140が供給された領域110dが形成されているため、絶縁層110から放出される酸素が領域108Lに拡散することが抑制される。その結果、領域108Lが高抵抗化してしまうことを効果的に防ぐことができる。さらにこのとき、絶縁層110の半導体層108のチャネル形成領域と重なる部分には、領域110dが形成されていないため、絶縁層110から放出される酸素を選択的に当該チャネル形成領域に供給することができる。
〔絶縁層118の形成〕
続いて、絶縁層116上に絶縁層118を形成する(図6(A))。
絶縁層118をプラズマCVD法により形成する場合、成膜温度が高すぎると、領域108N及び領域108L等に含まれる不純物によっては、当該不純物が半導体層108のチャネル形成領域を含む周辺部に拡散する恐れがある。その結果、チャネル形成領域が低抵抗化することや、領域108Nまたは領域108Lの電気抵抗が上昇してしまうなどの恐れがある。絶縁層116または絶縁層118の成膜温度としては、例えば150℃以上400℃以下、好ましくは180℃以上360℃以下、より好ましくは200℃以上250℃以下とすることが好ましい。絶縁層118を低温で成膜することにより、チャネル長の短いトランジスタであっても、良好な電気特性を付与することができる。
また、絶縁層118の形成後に加熱処理を行なってもよい。
〔開口部141a、開口部141bの形成〕
続いて、絶縁層118の所望の位置にリソグラフィによりマスクを形成した後、絶縁層118及び絶縁層116の一部をエッチングすることで、領域108Nに達する開口部141a及び開口部141bを形成する。
〔導電層120a、導電層120bの形成〕
続いて、開口部141a及び開口部141bを覆うように、絶縁層118上に導電膜を成膜し、当該導電膜を所望の形状に加工することで、導電層120a及び導電層120bを形成する(図6(B))。
以上の工程により、トランジスタ100Aを作製することができる。
[作製方法例の変形例]
以下では、上記作製方法例とは一部が異なる作製方法例について説明する。なお、上記と重複する部分については説明を省略し、相違する部分について説明する。
〔変形例1〕
まず、上記と同様に、導電層106、絶縁層103、半導体層108を形成する。続いて、絶縁膜110f、金属酸化物膜114f、及び導電膜112fを成膜し、導電膜112f上にレジストマスク115を形成する。
続いて、金属酸化物膜114f及び導電膜112fをエッチングし、金属酸化物層114と導電層112を形成する(図7(A))。
このとき、金属酸化物層114と導電層112は、レジストマスク115の輪郭よりも内側に端部が位置するように加工する。例えば、初めに金属酸化物膜114fと導電膜112fとを異方性のエッチングでエッチングした後に、等方性のエッチングにより、サイドエッチングすることで、金属酸化物層114と導電層112とを形成する。
続いて、レジストマスク115を用いて、絶縁膜110fを異方性のエッチングでエッチングし、絶縁層110を形成する(図7(B))。これにより、導電層112よりも外側に突出した部分を有する絶縁層110を形成することができる。その後、レジストマスク115を除去する。
このような方法により、金属酸化物膜114f及び導電膜112fのエッチングの際に、半導体層108が露出しないため、半導体層108の表面に、これらの成分が飛散し、付着してしまうことを防ぐことができる。そのため、信頼性の高いトランジスタを実現できる。
なお、以降の工程は、上記記載を援用できる。
〔変形例2〕
まず、上記と同様に、導電層106、絶縁層103、半導体層108を形成する。続いて、絶縁膜110f、金属酸化物膜114f、及び導電膜112fを成膜する。その後、導電膜112f上にレジストマスクを形成し、導電膜112fと金属酸化物膜114fをエッチングすることで、金属酸化物層114と導電層112を形成する。このときに用いるレジストマスクは、上記レジストマスク115と同一のパターンであってもよいが、導電層112となる領域を覆うパターンとすることが好ましい。なお、レジストマスク115と同一のパターンを用いる場合には、変形例1と同様に、金属酸化物膜114fと導電膜112fとをサイドエッチングする。その後、レジストマスクを除去する。
続いて、導電層112をマスクとして用いて、絶縁膜110f及び半導体層108に対して不純物元素140を添加する(図8(A))。これにより、半導体層108の導電層112と重畳しない部分に、不純物元素が添加された領域108Lを形成することができる。また同時に、絶縁膜110f中に不純物元素が添加された領域110dと、絶縁層103中に不純物元素が添加された領域103dが形成される。
続いて、導電層112及び金属酸化物層114の上面及び側面を覆って、レジストマスク115を形成する。レジストマスク115は、絶縁層110となる領域を覆うパターンを有する。その後、絶縁膜110fをエッチングして、導電層112よりも外側に突出した部分を有する絶縁層110を形成すると共に、半導体層108の一部(領域108Nとなる部分)を露出させる(図8(B))。
なお、この段階で、露出した半導体層108の一部に対して、水素を添加してもよい。例えば、レジストマスク115をマスクとして用いて、イオンドーピング法またはイオン注入法などの方法により、水素を添加してもよい。または、水素を含む雰囲気下で加熱処理を行なってもよい。加熱処理を行なう場合には、レジストマスク115が変質する場合があるため、これを除去してから加熱処理を行なうことが好ましい。導電層112が露出した状態で水素を含む雰囲気下で加熱処理を行なうことで、導電層112の表面の酸化物を還元して除去できるといった副次的な効果も期待できる。
続いて、上記と同様の方法により、半導体層108の露出した部分に接して絶縁層116を形成し、加熱処理を行なうことで、領域108Nを形成する(図8(C))。
このような方法により、不純物元素140の添加を行う際に、半導体層108の領域108Lとなる領域と、領域108Nとなる領域は、いずれも絶縁膜110fに覆われた状態であるため、これらの不純物濃度の深さ方向におけるプロファイルを同程度にすることができ、制御性を高めることができる。また、絶縁膜110fのエッチングの際に導電層112や金属酸化物層114がレジストマスク115に覆われ、露出しないため、導電層112や金属酸化物層114の成分の一部が半導体層108の表面に付着してしまうことを防ぐことができる。
なお、以降の工程は、上記記載を援用できる。
以上が、作製方法例の変形例についての説明である。
[半導体装置の構成要素]
次に、本実施の形態の半導体装置に含まれる構成要素について、詳細に説明する。
〔基板〕
基板102の材質などに大きな制限はないが、少なくとも、後の熱処理に耐えうる程度の耐熱性を有している必要がある。例えば、シリコンや炭化シリコンを材料とした単結晶半導体基板、多結晶半導体基板、シリコンゲルマニウム等の化合物半導体基板、SOI基板、ガラス基板、セラミック基板、石英基板、サファイア基板等を、基板102として用いてもよい。また、これらの基板上に半導体素子が設けられたものを、基板102として用いてもよい。
また、基板102として、可撓性基板を用い、可撓性基板上に直接、トランジスタ100等を形成してもよい。または、基板102とトランジスタ100等の間に剥離層を設けてもよい。剥離層は、その上に半導体装置を一部あるいは全部完成させた後、基板102より分離し、他の基板に転載するために用いることができる。その際、トランジスタ100等は耐熱性の劣る基板や可撓性の基板にも転載できる。
〔絶縁層103〕
絶縁層103は、スパッタリング法、CVD法、蒸着法、パルスレーザー堆積(PLD)法等を適宜用いて形成することができる。また、絶縁層103としては、例えば、酸化物絶縁膜または窒化物絶縁膜を単層または積層で形成することができる。なお、半導体層108との界面特性を向上させるため、絶縁層103において少なくとも半導体層108と接する領域は酸化物絶縁膜で形成することが好ましい。また、絶縁層103には、加熱により酸素を放出する膜を用いることが好ましい。
絶縁層103として、例えば酸化シリコン、酸化窒化シリコン、窒化酸化シリコン、窒化シリコン、酸化アルミニウム、酸化ハフニウム、酸化ガリウムまたはGa-Zn酸化物などを用いればよく、単層または積層で設けることができる。
また、絶縁層103の半導体層108に接する側に窒化シリコン膜などの酸化物膜以外の膜を用いた場合、半導体層108と接する表面に対して酸素プラズマ処理などの前処理を行い、当該表面、または表面近傍を酸化することが好ましい。
〔導電膜〕
ゲート電極として機能する導電層112及び導電層106、並びにソース電極またはドレイン電極の一方として機能する導電層120a及び、他方として機能する導電層120bとしては、クロム、銅、アルミニウム、金、銀、亜鉛、モリブデン、タンタル、チタン、タングステン、マンガン、ニッケル、鉄、コバルトから選ばれた金属元素、または上述した金属元素を成分とする合金か、上述した金属元素を組み合わせた合金等を用いてそれぞれ形成することができる。
また、導電層112、導電層106、導電層120a、及び導電層120bには、In-Sn酸化物、In-W酸化物、In-W-Zn酸化物、In-Ti酸化物、In-Ti-Sn酸化物、In-Zn酸化物、In-Sn-Si酸化物、In-Ga-Zn酸化物等の酸化物導電体または金属酸化物膜を適用することもできる。
ここで、酸化物導電体(OC:Oxide Conductor)について説明を行う。例えば、半導体特性を有する金属酸化物に酸素欠損を形成し、該酸素欠損に水素を添加すると、伝導帯近傍にドナー準位が形成される。この結果、金属酸化物は、導電性が高くなり導電体化する。導電体化された金属酸化物を、酸化物導電体ということができる。
また、導電層112等として、上記酸化物導電体(金属酸化物)を含む導電膜と、金属または合金を含む導電膜の積層構造としてもよい。金属または合金を含む導電膜を用いることで、配線抵抗を小さくすることができる。このとき、ゲート絶縁膜として機能する絶縁層と接する側には酸化物導電体を含む導電膜を適用することが好ましい。
また、導電層112、導電層106、導電層120a、導電層120bには、上述の金属元素の中でも、特にチタン、タングステン、タンタル、及びモリブデンの中から選ばれるいずれか一つまたは複数を有すると好適である。特に、窒化タンタル膜を用いると好適である。当該窒化タンタル膜は、導電性を有し、且つ、銅、酸素、または水素に対して、高いバリア性を有し、且つ自身からの水素の放出が少ないため、半導体層108と接する導電膜、または半導体層108の近傍の導電膜として、好適に用いることができる。
〔絶縁層110〕
トランジスタ100等のゲート絶縁膜として機能する絶縁層110は、PECVD法、スパッタリング法等により形成できる。絶縁層110としては、酸化シリコン膜、酸化窒化シリコン膜、窒化酸化シリコン膜、窒化シリコン膜、酸化アルミニウム膜、酸化ハフニウム膜、酸化イットリウム膜、酸化ジルコニウム膜、酸化ガリウム膜、酸化タンタル膜、酸化マグネシウム膜、酸化ランタン膜、酸化セリウム膜および酸化ネオジム膜を一種以上含む絶縁層を用いることができる。なお、絶縁層110を、2層の積層構造または3層以上の積層構造としてもよい。
また、半導体層108と接する絶縁層110は、酸化物絶縁膜であることが好ましく、化学量論的組成よりも過剰に酸素を含有する領域を有することがより好ましい。別言すると、絶縁層110は、酸素を放出することが可能な絶縁膜である。例えば、酸素雰囲気下にて絶縁層110を形成すること、成膜後の絶縁層110に対して酸素雰囲気下での熱処理、プラズマ処理等を行うこと、または、絶縁層110上に酸素雰囲気下で酸化物膜を成膜することなどにより、絶縁層110中に酸素を供給することもできる。
また、絶縁層110として、酸化シリコンや酸化窒化シリコンと比べて比誘電率の高い酸化ハフニウム等の材料を用いることもできる。これにより絶縁層110の膜厚を厚くしトンネル電流によるリーク電流を抑制できる。特に結晶性を有する酸化ハフニウムは、非晶質の酸化ハフニウムと比べて高い比誘電率を備えるため好ましい。
〔半導体層〕
半導体層108がIn-M-Zn酸化物の場合、In-M-Zn酸化物を成膜するために用いるスパッタリングターゲットは、Mに対するInの原子数比が1以上であることが好ましい。このようなスパッタリングターゲットの金属元素の原子数比として、In:M:Zn=1:1:1、In:M:Zn=1:1:1.2、In:M:Zn=2:1:3、In:M:Zn=3:1:2、In:M:Zn=4:2:3、In:M:Zn=4:2:4.1、In:M:Zn=5:1:6、In:M:Zn=5:1:7、In:M:Zn=5:1:8、In:M:Zn=6:1:6、In:M:Zn=5:2:5等が挙げられる。
また、スパッタリングターゲットとしては、多結晶の酸化物を含むターゲットを用いると、結晶性を有する半導体層108を形成しやすくなるため好ましい。なお、成膜される半導体層108の原子数比は、上記のスパッタリングターゲットに含まれる金属元素の原子数比のプラスマイナス40%の変動を含む。例えば、半導体層108に用いるスパッタリングターゲットの組成がIn:Ga:Zn=4:2:4.1[原子数比]の場合、成膜される半導体層108の組成は、In:Ga:Zn=4:2:3[原子数比]の近傍となる場合がある。
なお、原子数比がIn:Ga:Zn=4:2:3またはその近傍と記載する場合、Inを4としたとき、Gaが1以上3以下であり、Znが2以上4以下である場合を含む。また、原子数比がIn:Ga:Zn=5:1:6またはその近傍であると記載する場合、Inを5としたときに、Gaが0.1より大きく2以下であり、Znが5以上7以下である場合を含む。また、原子数比がIn:Ga:Zn=1:1:1またはその近傍であると記載する場合、Inを1としたときに、Gaが0.1より大きく2以下であり、Znが0.1より大きく2以下である場合を含む。
また、半導体層108は、エネルギーギャップが2eV以上、好ましくは2.5eV以上である。このように、シリコンよりもエネルギーギャップの広い金属酸化物を用いることで、トランジスタのオフ電流を低減することができる。
また、半導体層108は、非単結晶構造であると好ましい。非単結晶構造は、例えば、後述するCAAC構造、多結晶構造、微結晶構造、または非晶質構造を含む。非単結晶構造において、非晶質構造は最も欠陥準位密度が高く、CAAC構造は最も欠陥準位密度が低い。
以下では、CAAC(c-axis aligned crystal)について説明する。CAACは結晶構造の一例を表す。
CAAC構造とは、複数のナノ結晶(最大径が10nm未満である結晶領域)を有する薄膜などの結晶構造の一つであり、各ナノ結晶はc軸が特定の方向に配向し、かつa軸及びb軸は配向性を有さずに、ナノ結晶同士が粒界を形成することなく連続的に連結しているといった特徴を有する結晶構造である。特にCAAC構造を有する薄膜は、各ナノ結晶のc軸が、薄膜の厚さ方向、被形成面の法線方向、または薄膜の表面の法線方向に配向しやすいといった特徴を有する。
CAAC-OS(Oxide Semiconductor)は結晶性の高い酸化物半導体である。一方、CAAC-OSは、明確な結晶粒界を確認することはできないため、結晶粒界に起因する電子移動度の低下が起こりにくいといえる。また、酸化物半導体の結晶性は不純物の混入や欠陥の生成などによって低下する場合があるため、CAAC-OSは不純物や欠陥(酸素欠損など)の少ない酸化物半導体ともいえる。従って、CAAC-OSを有する酸化物半導体は、物理的性質が安定する。そのため、CAAC-OSを有する酸化物半導体は熱に強く、信頼性が高い。
ここで、結晶学において、単位格子を構成するa軸、b軸、及びc軸の3つの軸(結晶軸)について、特異的な軸をc軸とした単位格子を取ることが一般的である。特に層状構造を有する結晶では、層の面方向に平行な2つの軸をa軸及びb軸とし、層に交差する軸をc軸とすることが一般的である。このような層状構造を有する結晶の代表的な例として、六方晶系に分類されるグラファイトがあり、その単位格子のa軸及びb軸は劈開面に平行であり、c軸は劈開面に直交する。例えば層状構造であるYbFe型の結晶構造をとるInGaZnOの結晶は六方晶系に分類することができ、その単位格子のa軸及びb軸は層の面方向に平行となり、c軸は層(すなわちa軸及びb軸)に直交する。
微結晶構造を有する酸化物半導体膜(微結晶酸化物半導体膜)は、TEMによる観察像では、明確に結晶部を確認することができない場合がある。微結晶酸化物半導体膜に含まれる結晶部は、1nm以上100nm以下、または1nm以上10nm以下の大きさであることが多い。特に、1nm以上10nm以下、または1nm以上3nm以下の微結晶であるナノ結晶(nc:nanocrystal)を有する酸化物半導体膜を、nc-OS(nanocrystalline Oxide Semiconductor)膜と呼ぶ。また、nc-OS膜は、例えば、TEMによる観察像では、結晶粒界を明確に確認できない場合がある。
nc-OS膜は、微小な領域(例えば、1nm以上10nm以下の領域、特に1nm以上3nm以下の領域)において原子配列に周期性を有する。また、nc-OS膜は、異なる結晶部間で結晶方位に規則性が見られない。そのため、膜全体で配向性が見られない。従って、nc-OS膜は、分析方法によっては、非晶質酸化物半導体膜と区別が付かない場合がある。例えば、nc-OS膜に対し、結晶部よりも大きい径のX線を用いるXRD装置を用いて構造解析を行うと、out-of-plane法による解析では、結晶面を示すピークが検出されない。また、nc-OS膜に対し、結晶部よりも大きいプローブ径(例えば50nm以上)の電子線を用いる電子線回折(制限視野電子線回折ともいう。)を行うと、ハローパターンのような回折パターンが観測される。一方、nc-OS膜に対し、結晶部の大きさと近いか結晶部より小さいプローブ径(例えば1nm以上30nm以下)の電子線を用いる電子線回折(ナノビーム電子線回折ともいう。)を行うと、円を描くように(リング状に)輝度の高い領域が観測され、当該領域内に複数のスポットが観測される場合がある。
nc-OS膜は、非晶質酸化物半導体膜よりも欠陥準位密度が低い。ただし、nc-OS膜は、異なる結晶部間で結晶方位に規則性が見られない。そのため、nc-OS膜は、CAAC-OS膜と比べて欠陥準位密度が高くなる。従って、nc-OS膜はCAAC-OS膜と比べて、キャリア密度が高く、電子移動度が高くなる場合がある。従って、nc-OS膜を用いたトランジスタは、高い電界効果移動度を示す場合がある。
nc-OS膜は、CAAC-OS膜と比較して、成膜時の酸素流量比を小さくすることで形成することができる。また、nc-OS膜は、CAAC-OS膜と比較して、成膜時の基板温度を低くすることでも形成することができる。例えば、nc-OS膜は、基板温度を比較的低温(例えば130℃以下の温度)とした状態、または基板を加熱しない状態でも成膜することができるため、大型のガラス基板や、樹脂基板などを使う場合に適しており、生産性を高めることができる。
金属酸化物の結晶構造の一例について説明する。なお、以下では、In-Ga-Zn酸化物ターゲット(In:Ga:Zn=4:2:4.1[原子数比])を用いて、スパッタリング法にて成膜された金属酸化物を一例として説明する。上記ターゲットを用いて、基板温度を100℃以上130℃以下として、スパッタリング法により形成した金属酸化物は、nc(nano crystal)構造及びCAAC構造のいずれか一方の結晶構造、またはこれらが混在した構造をとりやすい。一方、基板温度を室温(R.T.)として、スパッタリング法により形成した金属酸化物は、ncの結晶構造をとりやすい。なお、ここでいう室温(R.T.)とは、基板を意図的に加熱しない場合の温度を含む。
[金属酸化物の構成]
以下では、本発明の一態様で開示されるトランジスタに用いることができるCAC(Cloud-Aligned Composite)-OSの構成について説明する。
なお、本明細書等において、CAAC(c-axis aligned crystal)、及びCAC(Cloud-Aligned Composite)と記載する場合がある。なお、CAACは結晶構造の一例を表し、CACは機能、または材料の構成の一例を表す。
CAC-OSまたはCAC-metal oxideとは、材料の一部では導電性の機能と、材料の一部では絶縁性の機能とを有し、材料の全体では半導体としての機能を有する。なお、CAC-OSまたはCAC-metal oxideを、トランジスタの活性層に用いる場合、導電性の機能は、キャリアとなる電子(またはホール)を流す機能であり、絶縁性の機能は、キャリアとなる電子を流さない機能である。導電性の機能と、絶縁性の機能とを、それぞれ相補的に作用させることで、スイッチングさせる機能(On/Offさせる機能)をCAC-OSまたはCAC-metal oxideに付与できる。CAC-OSまたはCAC-metal oxideにおいて、それぞれの機能を分離させることで、双方の機能を最大限に高めることができる。
また、CAC-OSまたはCAC-metal oxideは、導電性領域、及び絶縁性領域を有する。導電性領域は、上述の導電性の機能を有し、絶縁性領域は、上述の絶縁性の機能を有する。また、材料中において、導電性領域と、絶縁性領域とは、ナノ粒子レベルで分離している場合がある。また、導電性領域と、絶縁性領域とは、それぞれ材料中に偏在する場合がある。また、導電性領域は、周辺がぼけてクラウド状に連結して観察される場合がある。
また、CAC-OSまたはCAC-metal oxideにおいて、導電性領域と、絶縁性領域とは、それぞれ0.5nm以上10nm以下、好ましくは0.5nm以上3nm以下のサイズで材料中に分散している場合がある。
また、CAC-OSまたはCAC-metal oxideは、異なるバンドギャップを有する成分により構成される。例えば、CAC-OSまたはCAC-metal oxideは、絶縁性領域に起因するワイドギャップを有する成分と、導電性領域に起因するナローギャップを有する成分と、により構成される。当該構成の場合、キャリアを流す際に、ナローギャップを有する成分において、主にキャリアが流れる。また、ナローギャップを有する成分が、ワイドギャップを有する成分に相補的に作用し、ナローギャップを有する成分に連動してワイドギャップを有する成分にもキャリアが流れる。このため、上記CAC-OSまたはCAC-metal oxideをトランジスタのチャネル形成領域に用いる場合、トランジスタのオン状態において高い電流駆動力、つまり大きなオン電流、及び高い電界効果移動度を得ることができる。
すなわち、CAC-OSまたはCAC-metal oxideは、マトリックス複合材(matrix composite)、または金属マトリックス複合材(metal matrix composite)と呼称することもできる。
以上が、構成要素についての説明である。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
(実施の形態2)
本実施の形態では、先の実施の形態で例示したトランジスタを有する表示装置の一例について説明する。
[構成例]
図9(A)に、表示装置700の上面図を示す。表示装置700は、シール材712により貼り合された第1の基板701と第2の基板705を有する。また第1の基板701、第2の基板705、及びシール材712で封止される領域において、第1の基板701上に画素部702、ソースドライバ回路部704、及びゲートドライバ回路部706が設けられる。また画素部702には、複数の表示素子が設けられる。
また、第1の基板701の第2の基板705と重ならない部分に、FPC716(FPC:Flexible printed circuit)が接続されるFPC端子部708が設けられている。FPC716によって、FPC端子部708及び信号線710を介して、画素部702、ソースドライバ回路部704、及びゲートドライバ回路部706のそれぞれに各種信号等が供給される。
ゲートドライバ回路部706は、複数設けられていてもよい。また、ゲートドライバ回路部706及びソースドライバ回路部704は、それぞれ半導体基板等に別途形成され、パッケージされたICチップの形態であってもよい。当該ICチップは、第1の基板701上、またはFPC716に実装することができる。
画素部702、ソースドライバ回路部704及びゲートドライバ回路部706が有するトランジスタに、本発明の一態様の半導体装置であるトランジスタを適用することができる。
画素部702に設けられる表示素子としては、液晶素子、発光素子などが挙げられる。液晶素子としては、透過型の液晶素子、反射型の液晶素子、半透過型の液晶素子などを用いることができる。また、発光素子としては、LED(Light Emitting Diode)、OLED(Organic LED)、QLED(Quantum-dot LED)、半導体レーザなどの、自発光性の発光素子が挙げられる。また、シャッター方式または光干渉方式のMEMS(Micro Electro Mechanical Systems)素子や、マイクロカプセル方式、電気泳動方式、エレクトロウェッティング方式、または電子粉流体(登録商標)方式等を適用した表示素子などを用いることもできる。
図9(B)に示す表示装置700Aは、第1の基板701に換えて、可撓性を有する樹脂層743が適用され、フレキシブルディスプレイとして用いることのできる表示装置の例である。
表示装置700Aは、画素部702が矩形形状でなく、角部が円弧状の形状を有している。また、図9(B)中の領域P1に示すように、画素部702、及び樹脂層743の一部が切りかかれた切欠き部を有する。一対のゲートドライバ回路部706は、画素部702を挟んで両側に設けられる。またゲートドライバ回路部706は、画素部702の角部において、円弧状の輪郭に沿って設けられている。
樹脂層743は、FPC端子部708が設けられる部分が突出した形状を有している。また樹脂層743のFPC端子部708を含む一部は、図9(B)中の領域P2で裏側に折り返すことができる。樹脂層743の一部を折り返すことで、FPC716を画素部702の裏側に重ねて配置した状態で、表示装置700Aを電子機器に実装することができ、電子機器の省スペース化を図ることができる。
また表示装置700Aに接続されるFPC716には、IC717が実装されている。IC717は、例えばソースドライバ回路としての機能を有する。このとき、表示装置700Aにおけるソースドライバ回路部704は、保護回路、バッファ回路、デマルチプレクサ回路等の少なくとも一を含む構成とすることができる。
図9(C)に示す表示装置700Bは、大型の画面を有する電子機器に好適に用いることのできる表示装置である。表示装置700Bは、例えばテレビジョン装置、モニタ装置、パーソナルコンピュータ(ノート型またはデスクトップ型を含む)、タブレット端末、デジタルサイネージなどに好適に用いることができる。
表示装置700Bは、複数のソースドライバIC721と、一対のゲートドライバ回路部722を有する。
複数のソースドライバIC721は、それぞれFPC723に取り付けられている。また、複数のFPC723は、一方の端子が第1の基板701に、他方の端子がプリント基板724にそれぞれ接続されている。FPC723を折り曲げることで、プリント基板724を画素部702の裏側に配置して、電子機器に実装することができ、電子機器の省スペース化を図ることができる。
一方、ゲートドライバ回路部722は、第1の基板701上に形成されている。これにより、狭額縁の電子機器を実現できる。
このような構成とすることで、大型で且つ高解像度の表示装置を実現できる。例えば画面サイズが対角30インチ以上、40インチ以上、50インチ以上、または60インチ以上の表示装置を実現することができる。また、解像度が4K2K、または8K4Kなどといった極めて高解像度の表示装置を実現することができる。
[断面構成例]
以下では、表示素子として液晶素子を用いる構成、及びEL素子を用いる構成について、図10乃至図13を用いて説明する。なお、図10乃至図12は、それぞれ図9(A)に示す一点鎖線Q-Rにおける断面図である。また図13は、図9(B)に示した表示装置700A中の一点鎖線S-Tにおける断面図である。図10及び図11は、表示素子として液晶素子を用いた構成であり、図12及び図13は、EL素子を用いた構成である。
〔表示装置の共通部分に関する説明〕
図10乃至図13に示す表示装置は、引き回し配線部711と、画素部702と、ソースドライバ回路部704と、FPC端子部708と、を有する。引き回し配線部711は、信号線710を有する。画素部702は、トランジスタ750及び容量素子790を有する。ソースドライバ回路部704は、トランジスタ752を有する。図11では、容量素子790が無い場合を示している。
トランジスタ750及びトランジスタ752は、実施の形態1で例示したトランジスタを適用できる。
本実施の形態で用いるトランジスタは、高純度化し、酸素欠損の形成を抑制した酸化物半導体膜を有する。該トランジスタは、オフ電流を低くできる。よって、画像信号等の電気信号の保持時間を長くでき、画像信号等の書き込み間隔も長く設定できる。よって、リフレッシュ動作の頻度を少なくできるため、消費電力を低減する効果を奏する。
また、本実施の形態で用いるトランジスタは、比較的高い電界効果移動度が得られるため、高速駆動が可能である。例えば、このような高速駆動が可能なトランジスタを表示装置に用いることで、画素部のスイッチングトランジスタと、駆動回路部に使用するドライバトランジスタを同一基板上に形成することができる。すなわち、シリコンウェハ等により形成された駆動回路を適用しない構成も可能であり、表示装置の部品点数を削減することができる。また、画素部においても、高速駆動が可能なトランジスタを用いることで、高画質な画像を提供することができる。
図10、図12、及び図13に示す容量素子790は、トランジスタ750が有する第1のゲート電極と同一の膜を加工して形成される下部電極と、半導体層と同一の金属酸化物を加工して形成される上部電極と、を有する。上部電極は、トランジスタ750のソース領域及びドレイン領域と同様に低抵抗化されている。また、下部電極と上部電極との間には、トランジスタ750の第1のゲート絶縁層として機能する絶縁膜の一部が設けられる。すなわち、容量素子790は、一対の電極間に誘電体膜として機能する絶縁膜が挟持された積層型の構造である。また、上部電極には、トランジスタのソース電極及びドレイン電極と同一の膜を加工して得られる配線が接続されている。
また、トランジスタ750、トランジスタ752、及び容量素子790上には平坦化絶縁膜770が設けられている。
画素部702が有するトランジスタ750と、ソースドライバ回路部704が有するトランジスタ752とは、異なる構造のトランジスタを用いてもよい。例えば、いずれか一方にトップゲート型のトランジスタを適用し、他方にボトムゲート型のトランジスタを適用した構成としてもよい。なお、上記ゲートドライバ回路部706についてもソースドライバ回路部704と同様である。
信号線710は、トランジスタ750、752のソース電極及びドレイン電極等と同じ導電膜で形成されている。このとき、銅元素を含む材料等の低抵抗な材料を用いると、配線抵抗に起因する信号遅延等が少なく、大画面での表示が可能となるため好ましい。
FPC端子部708は、一部が接続電極として機能する配線760、異方性導電膜780、及びFPC716を有する。配線760は、異方性導電膜780を介してFPC716が有する端子と電気的に接続される。ここでは、配線760は、トランジスタ750、752のソース電極及びドレイン電極等と同じ導電膜で形成されている。
第1の基板701及び第2の基板705としては、例えばガラス基板、またはプラスチック基板等の可撓性を有する基板を用いることができる。第1の基板701に可撓性を有する基板を用いる場合には、第1の基板701とトランジスタ750等との間に、水や水素に対するバリア性を有する絶縁層を設けることが好ましい。
また、第2の基板705側には、遮光膜738と、着色膜736と、これらに接する絶縁膜734と、が設けられる。
〔液晶素子を用いる表示装置の構成例〕
図10に示す表示装置700は、液晶素子775と、スペーサ778を有する。液晶素子775は、導電層772、導電層774、及びこれらの間に液晶層776を有する。導電層774は、第2の基板705側に設けられ、共通電極としての機能を有する。また、導電層772は、トランジスタ750が有するソース電極またはドレイン電極と電気的に接続される。導電層772は、平坦化絶縁膜770上に形成され、画素電極として機能する。
導電層772には、可視光に対して透光性の材料、または反射性の材料を用いることができる。透光性の材料としては、例えば、インジウム、亜鉛、スズ等を含む酸化物材料を用いるとよい。反射性の材料としては、例えば、アルミニウム、銀等を含む材料を用いるとよい。
導電層772に反射性の材料を用いると、表示装置700は反射型の液晶表示装置となる。一方、導電層772に透光性の材料を用いると、透過型の液晶表示装置となる。反射型の液晶表示装置の場合、視認側に偏光板を設ける。一方、透過型の液晶表示装置の場合、液晶素子を挟むように一対の偏光板を設ける。
図11に示す表示装置700は、横電界方式(例えば、FFSモード)の液晶素子775を用いる例を示す。導電層772上に絶縁層773を介して、共通電極として機能する導電層774が設けられる。導電層772と導電層774との間に生じる電界によって、液晶層776の配向状態を制御することができる。
図11において、導電層774、絶縁層773、導電層772の積層構造により保持容量を構成することができる。そのため、別途容量素子を設ける必要がなく、開口率を高めることができる。
また、図10及び図11には図示しないが、液晶層776と接する配向膜を設ける構成としてもよい。また、偏光部材、位相差部材、反射防止部材などの光学部材(光学基板)、及びバックライト、サイドライトなどの光源を適宜設けることができる。
液晶層776には、サーモトロピック液晶、低分子液晶、高分子液晶、高分子分散型液晶(PDLC:Polymer Dispersed Liquid Crystal)、高分子ネットワーク型液晶(PNLC:Polymer Network Liquid Crystal)、強誘電性液晶、反強誘電性液晶等を用いることができる。また、横電界方式を採用する場合、配向膜を用いないブルー相を示す液晶を用いてもよい。
また、液晶素子のモードとしては、TN(Twisted Nematic)モード、VA(Vertical Alignment)モード、IPS(In-Plane-Switching)モード、FFS(Fringe Field Switching)モード、ASM(Axially Symmetric aligned Micro-cell)モード、OCB(Optically Compensated Birefringence)モード、ECB(Electrically Controlled Birefringence)モード、ゲストホストモードなどを用いることができる。
また、液晶層776に高分子分散型液晶や、高分子ネットワーク型液晶などを用いた、散乱型の液晶素子を用いることもできる。このとき、着色膜736を設けずに白黒表示を行う構成としてもよいし、着色膜736を用いてカラー表示を行う構成としてもよい。
また、液晶素子の駆動方法として、継時加法混色法に基づいてカラー表示を行う、時間分割表示方式(フィールドシーケンシャル駆動方式ともいう)を適用してもよい。その場合、着色膜736を設けない構成とすることができる。時間分割表示方式を用いた場合、例えばR(赤色)、G(緑色)、B(青色)のそれぞれの色を呈する副画素を設ける必要がないため、画素の開口率を向上させることや、精細度を高められるなどの利点がある。
〔発光素子を用いる表示装置〕
図12に示す表示装置700は、発光素子782を有する。発光素子782は、導電層772、EL層786、及び導電膜788を有する。EL層786は、有機化合物、または量子ドットなどの無機化合物を有する。
有機化合物に用いることのできる材料としては、蛍光性材料または燐光性材料などが挙げられる。また、量子ドットに用いることのできる材料としては、コロイド状量子ドット材料、合金型量子ドット材料、コア・シェル型量子ドット材料、コア型量子ドット材料、などが挙げられる。
図12に示す表示装置700には、平坦化絶縁膜770上に導電層772の一部を覆う絶縁膜730が設けられる。ここで、発光素子782は透光性の導電膜788を有し、トップエミッション型の発光素子である。なお、発光素子782は、導電層772側に光を射出するボトムエミッション構造や、導電層772側及び導電膜788側の双方に光を射出するデュアルエミッション構造としてもよい。
また、着色膜736は発光素子782と重なる位置に設けられ、遮光膜738は絶縁膜730と重なる位置、引き回し配線部711、及びソースドライバ回路部704に設けられている。また、着色膜736及び遮光膜738は、絶縁膜734で覆われている。また、発光素子782と絶縁膜734の間は封止膜732で充填されている。なお、EL層786を画素毎に島状または画素列毎に縞状に形成する、すなわち塗り分けにより形成する場合においては、着色膜736を設けない構成としてもよい。
図13には、フレキシブルディスプレイに好適に適用できる表示装置の構成を示している。図13は、図9(B)に示した表示装置700A中の一点鎖線S-Tにおける断面図である。
図13に示す表示装置700Aは、図12で示した第1の基板701に換えて、支持基板745、接着層742、樹脂層743、及び絶縁層744が積層された構成を有する。トランジスタ750や容量素子790等は、樹脂層743上に設けられた絶縁層744上に設けられている。
支持基板745は、有機樹脂やガラス等を含み、可撓性を有する程度に薄い基板である。樹脂層743は、ポリイミドやアクリルなどの有機樹脂を含む層である。絶縁層744は、酸化シリコン、酸化窒化シリコン、窒化シリコン等の無機絶縁膜を含む。樹脂層743と支持基板745とは、接着層742によって貼りあわされている。樹脂層743は、支持基板745よりも薄いことが好ましい。
また、図13に示す表示装置700Aは、図12で示した基板705に換えて保護層740を有する。保護層740は、封止膜732と貼りあわされている。保護層740としては、ガラス基板や樹脂フィルムなどを用いることができる。また、保護層740として、偏光板、散乱板などの光学部材や、タッチセンサパネルなどの入力装置、またはこれらを2つ以上積層した構成を適用してもよい。
また、発光素子782が有するEL層786は、絶縁膜730及び導電層772上に島状に設けられている。EL層786を、副画素毎に発光色が異なるように作り分けることで、着色膜736を用いずにカラー表示を実現することができる。また、発光素子782を覆って、保護層741が設けられている。保護層741は発光素子782に水などの不純物が拡散することを防ぐ機能を有する。保護層741は、無機絶縁膜を用いることが好ましい。また、無機絶縁膜と有機絶縁膜をそれぞれ一以上含む積層構造とすることがより好ましい。
また、図13では、折り曲げ可能な領域P2を示している。領域P2では、支持基板745、接着層742のほか、絶縁層744等の無機絶縁膜が設けられていない部分を有する。また、領域P2において、配線760を覆って樹脂層746が設けられている。折り曲げ可能な領域P2に無機絶縁膜をできるだけ設けず、且つ、金属または合金を含む導電層と、有機材料を含む層のみを積層した構成とすることで、曲げた際にクラックが生じることを防ぐことができる。また、領域P2に支持基板745を設けないことで、極めて小さい曲率半径で、表示装置700Aの一部を曲げることができる。
〔表示装置に入力装置を設ける構成例〕
また、図10乃至図13に示す表示装置に入力装置を設けてもよい。当該入力装置としては、例えば、タッチセンサ等が挙げられる。
例えばセンサの方式としては、静電容量方式、抵抗膜方式、表面弾性波方式、赤外線方式、光学方式、感圧方式など様々な方式を用いることができる。または、これら2つ以上を組み合わせて用いてもよい。
なお、タッチパネルの構成は、入力装置を一対の基板の間に形成する、所謂インセル型のタッチパネル、入力装置を表示装置上に形成する、所謂オンセル型のタッチパネル、または表示装置に貼り合わせて用いる、所謂アウトセル型のタッチパネルなどがある。
本実施の形態で例示した構成例、及びそれらに対応する図面等は、少なくともその一部を他の構成例、または図面等と適宜組み合わせて実施することができる。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
(実施の形態3)
本実施の形態では、本発明の一態様の半導体装置を有する表示装置について、図14を用いて説明を行う。
図14(A)に示す表示装置は、画素部502と、駆動回路部504と、保護回路506と、端子部507と、を有する。なお、保護回路506は、設けない構成としてもよい。
画素部502や駆動回路部504が有するトランジスタに、本発明の一態様のトランジスタを適用することができる。また保護回路506にも、本発明の一態様のトランジスタを適用してもよい。
画素部502は、X行Y列(X、Yはそれぞれ独立に2以上の自然数)に配置された複数の表示素子を駆動する複数の画素回路501を有する。
駆動回路部504は、走査線GL_1乃至GL_Xに走査信号を出力するゲートドライバ504a、データ線DL_1乃至DL_Yにデータ信号を供給するソースドライバ504bなどの駆動回路を有する。ゲートドライバ504aは、少なくともシフトレジスタを有する構成とすればよい。またソースドライバ504bは、例えば複数のアナログスイッチなどを用いて構成される。また、シフトレジスタなどを用いてソースドライバ504bを構成してもよい。
端子部507は、外部の回路から表示装置に電源、制御信号、及び画像信号等を入力するための端子が設けられた部分をいう。
保護回路506は、自身が接続する配線に一定の範囲外の電位が与えられたときに、該配線と別の配線とを導通状態にする回路である。図14(A)に示す保護回路506は、例えば、ゲートドライバ504aと画素回路501の間の配線である走査線GL、またはソースドライバ504bと画素回路501の間の配線であるデータ線DL等の各種配線に接続される。
また、ゲートドライバ504aとソースドライバ504bは、それぞれ画素部502と同じ基板上に設けられていてもよいし、ゲートドライバ回路またはソースドライバ回路が別途形成された基板(例えば、単結晶半導体膜または多結晶半導体膜で形成された駆動回路基板)をCOGやTAB(Tape Automated Bonding)によって基板に実装する構成としてもよい。
また、図14(A)に示す複数の画素回路501は、例えば、図14(B)、(C)に示す構成とすることができる。
図14(B)に示す画素回路501は、液晶素子570と、トランジスタ550と、容量素子560と、を有する。また画素回路501には、データ線DL_n、走査線GL_m、電位供給線VL等が接続されている。
液晶素子570の一対の電極の一方の電位は、画素回路501の仕様に応じて適宜設定される。液晶素子570は、書き込まれるデータにより配向状態が設定される。なお、複数の画素回路501のそれぞれが有する液晶素子570の一対の電極の一方に共通の電位(コモン電位)を与えてもよい。また、各行の画素回路501の液晶素子570の一対の電極の一方に異なる電位を与えてもよい。
また、図14(C)に示す画素回路501は、トランジスタ552、554と、容量素子562と、発光素子572と、を有する。また画素回路501には、データ線DL_n、走査線GL_m、電位供給線VL_a、電源供給線VL_b等が接続されている。
なお、電位供給線VL_a及び電位供給線VL_bの一方には、高電源電位VDDが与えられ、他方には、低電源電位VSSが与えられる。トランジスタ554のゲートに与えられる電位に応じて、発光素子572に流れる電流が制御されることにより、発光素子572からの発光輝度が制御される。
本実施の形態で例示した構成例、及びそれらに対応する図面等は、少なくともその一部を他の構成例、または図面等と適宜組み合わせて実施することができる。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
(実施の形態4)
以下では、画素に表示される階調を補正するためのメモリを備える画素回路と、これを有する表示装置について説明する。実施の形態1で例示したトランジスタは、以下で例示する画素回路に用いられるトランジスタに適用することができる。
[回路構成]
図15(A)に、画素回路400の回路図を示す。画素回路400は、トランジスタM1、トランジスタM2、容量C1、及び回路401を有する。また画素回路400には、配線S1、配線S2、配線G1、及び配線G2が接続される。
トランジスタM1は、ゲートが配線G1と、ソース及びドレインの一方が配線S1と、他方が容量C1の一方の電極と、それぞれ接続する。トランジスタM2は、ゲートが配線G2と、ソース及びドレインの一方が配線S2と、他方が容量C1の他方の電極、及び回路401と、それぞれ接続する。
回路401は、少なくとも一の表示素子を含む回路である。表示素子としては様々な素子を用いることができるが、代表的には有機EL素子やLED素子などの発光素子、液晶素子、またはMEMS(Micro Electro Mechanical Systems)素子等を適用することができる。
トランジスタM1と容量C1とを接続するノードをノードN1、トランジスタM2と回路401とを接続するノードをノードN2とする。
画素回路400は、トランジスタM1をオフ状態とすることで、ノードN1の電位を保持することができる。また、トランジスタM2をオフ状態とすることで、ノードN2の電位を保持することができる。また、トランジスタM2をオフ状態とした状態で、トランジスタM1を介してノードN1に所定の電位を書き込むことで、容量C1を介した容量結合により、ノードN1の電位の変位に応じてノードN2の電位を変化させることができる。
ここで、トランジスタM1、トランジスタM2のうちの一方または両方に、実施の形態1で例示した、酸化物半導体が適用されたトランジスタを適用することができる。そのため極めて低いオフ電流により、ノードN1及びノードN2の電位を長期間に亘って保持することができる。なお、各ノードの電位を保持する期間が短い場合(具体的には、フレーム周波数が30Hz以上である場合等)には、シリコン等の半導体を適用したトランジスタを用いてもよい。
[駆動方法例]
続いて、図15(B)を用いて、画素回路400の動作方法の一例を説明する。図15(B)は、画素回路400の動作に係るタイミングチャートである。なおここでは説明を容易にするため、配線抵抗などの各種抵抗や、トランジスタや配線などの寄生容量、及びトランジスタのしきい値電圧などの影響は考慮しない。
図15(B)に示す動作では、1フレーム期間を期間T1と期間T2とに分ける。期間T1はノードN2に電位を書き込む期間であり、期間T2はノードN1に電位を書き込む期間である。
〔期間T1〕
期間T1では、配線G1と配線G2の両方に、トランジスタをオン状態にする電位を与える。また、配線S1には固定電位である電位Vrefを供給し、配線S2には第1データ電位Vを供給する。
ノードN1には、トランジスタM1を介して配線S1から電位Vrefが与えられる。また、ノードN2には、トランジスタM2を介して第1データ電位Vが与えられる。したがって、容量C1には電位差V-Vrefが保持された状態となる。
〔期間T2〕
続いて期間T2では、配線G1にはトランジスタM1をオン状態とする電位を与え、配線G2にはトランジスタM2をオフ状態とする電位を与える。また、配線S1には第2データ電位Vdataを供給する。配線S2には所定の定電位を与える、またはフローティング状態としてもよい。
ノードN1には、トランジスタM1を介して第2データ電位Vdataが与えられる。このとき、容量C1による容量結合により、第2データ電位Vdataに応じてノードN2の電位が電位dVだけ変化する。すなわち、回路401には、第1データ電位Vと電位dVを足した電位が入力されることとなる。なお、図15(B)では電位dVが正の値であるように示しているが、負の値であってもよい。すなわち、第2データ電位Vdataが電位Vrefより低くてもよい。
ここで、電位dVは、容量C1の容量値と、回路401の容量値によって概ね決定される。容量C1の容量値が回路401の容量値よりも十分に大きい場合、電位dVは第2データ電位Vdataに近い電位となる。
このように、画素回路400は、2種類のデータ信号を組み合わせて表示素子を含む回路401に供給する電位を生成することができるため、画素回路400内で階調の補正を行うことが可能となる。
また画素回路400は、配線S1及び配線S2に供給可能な最大電位を超える電位を生成することも可能となる。例えば発光素子を用いた場合では、ハイダイナミックレンジ(HDR)表示等を行うことができる。また、液晶素子を用いた場合では、オーバードライブ駆動等を実現できる。
[適用例]
〔液晶素子を用いた例〕
図15(C)に示す画素回路400LCは、回路401LCを有する。回路401LCは、液晶素子LCと、容量C2とを有する。
液晶素子LCは、一方の電極がノードN2及び容量C2の一方の電極と、他方の電極が電位Vcom2が与えられる配線と接続する。容量C2は、他方の電極が電位Vcom1が与えられる配線と接続する。
容量C2は保持容量として機能する。なお、容量C2は不要であれば省略することができる。
画素回路400LCは、液晶素子LCに高い電圧を供給することができるため、例えばオーバードライブ駆動により高速な表示を実現すること、駆動電圧の高い液晶材料を適用することなどができる。また、配線S1または配線S2に補正信号を供給することで、使用温度や液晶素子LCの劣化状態等に応じて階調を補正することもできる。
〔発光素子を用いた例〕
図15(D)に示す画素回路400ELは、回路401ELを有する。回路401ELは、発光素子EL、トランジスタM3、及び容量C2を有する。
トランジスタM3は、ゲートがノードN2及び容量C2の一方の電極と、ソース及びドレインの一方が電位Vが与えられる配線と、他方が発光素子ELの一方の電極と、それぞれ接続される。容量C2は、他方の電極が電位Vcomが与えられる配線と接続する。発光素子ELは、他方の電極が電位Vが与えられる配線と接続する。
トランジスタM3は、発光素子ELに供給する電流を制御する機能を有する。容量C2は保持容量として機能する。容量C2は不要であれば省略することができる。
なお、ここでは発光素子ELのアノード側がトランジスタM3と接続する構成を示しているが、カソード側にトランジスタM3を接続してもよい。そのとき、電位Vと電位Vの値を適宜変更することができる。
画素回路400ELは、トランジスタM3のゲートに高い電位を与えることで、発光素子ELに大きな電流を流すことができるため、例えばHDR表示などを実現することができる。また、また、配線S1または配線S2に補正信号を供給することで、トランジスタM3や発光素子ELの電気特性のばらつきの補正を行うこともできる。
なお、図15(C)、(D)で例示した回路に限られず、別途トランジスタや容量などを追加した構成としてもよい。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
(実施の形態5)
本実施の形態では、本発明の一態様を用いて作製することができる表示モジュールについて説明する。
図16(A)に示す表示モジュール6000は、上部カバー6001と下部カバー6002との間に、FPC6005が接続された表示装置6006、フレーム6009、プリント基板6010、及びバッテリー6011を有する。
例えば、本発明の一態様を用いて作製された表示装置を、表示装置6006に用いることができる。表示装置6006により、極めて消費電力の低い表示モジュールを実現することができる。
上部カバー6001及び下部カバー6002は、表示装置6006のサイズに合わせて、形状や寸法を適宜変更することができる。
表示装置6006はタッチパネルとしての機能を有していてもよい。
フレーム6009は、表示装置6006の保護機能、プリント基板6010の動作により発生する電磁波を遮断する機能、放熱板としての機能等を有していてもよい。
プリント基板6010は、電源回路、ビデオ信号及びクロック信号を出力するための信号処理回路、バッテリー制御回路等を有する。
図16(B)は、光学式のタッチセンサを備える表示モジュール6000の断面概略図である。
表示モジュール6000は、プリント基板6010に設けられた発光部6015及び受光部6016を有する。また、上部カバー6001と下部カバー6002により囲まれた領域に一対の導光部(導光部6017a、導光部6017b)を有する。
表示装置6006は、フレーム6009を間に介してプリント基板6010やバッテリー6011と重ねて設けられている。表示装置6006とフレーム6009は、導光部6017a、導光部6017bに固定されている。
発光部6015から発せられた光6018は、導光部6017aにより表示装置6006の上部を経由し、導光部6017bを通って受光部6016に達する。例えば指やスタイラスなどの被検知体により、光6018が遮られることにより、タッチ操作を検出することができる。
発光部6015は、例えば表示装置6006の隣接する2辺に沿って複数設けられる。受光部6016は、発光部6015と対向する位置に複数設けられる。これにより、タッチ操作がなされた位置の情報を取得することができる。
発光部6015は、例えばLED素子などの光源を用いることができ、特に、赤外線を発する光源を用いることが好ましい。受光部6016は、発光部6015が発する光を受光し、電気信号に変換する光電素子を用いることができる。好適には、赤外線を受光可能なフォトダイオードを用いることができる。
光6018を透過する導光部6017a、導光部6017bにより、発光部6015と受光部6016とを表示装置6006の下側に配置することができ、外光が受光部6016に到達してタッチセンサが誤動作することを抑制できる。特に、可視光を吸収し、赤外線を透過する樹脂を用いると、タッチセンサの誤動作をより効果的に抑制できる。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
(実施の形態6)
本実施の形態では、本発明の一態様の表示装置を適用可能な、電子機器の例について説明する。
図17(A)に示す電子機器6500は、スマートフォンとして用いることのできる携帯情報端末機である。
電子機器6500は、筐体6501、表示部6502、電源ボタン6503、ボタン6504、スピーカ6505、マイク6506、カメラ6507、及び光源6508等を有する。表示部6502はタッチパネル機能を備える。
表示部6502に、本発明の一態様の表示装置を適用することができる。
図17(B)は、筐体6501のマイク6506側の端部を含む断面概略図である。
筐体6501の表示面側には透光性を有する保護部材6510が設けられ、筐体6501と保護部材6510に囲まれた空間内に、表示パネル6511、光学部材6512、タッチセンサパネル6513、プリント基板6517、バッテリー6518等が配置されている。
保護部材6510には、表示パネル6511、光学部材6512、及びタッチセンサパネル6513が図示しない接着層により固定されている。
また、表示部6502よりも外側の領域において、表示パネル6511の一部が折り返されている。また、当該折り返された部分に、FPC6515が接続されている。FPC6515には、IC6516が実装されている。またFPC6515は、プリント基板6517に設けられた端子に接続されている。
表示パネル6511には本発明の一態様のフレキシブルディスプレイパネルを適用することができる。そのため、極めて軽量な電子機器を実現できる。また、表示パネル6511が極めて薄いため、電子機器の厚さを抑えつつ、大容量のバッテリー6518を搭載することもできる。また、表示パネル6511の一部を折り返して、画素部の裏側にFPC6515との接続部を配置することにより、狭額縁の電子機器を実現できる。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
(実施の形態7)
本実施の形態では、本発明の一態様を用いて作製された表示装置を備える電子機器について説明する。
以下で例示する電子機器は、表示部に本発明の一態様の表示装置を備えるものである。したがって、高い解像度が実現された電子機器である。また高い解像度と、大きな画面が両立された電子機器とすることができる。
本発明の一態様の電子機器の表示部には、例えばフルハイビジョン、4K2K、8K4K、16K8K、またはそれ以上の解像度を有する映像を表示させることができる。
電子機器としては、例えば、テレビジョン装置、ノート型のパーソナルコンピュータ、モニタ装置、デジタルサイネージ、パチンコ機、ゲーム機などの比較的大きな画面を備える電子機器の他、デジタルカメラ、デジタルビデオカメラ、デジタルフォトフレーム、携帯電話機、携帯型ゲーム機、携帯情報端末、音響再生装置、などが挙げられる。
本発明の一態様が適用された電子機器は、家屋やビルの内壁または外壁、自動車等の内装または外装等が有する平面または曲面に沿って組み込むことができる。
図18(A)は、ファインダー8100を取り付けた状態のカメラ8000の外観を示す図である。
カメラ8000は、筐体8001、表示部8002、操作ボタン8003、シャッターボタン8004等を有する。またカメラ8000には、着脱可能なレンズ8006が取り付けられている。
なおカメラ8000は、レンズ8006と筐体とが一体となっていてもよい。
カメラ8000は、シャッターボタン8004を押す、またはタッチパネルとして機能する表示部8002をタッチすることにより撮像することができる。
筐体8001は、電極を有するマウントを有し、ファインダー8100のほか、ストロボ装置等を接続することができる。
ファインダー8100は、筐体8101、表示部8102、ボタン8103等を有する。
筐体8101は、カメラ8000のマウントと係合するマウントにより、カメラ8000に取り付けられている。ファインダー8100はカメラ8000から受信した映像等を表示部8102に表示させることができる。
ボタン8103は、電源ボタン等としての機能を有する。
カメラ8000の表示部8002、及びファインダー8100の表示部8102に、本発明の一態様の表示装置を適用することができる。なお、ファインダーが内蔵されたカメラ8000であってもよい。
図18(B)は、ヘッドマウントディスプレイ8200の外観を示す図である。
ヘッドマウントディスプレイ8200は、装着部8201、レンズ8202、本体8203、表示部8204、ケーブル8205等を有している。また装着部8201には、バッテリー8206が内蔵されている。
ケーブル8205は、バッテリー8206から本体8203に電力を供給する。本体8203は無線受信機等を備え、受信した映像情報を表示部8204に表示させることができる。また、本体8203はカメラを備え、使用者の眼球やまぶたの動きの情報を入力手段として用いることができる。
また、装着部8201には、使用者に触れる位置に、使用者の眼球の動きに伴って流れる電流を検知可能な複数の電極が設けられ、視線を認識する機能を有していてもよい。また、当該電極に流れる電流により、使用者の脈拍をモニタする機能を有していてもよい。また、装着部8201には、温度センサ、圧力センサ、加速度センサ等の各種センサを有していてもよく、使用者の生体情報を表示部8204に表示する機能や、使用者の頭部の動きに合わせて表示部8204に表示する映像を変化させる機能を有していてもよい。
表示部8204に、本発明の一態様の表示装置を適用することができる。
図18(C)(D)(E)は、ヘッドマウントディスプレイ8300の外観を示す図である。ヘッドマウントディスプレイ8300は、筐体8301と、表示部8302と、バンド状の固定具8304と、一対のレンズ8305と、を有する。
使用者は、レンズ8305を通して、表示部8302の表示を視認することができる。なお、表示部8302を湾曲して配置させると、使用者が高い臨場感を感じることができるため好ましい。また、表示部8302の異なる領域に表示された別の画像を、レンズ8305を通して視認することで、視差を用いた3次元表示等を行うこともできる。なお、表示部8302を1つ設ける構成に限られず、表示部8302を2つ設け、使用者の片方の目につき1つの表示部を配置してもよい。
なお、表示部8302に、本発明の一態様の表示装置を適用することができる。本発明の一態様の半導体装置を有する表示装置は、極めて精細度が高いため、図18(E)のようにレンズ8305を用いて拡大したとしても、使用者に画素が視認されることなく、より現実感の高い映像を表示することができる。
図19(A)乃至図19(G)に示す電子機器は、筐体9000、表示部9001、スピーカ9003、操作キー9005(電源スイッチ、又は操作スイッチを含む)、接続端子9006、センサ9007(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学物質、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフォン9008、等を有する。
図19(A)乃至図19(G)に示す電子機器は、様々な機能を有する。例えば、様々な情報(静止画、動画、テキスト画像など)を表示部に表示する機能、タッチパネル機能、カレンダー、日付または時刻などを表示する機能、様々なソフトウェア(プログラム)によって処理を制御する機能、無線通信機能、記録媒体に記録されているプログラムまたはデータを読み出して処理する機能、等を有することができる。なお、電子機器の機能はこれらに限られず、様々な機能を有することができる。電子機器は、複数の表示部を有していてもよい。また、電子機器にカメラ等を設け、静止画や動画を撮影し、記録媒体(外部またはカメラに内蔵)に保存する機能、撮影した画像を表示部に表示する機能、等を有していてもよい。
図19(A)乃至図19(G)に示す電子機器の詳細について、以下説明を行う。
図19(A)は、テレビジョン装置9100を示す斜視図である。テレビジョン装置9100は、大画面、例えば、50インチ以上、または100インチ以上の表示部9001を組み込むことが可能である。
図19(B)は、携帯情報端末9101を示す斜視図である。携帯情報端末9101は、例えばスマートフォンとして用いることができる。なお、携帯情報端末9101は、スピーカ9003、接続端子9006、センサ9007等を設けてもよい。また、携帯情報端末9101は、文字や画像情報をその複数の面に表示することができる。図19(B)では3つのアイコン9050を表示した例を示している。また、破線の矩形で示す情報9051を表示部9001の他の面に表示することもできる。情報9051の一例としては、電子メール、SNS、電話などの着信の通知、電子メールやSNSなどの題名、送信者名、日時、時刻、バッテリーの残量、アンテナ受信の強度などがある。または、情報9051が表示されている位置にはアイコン9050などを表示してもよい。
図19(C)は、携帯情報端末9102を示す斜視図である。携帯情報端末9102は、表示部9001の3面以上に情報を表示する機能を有する。ここでは、情報9052、情報9053、情報9054がそれぞれ異なる面に表示されている例を示す。例えば使用者は、洋服の胸ポケットに携帯情報端末9102を収納した状態で、携帯情報端末9102の上方から観察できる位置に表示された情報9053を確認することもできる。使用者は、携帯情報端末9102をポケットから取り出すことなく表示を確認し、例えば電話を受けるか否かを判断できる。
図19(D)は、腕時計型の携帯情報端末9200を示す斜視図である。携帯情報端末9200は、例えばスマートウォッチとして用いることができる。また、表示部9001はその表示面が湾曲して設けられ、湾曲した表示面に沿って表示を行うことができる。また、携帯情報端末9200は、例えば無線通信可能なヘッドセットと相互通信することによって、ハンズフリーで通話することもできる。また、携帯情報端末9200は、接続端子9006により、他の情報端末と相互にデータ伝送を行うことや、充電を行うこともできる。なお、充電動作は無線給電により行ってもよい。
図19(E)(F)(G)は、折り畳み可能な携帯情報端末9201を示す斜視図である。また、図19(E)は携帯情報端末9201を展開した状態、図19(G)は折り畳んだ状態、図19(F)は図19(E)と図19(G)の一方から他方に変化する途中の状態の斜視図である。携帯情報端末9201は、折り畳んだ状態では可搬性に優れ、展開した状態では継ぎ目のない広い表示領域により表示の一覧性に優れる。携帯情報端末9201が有する表示部9001は、ヒンジ9055によって連結された3つの筐体9000に支持されている。例えば、表示部9001は、曲率半径1mm以上150mm以下で曲げることができる。
図20(A)にテレビジョン装置の一例を示す。テレビジョン装置7100は、筐体7101に表示部7500が組み込まれている。ここでは、スタンド7103により筐体7101を支持した構成を示している。
図20(A)に示すテレビジョン装置7100の操作は、筐体7101が備える操作スイッチや、別体のリモコン操作機7111により行うことができる。または、表示部7500にタッチパネルを適用し、これに触れることでテレビジョン装置7100を操作してもよい。リモコン操作機7111は、操作ボタンの他に表示部を有していてもよい。
なお、テレビジョン装置7100は、テレビ放送の受信機や、ネットワーク接続のための通信装置を有していてもよい。
図20(B)に、ノート型パーソナルコンピュータ7200を示す。ノート型パーソナルコンピュータ7200は、筐体7211、キーボード7212、ポインティングデバイス7213、外部接続ポート7214等を有する。筐体7211に、表示部7500が組み込まれている。
図20(C)、(D)に、デジタルサイネージ(Digital Signage:電子看板)の一例を示す。
図20(C)に示すデジタルサイネージ7300は、筐体7301、表示部7500、及びスピーカ7303等を有する。さらに、LEDランプ、操作キー(電源スイッチ、または操作スイッチを含む)、接続端子、各種センサ、マイクロフォン等を有することができる。
また、図20(D)は円柱状の柱7401に取り付けられたデジタルサイネージ7400である。デジタルサイネージ7400は、柱7401の曲面に沿って設けられた表示部7500を有する。
表示部7500が広いほど、一度に提供できる情報量を増やすことができ、また人の目につきやすいため、例えば広告の宣伝効果を高める効果を奏する。
表示部7500にタッチパネルを適用し、使用者が操作できる構成とすると好ましい。これにより、広告用途だけでなく、路線情報や交通情報、商用施設の案内情報など、使用者が求める情報を提供するための用途にも用いることができる。
また、図20(C)、(D)に示すように、デジタルサイネージ7300またはデジタルサイネージ7400は、ユーザが所持するスマートフォン等の情報端末機7311と無線通信により連携可能であることが好ましい。例えば、表示部7500に表示される広告の情報を情報端末機7311の画面に表示させることや、情報端末機7311を操作することで、表示部7500の表示を切り替えることができる。
また、デジタルサイネージ7300またはデジタルサイネージ7400に、情報端末機7311を操作手段(コントローラ)としたゲームを実行させることもできる。これにより、不特定多数のユーザが同時にゲームに参加し、楽しむことができる。
図20(A)乃至(D)における表示部7500に、本発明の一態様の表示装置を適用することができる。
本実施の形態の電子機器は表示部を有する構成としたが、表示部を有さない電子機器にも本発明の一態様を適用することができる。
本実施の形態は、少なくともその一部を本明細書中に記載する他の実施の形態と適宜組み合わせて実施することができる。
本実施例では、金属酸化物膜に対して不純物元素を添加した試料(試料A1)と、金属酸化物膜に水素を供給した試料(試料A2)を作製し、そのシート抵抗を評価した。
[試料の作製]
〔試料A1〕
試料A1は、ガラス基板上に形成された第1の酸化窒化シリコン膜上に、島状の金属酸化物膜を有し、当該金属酸化物膜に対して、第2の酸化窒化シリコン膜越しにイオンドーピング法によりホウ素を添加した試料である。また、第2の酸化窒化シリコン膜はホウ素の添加後に除去し、新たに第3の酸化窒化シリコン膜で金属酸化物膜を覆った後に、金属酸化物膜に達する開口を形成して、端子を設けた。
試料A1において、金属酸化物膜には、厚さ約40nmのIn-Ga-Zn酸化物を用いた。またホウ素の添加条件は、金属酸化物膜と第2の酸化窒化シリコン膜との界面近傍が最も濃度が高くなる条件とした。
〔試料A2〕
試料A2は、ガラス基板上に形成された第1の酸化窒化シリコン膜上に、島状の金属酸化物膜を有し、当該金属酸化物膜に接して、水素を含む窒化シリコン膜、及び第4の酸化窒化シリコン膜を成膜した後に、加熱処理を行なった試料である。また、第4の酸化窒化シリコン膜を形成した後に、金属酸化物膜に達する開口を形成して、端子を設けた。
試料A2において、金属酸化物膜は試料A1と同じ条件で形成した。窒化シリコン膜は、成膜ガスとしてSiHガス、Nガス及びNHガスの混合ガスを用いたプラズマCVD法により成膜した。加熱処理は、窒素雰囲気下、350℃、1時間の条件で行った。
[シート抵抗]
作製した試料A1及び試料A2について、シート抵抗を測定した結果を図21に示す。
図21に示すように、試料A1のシート抵抗値は約380Ω/□であり、試料A2は約240Ω/□であり、両者共に低抵抗化していることが確認できる。なお、低抵抗化の処理を行なわずに、十分にキャリア濃度が低減された金属酸化物膜のシート抵抗値は、測定器の検出上限以上(例えば5MΩ/□以上)となる。
また、水素を供給した試料A2は、不純物元素を添加した試料A1と比較して低抵抗である。このことから、金属酸化物膜に不純物元素を添加し、さらに水素を供給することで、試料A1及び試料A2よりもさらにキャリア密度が増大し、低抵抗化することが示唆される。
以上の結果から、本発明の一態様のトランジスタにおいて、チャネル形成領域(第1の領域)を挟む第2の領域には不純物元素を添加した金属酸化物を用いることで、比較的高抵抗なLDD領域とし、さらにその外側の第3の領域には、不純物元素を添加した後に水素を供給することで、極めて低抵抗なソース領域またはドレイン領域とすることができることが分かった。
本実施例では、金属酸化物膜に接して窒化アルミニウム膜を成膜して低抵抗化を図った試料(試料B1)を作製し、そのシート抵抗を評価した。
[試料の作製]
〔試料B1〕
試料B1は、ガラス基板上に形成された第1の酸化窒化シリコン膜上に、島状の金属酸化物膜を有し、当該金属酸化物膜に接して、窒化アルミニウム膜を成膜した後に第1の加熱処理を行なった試料である。また、第1の加熱処理の後に酸化アルミニウム膜、及び第2の酸化窒化シリコン膜を成膜し、さらに第2の加熱処理を行なった後、金属酸化物膜に達する開口を形成して、端子を設けた。
試料B1において、金属酸化物膜は実施例1で例示した試料A1と同じ条件で形成した。酸化アルミニウム膜は、アルミニウムターゲットを用い、成膜ガスにNガスとArガスの混合ガスを用いた反応性スパッタリング法により形成した。第1の加熱処理及び第2の加熱処理は、それぞれ窒素雰囲気下、350℃、1時間の条件で行った。
[シート抵抗]
実施例1で例示した試料A1と、作製した試料B1について、シート抵抗を測定した結果を図22に示す。
図22に示すように、試料A1のシート抵抗値は約380Ω/□であり、試料B1は約270Ω/□であり、両者共に低抵抗化していることが確認できる。なお、低抵抗化の処理を行なわずに、十分にキャリア濃度が低減された金属酸化物膜のシート抵抗値は、測定器の検出上限以上(例えば5MΩ/□以上)となる。
また、金属酸化物膜に接して窒化アルミニウム膜を成膜した試料B1は、不純物元素を添加した試料A1と比較して低抵抗である。このことから、金属酸化物膜に不純物元素を添加し、さらにこれに接して窒化アルミニウム膜等の酸素を吸引しやすい膜を成膜することで、試料A1及び試料B1よりもさらにキャリア密度が増大し、低抵抗化することが示唆される。
以上の結果から、本発明の一態様のトランジスタにおいて、チャネル形成領域(第1の領域)を挟む第2の領域には不純物元素を添加した金属酸化物を用いることで、比較的高抵抗なLDD領域とし、さらにその外側の第3の領域上には、酸素を吸引しやすい膜を成膜することで、極めて極めて低抵抗なソース領域またはドレイン領域とすることができることが分かった。
100、100A:トランジスタ、102:基板、103:絶縁層、103d:領域、106:導電層、108、108a、b:半導体層、108L、108N:領域、110:絶縁層、110d:領域、110f:絶縁膜、112:導電層、112f:導電膜、114:金属酸化物層、114f:金属酸化物膜、115:レジストマスク、116、118:絶縁層、120a、b:導電層、140:不純物元素、141a、b、142:開口部

Claims (8)

  1. トランジスタを有する半導体装置であって、
    前記トランジスタのチャネル形成領域を有する第1の金属酸化物層と、第2の金属酸化物層と、第1の絶縁層と、第2の絶縁層と、第1の導電層と、を有し、
    前記第1の絶縁層は、前記第1の金属酸化物層上に設けられ、
    前記第2の金属酸化物層は、前記第1の絶縁層上に設けられ、
    前記第1の導電層は、前記第1の金属酸化物層上に設けられ、
    前記第2の絶縁層は、前記第1の金属酸化物、前記第1の絶縁層及び前記第1の導電層上に設けられ、
    前記トランジスタのチャネル長方向における断面視において、前記第1の絶縁層の端部は、前記第1の金属酸化物層上に位置し、
    前記第1の絶縁層は、前記第2の金属酸化物層及び前記第1の導電層と重なる領域と、前記第2の金属酸化物層及び前記第1の導電層と重ならない領域と、を有し、
    前記第1の金属酸化物層は、前記第1の導電層、前記第2の金属酸化物層及び前記第1の絶縁層と重なる第1の領域と、前記第2の金属酸化物層及び前記第1の導電層とは重ならず、前記第1の絶縁層と重なる第2の領域と、前記第2の絶縁層と接する第3の領域と、を有し、
    前記第2の絶縁層は、前記第1の導電層の上面及び側面に接する領域と、前記第2の金属酸化物層の側面に接する領域と、前記第1の絶縁層の上面及び側面に接する領域と、前記第3の領域の上面及び側面に接する領域と、を有し、
    前記第1の金属酸化物層及び前記第2の金属酸化物層の各々は、インジウム及びガリウムを含み、
    前記第2の金属酸化物層は、前記第1の金属酸化物層よりもガリウムを多く含み、
    前記第2の絶縁層は、前記第1の絶縁層よりも水素を多く含み、
    前記第2の領域及び前記第3の領域は、第1の元素を含み、
    前記第3の領域は、前記第2の領域よりも前記第1の元素を多く含み、
    前記第1の元素は、ホウ素、リン、アルミニウム、及びマグネシウムから選ばれる一以上の元素であり、
    前記第1の元素は、酸素と結合した状態で存在する、半導体装置。
  2. トランジスタを有する半導体装置であって、
    前記トランジスタのチャネル形成領域を有する第1の金属酸化物層と、第2の金属酸化物層と、第1の絶縁層と、第2の絶縁層と、第1の導電層と、を有し、
    前記第1の絶縁層は、前記第1の金属酸化物層上に設けられ、
    前記第2の金属酸化物層は、前記第1の絶縁層上に設けられ、
    前記第1の導電層は、前記第1の金属酸化物層上に設けられ、
    前記第2の絶縁層は、前記第1の金属酸化物、前記第1の絶縁層及び前記第1の導電層上に設けられ、
    前記トランジスタのチャネル長方向における断面視において、前記第1の絶縁層の端部は、前記第1の金属酸化物層上に位置し、
    前記第1の絶縁層は、前記第2の金属酸化物層及び前記第1の導電層と重なる領域と、前記第2の金属酸化物層及び前記第1の導電層と重ならない領域と、を有し、
    前記第1の金属酸化物層は、前記第1の導電層、前記第2の金属酸化物層及び前記第1の絶縁層と重なる第1の領域と、前記第2の金属酸化物層及び前記第1の導電層とは重ならず、前記第1の絶縁層と重なる第2の領域と、前記第2の絶縁層と接する第3の領域と、を有し、
    前記第2の絶縁層は、前記第1の導電層の上面及び側面に接する領域と、前記第2の金属酸化物層の側面に接する領域と、前記第1の絶縁層の上面及び側面に接する領域と、前記第3の領域の上面及び側面に接する領域と、を有し、
    前記第1の金属酸化物層及び前記第2の金属酸化物層の各々は、インジウム及びガリウムを含み、
    前記第2の金属酸化物層は、前記第1の金属酸化物層よりもガリウムを多く含み、
    前記第2の絶縁層は、アルミニウム、チタン、タンタル、タングステン、クロム、またはルテニウムから選ばれる一以上の元素と、窒素とを含み、
    前記第2の領域及び前記第3の領域は、第1の元素を含み、
    前記第3の領域は、前記第2の領域よりも前記第1の元素を多く含み、
    前記第1の元素は、ホウ素、リン、アルミニウム、及びマグネシウムから選ばれる一以上の元素であり、
    前記第1の元素は、酸素と結合した状態で存在する、半導体装置。
  3. 請求項1又は2において、
    前記第1の絶縁層の、前記第2の金属酸化物層及び前記第1の導電層と重ならない領域は、前記第1の元素を含み、
    前記第1の絶縁層の、前記第2の金属酸化物層及び前記第1の導電層と重ならない領域において、前記第1の元素は、酸素と結合した状態で存在する、半導体装置。
  4. 請求項1乃至のいずれか一において、
    前記第1の絶縁層は、酸化物を含む、半導体装置。
  5. 請求項乃至4のいずれか一において、
    前記第2の絶縁層は、窒化物を含む、半導体装置。
  6. 請求項1乃至のいずれか一において、
    第2の導電層と、第3の絶縁層と、をさらに有し、
    前記第3の絶縁層は、前記第2の導電層を覆って設けられ、
    前記第1の金属酸化物層は、前記第3の絶縁層上に設けられ、
    前記第2の導電層は、前記第3の絶縁層を介して前記第1の金属酸化物層、前記第1の絶縁層、前記第2の金属酸化物層及び前記第1の導電層と重畳する部分を有する、半導体装置。
  7. 第1の金属酸化物層を形成する工程と、
    前記第1の金属酸化物層上に、酸化物を含む第1の絶縁膜を形成する工程と、
    前記第1の絶縁膜上に金属酸化物膜を形成する工程と、
    前記金属酸化物膜上に第1の導電膜を形成する工程と、
    前記第1の導電膜、前記金属酸化物膜及び前記第1の絶縁膜をエッチングして、第1の導電層と、第2の金属酸化物層と、前記第1の導電層及び前記第2の金属酸化物層の側面よりも突出した部分を有する第1の絶縁層とを形成すると共に、前記第1の金属酸化物前記第1の絶縁層に覆われない部分を形成する工程と、
    前記第1の導電層及び前記第2の金属酸化物層をマスクとして、前記第1の絶縁層及び前記第1の金属酸化物層中に第1の元素を供給する工程と、
    前記第1の金属酸化物層の、前記第1の絶縁層に覆われない部分に接して、水素を含む第2の絶縁層をプラズマCVD法により成膜する工程と
    前記第2の絶縁層の形成後、加熱処理を行なって前記第1の金属酸化物層に水素を供給する工程と、を有し、
    前記第1の金属酸化物層及び前記第2の金属酸化物層の各々は、インジウム及びガリウムを含み、
    前記第2の金属酸化物層は、前記第1の金属酸化物層よりもガリウムを多く含み、
    前記第1の元素は、ホウ素、リン、アルミニウム、またはマグネシウムである、半導体装置の作製方法。
  8. 請求項において、
    記第1の元素は、プラズマイオンドーピング法またはイオン注入法を用いて供給される、半導体装置の作製方法。
JP2020505554A 2018-03-16 2019-03-05 半導体装置、および半導体装置の作製方法 Active JP7242633B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2023035911A JP2023060293A (ja) 2018-03-16 2023-03-08 半導体装置

Applications Claiming Priority (5)

Application Number Priority Date Filing Date Title
JP2018048802 2018-03-16
JP2018048800 2018-03-16
JP2018048802 2018-03-16
JP2018048800 2018-03-16
PCT/IB2019/051751 WO2019175708A1 (ja) 2018-03-16 2019-03-05 半導体装置、および半導体装置の作製方法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2023035911A Division JP2023060293A (ja) 2018-03-16 2023-03-08 半導体装置

Publications (3)

Publication Number Publication Date
JPWO2019175708A1 JPWO2019175708A1 (ja) 2021-03-25
JPWO2019175708A5 JPWO2019175708A5 (ja) 2022-03-11
JP7242633B2 true JP7242633B2 (ja) 2023-03-20

Family

ID=67908732

Family Applications (2)

Application Number Title Priority Date Filing Date
JP2020505554A Active JP7242633B2 (ja) 2018-03-16 2019-03-05 半導体装置、および半導体装置の作製方法
JP2023035911A Pending JP2023060293A (ja) 2018-03-16 2023-03-08 半導体装置

Family Applications After (1)

Application Number Title Priority Date Filing Date
JP2023035911A Pending JP2023060293A (ja) 2018-03-16 2023-03-08 半導体装置

Country Status (3)

Country Link
US (1) US11799032B2 (ja)
JP (2) JP7242633B2 (ja)
WO (1) WO2019175708A1 (ja)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113140637A (zh) * 2020-01-20 2021-07-20 京东方科技集团股份有限公司 显示装置、阵列基板、薄膜晶体管及其制造方法
KR20210123003A (ko) * 2020-04-02 2021-10-13 엘지디스플레이 주식회사 산화물 반도체 박막 트랜지스터 및 그 제조 방법
US20210399136A1 (en) 2020-06-18 2021-12-23 Taiwan Semiconductor Manufacturing Co., Ltd. Semiconductor device and manufacturing method thereof
US11404543B2 (en) * 2020-06-19 2022-08-02 Taiwan Semiconductor Manufacturing Company, Ltd. Semiconductor device and manufacturing method thereof

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017028252A (ja) 2015-05-22 2017-02-02 株式会社半導体エネルギー研究所 半導体装置、該半導体装置を有する表示装置
JP2017079330A (ja) 2015-10-20 2017-04-27 株式会社半導体エネルギー研究所 半導体装置の作製方法

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011074407A1 (en) 2009-12-18 2011-06-23 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
JP5708910B2 (ja) 2010-03-30 2015-04-30 ソニー株式会社 薄膜トランジスタおよびその製造方法、並びに表示装置
JP2012209543A (ja) 2011-03-11 2012-10-25 Semiconductor Energy Lab Co Ltd 半導体装置
JP6035195B2 (ja) 2012-05-01 2016-11-30 株式会社半導体エネルギー研究所 半導体装置の作製方法
KR102071545B1 (ko) 2012-05-31 2020-01-30 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치
JP6506545B2 (ja) * 2013-12-27 2019-04-24 株式会社半導体エネルギー研究所 半導体装置
US9577110B2 (en) * 2013-12-27 2017-02-21 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device including an oxide semiconductor and the display device including the semiconductor device
US9443876B2 (en) 2014-02-05 2016-09-13 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, display device including the semiconductor device, display module including the display device, and electronic device including the semiconductor device, the display device, and the display module
US9935633B2 (en) * 2015-06-30 2018-04-03 Semiconductor Energy Laboratory Co., Ltd. Logic circuit, semiconductor device, electronic component, and electronic device

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017028252A (ja) 2015-05-22 2017-02-02 株式会社半導体エネルギー研究所 半導体装置、該半導体装置を有する表示装置
JP2017079330A (ja) 2015-10-20 2017-04-27 株式会社半導体エネルギー研究所 半導体装置の作製方法

Also Published As

Publication number Publication date
US11799032B2 (en) 2023-10-24
JP2023060293A (ja) 2023-04-27
JPWO2019175708A1 (ja) 2021-03-25
WO2019175708A1 (ja) 2019-09-19
US20210005752A1 (en) 2021-01-07

Similar Documents

Publication Publication Date Title
JP7242633B2 (ja) 半導体装置、および半導体装置の作製方法
JP7183184B2 (ja) 半導体装置
JP7344707B2 (ja) 半導体装置の作製方法
WO2020089726A1 (ja) 半導体装置
JP7462087B2 (ja) 半導体装置
JP2023106446A (ja) 半導体装置
JP2023166508A (ja) 半導体装置の作製方法
JP2023118763A (ja) 半導体装置の作製方法
JP7475282B2 (ja) 半導体装置
JP2023017043A (ja) 半導体装置
US20230420571A1 (en) Semiconductor device
JP2024037777A (ja) 半導体装置の作製方法
WO2020089762A1 (ja) 半導体装置
JP7275112B2 (ja) 半導体装置
US20240136442A1 (en) Semiconductor device and method for manufacturing semiconductor device
WO2020012276A1 (ja) 半導体装置

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20220303

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20220303

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20220927

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20221121

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20230126

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20230207

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20230308

R150 Certificate of patent or registration of utility model

Ref document number: 7242633

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150