JP7139552B2

JP7139552B2 - 半導体集積回路の配線設計装置及び半導体集積回路の配線設計用プログラム

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Publication number: JP7139552B2
Application number: JP2019125804A
Authority: JP
Inventors: 智洋長谷川
Original assignee: Toshiba Information Systems Japan Corp
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Priority date: 2019-07-05
Filing date: 2019-07-05
Publication date: 2022-09-21
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Description

この発明は、半導体集積回路の配線設計装置及び半導体集積回路の配線設計用プログラムに関するものである。

従来、半導体集積回路の設計の素子配置工程においては、できる限りサイズを小さくすることを優先し、デッドスペースを作らない配置プランを作ることが一般的である。例えば、特許文献１には、セル上フィードスルーの使用効率上昇を図り、配線の迂回を減少させて、チップ全体の面積を小さくする配線設計用ＣＡＤ装置が開示されている。しかし、ほとんどのケースでは配置の段階で結線に要する配線トラックの利用効率まで考慮されておらず、配置効率を優先するが故に配線効率、品質の悪化を招来する可能性があった。

素子が格子状に配置されている場合、幹線から素子のピンまで最短距離で結線しようとすると、上下に配置されている素子と配線トラックが重なり合うことになり、配線ショートが発生することとなった。

また、どの座標からでも支線と結線できるようにセルのピン形状を長くすることが考えられる（図１）。即ち、ピンＰ１は幹線配線Ｍ１の区間Ｍ１１で直線的に接続されれば良く、また、Ｐ２は幹線配線Ｍ２の区間Ｍ２２で直線的に接続されれば良い。しかし、区間Ｍ１１と区間Ｍ２２は同じ直線上に配置する訳にはいかず、図の上下方向にずれた位置に配置せざるを得ない。同様に、ピンＰ３は幹線配線Ｍ３の区間Ｍ３３で直線的に接続されれば良く、また、Ｐ４は幹線配線Ｍ４の区間Ｍ４４で直線的に接続されれば良い。しかし、区間Ｍ３３と区間Ｍ４４は同じ直線上に配置する訳にはいかず、図の上下方向にずれた位置に配置せざるを得ない。このように支線の迂回配線は回避できるが、幹線の配線時にピンの座標から終点を特定できなくなるため、二重配線トラックを作ってしまう問題もある。

特許文献２には、配線レイアウトの設計方法が開示されている。この設計手法は、側壁法と呼ばれる手法を用いる。側壁法を前提としたレイアウトの設計方法であって、第１の方向に延び、前記第１の方向と交差する第２の方向に第１の周期で配置された複数本の第１のパターン、及び、前記第１の方向に延び、前記第１のパターン間の中央にそれぞれ配置された複数本の第２のパターンが設けられたベースパターンを用意する工程を備える。更に、１本の前記第２のパターンを挟んで隣り合う２本の前記第１のパターン間に、前記第２の方向に延び、前記２本の第１のパターン同士を接続すると共に、前記１本の第２のパターンを前記２本の第１のパターンと接しない２つのパターンに置き換える工程と、を備える。これにより高集積度を実現するものである。

特許文献３には、配線後の入力レイアウトデータの配線パターンの配線毎の配線幅を検出したり、配線領域毎の配線密度を検出したりする。そして、上記の検出結果に基づいて、プロセスによって決まる配線幅・配線密度条件を用いて、ＣＭＰの際に段差が発生しやすい太幅配線や配線密度の高い領域を特定する。その後、上記により特定された太幅配線や配線領域の周辺領域に存在し、円錐部の高いエアギャップが形成される配線間隔箇所を検出し、その検出結果に基づいてエアギャップ生成領域を生成又は削除する手法が開示されている。

特許文献４には、チップサイズの増大を防止しつつ、厳格なデザインルールおよびチップの平坦性を考慮した、効率的な電源配線のレイアウト設計を実現する手法が開示されている。具体的には、電源配線補強実施部が電源配線の補強を行う際に、一般配線との関係も考慮してレイアウトを決定する。また、配線面積率制約判定部が測定した各配線層の配線面積率を参照し、面積率の最も低い配線層を優先的に用いて配線の補強を実施する。補強配線には、補強配線属性付与部が属性情報を付与し、一般配線の設計変更があったときは、その属性情報に基づき、補強配線削除部が補強配線を一括削除し、レイアウト設計のやり直しを可能とするものである。

特開平５－３０４２０９号公報特開２０１３－６１５７５号公報特開２００８－２０５２８３号公報特開２００５－２４３８８６号公報

本実施形態では、事前に配線工程を考慮してセル配置することによって、必要な座標計算を単純化して自動配置配線する半導体集積回路の配線設計装置を提供する。

実施形態に係る半導体集積回路の配線設計装置は、セルの位置情報及び大きさ情報、前記セル内のピンの位置情報及び大きさ情報、幹線配線の位置情報及び大きさ情報を含む配線設計情報に基づき、複数の幹線配線中の所定数本の幹線配線を始点とし前記幹線配線に直交する幹線始点支線と、セル内のピンを始点とし前記幹線配線に直交するように延びるピン始点支線とを発生する始点支線発生手段と、発生された前記幹線始点支線と発生された前記ピン始点支線とに関する発生支線情報及び前記配線設計情報に基づき、発生された前記幹線始点支線と発生された前記ピン始点支線が他の配線に重ならぬように最短距離で接続する最短距離接続手段とを具備することを特徴とする。

従来の配線手法を示す配線部分の平面図。本発明に係る半導体集積回路の配線設計装置の実施形態の構成を示すブロック図。本発明に係る半導体集積回路の配線設計装置の実施形態の機能構成を示すブロック図。本発明に係る半導体集積回路の配線設計装置の実施形態により配線設計されるセルの構成を示す図。本発明に係る半導体集積回路の配線設計装置の第１の実施形態の動作を示すフローチャート（前半）。本発明に係る半導体集積回路の配線設計装置の第１の実施形態の動作を示すフローチャート（後半）。本発明に係る半導体集積回路の配線設計装置の第１の実施形態の配線動作手順を示す平面図（その１）。本発明に係る半導体集積回路の配線設計装置の第１の実施形態の配線動作手順を示す平面図（その２）。本発明に係る半導体集積回路の配線設計装置の第１の実施形態の配線動作手順により完成した配線の平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線ルール（その１）を示す平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線ルール（その２）を示す平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線ルール（その３）を示す平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線ルール（その４）を示す平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の動作を示すフローチャート。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線動作手順により完成した配線の平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線動作手順を詳細に説明する配線の要部平面図。本発明に係る半導体集積回路の配線設計装置の第２の実施形態の配線動作手順により、１群の幹線配線の両方の側部に対してセル群が配置される半導体集積回路について第２の実施形態を適用した場合により完成した配線の平面図。

以下添付図面を参照して、本発明に係る半導体集積回路の配線設計装置及び半導体集積回路の配線設計用プログラムの実施形態を説明する。各図において同一の構成要素には、同一の符号を付して重複する説明を省略する。図２に実施形態に係る半導体集積回路の配線設計装置１００のブロック図を示す。半導体集積回路の配線設計装置１００は、サーバコンピュータ、パーソナルコンピュータ、その他のコンピュータにより構成することができる。

半導体集積回路の配線設計装置１００は、ＣＰＵ１０１が主メモリ１０２のプログラムやデータに基づき演算を行うものである。ＣＰＵ１０１には、バス１０３及び外部記憶インタフェース３０４を介して外部記憶装置１０４が接続されており、外部記憶装置１０４には、半導体集積回路の配線設計用プログラムが記憶されている。ＣＰＵ１０１が外部記憶装置１０４から半導体集積回路の配線設計用プログラムを主メモリ１０２へ読み出してこのプログラムを実行することにより半導体集積回路の配線設計装置１００として機能する。

バス１０３には、外部記憶装置１０４以外に配線設計用情報供給部インタフェース３０５を介して半導体集積回路の配線設計用情報供給部１０５が接続されている。配線設計用情報供給部１０５は、外部の入力装置などから配線設計用情報を入力して保持するものとすることができ、或いは、外部の何らかの装置等で既に作成された配線設計用情報を取り込み保持したものとすることができる。更に、クライアントから提供された配線設計用情報を記憶した媒体がセットされることにより、配線設計用情報を保持し供給可能となっている装置であっても良い。更に、上記の構成を全て備えたものであっても良い。いずれにしても、ＣＰＵ１０１が半導体集積回路の配線設計用プログラムを実行して配線設計用情報に基づき配線設計を行う場合には配線設計用情報はこの配線設計用情報供給部１０５から供給される。

配線設計用情報は、配線を行うために必要な情報であって、セルの位置情報及び大きさ情報、前記セル内のピンの位置情報及び大きさ情報、幹線配線の位置情報及び大きさ情報を含むものであリ、接続すべきピンの識別情報と幹線配線の識別情報のペアが含まれる。なお、大きさ情報は、セル、ピン、幹線配線のいずれのものについても、例えば四角の枠により規定されるものとし、四角形における対角線により結ばれる２つの角の座標によって表すものとすることができる。また、半導体集積回路自体については、設計済みであっても未設計であっても良く、上記配線設計用情報が作成されていれば良い。

バス１０３には、出力部インタフェース３０６を介して結果出力部１０６が接続されている。結果出力部１０６は、表示装置やプリンタなど、半導体集積回路の設計装置１００において処理した結果を出力する装置とすることができる。また、結果出力部１０６は、半導体集積回路の配線設計装置１００において処理した結果を記憶する媒体でもよく、更に、回線などを介して処理の依頼者（クライアント）へ処理結果を送信などする装置であっても良い。

本実施形態では、外部記憶装置１０４に記憶されている半導体集積回路の配線設計用プログラムが実行されることにより、図３に示される各手段が実現される。即ち、半導体集積回路の配線設計装置１００は、図３に示されるように、始点支線発生手段２０１、最短距離接続手段２０２を具備している。

始点支線発生手段２０１は、セルの位置情報及び大きさ情報、上記セル内のピンの位置情報及び大きさ情報、幹線配線の位置情報及び大きさ情報を含む配線設計情報に基づき、複数の幹線配線中の所定数本の幹線配線を始点とし上記幹線配線に直交する幹線始点支線と、セル内のピンを始点とし上記幹線配線に直交するように延びるピン始点支線とを発生するものである。

最短距離接続手段２０２は、発生された上記幹線始点支線と発生された上記ピン始点支線とに関する発生支線情報及び上記配線設計情報に基づき、発生された上記幹線始点支線と発生された上記ピン始点支線が他の配線に重ならぬように最短距離で接続するものである。

本実施形態では、半導体集積回路の配線設計装置１００は、同じ大きさのセルであって、セル内の同じ位置にピンが配置されているセルが図４の如く縦横に複数並べられた半導体集積回路について配線設計を行う。図４は、４行４列でセルＣ１～Ｃ１６が並べられたものである。各セルＣ１～Ｃ１６の領域内に示されている２つのドットは、ピン位置を示している。

本実施形態では、前記最短距離接続手段２０２は、上記幹線始点支線または上記ピン始点支線が他の配線と重なる場合には、上記幹線始点支線と上記ピン始点支線に直交する接続線を発生させて上記幹線始点支線と上記ピン始点支線とを接続する。また、最短距離接続手段２０２は、複数本の幹線配線に最も近接するセルのピンと幹線配線との間については、発生された上記幹線始点支線と発生された上記ピン始点支線とを直接接続した直線支線により接続を行う。

本実施形態では、前記始点支線発生手段２０１は、上記複数の幹線配線から数えて第１行目のセルにおけるピンと接続する幹線始点支線に隣接させて、複数の幹線配線から数えて第２行目のセルにおけるピンと接続する幹線始点支線を発生させる。また、上記複数の幹線配線から数えて第２行目のセルにおけるピンと接続する幹線始点支線に隣接させて、複数の幹線配線から数えて第３行目のセルにおけるピンと接続する幹線始点支線を発生させる。以下同様に、前行のセルにおけるピンと接続する幹線始点支線と次行のセルにおけるピンと接続する幹線始点支線とを隣接させて幹線始点支線を発生させる。

以上の構成を有する第１の実施形態は、図５、図６に示されるフローチャートに対応するプログラムが実行されることにより実現される。本実施形態では、４列４行のセルであり、コラムｉを１とし、ロウｊを１とする（Ｓ１１）。ピンを始点とするピン始点支線を発生し（Ｓ１２）、このピン始点支線と直交する所要幹線配線の位置を始点として幹線始点支線を発生させる（Ｓ１３）。ロウｊ＝１であり、最も幹線配線に近い行のセルであるからピン始点支線と幹線始点支線を直線により接続して（コラムｉ，ロウｊ）＝（１，１）の支線発生を完了する（Ｓ１４）。

次にコラムｉを１歩進し（Ｓ１５）、コラムｉ＝５となっていないかを検出する（Ｓ１６）。コラムｉ＝５となっていない場合には、ステップＳ１２へ戻って処理を続ける。ステップＳ１６においてコラムｉ＝５となっていることが検出された場合にはコラムｉ＝１として（Ｓ１７）、図６のフローチャートへ進み、ロウｊを１歩進し（Ｓ２１）、ロウｊ＝５となっていないかを検出する（Ｓ２２）。ロウｊ＝５となっていない場合には、ピンを始点とするピン始点支線Ｐ２１を発生し（Ｓ２３）、他の配線と重なりがないかを検出する（Ｓ２４）。この例では、重なりが生じるのでＹＥＳへ分岐し、上記複数の幹線配線ＭＭから数えて第１行目のセルＣ１におけるピンと接続する幹線始点支線Ｂ１１に隣接させて、複数の幹線配線ＭＭから数えて第２行目のセルＣ５におけるピンと接続する幹線始点支線Ｂ２１を発生させる（Ｓ２５）。この様子を図７に示す。

次に、上記は、幹線始点支線Ｂ２１または上記ピン始点支線Ｐ２１が他の配線と重なる場合に相当するので、上記幹線始点支線Ｂ２１と上記ピン始点支線Ｐ２１に直交する接続線Ｊ２１を発生させて上記幹線始点支線Ｂ２１と上記ピン始点支線Ｐ２１とを接続する（Ｓ２６）。この様子を図８に示す。

ステップＳ２６の次には、コラムｉを１歩進し（Ｓ２７）、コラムｉ＝５となっていないかを検出する（Ｓ２８）。コラムｉ＝５となっていない場合には、ステップＳ２３へ戻って処理を続ける。上記ステップＳ２８においてコラムｉ＝５となっていることが検出された場合には、コラムｉ＝１として（Ｓ２９）、次の行のセル内のピンからのピン始点支線の発生処理を行うためにステップＳ２１へ戻る。このため、以下同様に、前行のセルにおけるピンと接続する幹線始点支線と次行のセルにおけるピンと接続する幹線始点支線とを隣接させて幹線始点支線を発生させる処理が行われる（Ｓ２１～Ｓ２９）。

本実施形態では、４行分の処理が行われたときに、ステップＳ２２においてＹＥＳへ分岐することになり、処理は終了となる。このときに、図９に示すように全てのセルＣ１～Ｃ１６のピンと複数の幹線配線ＭＭの対応する幹線配線との間に、ピン始点支線（Ｐ××（××は、数字））で示した線）と幹線始点支線（Ｂ××で示した線）と接続線（Ｊ××で示した線）とにより構成される支線ＳＳが設けられる。この支線ＳＳは、前行のセルにおけるピンと接続する幹線始点支線と次行のセルにおけるピンと接続する幹線始点支線とを隣接させて幹線始点支線を発生させる処理を行っているために、接続線（Ｊ××で示した線）を最短にでき、最短距離の配線を実現している。

次に第２の実施形態を説明する。この第２の実施形態では、上記第１の実施形態において発生させた接続線（Ｊ××で示した線）を用いない。本実施形態の始点支線発生手段２０１は、上記幹線始点支線または上記ピン始点支線が他の配線と重なる場合には、セルを横方向にシフトさせてシフトした位置のピンと複数の幹線配線との間で支線を発生させる。

シフトした位置のピンと複数の幹線配線との間で支線を発生させる場合において、ピンからは複数の幹線配線に直交する方向に延びるピン始点支線を発生させ、幹線配線の上記ピンに対応する位置から幹線配線に直交するようにピン方向へ延びる幹線始点支線を発生させる点は、第１の実施形態と同じである。発生させたピン始点支線と対応する幹線始点支線を直線的に接続する。

上記のようにすることから、図１０に示すように上記複数の幹線配線ＭＭに近いセルＣ１～Ｃ４のピンと上記複数の幹線配線ＭＭ中のセル側から遠い位置（図では下側）から幹線の選択を行って該当位置から幹線始点支線を発生する。即ち、幹線については配線トラックの順番＜１＞～＜１６＞で選択し、セルのピンの選択は、「セルのピン選択順」の矢印に示される順で行う。この順は、セルの枠内に＜１＞～＜１６＞で示されている。

発生された幹線始点支線と発生されたピン始点支線とを接続する順は、図１１に示されるようになる。即ち、幹線については配線トラックの順番＜１＞～＜１６＞で選択したものに対し、ピン始点支線としては図１１の右側に描かれている矢印の通りに進む。つまり、ピン始点支線としてはセル枠内に［１］～［１６］の順に幹線始点支線と接続してゆく。しかしながら、上記の通りにピン始点支線を発生させ、幹線始点支線を発生させた場合には、ピン始点支線は同じ列にあるから、そのままでは支線に重なりが生じる。

始点支線発生手段２０１は、上記幹線始点支線または上記ピン始点支線が他の配線と重なる場合には、セルを横方向にシフトさせてシフトした位置のピンと複数の幹線配線との間で支線を発生させる。例えば、図１２に示すように、第１行目のセルＣ１～Ｃ４については、当初の位置へ配置したままとし、第２行目のセルＣ５～Ｃ８については、セルＣ５～Ｃ８のピンから引き出したピン始点支線が第１行目のセルＣ１～Ｃ４のピンから引き出したピン始点支線と重ならないようにシフトを行う（ここでは、左シフト）。また、第３行目のセルＣ９～Ｃ１２については、セルＣ９～Ｃ１２のピンから引き出したピン始点支線が第２行目のセルＣ５～Ｃ８のピンから引き出したピン始点支線と重ならないようにシフトを行う（ここでは、左シフト）。更に、第４行目のセルＣ１３～Ｃ１６については、セルＣ１３～Ｃ１６のピンから引き出したピン始点支線が第３行目のセルＣ９～Ｃ１２のピンから引き出したピン始点支線と重ならないようにシフトを行う（ここでは、左シフト）。

また、始点支線発生手段２０１は、セルの大きさに応じてシフト量を決定してシフトを行う。例えば、セルの一部について示す図１３のように、１行目のセルＣ０１、Ｃ０２、・・・が２行目以降のセルＣ５、・・・、Ｃ９、・・・、Ｃ１３の大きさと異なる場合について説明する。この例では、４行目のセルはシフトせず、３行目から１行目のセルをシフトするものとする。すると、３行目から１行目のセルを同じ距離シフトした場合には、図１３（Ａ）に示すように、１行目のセルＣ０１、Ｃ０２が重なってしまう。係る場合には、１行目のセルＣ０１、Ｃ０２についてシフト量の調整を行い、図１３（Ｂ）に示されるように１行目のセルＣ０１、Ｃ０２が重ならぬようにする。

以上の構成を有する第２の実施形態は、図１４に示されるフローチャートに対応するプログラムが実行されることにより実現される。本実施形態では、４列４行のセルである。まず、幹線配線の配線する順を入力する（Ｓ３１）。ここでは、図１０において説明したように、順番＜１＞～＜１６＞と入力がなされる。次に既にセル配置の設計が完了しているか検出する（Ｓ３２）。ステップＳ３２においてＮＯへ分岐すると、セルが何行（ロウ）×何列（コラム）に配置されているかの情報を入力し（Ｓ３４）、この情報に基づきセルの配置が行われる（Ｓ３５）。一方、セル配置の設計が完了している場合には、設計済の情報（データ）からセルが何行（ロウ）×何列（コラム）に配置されているかの情報を取り出す（Ｓ３３）。

ステップＳ３３またはステップＳ３５に続いて、図１０において説明した通り、幹線の配線トラックの順番を元に、可能な限り支線の長さが均等になるよう、「セルのピン選択順」を決定する（Ｓ３６）。次に、図１１において説明した通りに、セル配置の座標、ロウ位置、セルのセル枠サイズを基に支線の配線トラックの順番（配線順）を算出する（Ｓ３７）。

ステップＳ３７に続いて図１２において説明した通り、支線の配線トラックの順番、ピン図形の座標、配線ピッチの値を元にセル配置をシフトする（Ｓ３８）。次に、シフトによりセルの重なりが生じないかを検出し（Ｓ３９）、生じる場合には図１３において説明した通りにシフト量を調整して適正な位置に配置する（Ｓ４０）。以上によりセルの配置位置が確定となる（Ｓ４１）。

上記でセルのシフトが完了したのかを検出し（Ｓ４２）、ＮＯとなるとステップＳ３８へ戻って発生させるセルから延びる支線が他の配線（支線）と重ならないように処理を続ける。この結果、ステップＳ４２においてＹＥＳへ分岐すると、ピン位置、幹線の配線トラックの順番の情報を基に、幹線を配線する（Ｓ４３）。更に、幹線とセルのピンを支線で結線する（Ｓ４４）。即ち、図１２、図１３により説明した通りのシフト後のセルのピンから発生させたピン始点支線と、幹線始点支線とを直線で結んで支線として配線を完了する。この結果、図１５に示されるように、セルＣ１～Ｃ１６からは幹線ＭＭへ向けて直交するように延びた直線である支線ＳＳによりピンと幹線ＭＭの間が最短距離で接続される。

また、図１６に示す通り、ピンＰ１は幹線配線Ｍ１の端部で直線的に接続されれば良く、また、Ｐ１は幹線配線Ｍ１の端部で直線的に接続されれば良いので、無駄な配線を不要とでき、しかも最短距離で支線の配線を行うことができる。ピンＰ２と幹線配線Ｍ２、ピンＰ３と幹線配線Ｍ３、ピンＰ４と幹線配線Ｍ４についてもピンＰ１と幹線配線Ｍ１について述べた事項が成り立ち、図１に示した二重トラックを防ぐことができる。

なお、以上の実施形態では、１群の幹線配線ＭＭの一方の側部に対してセル群が配置される半導体集積回路について述べてきたが、１群の幹線配線ＭＭの両方の側部に対してセル群が配置される半導体集積回路について第１の実施形態と第２の実施形態は適用可能である。例えば、図１７に示されるように１群の幹線配線ＭＭに対し図の上側と図の下側にセル群が配置される場合を考える。

図１７において、１群の幹線配線ＭＭに対し図の上側に配置されているセル群のセルをＣ１Ｕ～Ｃ８Ｕとし、図の下側に配置されているセル群のセルをＣ１Ｄ～Ｃ８Ｄとする。係る場合に、図の上側の半導体集積回路についても図の下側の半導体集積回路についても、第１の実施形態の手法で動作する始点支線発生手段２０１と最短距離接続手段２０２とにより装置を構成することにより、第１の実施形態の例と同じように処理がなされ同様の効果を得ることができる。また、図の上側の半導体集積回路についても図の下側の半導体集積回路についても、第２の実施形態の実施形態の手法で動作する始点支線発生手段２０１と最短距離接続手段２０２とにより装置を構成することにより、第２の実施形態の例と同じように処理がなされ同様の効果を得ることができる。

そして、図の上側の半導体集積回路のセル内のピン構成及び位置が、図の下側の半導体集積回路のセル内のピン構成及び位置と対象的である場合には、図の上側において設計される支線と図の上側において設計される支線とは、１群の幹線配線ＭＭを挟んで対称となる。図１７においては、図の上側のセルＣ５Ｕの１つのピンへ延びる支線Ｓ５Ｕと図の下側のセルＣ５Ｄの１つのピンへ延びる支線Ｓ５Ｄとは、１群の幹線配線ＭＭを挟んで対称となる。このことから、図の上側の半導体集積回路のセル内のピンへ延びる全ての支線と対称的な下側の半導体集積回路のセル内のピンへ延びる全ての支線とは、１群の幹線配線ＭＭを挟んで一直線となることから、支線の配線トラック（半導体集積回路における配線領域）として一連の位置に形成することができる。つまり、支線の配線トラックは共有ないしは一本化することができる。

１００配線設計装置
１０２主メモリ
１０３バス
１０４外部記憶装置
１０５配線設計用情報供給部
１０６結果出力部
２０１始点支線発生手段
２０２最短距離接続手段
３０４外部記憶インタフェース
３０５配線設計用情報供給部インタフェース
３０６出力部インタフェース

Claims

セルの位置情報及び大きさ情報、前記セル内のピンの位置情報及び大きさ情報、幹線配線の位置情報及び大きさ情報を含む配線設計情報に基づき、複数の幹線配線中の所定数本の幹線配線を始点とし前記幹線配線に直交する幹線始点支線と、セル内のピンを始点とし前記幹線配線に直交するように延びるピン始点支線とを発生する始点支線発生手段と、
発生された前記幹線始点支線と発生された前記ピン始点支線とに関する発生支線情報及び前記配線設計情報に基づき、発生された前記幹線始点支線と発生された前記ピン始点支線が他の配線に重ならぬように最短距離で接続する最短距離接続手段と
を具備し、
前記最短距離接続手段は、複数本の幹線配線に最も近接するセルのピンと幹線配線との間については、発生された前記幹線始点支線と発生された前記ピン始点支線とを直接接続した直線支線により接続を行う
ことを特徴とする半導体集積回路の配線設計装置。
前記最短距離接続手段は、前記幹線始点支線または前記ピン始点支線が他の配線と重なる場合には、前記幹線始点支線と前記ピン始点支線に直交する接続線を発生させて前記幹線始点支線と前記ピン始点支線とを接続することを特徴とする請求項１に記載の半導体集積回路の配線設計装置。
同じ大きさのセルであって、セル内の同じ位置にピンが配置されているセルが縦横に複数並べられた半導体集積回路について配線設計を行うことを特徴とする請求項１または２に記載の半導体集積回路の配線設計装置。
前記始点支線発生手段は、
前記複数の幹線配線から数えて第１行目のセルにおけるピンと接続する幹線始点支線に隣接させて、複数の幹線配線から数えて第２行目のセルにおけるピンと接続する幹線始点支線を発生させ、
前記複数の幹線配線から数えて第２行目のセルにおけるピンと接続する幹線始点支線に隣接させて、複数の幹線配線から数えて第３行目のセルにおけるピンと接続する幹線始点支線を発生させ、
以下同様に、前行のセルにおけるピンと接続する幹線始点支線と次行のセルにおけるピンと接続する幹線始点支線とを隣接させて幹線始点支線を発生させることを特徴とする請求項３に記載の半導体集積回路の配線設計装置。
前記始点支線発生手段は、前記幹線始点支線または前記ピン始点支線が他の配線と重なる場合には、セルを横方向にシフトさせてシフトした位置のピンと複数の幹線配線との間で支線を発生させることを特徴とする請求項３または４に記載の半導体集積回路の配線設計装置。
前記始点支線発生手段は、セルの大きさに応じてシフト量を決定してシフトを行うことを特徴とする請求項５に記載の半導体集積回路の配線設計装置。
コンピュータを、
セルの位置情報及び大きさ情報、前記セル内のピンの位置情報及び大きさ情報、幹線配線の位置情報及び大きさ情報を含む配線設計情報に基づき、複数の幹線配線中の所定数本の幹線配線を始点とし前記幹線配線に直交する幹線始点支線と、セル内のピンを始点とし前記幹線配線に直交するように延びるピン始点支線とを発生する始点支線発生手段、
発生された前記幹線始点支線と発生された前記ピン始点支線とに関する発生支線情報及
び前記配線設計情報に基づき、発生された前記幹線始点支線と発生された前記ピン始点支線が他の配線に重ならぬように最短距離で接続する最短距離接続手段
として機能させ、
前記コンピュータを前記最短距離接続手段として、
複数本の幹線配線に最も近接するセルのピンと幹線配線との間については、発生された前記幹線始点支線と発生された前記ピン始点支線とを直接接続した直線支線により接続を行うように機能させる
ことを特徴とする半導体集積回路の配線設計用プログラム。
前記コンピュータを前記最短距離接続手段として、
前記幹線始点支線または前記ピン始点支線が他の配線と重なる場合には、前記幹線始点支線と前記ピン始点支線に直交する接続線を発生させて前記幹線始点支線と前記ピン始点支線とを接続するように機能させることを特徴とする請求項７に記載の半導体集積回路の配線設計用プログラム。
同じ大きさのセルであって、セル内の同じ位置にピンが配置されているセルが縦横に複数並べられた半導体集積回路について配線設計を行うことを特徴とする請求項７または８に記載の半導体集積回路の配線設計用プログラム。
前記コンピュータを前記始点支線発生手段として、
前記複数の幹線配線から数えて第１行目のセルにおけるピンと接続する幹線始点支線に隣接させて、複数の幹線配線から数えて第２行目のセルにおけるピンと接続する幹線始点支線を発生させ、
前記複数の幹線配線から数えて第２行目のセルにおけるピンと接続する幹線始点支線に隣接させて、複数の幹線配線から数えて第３行目のセルにおけるピンと接続する幹線始点支線を発生させ、
以下同様に、前行のセルにおけるピンと接続する幹線始点支線と次行のセルにおけるピンと接続する幹線始点支線とを隣接させて幹線始点支線を発生させるように機能させることを特徴とする請求項９に記載の半導体集積回路の配線設計用プログラム。
前記コンピュータを前記始点支線発生手段として、
前記幹線始点支線または前記ピン始点支線が他の配線と重なる場合には、セルを横方向にシフトさせてシフトした位置のピンと複数の幹線配線との間で支線を発生させるように機能させることを特徴とする請求項９または１０に記載の半導体集積回路の配線設計用プログラム。
前記コンピュータを前記始点支線発生手段として、セルの大きさに応じてシフト量を決定してシフトを行うように機能させることを特徴とする請求項１１に記載の半導体集積回路の配線設計用プログラム。