JP6696383B2 - 数値制御装置 - Google Patents
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Description
又、数値制御装置は、第一バージョン及び第二バージョンを簡易な方法で管理できる。
図1を参照し、工作機械1の構造を説明する。工作機械1は基台2、Y軸移動機構(図示略)、X軸移動機構(図示略)、Z軸移動機構(図示略)、移動体15、立柱5、主軸ヘッド6、主軸(図示略)、被削材支持装置8、数値制御装置40(図2参照)等を備える。基台2は架台11、主軸基台12、右側基台13、左側基台14等を備える。架台11は前後方向に長い略直方体状の構造体である。主軸基台12は前後方向に長い略直方体状に形成し、架台11上面後方に設ける。右側基台13は架台11上面右前方に設ける。左側基台14は架台11上面左前方に設ける。右側基台13と左側基台14は夫々、上面に被削材支持装置8を支持する。
図2を参照し数値制御装置40と工作機械1の電気的構成を説明する。数値制御装置40はCPU41、ROM42、RAM43、フラッシュメモリ44、入出力部45、外部インタフェース(I/F)46、駆動回路51〜56を備える。工作機械1はX軸モータ61、Y軸モータ62、Z軸モータ63、A軸モータ64、C軸モータ65、主軸モータ66を備える。
図3を参照し、バージョンについて具体例を挙げて説明する。図3のバージョン「WB00.05.001F03.000」は、第一共通識別子「WB00.」、第一バージョン「05.001」、第二共通識別子「F」、第二バージョン「03.000」が順番に配列した文字列である。
バージョンの更新の過程で、機能が追加で実装されると同時に、更新時点で判明している制御プログラムの不具合等が修正する時がある。例えば図3に示す例では、第一バージョンを「03.000」から「04.000」に更新する過程(S1)で、制御プログラムを修正する。以下、この修正を「修正1」という。第一バージョン「04.000」の制御プログラムには、修正1が含まれる。第一バージョンを「04.000」から「05.000」に更新する過程(S2)で、制御プログラムを修正する。以下、この修正を「修正2」という。第一バージョン「05.000」の制御プログラムには、修正1、修正2が含まれる。第一バージョンを「05.000」から「05.001」に更新する過程(S3)で、制御プログラムを修正する。以下、この修正を「修正3」「修正4」という。第一バージョン「05.001」の制御プログラムには、修正1〜修正4が含まれる。
図4を参照しバージョン設定処理を説明する。CPU41は、接続口19(図2参照)に外部記憶媒体46Aを装着したことを検出した時、フラッシュメモリ44のうち、ブートプログラムから呼び出すプログラム開始番地のアドレスに記憶した導入済プログラムを実行することによりバージョン設定処理を開始する。
図5を参照し、バージョン変更処理を説明する。CPU41は、操作部17を介した操作を検出した時、フラッシュメモリ44に記憶した導入済プログラムを実行することによりバージョン変更処理を開始する。
図6を参照し、指令実行処理を説明する。CPU41は、フラッシュメモリ44に記憶したNCプログラムに基づいてモータ61〜66を駆動する動作の開始指示を、操作部17を介して検出した時、フラッシュメモリ44に記憶した制御プログラムを実行することにより指令実行処理を開始する。NCプログラムに含まれる指令は、制御プログラムの実装機能により全て実行可能であることを前提とする。
数値制御装置40のCPU41は、導入済プログラム、及び、導入済バージョン(第一導入済バージョン及び第二導入済バージョン)をフラッシュメモリ44に記憶する。CPU41は、NCプログラムの指令X(n)に対応する処理(モータ61〜66の駆動)を、第二導入済バージョンが示す有効機能により実行することが可能か判定する(S59)。CPU41は、実行可能と判定した時(S59:YES)、指令X(n)に対応する処理を実行する(S61)。このように、CPU41は、一つの導入済ブログラムの導入済バージョンとして、第一導入済バージョンと第二導入済バージョンを記憶することにより、制御プログラムに実装された実装機能のうち有効機能以外の機能を禁止できる。従って、更新プログラムを有効機能毎に複数保持する必要がない。このため、工作機械製造メーカは、制御プログラムを容易に管理できる。
本発明は上記実施形態に限らない。数値制御装置40は、導入済プログラムと導入済バージョン(第一導入済バージョン及び第二導入済バージョン)を、異なる記憶媒体に記憶してもよい。例えば数値制御装置40は、複数のフラッシュメモリ44を備えてもよい。数値制御装置40は、導入済プログラムと導入済バージョンとを、別のフラッシュメモリ44に記憶してもよい。CPU41は、NCプログラムの指令X(n)を順番に実行するのでなく、操作部17を介して使用者が入力した指令を、指令を検出する度に実行してもよい。
導入済プログラム及び導入済バージョンを記憶するフラッシュメモリ44は本発明の「第一記憶部」「第二記憶部」の一例である。S53の処理を行うCPU41は本発明の「第一受付手段」の一例である。S59の処理を行うCPU41は本発明の「第一判定手段」の一例である。S61の処理を行うCPU41は本発明の「実行手段」の一例である。
S63の処理を行うCPU41は本発明の「通知手段」の一例である。S13の処理を行うCPU41は本発明の「第二受付手段」の一例である。S15の処理を行うCPU41は本発明の「取得手段」の一例である。S17の処理を行うCPU41は本発明の「制御手段」の一例である。S25の処理を行うCPU41は本発明の「第一更新手段」の一例である。S29の処理を行うCPU41は本発明の「第二判定手段」の一例である。S37の処理を行うCPU41は本発明の「第二更新手段」の一例である。S39の処理を行うCPU41は本発明の「禁止手段」の一例である。S71の処理を行うCPU41は本発明の「第三受付手段」の一例である。S75の処理を行うCPU41は本発明の「第三更新手段」の一例である。
40 :数値制御装置
41 :CPU
44 :フラッシュメモリ
44A :テーブル
V1a :第一導入済バージョン
V1b :第一更新バージョン
V2a :第二導入済バージョン
V2b :第二更新バージョン
X(n) :指令
Claims (4)
- 制御プログラムに基づいて駆動する数値制御装置であって、
前記制御プログラムを記憶する第一記憶部と、
前記制御プログラムに実装された実装機能に対応する値であって前記実装機能の追加に伴い昇順で増加する第一値で示される第一バージョン、及び、前記実装機能のうち有効な有効機能に対応する値であって前記第一値以下の第二値で示される第二バージョンを含むバージョンを記憶する第二記憶部と、
指令を受け付ける第一受付手段と、
前記第二値の第一バージョンに対応する前記実装機能を、前記第二バージョンによって示される前記有効機能として特定し、特定された前記有効機能によって、前記第一受付手段によって受け付けられた前記指令に対応する処理を実行することが可能か否かを判定する第一判定手段と、
前記第一判定手段によって、前記有効機能によって前記処理を実行することが可能と判定した時、前記有効機能に基づいて前記処理を実行する実行手段と
を備えたことを特徴とする数値制御装置。 - 前記第一判定手段によって、前記有効機能によって前記処理を実行することが不可能と判定した時、使用者に通知する通知手段を更に備えたことを特徴とする請求項1に記載の数値制御装置。
- 更新制御プログラムを受け付ける第二受付手段と、
前記第二受付手段によって受け付けられた前記更新制御プログラムに実装された実装機能を示す第一更新バージョン、及び、前記更新制御プログラムに実装された前記実装機能のうち有効な有効機能を示す第二更新バージョンを取得する取得手段と、
前記第二受付手段によって受け付けられた前記更新制御プログラムを、前記制御プログラムとして前記第一記憶部に記憶する制御手段と、
前記第二記憶部に記憶した前記第一バージョンを、前記取得手段によって取得した前記第一更新バージョンに更新する第一更新手段と、
前記第二記憶部に記憶した前記第二バージョンを更新する指示を受け付けたか判定する第二判定手段と、
前記第二判定手段によって、前記第二バージョンを更新する指示を受け付けたと判定した時、前記第二記憶部に記憶した前記第二バージョンを、前記取得手段によって取得した前記第二更新バージョンに更新する第二更新手段と、
前記第二受付手段によって、前記第二バージョンを更新する指示を受け付けないと判定した時、前記第二記憶部に記憶した前記第二バージョンの更新を禁止する禁止手段と
を備えたことを特徴とする請求項1又は2に記載の数値制御装置。 - 前記第二記憶部に記憶した前記第二バージョンを前記第一バージョンに更新する指示を受け付ける第三受付手段と、
前記第三受付手段によって前記指示を受け付けた時、前記第二記憶部に記憶した前記第二バージョンを前記第一バージョンに更新する第三更新手段と
を備えたことを特徴とする請求項1から3の何れかに記載の数値制御装置。
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Family Applications (1)
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- 2016-09-27 JP JP2016187765A patent/JP6696383B2/ja active Active
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