JP6526815B2 - アナログ−デジタル・コンバータ保護回路、アナログ−デジタル・コンバータ保護回路を制御する方法、及びコントローラ - Google Patents
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Description
前記直列回路の前記テイル抵抗の抵抗値と前もってセットされた光電流閾値との積は、前記サンプリング電圧範囲内にある。
前記第2出力ポートは、具体的に、前記デジタル電圧が前記第1プリセット電圧閾値よりも小さく、且つ、前記デジタル電圧が前記第2プリセット電圧閾値よりも大きいとき、前記デジタル電圧を出力するよう構成され;且つ、前記第1出力ポートは、前記デジタル電圧が前記第2プリセット電圧閾値以下であるとき、前記アナログ・スイッチへ第2制御信号を出力するよう更に構成され、前記第2制御信号が、前記アナログ・スイッチをトリガし、第3サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第3サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも大きい。
デジタル電圧が第1プリセット電圧閾値よりも小さく、且つ、デジタル電圧が第2プリセット電圧閾値よりも大きいとき、デジタル電圧を出力するようコントローラの第2出力端を制御することであり、第2プリセット電圧閾値は、サンプリング電圧範囲内にある。
コントローラによって、デジタル電圧が第2プリセット電圧閾値よりも大きいかどうかを判定すること
を更に含んでよい。
デジタル電圧が第1プリセット電圧閾値よりも小さく、且つ、デジタル電圧が第2プリセット電圧閾値よりも大きいとき、コントローラによって、デジタル電圧を出力するようコントローラの第2出力端を制御すること
であってよく、第2プリセット電圧閾値は、サンプリング電圧範囲内にある。
デジタル電圧が第2プリセット電圧閾値以下であるとき、コントローラによって、第2制御信号をアナログ・スイッチへ出力すること
を更に含んでよい。第2制御信号は、アナログ・スイッチの出力端へ導かれる導通サンプリング端を第1サンプリング端から第3サンプリング端へ切り替えるようアナログ・スイッチをトリガするために使用され、第3サンプリング端によってサンプリングされるアナログ電圧は、第1サンプリング端によってサンプリングされるアナログ電圧よりも大きい。
デジタル電圧が、アナログ−デジタル・コンバータのサンプリング電圧範囲内にある第1プリセット電圧閾値以上であるかどうかを判定し、デジタル電圧が第1プリセット電圧閾値以上であるとき、第1制御信号を生成すること
を実施するよう構成される。
デジタル電圧が、第1プリセット電圧閾値よりも小さく、且つ、サンプリング電圧範囲内にある第2プリセット電圧閾値よりも大きいかどうかを判定し、デジタル電圧が第2プリセット電圧閾値よりも大きくない(すなわち、それ以下である)とき、第2制御信号を生成すること
を更に実施するよう構成される。
Claims (15)
- アナログ−デジタル・コンバータ保護回路であって、
アナログ・スイッチ、アナログ−デジタル・コンバータ、コントローラ、及び直列回路を有し、前記直列回路は、直列に接続されている少なくとも2つの抵抗を有し;
前記直列回路のヘッドエンドは、双方向光サブアセンブリ(BOSA)の出力端へ接続されるよう構成され、前記直列回路のテイルエンドは、接地されるよう構成され、前記直列回路における夫々の抵抗の接地遠位端は、前記アナログ・スイッチの異なるサンプリング端へ接続され、前記アナログ・スイッチの出力端は、前記アナログ−デジタル・コンバータの入力端へ接続され、前記アナログ−デジタル・コンバータの出力端は、前記コントローラの入力端へ接続され、前記コントローラの第1出力端は、前記アナログ・スイッチの制御端へ接続され;
前記直列回路は、前記BOSAによって出力された光電流をアナログ電圧に変換するよう構成され、前記異なるサンプリング端は、前記直列回路によって出力された前記アナログ電圧をサンプリングするよう構成され、前記アナログ・スイッチは、該アナログ・スイッチの導通サンプリング端によってサンプリングされたアナログ電圧を前記アナログ−デジタル・コンバータへ出力するよう構成され、第1サンプリング端は、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働き;
前記アナログ−デジタル・コンバータは、デジタル電圧を生成するよう前記導通サンプリング端によってサンプリングされた前記アナログ電圧に対してアナログ−デジタル変換を実施し、前記デジタル電圧を前記コントローラへ出力するよう構成され;且つ
前記コントローラは、
前記デジタル電圧が第1プリセット電圧閾値以上であるとき、第1制御信号を前記アナログ・スイッチへ出力し、前記第1制御信号が、前記アナログ・スイッチをトリガし、第2サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第2サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも小さく、
前記デジタル電圧が前記第1プリセット電圧閾値よりも小さいとき、前記デジタル電圧を出力するよう前記コントローラの第2出力端を制御し、前記第1プリセット電圧閾値が、前記アナログ−デジタル・コンバータのサンプリング電圧範囲内にある
よう構成される、
アナログ−デジタル・コンバータ保護回路。 - 前記デジタル電圧が前記第1プリセット電圧閾値よりも小さいとき、前記コントローラが、前記デジタル電圧を出力するよう前記コントローラの第2出力端を制御することは:
前記デジタル電圧が前記第1プリセット電圧閾値よりも小さく、且つ、前記デジタル電圧が第2プリセット電圧閾値よりも大きいとき、前記デジタル電圧を出力するよう前記コントローラの前記第2出力端を制御し、前記第2プリセット電圧閾値が、前記サンプリング電圧範囲内にある
ことであり;且つ
前記コントローラは、
前記デジタル電圧が前記第2プリセット電圧閾値以下であるとき、前記アナログ・スイッチへ第2制御信号を出力し、前記第2制御信号が、前記アナログ・スイッチをトリガし、第3サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第3サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも大きい
よう更に構成される、
請求項1に記載のアナログ−デジタル・コンバータ保護回路。 - 前記直列回路は、前記テイルエンドと前記ヘッドエンドとの間に前記直列に接続されている少なくとも2つの抵抗を有し、
前記アナログ・スイッチが、該アナログ・スイッチの出力端へ導かれる前記導通サンプリング端を変更するとき、前記直列回路に含まれる前記少なくとも2つの抵抗のうち、前記アナログ・スイッチの出力端へ導かれる前記導通サンプリング端と前記直列回路の前記テイルエンドとの間にある抵抗の数の変化は、少なくとも1である、
請求項1又は2に記載のアナログ−デジタル・コンバータ保護回路。 - 前記アナログ・スイッチの出力端へ導かれる最初の導通サンプリング端は、前記直列回路に含まれる前記少なくとも2つの抵抗のうち接地された前記テイルエンドにあるテイル抵抗の接地遠位端へ接続されているサンプリング端であり;且つ
前記直列回路の前記テイル抵抗の抵抗値と前もってセットされた光電流閾値との積は、前記サンプリング電圧範囲内にある、
請求項1乃至3のうちいずれか一項に記載のアナログ−デジタル・コンバータ保護回路。 - 前記直列回路の全ての抵抗の総抵抗値と前もってセットされた光電流閾値との積は、前記アナログ−デジタル・コンバータのサンプリング精度以上である、
請求項1乃至4のうちいずれか一項に記載のアナログ−デジタル・コンバータ保護回路。 - アナログ−デジタル・コンバータ保護回路を制御する方法であって、
前記アナログ−デジタル・コンバータ保護回路は、アナログ・スイッチ、アナログ−デジタル・コンバータ、コントローラ、及び直列回路を有し、前記直列回路は、直列に接続されている少なくとも2つの抵抗を有し、前記直列回路のヘッドエンドは、BOSAの出力端へ接続されるよう構成され、前記直列回路のテイルエンドは、接地されるよう構成され、前記直列回路における夫々の抵抗の接地遠位端は、前記アナログ・スイッチの異なるサンプリング端へ接続され、前記アナログ・スイッチの出力端は、前記アナログ−デジタル・コンバータの入力端へ接続され、前記アナログ−デジタル・コンバータの出力端は、前記コントローラの入力端へ接続され、前記コントローラの第1出力端は、前記アナログ・スイッチの制御端へ接続され、当該方法は:
前記コントローラによって、前記アナログ−デジタル・コンバータによって出力されたデジタル電圧を受け、該デジタル電圧は、前記アナログ・スイッチの導通サンプリング端によってサンプリングされたアナログ電圧に対してアナログ−デジタル変換を実施することによって前記アナログ−デジタル・コンバータによって得られたデジタル電圧であり、第1サンプリング端は、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働き;
前記デジタル電圧が第1プリセット電圧閾値以上であるとき、前記コントローラによって、第1制御信号を前記アナログ・スイッチへ出力し、前記第1制御信号が、前記アナログ・スイッチをトリガし、第2サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第2サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも小さく、前記第1プリセット電圧閾値が、前記アナログ−デジタル・コンバータのサンプリング電圧範囲内にあり;且つ
前記デジタル電圧が前記第1プリセット電圧閾値よりも小さいとき、前記コントローラによって、前記デジタル電圧を出力するよう前記コントローラの第2出力端を制御する
ことを有する、
方法。 - 前記デジタル電圧が前記第1プリセット電圧閾値よりも小さいとき、前記コントローラによって、前記デジタル電圧を出力するよう前記コントローラの第2出力端を制御することは:
前記デジタル電圧が前記第1プリセット電圧閾値よりも小さく、且つ、前記デジタル電圧が第2プリセット電圧閾値よりも大きいとき、前記コントローラによって、前記デジタル電圧を出力するよう前記コントローラの前記第2出力端を制御し、前記第2プリセット電圧閾値が、前記サンプリング電圧範囲内にある
ことを有し、
当該方法は:
前記デジタル電圧が前記第2プリセット電圧閾値以下であるとき、前記コントローラによって、前記アナログ・スイッチへ第2制御信号を出力し、前記第2制御信号が、前記アナログ・スイッチをトリガし、第3サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第3サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも大きい
ことを更に有する、
請求項6に記載の方法。 - 前記直列回路は、前記テイルエンドと前記ヘッドエンドとの間に前記直列に接続されている少なくとも2つの抵抗を有し、
前記アナログ・スイッチが、該アナログ・スイッチの出力端へ導かれる前記導通サンプリング端を制御し変更するとき、前記直列回路に含まれる前記少なくとも2つの抵抗のうち、前記アナログ・スイッチの出力端へ導かれる前記導通サンプリング端と前記直列回路の前記テイルエンドとの間にある抵抗の数の変化は、少なくとも1である、
請求項6又は7に記載の方法。 - 前記アナログ・スイッチの出力端へ導かれる最初の導通サンプリング端は、前記直列回路に含まれる前記少なくとも2つの抵抗のうち接地された前記テイルエンドにあるテイル抵抗の接地遠位端へ接続されているサンプリング端であり;且つ
前記直列回路の前記テイル抵抗の抵抗値と前もってセットされた光電流閾値との積は、前記サンプリング電圧範囲内にある、
請求項6乃至8のうちいずれか一項に記載の方法。 - 前記直列回路の全ての抵抗の総抵抗値と前もってセットされた光電流閾値との積は、前記アナログ−デジタル・コンバータのサンプリング精度以上である、
請求項6乃至9のうちいずれか一項に記載の方法。 - アナログ−デジタル・コンバータ保護回路の中のコントローラであって:
プロセッサ、メモリ、入力ポート、第1出力ポート、及び第2出力ポートを有し、
前記アナログ−デジタル・コンバータ保護回路は、アナログ・スイッチ、アナログ−デジタル・コンバータ、前記コントローラ、及び直列回路を有し、前記直列回路は、直列に接続されている少なくとも2つの抵抗を有し、前記直列回路のヘッドエンドは、BOSAの出力端へ接続されるよう構成され、前記直列回路のテイルエンドは、接地されるよう構成され、前記直列回路における夫々の抵抗の接地遠位端は、前記アナログ・スイッチの異なるサンプリング端へ接続され、前記アナログ・スイッチの出力端は、前記アナログ−デジタル・コンバータの入力端へ接続され、前記アナログ−デジタル・コンバータの出力端は、前記入力ポートへ接続され、前記第1出力ポートは、前記アナログ・スイッチの制御端へ接続され;
前記入力ポートは、前記アナログ−デジタル・コンバータによって出力されたデジタル電圧を受けるよう構成され、該デジタル電圧は、前記アナログ・スイッチの導通サンプリング端によってサンプリングされたアナログ電圧に対してアナログ−デジタル変換を実施することによって前記アナログ−デジタル・コンバータによって得られたデジタル電圧であり、第1サンプリング端は、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働き;
前記メモリは、プログラム・コードの組を記憶し、前記プロセッサは、前記メモリに記憶されている前記プログラム・コードを呼び出して、次の動作:
前記デジタル電圧が第1プリセット電圧閾値以上であるかどうかを判定し、該第1プリセット電圧閾値が前記アナログ−デジタル・コンバータのサンプリング電圧範囲内にあること
を実施するよう構成され;
前記第1出力ポートは、前記デジタル電圧が前記第1プリセット電圧閾値以上であるとき、第1制御信号を前記アナログ・スイッチへ出力するよう構成され、前記第1制御信号が、前記アナログ・スイッチをトリガし、第2サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第2サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも小さく;且つ
前記第2出力ポートは、前記デジタル電圧が前記第1プリセット電圧閾値よりも小さいとき、前記デジタル電圧を出力するよう構成される、
コントローラ。 - 前記プロセッサは、前記メモリに記憶されている前記プログラム・コードを呼び出して、次の動作:
前記デジタル電圧が第2プリセット電圧閾値よりも大きいかどうかを判定し、該第2プリセット電圧閾値が前記サンプリング電圧範囲内にあること
を更に実施するよう構成され、
前記第2出力ポートは、前記デジタル電圧が前記第1プリセット電圧閾値よりも小さく、且つ、前記デジタル電圧が前記第2プリセット電圧閾値よりも大きいとき、前記デジタル電圧を出力するよう構成され;且つ
前記第1出力ポートは、前記デジタル電圧が前記第2プリセット電圧閾値以下であるとき、前記アナログ・スイッチへ第2制御信号を出力するよう更に構成され、前記第2制御信号が、前記アナログ・スイッチをトリガし、第3サンプリング端を制御して、前記アナログ・スイッチの出力端へ導くよう前記導通サンプリング端として働くようにするために使用され、前記第3サンプリング端によってサンプリングされたアナログ電圧が、前記第1サンプリング端によってサンプリングされたアナログ電圧よりも大きい、
請求項11に記載のコントローラ。 - 前記直列回路は、前記テイルエンドと前記ヘッドエンドとの間に前記直列に接続されている少なくとも2つの抵抗を有し、
前記アナログ・スイッチが、該アナログ・スイッチの出力端へ導かれる前記導通サンプリング端を制御し変更するとき、前記直列回路に含まれる前記少なくとも2つの抵抗のうち、前記アナログ・スイッチの出力端へ導かれる前記導通サンプリング端と前記直列回路の前記テイルエンドとの間にある抵抗の数の変化は、少なくとも1である、
請求項11又は12に記載のコントローラ。 - 前記アナログ・スイッチの出力端へ導かれる最初の導通サンプリング端は、前記直列回路に含まれる前記少なくとも2つの抵抗のうち接地された前記テイルエンドにあるテイル抵抗の接地遠位端へ接続されているサンプリング端であり;且つ
前記直列回路の前記テイル抵抗の抵抗値と前もってセットされた光電流閾値との積は、前記サンプリング電圧範囲内にある、
請求項11乃至13のうちいずれか一項に記載のコントローラ。 - 前記直列回路の全ての抵抗の総抵抗値と前もってセットされた光電流閾値との積は、前記アナログ−デジタル・コンバータのサンプリング精度以上である、
請求項11乃至14のうちいずれか一項に記載のコントローラ。
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