JP6455106B2 - 情報処理装置およびプログラム - Google Patents

Description

本発明は、情報処理装置およびプログラムに関する。

ネットワーク通信における消費電力を低減するための技術が提案されている。特許文献１には、通信端末装置のバックエンドシステムが省電力モードから通常モードに復帰する頻度を、待機応答ＬＳＩを用いて抑制する技術が記載されている。

特開２０１２−１５１６８１号公報

情報処理装置、例えば、スキャナ、プリンタ、ファクシミリ、複写機、またはこれらの一部または全部を含む複合機が通常の電力供給による動作を行う通常状態と、装置内の一部または全部に対して通常の電力供給を遮断または通常より少なくする低電力状態とを備える場合、低電力状態において、ネットワーク通信を通常状態で応答するＣＰＵ等の消費電力を低下させ、これに代わり、ＣＰＵ等より消費電力が小さい待機応答ＬＳＩが応答することにより、低電力状態時のネットワーク通信の応答を維持しつつ、消費電力を低下させることができる。従来、この情報処理装置が、単一のネットワークインタフェースしか備えていない場合、ＣＰＵ等の電源状態（ＯＮ／ＯＦＦまたは消費電力低下）と待機応答ＬＳＩの動作状態（パススルー動作／低電力状態時の待機応答動作）とが同期していた。一方、情報処理装置においては、複数のネットワークの種類（イントラネットやインターネットなど）や用途（部署、部門別など）に対応するべく、複数のネットワークインタフェースを備えることが求められている。複数のネットワークインタフェースを備えた場合、ネットワークインタフェースごとに低電力状態時に待機応答ＬＳＩを実装する必要がある。この場合、従来どおり上記のＣＰＵ等の電源状態と複数の待機応答ＬＳＩの動作状態とが同期してしまい（図３）、個々のネットワークから送信されるデータの状態によらず、すべての待機応答ＬＳＩが同じ動作状態になり、消費電力抑制が効果的に行われなくなるという問題が生じる。具体的には、ネットワークからＣＰＵが処理すべきデータが受信されないにもかかわらず、他のネットワークから受信されたデータの影響で待機応答ＬＳＩの動作状態がパススルー動作になる。待機応答ＬＳＩは、待機応答動作時はパススルーモード時に比べて低い消費電力で動作するため、ネットワークからＣＰＵが処理すべきデータが受信されないにもかかわらず、当該ネットワークに対応する通信部の消費電力が増加することとなり、適切に消費電力削減ができないことが想定される。本発明は、複数のネットワークインタフェースにそれぞれ待機応答ＬＳＩを備えた情報処理装置において、それぞれのネットワークから受信したデータに応じて待機応答ＬＳＩの状態を適切な状態に制御して、ＣＰＵと複数のすべての待機応答ＬＳＩが同期する制御に比べて消費電力を抑制することを目的とする。

請求項１に係る情報処理装置は、ネットワークに対しデータを送受信する送受信手段と、前記送受信手段から受信したデータに対し応答処理を行わず、当該データの処理を後段の処理手段に委ねる第１の状態と、前記送受信手段から受信したデータの処理を後段の処理手段に委ねず、且つ、当該データの少なくとも一部に対して応答処理を行う第２の状態とを切り替え可能な応答処理手段と、前記応答処理手段の第１の状態と第２の状態とを切り替える切り替え手段とを備え、前記送受信手段と前記応答処理手段とは、共通の前記処理手段と複数のネットワークとの間にそれぞれ個別に備えられており、すべての前記応答処理手段が前記第２の状態にある場合において一の応答処理手段が前記予め定められたデータを受信したときは、前記切り替え手段は、他の応答処理手段の動作状態を前記第２の状態としたまま、前記一の応答処理手段の動作状態を前記第２の状態から前記第１の状態に切り替えることを特徴とする。

請求項２に係る情報処理装置は、請求項１に記載の構成において、前記切り替え手段は、すべての前記応答処理手段のうち、予め定められたデータを受信しなかった前記応答処理手段の動作状態については、前記第２の状態を維持することを特徴とする。

請求項３に係るプログラムは、ネットワークに対しデータを送受信する送受信手段と、前記送受信手段から受信したデータに対し応答処理を行わず、当該データの処理を後段の処理手段に委ねる第１の状態と、前記送受信手段から受信したデータの処理を後段の処理手段に委ねず、且つ、当該データの少なくとも一部に対して応答処理を行う第２の状態とを切り替え可能な応答処理手段と、前記応答処理手段の第１の状態と第２の状態とを切り替える切り替え手段とを備え、前記送受信手段と前記応答処理手段とが、共通の前記処理手段と複数のネットワークとの間にそれぞれ個別に備えられたコンピュータに、すべての前記応答処理手段が前記第２の状態にある場合において一の応答処理手段が前記予め定められたデータを受信したときは、前記切り替え手段が、他の応答処理手段の動作状態を前記第２の状態としたまま、前記一の応答処理手段の動作状態を前記第２の状態から前記第１の状態に切り替えるステップを実行させる。

請求項１に係る情報処理装置によれば、複数のネットワークインタフェースにそれぞれ待機応答ＬＳＩを備えた情報処理装置において、複数のすべての待機応答ＬＳＩの動作状態の切り替えが同期する制御に比べて消費電力を抑制することできる。
請求項２に係る情報処理装置によれば、複数のネットワークインタフェースにそれぞれ待機応答ＬＳＩを備えた情報処理装置において、予め定められたデータを受信しなかった応答処理手段の動作状態を維持することで、複数のすべての待機応答ＬＳＩの動作状態の切り替えが同期する制御に比べて消費電力を抑制することできる。
請求項３に係るプログラムによれば、複数のネットワークインタフェースにそれぞれ待機応答ＬＳＩを備えたコンピュータにおいて、複数のすべての待機応答ＬＳＩの動作状態の切り替えが同期する制御に比べて消費電力を抑制することできる。

画像形成装置のハードウェア構成を示すブロック図 通信機能を実現するためのハードウェア構成を示すブロック図 比較例に係る画像形成装置の動作モードを示す図 画像形成装置の機能構成を示すブロック図 画像形成装置の動作モードを示す図 各動作モードの省電力性を対比する図 スリープモードから省電力モードに切り替わる際の処理を説明する図 省電力モードから通常モードに切り替わる際の処理を説明する図 電源制御部における論理回路を簡略化して示す図 画像形成装置による処理を示すフローチャート

図１は、画像形成装置１０のハードウェア構成を示すブロック図である。同図に示したように、画像形成装置１０は、制御部１１と、記憶部１２と、操作部１３と、表示部１４と、画像読取部１５と、画像形成部１６と、通信部１７と、画像処理部１８と、電源制御部１９とを備える。また、画像形成装置１０の各部は、バスＢ１に接続されており、このバスＢ１を介して各種データの授受を行う。

制御部１１は、画像形成装置１０の各部の動作を制御する手段である。制御部１１は、ＣＰＵ（Central Processing Unit）などの演算処理装置と、ＲＯＭ（Read Only Memory）、ＲＡＭ（Random Access Memory）などの記憶媒体（主記憶装置）とを備える。ＣＰＵ（後述するＣＰＵ１１０）は、ＲＯＭおよび記憶部１２に記憶されているプログラムを読み出し、ＲＡＭを作業エリアにしてプログラムを実行する。制御部１１は、このようにプログラムを実行することにより、用紙に画像を形成すること、原稿から画像を読み取って画像データを生成すること、通信回線を介して他の装置と通信を行うことなどを実現する。

記憶部１２は、データを記憶する手段である。記憶部１２は、ハードディスク、フラッシュメモリなどの記憶媒体（補助記憶装置）を備え、通信部１７で受信したデータや画像形成装置１０で生成されたデータなどを記憶する。また、記憶部１２は、いわゆるメモリーカードやＵＳＢメモリなどの着脱可能な記憶媒体（リムーバブルメディア）と、その記憶媒体にデータを読み書きする手段とを含んでもよい。

操作部１３は、ユーザの操作を受け付ける手段である。操作部１３は、操作子（ボタン、キーなど）を備え、押下された操作子に応じた制御信号を制御部１１に供給する。また、操作部１３は、表示部１４と、表示部１４の表示面に重ねて設けられたセンサとを備え、押圧した位置に応じた制御信号を制御部１１に供給するタッチパネルによって構成されてもよい。

表示部１４は、情報を表示する手段である。表示部１４は、表示装置として例えば液晶ディスプレイを有する。表示部１４は、制御部１１の制御の下、画像形成装置１０を操作するためのメニュー画面を表示する。

画像読取部１５は、原稿を読み取って画像データに変換する手段である。画像読取部１５は、原稿を光学的に読み取り、読み取った原稿の画像を表す画像データを生成する画像読取装置を備えている。画像読取部１５は、生成した画像データを画像処理部１８に供給する。

画像形成部１６は、用紙に画像を形成する手段である。画像形成部１６は、電子写真方式によって用紙にＹＭＣＫの各色成分のトナー像を形成する画像形成機構を具備している。なお、画像形成機構は、電子写真方式に限らず、インクジェット方式などの他の記録方式が用いられてもよい。

通信部１７は、データを送受信する手段である。通信部１７は、通信回線に接続されており、外部装置と有線または無線の通信を行う通信インタフェース（以下、「通信ＩＦ」という）として機能する。本発明において、通信部１７は、後述するＰＨＹ１７１とＬＳＩ１７２（図２参照）をそれぞれ複数有しており、複数の通信ＩＦとして機能する。

画像処理部１８は、画像データに対して画像処理を実行する手段である。ここでいう画像処理とは、例えば、色補正や階調補正である。画像形成装置１０においてプリント機能が実行される場合、画像処理部１８は、画像処理が施された画像データを画像形成部１６に供給する。

電源制御部１９は、図示せぬ電源と電気的に接続され、当該電源から画像形成装置１０の各部への電力の供給を制御する。電源制御部１９は、自らの記憶領域に記憶されたプログラムを読み出して実行することにより、電力の供給を制御する。

図２は、画像形成装置１０のハードウェア構成のうち通信機能を実現するための構成を示すブロック図である。図２に示す通り、画像形成装置１０は、ＣＰＵ１１０と、ＰＨＹ（Physical Layer）１７１と、ＬＳＩ（Large Scale Integration）１７２と、電源制御部１９とにより通信機能を実現する。なお、図２に示す構成のうち、ＰＨＹ１７１とＬＳＩ１７２は、通信部１７に含まれる。ＰＨＹ１７１は、ＯＳＩ参照モデルの物理層において、ネットワークとの接続およびデータの伝送に関する物理的な方式を規定する。本発明において、通信部１７は、２つの通信ＩＦ（通信ＩＦ１および通信ＩＦ２）を備えており、２つのＰＨＹ１７１（ＰＨＹ１７１ＡおよびＰＨＹ１７１Ｂ）を有する。なお、本実施例では、２つの通信ＩＦの場合について述べるが、本発明は、通信ＩＦが２つの場合に限られるものではない。図２において、ＰＨＹ１７１Ａは通信ＩＦ１に対して設けられており、ＰＨＹ１７１Ｂは通信ＩＦ２に対して設けられている。通信ＩＦ１と通信ＩＦ２とは、互いに異なる通信回線に接続される。具体的な例として、通信ＩＦ１と通信ＩＦ２のうちの一方はインターネットに接続され、他方はイントラネットなどのＬＡＮ（Local Area Network）に接続される。別の例で、通信ＩＦ１と通信ＩＦ２とは互いに異なるグループ（部署、部門など）の通信回線に接続される。なお、通信ＩＦ１と通信ＩＦ２とは、有線と無線のどちらの方式であってもよい。

ＣＰＵ１１０は、通信ＩＦ１および通信ＩＦ２を介して通信を行う。ＣＰＵ１１０は、ＣＰＵ１１０へ電力が供給された状態またはＣＰＵ１１０がフル稼働可能な状態のとき（オンのとき）に、後述するＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂの少なくとも一方から出力されたパケット（データユニットの一例）を処理し、ＣＰＵ１１０へ一部または全部の電力が供給されていない状態あるいはＣＰＵ１１０の一部または全部の機能を停止している状態のとき（オフのとき）には当該処理を行わない。後者でＣＰＵ１１０への一部または全部の電力がされていない状態は、例えば、画像形成装置１０が一定時間使用されていない状態等を要因として設定する低電力状態に移行した際の状態である。

ＬＳＩ１７２は、オフの状態にあるＣＰＵ１１０に代わって、通信ＩＦにおいて受信されたパケットを処理する、いわゆる待機応答ＬＳＩである。ＬＳＩ１７２は、ＣＰＵ１１０における消費電力を抑制するために用いられる。通信部１７は、各通信ＩＦに対応させて２つのＬＳＩ１７２（ＬＳＩ１７２ＡとＬＳＩ１７２Ｂ）を有する。図２において、ＬＳＩ１７２Ａは、通信ＩＦ１に対応する待機応答ＬＳＩであり、ＰＨＹ１７１ＡとＣＰＵ１１０との間に設けられている。ＬＳＩ１７２Ｂは、通信ＩＦ２に対応する待機応答ＬＳＩであり、ＰＨＹ１７１ＢとＣＰＵ１１０との間に設けられている。ＬＳＩ１７２は、パススルーモードまたは待機応答モードのいずれかの動作モードで動作する。パススルーモードは、ＬＳＩ１７２が、通信ＩＦにおいて受信されたパケットをＣＰＵ１１０に出力する動作モードである。待機応答モードは、ＬＳＩ１７２が、通信ＩＦにおいて受信されたパケットのうちの少なくとも一部のパケットに対して、当該通信ＩＦを介して応答する動作モードである。以下では、待機応答モード中のＬＳＩ１７２が、入力されたパケットに対して自ら応答する動作を「自動応答」と表現する。ＬＳＩ１７２は、待機応答モードにおいて、パススルーモードに比べて低い消費電力で動作する。

電源制御部１９は、ＣＰＵ１１０とＬＳＩ１７２への電力の供給を制御する。電源制御部１９は、ＣＰＵ１１０のオンとオフとを切り替え、また、ＬＳＩ１７２の動作モードを切り替える。

図３は、比較例に係る画像形成装置１０の動作モードを示す図である。この例で、画像形成装置１０は、通常モードとスリープモードの２つの動作モードのいずれかで、外部装置と通信を行う。なお、図３（および後述の図５、図７、および図８）において、斜線で塗りつぶされたＣＰＵ１１０は、当該ＣＰＵ１１０がオフであることを表し、斜線で塗りつぶされていないＣＰＵ１１０は、当該ＣＰＵ１１０がオンであることを表す。また、斜線で塗りつぶされたＬＳＩ１７２は、当該ＬＳＩ１７２の動作モードが待機応答モードであることを表し、斜線で塗りつぶされていないＬＳＩ１７２は、当該ＬＳＩ１７２の動作モードがパススルーモードであることを表す。

通常モードは、ＣＰＵ１１０がオンであり、且つ、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂがパススルーモードである動作モードである。通常モードにおいては、通信ＩＦ１および通信ＩＦ２において受信されたパケットは、ＬＳＩ１７２を介してＣＰＵ１１０に送られる。この場合、ＣＰＵ１１０は、受信されたパケットの内容に応じた処理を行う。スリープモードは、ＣＰＵ１１０がオフであり、且つ、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂが待機応答モードである動作モードである。スリープモードにおいては、通信ＩＦ１および通信ＩＦ２において受信されたパケットは対応するＬＳＩ１７２に送られ、ＬＳＩ１７２は入力されたパケットの内容に応じた処理（自動応答またはパケットの破棄）を行う。したがって、スリープモードにおいては、通信ＩＦ１および通信ＩＦ２において受信されたパケットは、ＣＰＵ１１０に送られることなくＬＳＩ１７２により処理される。画像形成装置１０は、例えば、通信ＩＦ１と通信ＩＦ２において予め定められた時間を超えてパケットが受信されない場合など予め決められた条件（以下、「節電条件」という）を満たすと通常モードからスリープモードに切り替わり、通信ＩＦ１または通信ＩＦ２においてＣＰＵ１１０をオンにする必要があるパケット（すなわち、ＣＰＵ１１０での処理が必要なパケット。以下、「復帰パケット」という）が入力されるとスリープモードから通常モードに切り替わる。

図３に示した画像形成装置１０の動作モードの切り替わりにおいては、ＣＰＵ１１０のオン／オフとすべてのＬＳＩ１７２の動作モードとが一対一で対応しているため、ＬＳＩ１７２ＡとＬＳＩ１７２Ｂは互いに同じ動作モードで動作している。しかし、上述の通り、ＬＳＩ１７２は、待機応答モード時の方がパススルーモード時に比べて消費電力が低いため、ＬＳＩ１７２ＡとＬＳＩ１７２Ｂとが互いに同じ動作モードで動作すると、ＬＳＩ１７２において余計に電力が消費される場合がある。例えば、通信ＩＦ１または通信ＩＦ２のいずれか一方の通信ＩＦにおいて復帰パケットが受信されたことにより、画像形成装置１０の動作モードがスリープモードから通常モードに切り替わった場合であっても、必ずしも他方の通信ＩＦにおいて直ちに復帰パケットが受信されるとは限らない。この場合、復帰パケットが受信されていない通信ＩＦに対応するＬＳＩ１７２では、待機応答モードからパススルーモードに切り替えられたことにより、余計に電力が消費される。本発明は、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂの動作モードを個別に切り替えることにより、ＬＳＩ１７２における消費電力を抑制する。

図４は、画像形成装置１０の機能構成を示すブロック図である。画像形成装置１０は、送受信手段１０１と、応答処理手段１０２と、切り替え手段１０３と、処理手段１０４とを有する。送受信手段１０１は、ネットワークに対しデータを送受信する。応答処理手段１０２は、送受信手段１０１から受信したデータに対し応答処理を行わず、当該データの処理を後段の処理手段１０４に委ねるパススルーモードと、送受信手段１０１から受信したデータの処理を後段の処理手段１０４に委ねず、且つ、当該データの少なくとも一部に対して応答処理を行う待機応答モードのいずれかの動作モードで動作する。送受信手段１０１と応答処理手段１０２とは、複数のネットワークにそれぞれ個別に備えられている。切り替え手段１０３は、応答処理手段１０２の動作モードを切り替える。切り替え手段１０３は、すべての応答処理手段１０２が待機応答モードにある場合、すべての応答処理手段１０２のうち、予め定められたデータを受信した応答処理手段１０２の動作モードを待機応答モードからパススルーモードに切り替える。

図２に示した構成において、ＰＨＹ１７１は、送受信手段１０１の一例である。ＬＳＩ１７２は、応答処理手段１０２の一例である。電力の供給を制御するためのプログラムを実行している電源制御部１９は、切り替え手段１０３の一例である。通信ＩＦにおける通信を制御するためのプログラムを実行しているＣＰＵ１１０は、処理手段１０４の一例である。

図５は、本発明において、画像形成装置１０の動作モードを示す図である。なお、通常モード時とスリープモード時における各部の動作状態については、図３と同様であるため、ここでは図示を省略する。本発明において、画像形成装置１０は、上述した通常モードとスリープモードに加えて、省電力モードを実現する。省電力モードは、ＣＰＵ１１０がオンであり、且つ、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂのいずれか一方が待機応答モードである（待機応答モードで動作するＬＳＩ１７２とパススルーモードで動作するＬＳＩ１７２とが混在する）動作モードである。図５では、省電力モードの一例として、ＬＳＩ１７２Ａがパススルーモードであり、ＬＳＩ１７２Ｂが待機応答モードである状態を示している。省電力モードにおいては、パススルーモードで動作するＬＳＩ１７２に対応する通信ＩＦにおいて受信されたパケットは、当該ＬＳＩ１７２を介してＣＰＵ１１０に送られる。待機応答モードで動作するＬＳＩ１７２に対応する通信ＩＦにおいて受信されたパケットは、ＣＰＵ１１０に送られることなく当該ＬＳＩ１７２により処理される。

本発明において、画像形成装置１０は、スリープモードであるときに、通信ＩＦ１または通信ＩＦ２において復帰パケットが受信されるとスリープモードから省電力モードに切り替わる。このとき、ＬＳＩ１７２ＡとＬＳＩ１７２Ｂのうち、復帰パケットが受信された通信ＩＦに対応するＬＳＩ１７２の動作モードが待機応答モードからパススルーモードに切り替わり、他方のＬＳＩ１７２は待機応答モードのまま動作する。また、省電力モードであるときに、待機応答モードである一方のＬＳＩ１７２に対応する通信ＩＦにおいて復帰パケットが受信されると当該ＬＳＩ１７２は、待機応答モードからパススルーモードに切り替わり、画像形成装置１０は、省電力モードから通常モードに切り替わる。画像形成装置１０がスリープモードから省電力モードに切り替わる際に行われる処理、および、省電力モードから通常モードに切り替わる際に行われる処理の詳細については後述する。

図６は、画像形成装置１０により実現される各動作モードの省電力性を対比する図である。図６では、各動作モードの省電力性を「○」、「△」、「×」の３種類の記号により示しており、「○」は３つの動作モードの中で省電力性が最も高いこと、「△」は省電力性が「○」の次に高いことを、「×」は３つの動作モードの中で省電力性が最も低いことを示す。図６に示す通り、通常モード時の画像形成装置１０は、ＣＰＵ１１０がオンであり、且つ、すべてのＬＳＩ１７２がパススルーモードになっている。そのため、通常モードは、３つの動作モードの中で最も省電力性が低い。スリープモード時の画像形成装置１０は、ＣＰＵ１１０がオフであり、且つ、すべてのＬＳＩ１７２が待機応答モードになっている。そのため、通常モードは、３つの動作モードの中で最も省電力性が高い。省電力モード時の画像形成装置１０は、ＣＰＵ１１０がオンであり、且つ、パススルーモードで動作するＬＳＩ１７２と待機応答モードで動作するＬＳＩ１７２とが混在している。そのため、省電力モードは、通常モードよりも省電力性が高く、スリープモードよりも省電力性が低い。本発明における画像形成装置１０は、上述の通り、スリープモードから通常モードに切り替わる際に、スリープモードから通常モードに直接的に切り替わるのではなく、省電力モードを経て通常モードに切り替わる。したがって、省電力モードを有しない場合に比べて、通信機能における省電力性が向上する。

図７は、スリープモードから省電力モードに切り替わる際に画像形成装置１０において行われる処理を説明する図である。図７では、通信ＩＦ１において復帰パケットが受信されたことにより、画像形成装置１０がスリープモードから省電力モードに切り替わる様子を示している。図７に示す通り、待機応答モードで動作するＬＳＩ１７２Ａは、通信ＩＦ１において復帰パケットが受信されると（図７（ａ））、ＣＰＵ１１０をオンにするための信号（以下、「ＣＰＵオン信号」という）を電源制御部１９に出力する（図７（ｂ））。電源制御部１９は、ＣＰＵオン信号を受信すると、ＣＰＵ１１０をオフからオンに切り替える（図７（ｃ））。電源制御部１９は、ＣＰＵ１１０をオンに切り替えると、ＣＰＵ１１０がオンに切り替わったことを示す信号（以下、「完了信号」という）を、ＣＰＵオン信号を出力したＬＳＩ１７２（この例ではＬＳＩ１７２Ａ）のみに出力する（図７（ｄ））。ＬＳＩ１７２Ａは、完了信号を受信すると、待機応答モードからパススルーモードに切り替わる（図７（ｅ））。ＣＰＵ１１０とＬＳＩ１７２とは、画像形成装置１０が通常モードからスリープモードに切り替わる際に電気的に絶縁（アイソレーション）されている。ＣＰＵ１１０は、オフからオンに切り替わると、ＣＰＵオン信号を出力したＬＳＩ１７２とのアイソレーションを解除する（図７（ｆ））。図７に示した一連の処理により、復帰パケットが受信された通信ＩＦ１に対応するＬＳＩ１７２のみが待機応答モードからパススルーモードに切り替わり、当該ＬＳＩ１７２が受信したパケットはＣＰＵ１１０に送られる。

図８は、省電力モードから通常モードに切り替わる際に画像形成装置１０において行われる処理を説明する図である。図８では、通信ＩＦ２において復帰パケットが受信されたことにより、画像形成装置１０が省電力モードから通常モードに切り替わる様子を示している。図８に示す通り、待機応答モードで動作するＬＳＩ１７２Ｂは、通信ＩＦ２において復帰パケットが受信されると（図８（ａ））、ＣＰＵオン信号を電源制御部１９に出力する（図８（ｂ））。省電力モードにおいてＣＰＵ１１０はオンであるため、電源制御部１９は、ＣＰＵオン信号を受信すると、ＣＰＵオン信号を出力したＬＳＩ１７２（この例ではＬＳＩ１７２Ｂ）のみに完了信号を出力する（図８（ｃ））。ＬＳＩ１７２Ｂは、完了信号を受信すると、待機応答モードからパススルーモードに切り替わる（図８（ｄ））。ＣＰＵ１１０は、ＣＰＵオン信号を出力したＬＳＩ１７２とのアイソレーションを解除する（図８（ｅ））。

図９は、電源制御部１９における論理回路の一例を簡略化して示す図である。図９は、電源制御部１９が、ＣＰＵオン信号を出力したＬＳＩ１７２のみに対して完了信号を出力するための論理回路を示す。信号線Ｌ１１は、ＬＳＩ１７２Ａから電源制御部１９にＣＰＵオン信号を伝送するための信号線である。信号線Ｌ１２は、ＬＳＩ１７２Ｂから電源制御部１９にＣＰＵオン信号を伝送するための信号線である。信号線Ｌ２０は、ＣＰＵ１１０から電源制御部１９に完了信号を伝送するための信号線である。信号線Ｌ２１は、電源制御部１９からＬＳＩ１７２Ａに完了信号を伝送するための信号線である。信号線Ｌ２２は、電源制御部１９からＬＳＩ１７２Ｂに完了信号を伝送するための信号線である。図９において、電源制御部１９は、１つのＯＲ回路Ｃ１と、２つのＡＮＤ回路Ｃ２（Ｃ２ａおよびＣ２ｂ）とを有する。ＯＲ回路Ｃ１の２つの入力端子は信号線Ｌ１１および信号線Ｌ１２に、出力端子は、ＣＰＵ１１０に接続される。これにより、ＬＳＩ１７２ＡまたはＬＳＩ１７２ＢからＣＰＵオン信号が出力されると、電源制御部１９は、ＣＰＵ１１０をオンに切り替える（図９では、ＣＰＵオン信号をＣＰＵ１１０に出力する）。ＡＮＤ回路Ｃ２ａの２つの入力端子のうちの一方は信号線Ｌ１１に接続され、もう一方は信号線Ｌ２０に接続される。なお、ＣＰＵ１１０は、ＣＰＵオン信号を電源制御部１９から受信すると、オンに遷移し、信号線Ｌ２０を介して完了信号を電源制御部１９に出力する。ＡＮＤ回路Ｃ２ａの出力端子は、信号線Ｌ２１に接続される。これにより、ＬＳＩ１７２ＡがＣＰＵオン信号を出力した場合に限り、ＬＳＩ１７２Ａに対して完了信号が出力される。ＡＮＤ回路Ｃ２ｂの２つの入力端子のうちの一方は信号線Ｌ１２に接続され、もう一方は信号線Ｌ２０に接続される。ＡＮＤ回路Ｃ２ｂの出力端子は、信号線Ｌ２２に接続される。これにより、ＬＳＩ１７２ＢがＣＰＵオン信号を出力した場合に限り、ＬＳＩ１７２Ｂに対して完了信号が出力される。

図１０は、画像形成装置１０による処理を示すフローチャートである。図１０に示す処理は、待機応答モードで動作するＬＳＩ１７２により制御された通信ＩＦにおいてパケットが受信されたことを契機として開始される。なお、図１０において、ステップＳ１からステップＳ３の処理は、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂのうち、パケットが受信された通信ＩＦに対応するＬＳＩ１７２により実行される。

ステップＳ１において、ＬＳＩ１７２は、通信ＩＦにおいて受信されたパケットが復帰パケットであるか否かを判断する。ＬＳＩ１７２は、例えば、通信ＩＦにおいて受信されたパケットのプロトコルおよび宛先（ＩＰ（Internet Protocol）アドレスおよびポート番号）を解析することにより、当該パケットが復帰パケットであるか否かを判断する。受信されたパケットが復帰パケットでないと判断された場合（Ｓ１：ＮＯ）、ＬＳＩ１７２は、処理をステップＳ２に移行する。受信されたパケットが復帰パケットであると判断された場合（Ｓ１：ＹＥＳ）、ＬＳＩ１７２は、処理をステップＳ３に移行する。

ステップＳ２において、ＬＳＩ１７２は、入力されたパケットに対して自動応答し、または、入力されたパケットを破棄する。ＬＳＩ１７２の記憶領域には、パケットのプロトコルおよび宛先の組み合わせと、ＬＳＩ７２がパケットに対して行う動作との対応関係を示す情報（以下、「対応情報」という）が予め記憶されている。ＬＳＩ１７２は、この対応情報に従って、パケットに対して自動応答し、または、パケットを破棄する。ステップＳ２の処理が行われると、図１０に示した処理は終了する。

ステップＳ３において、ＬＳＩ１７２は、ＣＰＵオン信号を電源制御部１９に出力する。ステップＳ４において、電源制御部１９は、ＣＰＵ１１０がオンであるか否かを判断する。ＣＰＵ１１０がオフであると判断された場合（Ｓ４：ＮＯ）、電源制御部１９は、処理をステップＳ５に移行する。画像形成装置１０がスリープモードである場合、ステップＳ４においてＣＰＵ１１０がオフであると判断される。ＣＰＵ１１０がオンであると判断された場合（Ｓ４：ＹＥＳ）、電源制御部１９は、処理をステップＳ６に移行する。

ステップＳ５において、電源制御部１９は、ＣＰＵ１１０をオフからオンに切り替える。電源制御部１９は、ステップＳ５の処理を終えると、処理をステップＳ７に移行する。

ステップＳ６において、電源制御部１９は、パススルーモードで動作するＬＳＩ１７２があるか否かを判断する。パススルーモードで動作するＬＳＩ１７２があると判断された場合（Ｓ６：ＹＥＳ）、電源制御部１９は、処理をステップＳ７に移行する。画像形成装置１０が省電力モードである場合、ステップＳ６においてパススルーモードで動作するＬＳＩ１７２があると判断される。パススルーモードで動作するＬＳＩ１７２がないと判断された場合（Ｓ６：ＮＯ）、電源制御部１９は、処理をステップＳ９に移行する。画像形成装置１０が通常モードからスリープモードに移行中である場合、ステップＳ６においてパススルーモードで動作するＬＳＩ１７２がないと判断される。

ステップＳ７において、電源制御部１９は、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂのうち、ステップＳ３においてＣＰＵオン信号を出力したＬＳＩ１７２に完了信号を出力する。ＣＰＵオン信号を出力したＬＳＩ１７２に完了信号を出力するための仕組みは図９に示した通りである。電源制御部１９は、また、完了信号を出力すると、完了信号の出力先となるＬＳＩ１７２を識別する識別子を自らの記憶領域に記憶する。電源制御部１９の記憶領域には、最後に完了信号が出力されたＬＳＩ１７２を識別する識別子が記憶される。完了信号が入力されたＬＳＩ１７２は、待機応答モードからパススルーモードに切り替わる。

ステップＳ８において、ＣＰＵ１１０は、ステップＳ７において完了信号が出力されたＬＳＩ１７２とのアイソレーションを解除する。具体的には、ＣＰＵ１１０は、電源制御部１９の記憶領域に記憶された識別子を参照することにより、ステップＳ７において完了信号が出力されたＬＳＩ１７２を特定し、当該ＬＳＩ１７２とのアイソレーションを解除する。なお、ＣＰＵ１１０は、電源制御部１９とＬＳＩ１７２とを繋ぐ信号線Ｌ２を伝わる完了信号を監視することにより、完了信号が出力されたＬＳＩ１７２を特定してもよい。

ステップＳ９において、電源制御部１９は、ＣＰＵ１１０とＬＳＩ１７２とがアイソレーションされているか否かを判断する。ＣＰＵ１１０とＬＳＩ１７２とがアイソレーションされていると判断された場合（Ｓ９：ＹＥＳ）、電源制御部１９は、処理をステップＳ１０に移行する。ＣＰＵ１１０とＬＳＩ１７２とがアイソレーションされていないと判断された場合（Ｓ９：ＮＯ）、電源制御部１９は、処理をステップＳ１１に移行する。

ステップＳ１０において、電源制御部１９は、ＣＰＵ１１０をオンからオフに切り替える。電源制御部１９は、ステップＳ１０の処理を終えると、処理をステップＳ５に移行する。ステップＳ１１において、ＣＰＵ１１０は、通常モードからスリープモードへの移行を中止する。具体的には、ＣＰＵ１１０は、ＬＳＩ１７２とのアイソレーションを中止する。ステップＳ１２において、電源制御部１９は、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂのうち、ステップＳ３においてＣＰＵオン信号を出力したＬＳＩ１７２を待機応答モードからパススルーモードに切り替える。具体的には、電源制御部１９は、ステップＳ３においてＣＰＵオン信号を出力したＬＳＩ１７２に完了信号を出力する。ステップＳ１３において、ＣＰＵ１１０は、ステップＳ１２においてパススルーモードに切り替えられた一方のＬＳＩ１７２とは異なる他方のＬＳＩ１７２とのアイソレーションを行う。具体的には、ＣＰＵ１１０は、電源制御部１９の記憶領域に記憶された識別子を参照することにより、ステップＳ１２において完了信号が出力されたＬＳＩ１７２を特定し、当該ＬＳＩ１７２とは異なる他のＬＳＩ１７２とのアイソレーションを行う。

以上で説明した通り、本発明に係る画像形成装置１０では、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂの動作モードが個別に切り替えられる。そのため、ＬＳＩ１７２ＡおよびＬＳＩ１７２Ｂの動作モードが一括して切り替えられた場合に比べて、通信機能における省電力性が向上する。

本発明は、上述の実施形態に限定されるものではなく、種々の変形実施が可能である。以下、変形例をいくつか説明する。以下で説明する変形例のうち、２つ以上のものが組み合わされて用いられてもよい。

（１）変形例１
電源制御部１９は、複数のＬＳＩ１７２について、パススルーモードから待機応答モードへの切り替わりを個別に制御してもよい。例えば、電源制御部１９は、節電条件が満たされたか否かを通信ＩＦごとに判断し、節電条件が満たされた通信ＩＦに対応するＬＳＩ１７２の動作モードをパススルーモードから待機応答モードに切り替えてもよい。

（２）変形例２
節電条件は、実施形態に記載した条件に限らない。例えば、予め定められた時間を超えて操作部１３が操作されていないことなどが節電条件として定められていてもよい。

（３）変形例３
ＬＳＩ１７２および電源制御部１９により出力される信号の種類および信号の数は、実施形態に記載した信号に限らない。例えば、電源制御部１９は、完了信号に加え、他の信号をＬＳＩ１７２に出力することにより、ＬＳＩ１７２の動作モードを待機応答モードからパススルーモードに切り替えてもよい。

（４）変形例４
電源制御部１９が、ＣＰＵオン信号を出力したＬＳＩ１７２のみに完了信号を出力するための仕組みは、図９に示した論理回路に限らない。電源制御部１９は、例えば、ＣＰＵオン信号を出力したＬＳＩ１７２を識別する識別子を自らの記憶領域に記憶しておき、当該識別子を参照することにより特定された一のＬＳＩ１７２に完了信号を出力してもよい。

（５）変形例５
本発明は、画像形成装置１０以外の情報処理装置において適用されてもよい。例えば、画像データに対して画像処理を実行する画像処理装置などにおいて、本発明が適用されてもよい。

（６）その他の変形例
画像形成装置１０の構成は、図１に示した構成に限らない。また、通信部１７の構成は、図３に示した構成に限らない。例えば、通信部１７は、３つ以上の通信ＩＦとして機能してもよい。

実施形態において、電源制御部１９およびＣＰＵ１１０によって実行される各種プログラムは、磁気記憶媒体（磁気テープ、磁気ディスク（ＨＤＤ、ＦＤ（Flexible Disk））など）、光記憶媒体（光ディスク（ＣＤ（Compact Disk）、ＤＶＤ（Digital Versatile Disk））など）、光磁気記憶媒体、半導体メモリ（フラッシュＲＯＭなど）などのコンピュータが読み取り可能な記憶媒体に記憶した状態で提供されてもよい。また、このプログラムは、インターネットなどのネットワーク経由でダウンロードされてもよい。

１０…画像形成装置、１１…制御部、１１０…ＣＰＵ、１２…記憶部、１３…操作部、１４…表示部、１５…画像読取部、１６…画像形成部、１７…通信部、１８…画像処理部、１９…電源制御部、１７１…ＰＨＹ、１７２…ＬＳＩ、１０１…送受信手段、１０２…応答処理手段、１０３…切り替え手段、１０４…処理手段

Claims (3)

1. ネットワークに対しデータを送受信する送受信手段と、
   前記送受信手段から受信したデータに対し応答処理を行わず、当該データの処理を後段の処理手段に委ねる第１の状態と、前記送受信手段から受信したデータの処理を後段の処理手段に委ねず、且つ、当該データの少なくとも一部に対して応答処理を行う第２の状態とを切り替え可能な応答処理手段と、
   前記応答処理手段の第１の状態と第２の状態とを切り替える切り替え手段と
   を備え、
   前記送受信手段と前記応答処理手段とは、共通の前記処理手段と複数のネットワークとの間にそれぞれ個別に備えられており、すべての前記応答処理手段が前記第２の状態にある場合において一の応答処理手段が前記予め定められたデータを受信したときは、前記切り替え手段は、他の応答処理手段の動作状態を前記第２の状態としたまま、前記一の応答処理手段の動作状態を前記第２の状態から前記第１の状態に切り替える
   ことを特徴とする情報処理装置。
2. 前記切り替え手段は、すべての前記応答処理手段のうち、予め定められたデータを受信しなかった前記応答処理手段の動作状態については、前記第２の状態を維持する
   ことを特徴とする請求項１に記載の情報処理装置。
3. ネットワークに対しデータを送受信する送受信手段と、
   前記送受信手段から受信したデータに対し応答処理を行わず、当該データの処理を後段の処理手段に委ねる第１の状態と、前記送受信手段から受信したデータの処理を後段の処理手段に委ねず、且つ、当該データの少なくとも一部に対して応答処理を行う第２の状態とを切り替え可能な応答処理手段と、
   前記応答処理手段の第１の状態と第２の状態とを切り替える切り替え手段と
   を備え、
   前記送受信手段と前記応答処理手段とが、共通の前記処理手段と複数のネットワークとの間にそれぞれ個別に備えられたコンピュータに、
   すべての前記応答処理手段が前記第２の状態にある場合において一の応答処理手段が前記予め定められたデータを受信したときは、前記切り替え手段が、他の応答処理手段の動作状態を前記第２の状態としたまま、前記一の応答処理手段の動作状態を前記第２の状態から前記第１の状態に切り替えるステップ
   を実行させるためのプログラム。

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