JP6322867B2 - Pll回路 - Google Patents
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Description
概略的には、本実施形態では、PLL回路の比較周波数の2分の1の整数倍に出現する整数境界スプリアスがPLL回路のループフィルタのループ帯域外に存在するように、所望の設定周波数に応じて比較周波数を切り替える。これにより、PLL回路のループフィルタのループ帯域内における整数境界スプリアスの出現を防止すると共に、PLL回路のループ帯域外での抑圧特性を利用することにより、ループ帯域外における整数境界スプリアスを抑圧する。本実施形態では、説明の便宜上、比較周波数として、第1比較周波数Fpdaおよび第2比較周波数Fpdbの2つの比較周波数を導入し、第1比較周波数Fpdaを92MHzとし、第2比較周波数Fpdbを91.2MHzとする。
図1は、本実施形態に係るPLL回路100の構成例を示す図である。
PLL回路100は、小数分周型PLL回路であり、基準周波数発生部110、比較周波数発生部120、設定周波数発生部130、記憶部140、比較周波数設定部150を備えている。ここで、基準周波数発生部110は、図示しない例えば水晶発振器により発生された基準周波数Fcrから基準比較周波数Fpdを発生させるものであり、分周器111、位相比較器112、電圧制御発振器(VCO; Voltage Controlled Oscillator)113、分周器114、帯域通過フィルタ115を備えている。本実施形態では、理解の容易化のために、基準周波数Fcrは10MHzであるものとするが、この例に限定されない。
図2は、PLL回路のループ帯域外での抑圧効果の一例を説明するための図であり、(A)は、設定周波数を「比較周波数Fpdxの整数倍+200kHz」に設定した場合に発生する整数境界スプリアスの一例を示し、(B)は、設定周波数を「比較周波数Fpdxの整数倍+400kHz」に設定した場合に発生する整数境界スプリアスの一例を示し、(C)は、設定周波数を「比較周波数Fpdxの整数倍+600kHz」に設定した場合に発生する整数境界スプリアスの一例を示している。
図3は、本発明の実施形態によるPLL回路100の記憶部140に格納されたテーブルを説明するための図である。
図4に示す例では、第1比較周波数Fpdaによる整数境界スプリアスは、周波数Fpda/2,2Fpda/2,3Fpda/2,4Fpda/2,…,(n−1)Fpda/2,nFpda/2,(n+1)Fpda/2,…,mFpda/2で出現している。また、第2比較周波数Fpdbによる整数境界スプリアスは、周波数Fpdb/2,2Fpdb/2,3Fpdb/2,4Fpdb/2,…,(n−1)Fpdb/2,nFpdb/2,(n+1)Fpdb/2,…,mFpdb/2で出現している。ここで、n,m(m>n)は任意の整数である。
図5は、本発明の実施形態によるPLL回路100による比較周波数の選定方法を説明するための図である。第1比較周波数Fpdaおよび第2比較周波数Fpdbは、次の手順1〜3により選定することができる。ただし、この例に限定されず、第1比較周波数Fpdaおよび第2比較周波数Fpdbは、所望の設定周波数Foを阻害しないことを限度として、任意に設定することができる。
基準比較周波数Fpdの暫定値は、PLL回路100の各構成要素(例えば、電圧制御発振器123、ループフィルタ、位相比較器122)の雑音特性等を基に、PLL回路100のループ帯域内雑音が最も低くなる周波数に決定する。
次に、本実施形態によるPLL回路の動作を説明する。
ここでは、説明の便宜上、所望の設定周波数Foは、図3に示す周波数領域Cに属するものとする。
基準周波数発生部110は、図示しない水晶発振器から出力される基準周波数Fcrの信号を整数分周して基準比較周波数Fpdの周波数信号を発生させる。この例では、基準周波数Fcrは10MHzであり、分周比は「10」であるから、基準周波数発生部110は基準比較周波数Fpdとして100MHzの周波数信号を発生させて比較周波数発生部120に供給する。
また、上述した実施形態によれば、比較周波数発生部120に狭帯域通過フィルタとして水晶フィルタ127,128を切り替え可能に備えたので、例えば、比較周波数から約10kHz以上離れた周波数帯域おける位相雑音をカットすることができ、低スプリアスの周波数シンセサイザを実現することができる。
また、上述の実施形態によれば、HF帯からX帯にわたる広い周波数範囲において、周波数設定分解能、低位相雑音、低スプリアスを実現することができる。
なお、本発明者らは、従来技術によるスプリアス抑圧比が−60dBc程度であるのに対し、本発明によれば、−80dBc以上に改善されることを実験的に検証した。
例えば、上述の実施形態では、第1比較周波数Fpdaと第2比較周波数Fpdbの2つの比較周波数を用いる場合を例としたが、その選定方法は任意である。比較周波数の選定については、例えば、比較周波数の2分の1の整数倍の周波数がPLL回路のループ帯域から充分に離れた周波数になるように比較周波数を選定すればよく、表計算ソフト等を用いて容易に計算することができる。
また、上述の実施形態では、整数境界スプリアスを例として説明したが、本発明は、図6に示した比較スプリアスFS1や小数分周スプリアスFS2など、他の任意のスプリアスに適用することが可能である。
110 基準周波数発生部
111,121,124,125,131,134 分周器
112,122,132 位相比較器
113,123,133 電圧制御発振器
114 分周器(10分周)
115 帯域通過フィルタ
120 比較周波数発生部
126,129 スイッチ
127,128帯域通過フィルタ
130 設定周波数発生部
140 記憶部(テーブル)
150 比較周波数設定部
Claims (4)
- 複数の比較周波数を選択的に発生させる比較周波数発生部と、
前記比較周波数の2分の1の整数倍にあたる整数境界スプリアスがPLL回路のループフィルタのループ帯域外に存在するように設定された前記複数の比較周波数と前記複数の比較周波数に対応する複数の周波数領域とが対応づけられて規定されたテーブルを格納する記憶部と、
前記比較周波数発生部により発生された比較周波数を用いて所望の設定周波数を発生させる設定周波数発生部と、
前記テーブルを参照して、前記比較周波数発生部が発生すべき比較周波数を設定する比較周波数設定部と、
を備えたPLL回路。 - 前記複数の周波数領域のそれぞれは、対応する比較周波数によるスプリアスを含まない周波数領域であり、
前記比較周波数設定部は、
前記テーブルに規定された複数の周波数領域のうち、前記設定周波数が属する周波数領域に対応した比較周波数を前記比較周波数発生部が発生すべき比較周波数として設定する、請求項1に記載のPLL回路。 - 前記比較周波数発生部は、
基準比較周波数信号とフィードバック信号とを位相比較して、前記基準比較周波数信号と前記フィードバック信号との間の位相差を示す信号を出力する位相比較器と、
前記位相比較器の出力信号によって示される前記位相差を縮小させる周波数信号を出力する電圧制御発振器と、
前記比較周波数設定部により設定された比較周波数に応じた分周比で前記電圧制御発振器の出力信号を小数分周して前記フィードバック信号として前記位相比較器に供給する小数分周器と、
前記小数分周器の分周比に応じて前記電圧制御発振器が発生し得る複数の周波数信号に対応した複数の水晶フィルタと、
前記比較周波数設定部により設定された比較周波数に応じて前記複数の水晶フィルタを択一的に選択するスイッチと、
を備えた請求項1または2に記載のPLL回路。 - 前記複数の周波数領域のそれぞれは、
当該PLL回路のループフィルタのループ帯域内に、対応する比較周波数のスプリアスが存在しないように設定された、請求項1から3の何れか1項に記載のPLL回路。
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