JP6167672B2 - モータ制御装置及びモータ制御方法 - Google Patents
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Description
図1は、第1実施形態のモータ制御装置100の構成の一例を示す図である。本実施形態のモータ制御装置100は、パルス発生器1、レジスタ2、CPU3、メモリ4、レジスタ5、アドレスカウンタ6及び比較器7を備える。モータ制御装置100は、モータドライバ400にパルスを送信することにより、モータを制御する。モータドライバ400は、モータ制御装置100から受信したパルスに応じた電流をモータに与えることにより、モータを動作させる。
次に、第2実施形態のモータ制御装置200について説明する。第2実施形態のモータ制御装置200は、モータ制御情報として、目標カウント数が追加されている点が、第1実施形態とは異なる。
次に、第3実施形態のモータ制御装置300について説明する。第3実施形態のモータ制御装置300は、モータ制御情報として、パルスの目標発生回数の代わりに目標カウント数を使用する点が、第1実施形態とは異なる。モータドライバ400については、第1実施形態と同じであるため説明を省略する。
2 レジスタ
3 CPU
4 メモリ
5 レジスタ
6 アドレスカウンタ
7 比較器
21 パルス発生器
22 レジスタ
23 CPU
24 メモリ
25 レジスタ
26 アドレスカウンタ
27 比較器
28 レジスタ
29 セレクタ
31 パルス発生器
32 レジスタ
33 CPU
34 メモリ
35 レジスタ
36 アドレスカウンタ
37 比較器
38 セレクタ
100 モータ制御装置
200 モータ制御装置
300 モータ制御装置
400 モータドライバ
Claims (6)
- パルスをモータドライバに送信することによりモータを制御するモータ制御装置であって、
パルスを発生させるタイミングを示す、パルス間の基準クロックのカウント数を含む制御テーブルを記憶するメモリと、
前記パルスの目標発生回数を記憶する第1レジスタと、
前記メモリから前記カウント数を読み出して記憶する第2レジスタと、
前記カウント数の目標カウント数を記憶する第3レジスタと、
前記パルスの目標発生回数を前記第1レジスタに指定し、前記第2レジスタに該第2レジスタがはじめに参照する前記メモリのアドレスを指定し、前記目標カウント数を前記第3レジスタに指定する制御部と、
前記パルスの発生回数に応じて、前記カウント数を読み出す前記メモリのアドレスを変更するアドレスカウンタと、
前記発生回数と前記目標発生回数とが一致したときに、前記アドレスカウンタの動作を停止させる比較器と、
前記発生回数が前記目標発生回数以下である場合に、前記第2レジスタの前記カウント数をパルス発生器に送信し、前記発生回数が前記目標発生回数より大きい場合に、前記第3レジスタの前記目標カウント数を前記パルス発生器に送信するセレクタと、
前記パルスを前回発生させてから、前記セレクタから受信した前記カウント数又は前記目標カウント数だけ待った後、前記パルスを発生させるパルス発生器と、
を備えるモータ制御装置。 - パルスをモータドライバに送信することによりモータを制御するモータ制御装置であって、
パルスを発生させるタイミングを示す、パルス間の基準クロックのカウント数を含む制御テーブルを記憶するメモリと、
前記カウント数を記憶する第1レジスタと、
前記メモリから前記カウント数を読み出して記憶する第2レジスタと、
前記カウント数を前記第1レジスタに指定し、前記第2レジスタに該第2レジスタがはじめに参照する前記メモリのアドレスを指定する制御部と、
前記パルスの発生回数に応じて、前記カウント数を読み出す前記メモリのアドレスを変更するアドレスカウンタと、
前記第1レジスタのカウント数、又は前記第2レジスタのカウント数を送信するセレクタと、
前記第1レジスタのカウント数と、前記第2レジスタのカウント数との比較結果に応じて、前記セレクタへの選択信号の送信と、前記アドレスカウンタへの停止信号の送信とを行う比較器と、
前記パルスを前回発生させてから、前記セレクタから受信した前記第1レジスタのカウント数、又は前記第2レジスタのカウント数だけ待った後、前記パルスを発生させるパルス発生器と、
を備えるモータ制御装置。 - 前記比較器は、
モータの加速時には、前記第1レジスタのカウント数が、前記第2レジスタのカウント数よりも大きくなった場合に、前記第1レジスタのカウント数を選択することを示す前記選択信号を前記セレクタに送信し、前記停止信号を前記アドレスカウンタに送信する
請求項2に記載のモータ制御装置。 - 前記比較器は、
モータの減速時には、前記第1レジスタのカウント数が、前記第2レジスタのカウント数よりも小さくなった場合に、前記第1レジスタのカウント数を選択することを示す前記選択信号を前記セレクタに送信し、前記停止信号を前記アドレスカウンタに送信する
請求項2又は3に記載のモータ制御装置。 - パルスを発生させるタイミングを示す、パルス間の基準クロックのカウント数を含む制御テーブルを記憶するメモリと、前記パルスの目標発生回数を記憶する第1レジスタと、前記メモリから前記カウント数を読み出して記憶する第2レジスタと、前記カウント数の目標カウント数を記憶する第3レジスタと、を備えるモータ制御装置のモータ制御方法であって、
制御部が、前記パルスの目標発生回数を前記第1レジスタに指定するステップと、
制御部が、前記第2レジスタに該第2レジスタがはじめに参照する前記メモリのアドレスを指定するステップと、
制御部が、前記目標カウント数を前記第3レジスタに指定するステップと、
アドレスカウンタが、前記パルスの発生回数に応じて、前記カウント数を読み出す前記メモリのアドレスを変更するステップと、
比較器が、前記発生回数と前記目標発生回数とが一致したときに、前記アドレスカウンタの動作を停止させるステップと、
セレクタが、前記発生回数が前記目標発生回数以下である場合に、前記第2レジスタの前記カウント数をパルス発生器に送信し、前記発生回数が前記目標発生回数より大きい場合に、前記第3レジスタの前記目標カウント数を前記パルス発生器に送信するステップと、
パルス発生器が、前記パルスを前回発生させてから、前記セレクタから受信した前記カウント数又は前記目標カウント数だけ待った後、前記パルスを発生させるステップと、
を含むモータ制御方法。 - パルスを発生させるタイミングを示す、パルス間の基準クロックのカウント数を含む制御テーブルを記憶するメモリと、前記カウント数を記憶する第1レジスタと、前記メモリから前記カウント数を読み出して記憶する第2レジスタと、を備えるモータ制御装置のモータ制御方法であって、
制御部が、前記カウント数を前記第1レジスタに指定するステップと、
制御部が、前記第2レジスタに該第2レジスタがはじめに参照する前記メモリのアドレスを指定するステップと、
アドレスカウンタが、前記パルスの発生回数に応じて、前記カウント数を読み出す前記メモリのアドレスを変更するステップと、
セレクタが、前記第1レジスタのカウント数、又は前記第2レジスタのカウント数を送信するステップと、
比較器が、前記第1レジスタのカウント数と、前記第2レジスタのカウント数との比較結果に応じて、前記セレクタへの選択信号の送信と、前記アドレスカウンタへの停止信号の送信とを行うステップと、
パルス発生器が、前記パルスを前回発生させてから、前記セレクタから受信した前記第1レジスタのカウント数、又は前記第2レジスタのカウント数だけ待った後、前記パルスを発生させるステップと、
を含むモータ制御方法。
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JP2013115556A JP6167672B2 (ja) | 2013-05-31 | 2013-05-31 | モータ制御装置及びモータ制御方法 |
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JP2013115556A JP6167672B2 (ja) | 2013-05-31 | 2013-05-31 | モータ制御装置及びモータ制御方法 |
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