JP6132095B2 - 信号変換装置 - Google Patents
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Description
演算増幅器と抵抗とコンデンサとで構成され、第1の基準電圧に基づいて積分を行うスイッチング周期が制御可能な積分器と、
前記積分器の出力信号を第2の基準電圧に基づいてデジタル信号に変換するA/D変換部と、このA/D変換部の出力信号をパルス信号に変換して前記積分器のスイッチング周期制御信号として帰還するパルス幅信号変換部を含むA/D変換器とで構成された信号変換装置において、
前記A/D変換器のA/D変換部とパルス幅信号変換部の間に、前記積分器におけるコンデンサの両端電位を等しくするために前記A/D変換部の出力信号を増幅して前記パルス幅信号変換部へ出力するデジタルゲイン演算部を設けたことを特徴とする。
また、請求項2記載の発明は、前記デジタルゲイン演算部は、前記積分器の出力信号が前記A/D変換部に入力されたとき、前記積分器におけるコンデンサの両端電位を等しくするため、前記第1の基準電圧と前記第2の基準電圧に応じたゲインを演算し、前記A/D変換部の出力信号を前記ゲインに基づき増幅することを特徴とする。
OA 演算増幅器
R 抵抗
C コンデンサ
SW 切換スイッチ
SMC シングルチップマイクロコンピュータ
ADC A/D変換部
DF デジタルフィルタ
PWC パルス幅信号変換部
DGO デジタルゲイン演算部
Claims (5)
- 演算増幅器と抵抗とコンデンサとで構成され、第1の基準電圧に基づいて積分を行うスイッチング周期が制御可能な積分器と、
前記積分器の出力信号を第2の基準電圧に基づいてデジタル信号に変換するA/D変換部と、このA/D変換部の出力信号をパルス信号に変換して前記積分器のスイッチング周期制御信号として帰還するパルス幅信号変換部を含むA/D変換器とで構成された信号変換装置において、
前記A/D変換器のA/D変換部とパルス幅信号変換部の間に、前記積分器におけるコンデンサの両端電位を等しくするために前記A/D変換部の出力信号を増幅して前記パルス幅信号変換部へ出力するデジタルゲイン演算部を設けたことを特徴とする信号変換装置。 - 前記デジタルゲイン演算部は、前記積分器の出力信号が前記A/D変換部に入力されたとき、前記積分器におけるコンデンサの両端電位を等しくするため、前記第1の基準電圧と前記第2の基準電圧に応じたゲインを演算し、前記A/D変換部の出力信号を前記ゲインに基づき増幅することを特徴とする請求項1に記載の信号変換装置。
- 前記A/D変換器は、ΔΣ型A/D変換器であることを特徴とする請求項1または2に記載の信号変換装置。
- 前記ΔΣ型A/D変換器はシングルチップマイクロコンピュータで構成されていることを特徴とする請求項3に記載の信号変換装置。
- 前記制御器のコンデンサはセラミックコンデンサであることを特徴とする請求項1から4のいずれかに記載の信号変換装置。
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