JP5983082B2 - 表示制御回路、表示装置、及び、電子機器 - Google Patents
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Description
従来、フィルター処理は、表示色毎に個別の回路を用いて実行していたため、フィルター処理を実行する回路の回路規模が大きくなるという問題が存在した。
これに対して、本発明に係る表示制御回路は、映像信号に基づいて、画素に割り当てられた表示色について当該画素で表示すべき階調を規定する階調信号を生成(すなわち、フィルター処理を実行)してこれを表示パネルに供給する。すなわち、本発明に係る表示制御回路は、各画素に対する表示色の割り当てを考慮しない映像信号から、各画素に対する表示色の割り当てを考慮した階調信号を生成するフィルター処理を実行し、生成した階調信号を表示パネルに供給する。このため、表示装置は映像信号により定められる画像を表示することが可能となる。
この態様によれば、演算部は、ある画素で表示すべき階調を規定する階調信号を、ブロックで表示すべき階調に基づいて定める。このため、モアレや偽色等の表示不良の発生を抑制することが可能となり、高品位な表示を実現することができる。
この態様によれば、演算部は、ある画素で表示すべき階調を規定する階調信号を、ブロックで表示すべき階調に基づいて定める。このため、モアレや偽色等の表示不良の発生を抑制することが可能となり、高品位な表示を実現することができる。
ことが好ましい。
この態様によれば、2以上の表示色毎に定められる所定数の係数の合計値がすべて「1」であるため、階調信号が指定する2以上の表示色間の階調のバランスは、映像信号における2以上の表示色間の階調のバランスに等しくなる。換言すれば、演算部が、映像データVideoから階調信号Vidを生成することによる色味の変化は生じず、映像信号により定められる画像に現れる色味を正確に再現することが可能となる。
また、ある画素で表示する階調は、ブロック(所定数の画素)で表示すべき階調の加重平均として定められるため、当該ある画素で表示すべき階調と、ある画素の周辺の画素で表示すべき階調とが大きく異なる場合であっても、モアレや偽色等の表示不良の発生する可能性を低減することが可能となる。
この態様によれば、表示制御回路は、赤色、青色、緑色についての階調を規定する映像信号に基づいて、白色についての階調を規定する第4映像信号を生成する。そのため、赤色、青色、緑色の3原色についての階調を規定する映像信号に基づいて、赤色、青色、緑色、白色の4色を表示可能な表示パネルに、映像信号の定める画像を表示させることが可能となる。
また、この態様によれば、表示装置は白色を表示可能であるため、白色を表示できない場合に比べて、表示パネルに表示される画像全体の明度を向上させることができる。
また、上述した表示制御回路において、前記ブロックは、b行×c列の画素(b、cは1以上の整数)から構成される、態様としてもよい。
これらの態様によれば、ある画素で表示すべき階調を規定する階調信号が、ブロックで表示すべき階調に基づいて定められる。このため、モアレや偽色等の表示不良の発生を抑制することが可能となり、高品位な表示を実現することができる。
この発明によれば、表示装置が、2以上の表示色を表示可能であり、且つ、2以上の表示色のうちいずれかの表示色が割り当てられた画素を備える場合に、表示不良の発生を抑制した高品位の表示を実現させることを目的とする。
図1は、本発明の第1実施形態に係る表示装置1のブロック図である。表示装置1は、表示パネル2と、表示パネル2の動作を制御する制御部30とを備える。
表示部10には、複数の画素PXがマトリクス状に配列されている。具体的には、図1に示すように、表示部10において、M本の走査線12が横方向(X方向)に延在して設けられ、またN本のデータ線14が縦方向(Y方向)に延在し、且つ、各走査線12と互いに電気的な絶縁を保って設けられている。そして、M本の走査線12とN本のデータ線14との交差に対応して画素PXが設けられている。このため、本実施形態において複数の画素PXは、縦M行×横N列のマトリクス状に配列されている。ここで、M、Nは、いずれも2以上の自然数である。
なお、各走査線12を区別するために、図1において上から順に、第1行、第2行、…、第M行と呼ぶ場合がある。同様に、各データ線14を区別するために、図1において左から順に、第1列、第2列、…、第M列と呼ぶ場合がある。また、第m行(1≦m≦M)、第n列(1≦n≦N)に位置する画素PXを、画素PX[m][n]と表記する場合がある。
なお、図2に示す回路図は一例であり、画素回路11はこれ以外の構成であってもよい。例えば、画素回路11は、液晶素子CLに並列に補助容量を接続した構成も採用され得る。
より具体的には、図3に示すように、表示部10が備える複数の画素PXは、赤色を表示可能な画素PX−R、緑色を表示可能な画素PX−G、青色を表示可能な画素PX−B、及び、白色を表示可能な画素PX−Wを含む。このため、表示部10は、赤色(R)、緑色(G)、青色(B)、及び、白色(W)の4色の表示色を表示することができる。
なお、本実施形態では、これら4種類の画素PX(画素PX−R、画素PX−G、画素PX−B、画素PX−W)は、表示部10においてベイヤー配列されている。具体的には、ある行(例えば、偶数行)において、画素PX−Gと画素PX−Rとが交互に配列され、当該ある行に隣り合う行(例えば、奇数行)において、画素PX−Wと画素PX−Bとが交互に配列されている。
走査線駆動回路21は、制御部30から供給される制御信号Ctrに従って、走査信号Gw[1]〜Gw[M]を生成し、これらをそれぞれ第1行目〜第M行目の走査線12に対して供給することによって、第1行〜第M行の走査線12を順次に選択する。具体的には、走査線駆動回路21は、走査信号Gw[1]〜Gw[M]を、1フレームの期間において、1水平走査期間毎に順番に所定の選択電位に設定することで、1水平走査期間毎に各走査線12を順次に選択する。
データ線駆動回路22は、図示省略されたDA変換回路を備え、制御部30から供給されるデジタルの階調信号Vidに基づいて、階調電位VD[1]〜VD[N]を生成する。そして、データ線駆動回路22は、走査線駆動回路21による走査線12の選択に同期して、階調電位VD[1]〜VD[N]を、N本のデータ線14の各々に対して供給する。
駆動制御回路40は、同期信号に基づいて、制御信号Ctrを生成するとともに、制御信号Ctrを駆動回路20及び表示制御回路50に供給する。
表示制御回路50は、映像データVideo及び制御信号Ctrに基づいて、階調信号Vidを生成し、これをデータ線駆動回路22に供給する。
上述のとおり、複数の画素PXの各々は、4つの表示色のうちのいずれか1色が割り当てられ、当該割り当てられた1の表示色を表示可能である。従って、複数の画素PXの各々は、映像データVideoが規定する3原色(RGB)の全てを表示することはできない。例えば、ある画素PXに割り当てられた表示色が緑色である場合(つまり、画素PXが画素PX−Gである場合)であっても、映像データVideoは、当該ある画素PXで表示すべき緑色の階調の他に、当該ある画素PXで表示すべき赤色の階調、及び、当該ある画素PXで表示すべき青色の階調といった、当該ある画素PXに割り当てられた表示色以外の表示色についての階調も規定する。
一方、階調信号Vidは、複数の画素PXの各々が表示可能な表示色(つまり、各画素PXに割り当てられた表示色)について、当該画素PXが表示する階調を例えば8ビットで規定するデータである。例えば、ある画素PXに割り当てられた表示色が緑色である場合、階調信号Vidは、当該ある画素PXに割り当てられた表示色である緑色についてのみ、当該ある画素PXで表示する階調を規定する。
このように、制御部30は、複数の画素PXに対する表示色の割り当てを考慮せずに定められた映像データVideoに基づいて、各画素PXに対する表示色の割り当てを考慮した階調信号Vidを生成するフィルター処理を実行し、これを、(データ線駆動回路22を介して)複数の画素PXに供給する。
表示制御回路50は、映像データVideoに基づいて、赤色映像信号VsR(第1映像信号)、緑色映像信号VsG(第2映像信号)、青色映像信号VsB(第3映像信号)、及び、各画素PXで表示すべき白色の階調を規定する白色映像信号VsW(第4映像信号)を含む映像信号Vを生成する変換部51、映像信号Vに基づいて、赤色抽出信号XsR、緑色抽出信号XsG、青色抽出信号XsB、及び、白色抽出信号XsWを含む抽出信号Xを生成する抽出部52、並びに、赤色係数KR、緑色係数KG、青色係数KB、及び、白色係数KWを記憶する記憶部53を備える。
なお、以下では、赤色映像信号VsR、緑色映像信号VsG、青色映像信号VsB、及び、白色映像信号VsWを、「単色映像信号Vs」と総称し、赤色抽出信号XsR、緑色抽出信号XsG、青色抽出信号XsB、及び、白色抽出信号XsWを、「単色抽出信号Xs」と総称し、赤色係数KR、緑色係数KG、青色係数KB、及び、白色係数KWを、「係数K」と総称する場合がある。
以下、変換部51、抽出部52、及び、記憶部53について詳述する。
なお、以下では、画素PX[m][n]に対して各単色映像信号Vsが指定する階調をVs[m][n]で表す場合がある。
図3に示すように、本実施形態において、ブロックBL[m][n]とは、画素PX[m][n]を取り囲む8個の画素PX、及び、当該画素PX[m][n]からなる、9個の画素PXである(すなわち、本実施形態において、所定数は「9」である)。換言すれば、本実施形態におけるブロックBL[m][n]は、第(m−1)行〜第(m+1)行に位置し、且つ、第(n−1)列〜第(n+1)列に位置する、画素PX[m][n]を中心とした縦3行×横3列の9個の画素PXである。
つまり、単色抽出信号Xsは、図5に示すように、Xs11(=Vs[m−1][n−1])、Xs12(=Vs[m−1][n])、Xs13(=Vs[m−1][n+1])、Xs21(=Vs[m][n−1])、Xs22(=Vs[m][n])、Xs23(=Vs[m][n+1])、Xs31(=Vs[m+1][n−1])、Xs32(=Vs[m+1][n])、及び、Xs33(=Vs[m+1][n+1])からなる所定数(9個)の値を有する。
すなわち、抽出部52は、赤色映像信号VsRから赤色抽出信号XsRを抽出し、緑色映像信号VsGから緑色抽出信号XsGを抽出し、青色映像信号VsBから青色抽出信号XsBを抽出し、白色映像信号VsWから白色抽出信号XsWを抽出する。
なお、以下では、画素PX[m][n]に対して階調信号Vidが指定する階調を、Vid[m][n]と表す場合がある。
以下、第1選択部54、第2選択部55、及び、演算部70について詳述する。
例えば、図3に示すように、画素PX[m][n]が画素PX−Gであり、画素PX[m][n]に割り当てられた表示色が緑色である場合、第1選択部54は、抽出部52より出力される4つの単色抽出信号Xsから緑色抽出信号XsG(XsG11〜XsG33)を選択し、これを出力する。
例えば、図3に示すように、画素PX[m][n]に割り当てられた表示色が緑色である場合、第2選択部55は、4つの係数Kから緑色係数KG(KG11〜KG33)を選択し、これを出力する。
具体的には、演算部70は、以下の式(1)に基づいて階調信号Vidを生成する。ここで、式(1)において登場する符号<x,y>は、ベクトルx及びベクトルyの内積を表す。また、式(1)において登場するVec(Xs)は、式(2)に示すように、単色抽出信号Xsの有する所定数(9個)の値を要素とする9次元のベクトルを表し、Vec(K)は、式(3)に示すように、所定数(9個)の係数K11〜K33を要素とする9次元のベクトルを表す。
Vid[m][n] = <Vec(Xs),Vec(K)>
= Xs11*K11+Xs12*K12+Xs13*K13
+Xs21*K21+Xs22*K22+Xs23*K23
+Xs31*K31+Xs32*K32+Xs33*K33 ……(1)
但し、
Vec(Xs)
=(Xs11,Xs12,Xs13,Xs21,
Xs22,Xs23,Xs31,Xs32,Xs33) ……(2)
Vec(K)
=(K11,K12,K13,K21,
K22,K23,K31,K32,K33) ……(3)
すなわち、演算部70は、式(1)に示すように、ブロックBL[m][n]を構成する所定数(9個)の画素PXの各々について、単色抽出信号Xsの有する値と当該値に対応する係数Kとの乗算を実行することで、9個の乗算値を算出し、算出された9個の乗算値の合計値として階調Vid[m][n]を算出する。
このため、式(1)で算出されるVid[m][n]は、係数K11〜K33を重みとした、単色抽出信号Xsの示す階調Xs11〜Xs33の加重平均としての意味を有することになる。
具体的には、係数K11〜K33の中で、画素PX[m][n]に対応する係数K22が最も大きな値に定められ、画素PX[m][n]に上下左右方向で隣接する4つの画素PX(画素PX[m−1][n]、画素PX[m][n−1]、画素PX[m][n+1]、画素PX[m+1][n])に対応する4つの係数K12、K21、K23、K32は、画素PX[m][n]に斜め方向で隣接する4つの画素PX(画素PX[m−1][n−1]、画素PX[m−1][n+1]、画素PX[m+1][n−1]、画素PX[m+1][n+1])に対応する4つの係数K11、K13、K31、K33よりも大きな値に定められる。例えば、図6に示すように、係数KG22を「0.8」に設定し、係数KG12、KG21、KG23、及び、KG32を「0.05」に設定し、係数KG22、KG22、KG22、及び、KG22を「0」に設定してもよい。
また、係数K11〜K33には、4つの表示色毎に異なる値を設定しもよいし、4つの表示色に対して同一の値を設定してもよい。
以下、乗算部56及び加算部57について詳述する。
図7(A)に示すように、乗算部56は、入力された複数の値の乗算値を算出する乗算器Mpを所定数(9個)備える。各乗算器Mpには、単色抽出信号Xsの有する9個の値の各々と、当該値に対応する係数Kが入力される。例えば、1番目の乗算器Mpには、Xs11とK11とが入力され、2番目の乗算器Mpには、Xs12とK12とが入力される。そして、各乗算器Mpは、入力された2つの値の乗算値を出力する。例えば、1番目の乗算器Mpに、Xs11とK11とが入力されたときに、当該乗算器Mpは、これらの2つの値の乗算値Xs11*K11を出力する。これにより、乗算部56は、式(1)の右辺の第1項〜第9項(Xs11*K11〜Xs33*K33)の各々の値を算出する。
第1段571に配置された3個の加算器Adには、それぞれ、3つの乗算器Mpから出力される3つの値が入力される。例えば、第1段571に配置された3個の加算器Adのうち、1番目の加算器Adには、式(1)の右辺第1項〜第3項を表す3つの値(Xs11*K11〜Xs13*K13)が入力され、2番目の加算器Adには、式(1)の右辺第4項〜第6項を表す3つの値(Xs21*K21〜Xs23*K23)が入力され、3番目の加算器Adには、式(1)の右辺第7項〜第9項を表す3つの値(Xs31*K31〜Xs33*K33)が入力される。そして、第1段571に配置された3個の加算器Adの各々は、入力された3個の値の加算値を算出してこれを、第2段572に配置された加算器Adに出力する。
第2段572に配置された加算器Adは、第1段571に配置された3個の加算器Adから出力される3個の値の加算値を演算する。そして、演算部70(第2段572に配置された加算器Ad)は、当該第2段572に配置された加算器Adの算出値を、階調信号Vidが画素PX[m][n]に対して指定する階調であるVid[m][n]として出力する。
上述のとおり、映像データVideoは、各画素PXで表示すべき赤色、緑色、青色についての階調を規定するデータである。一方、表示部10が備える複数の画素PXの各々には、赤色、緑色、青色、白色の4つの表示色のうち、いずれかの表示色が割り当てられている。従って、映像データVideoがそのまま供給されても、表示部10は画像を表示することができない。
これに対して、本実施形態では、制御部30が、映像データVideoに基づいて、各画素PXに対する表示色の割り当てを考慮して各画素PXで表示する階調を規定する階調信号Vidを生成する。
従って、本実施形態は、表示装置1の上位装置が、赤色、緑色、青色の3原色の階調を規定する映像データVideoを出力する場合であっても、3原色以外の色(例えば白色)を表示可能な表示パネル2(表示部10)を当該表示装置1に適用することができる。
すなわち、本実施形態は、制御部30が、第1選択部54及び第2選択部55を備えるため、4つの表示色に1対1に対応した4つの演算部70を設ける必要がなく、制御部30は演算部70を1つ備える構成とすることができる。これにより、本実施形態に係る表示装置1は、制御部30の回路規模を小さく抑えることができる。
そのため、例えば、画素PX[m][n]の周囲の画素(すなわち、ブロックBL[m][n])で表示すべき階調と、画素PX[m][n]で表示すべき階調が大きく異なる場合であっても、画素PX[m][n]で表示する階調が、周辺の画素PXで表示すべき階調を考慮して定められるため、モアレや偽色の発生を抑止し、表示のざらつき感を低減させることが可能となる。これにより、本実施形態では、表示品位を向上させることができる。
以上の各形態は多様に変形され得る。具体的な変形の態様を以下に例示する。以下の例示から任意に選択された2以上の態様は、相互に矛盾しない範囲内で適宜に併合され得る。
上述した実施形態において、ブロックBL[m][n]は、画素PX[m][n]を中心とする縦3行×横3列の9個の画素PXであるが、本発明はこのような態様に限定されるものではなく、aを3以上の奇数として、画素PX[m][n]を中心とした、縦a行×横a列の(a×a)個の画素PXであってもよい(この場合、所定数は「a×a」)。例えば、ブロックBL[m][n]は、a=7として、第(m−3)行〜第(m+3)行に位置し、且つ、第(n−3)列〜第(n+3)列に位置する、画素PX[m][n]を中心とした7行7列の49個の画素PXであってもよい。
また、b及びcを1以上の整数として、ブロックBL[m][n]は、画素PX[m][n]を含む縦b行×横c列の(b×c)個の画素PXであってもよい(この場合、所定数は「b×c」)。例えば、ブロックBL[m][n]は、b=3、c=5として、第(m−1)行〜第(m+1)行に位置し、且つ、第(n−2)列〜第(n+2)列に位置する、画素PX[m][n]を含む3行5列の15個の画素PXであってもよい。
上述した実施形態及び変形例において、ブロックBL[m][n]は、例えば縦b行×横c列の画素PX、すなわち、長方形(または正方形)の領域に配置される所定数の画素PXであるが、本発明はこのような態様に限定されるものではなく、ブロックBL[m][n]は、長方形(または正方形)以外の形状を有する1領域に含まれる所定数の画素PXから構成されるものであってもよい。
例えば、図8に示すように、ブロックBL[m][n]は、画素PX[m][n]、画素PX[m][n]に上下左右方向で隣接する4個の画素PX、及び、当該4個の画素PXと上下左右方向で隣接する画素PXの、13個の画素PXから構成されるものであってもよい(この場合、所定数は「13」)。
上述した実施形態及び変形例では、4種類の画素PX(画素PX−R、画素PX−G、画素PX−B、画素PX−W)は、図3に示すように、表示部10においてベイヤー配列されているが、本発明はこのような態様に限定されるものではなく、4種類の画素PXは、表示部10において、どのような規則に従って配列されるものであってもよい。例えば、図8に示すように、各列に1色の画素PXのみを配列してもよい。
画素PXがどのように配列される場合であっても、各画素PXに割り当てられた表示色が、画素表示色対応情報Infoとして記憶部53に記憶されるため、制御部30は、各画素PXに割り当てられた表示色(各画素PXが表示可能な表示色)についての階調を指定する階調信号Vidを生成することができる。
上述した実施形態及び変形例において、表示部10は、赤色(R)、緑色(G)、青色(B)、及び、白色(W)の4色の表示色を表示することができるが、本発明はこのような態様に限定されるものではなく、表示部10は、赤色(R)、緑色(G)、青色(B)、及び、白色(W)の4色の表示色のうち一部の表示色のみを表示できるものであってもよい。例えば、表示部10は、赤色(R)、緑色(G)、及び、青色(B)の3色の表示色(3原色)を表示できるものであってもよい。また、表示部10は、赤色(R)、緑色(G)、青色(B)、及び、白色(W)の4色の表示色以外の表示色を表示できるものであってもよい。要するに、表示部10は、2以上の表示色を表示できるものであればよい。
この場合、変換部51は、2以上の表示色毎に、各画素PXが表示すべき階調を規定する単色映像信号Vsを生成し、抽出部52は、2以上の表示色毎に、画素PX[m][n]を含む所定数の画素PXであるブロックBL[m][n]で表示すべき階調を規定する単色抽出信号Xsを生成するものであればよい。また、この場合、記憶部53は、2以上の表示色毎に、所定数の画素PXと1対1に対応して定められた所定数の係数Kを記憶していればよい。
上述した実施形態及び変形例において、加算部57は、第1段571に3個の加算器Adを備えるが、本発明はこのような態様に限定されるものではなく、第1段571に2個または4個以上の加算器Adを配置するものであってもよい。
また、上述した実施形態及び変形例において、加算部57は、2段に配置(すなわち、第1段571及び第2段572に配置)された複数の加算器Adを備えるが、本発明はこのような態様に限定されるものではなく、加算部57は、3段に配置された複数の加算器Adを備えるものであってもよい。また、加算部57は、図9に示すように、1段に配置された加算器Ad(つまり、1つの加算器Ad)を備えるものであってもよい。
但し、ブロックBL[m][n]を構成する画素PXの数(所定数)が大きな値である場合、加算部57は、2段以上に配置された複数の加算器Adを備えることが好ましい。
上述した実施形態及び変形例において、演算部70は、乗算部56及び加算部57を備えるが、本発明はこのような態様に限定されるものではなく、演算部70は、式(1)に示す演算を実行することができるものであれば、どのような構成であってもよい。
上述した実施形態及び変形例において、記憶部53は、表示パネル2が表示可能な表示色毎に所定数の係数K(例えば、RGBW毎に9個の係数K11〜K33)を1組ずつ記憶するが、本発明はこのような態様に限定されるものではなく、表示色毎に所定数の係数Kからなる組を複数記憶するものであってもよい。具体的には、実施形態において、記憶部53は、赤色係数KR11〜KR33を複数組記憶し、緑色係数KG11〜KG33を複数組記憶し、青色係数KB11〜KB33を複数組記憶し、白色係数KW11〜KW33を複数組記憶するものであってもよい。例えば、記憶部53は、緑色係数KGについて、係数KG22が「0.8」に設定され、係数KG12、KG21、KG23、KG32が「0.05」に設定され、係数KG22、KG22、KG22、KG22が「0」に設定される組と、係数KG22が「0.6」に設定され、係数KG12、KG21、KG23、KG32が「0.1」に設定され、係数KG22、KG22、KG22、KG22が「0」に設定される組と、を記憶するものであってもよい。
また、表示装置1は、文字を表示するための表示モード、風景等の画像を表示するための表示モード等、用途に応じた複数の表示モードを実行することができるものであってもよい。この場合、第2選択部55は、複数組の係数K11〜K33から表示モードに応じた係数K11〜K33の組を選択できるものであってもよい。
また、上述した実施形態及び変形例において、記憶部53は、表示色毎に所定数の係数K(例えば、RGBW毎に9個の係数K11〜K33)を1組ずつ記憶するが、本発明はこのような態様に限定されるものではなく、表示色毎に所定数よりも少ない係数Kを1組ずつ記憶するものであってもよい。例えば、係数K11〜K33の値が、図6に示すように定められる場合、記憶部53は、画素PX[m][n]に対応する係数K22(=「0.8」)、画素PX[m][n]に上下左右方向で隣接する4つの画素PXに対応する係数K12(=K21=K23=K32=「0.05」)、及び、画素PX[m][n]に斜め方向で隣接する4つの画素PXに対応する係数K11(=K13=K31=K33=「0」)の、3つの係数Kを記憶するものであればよい。要するに、記憶部53は、ブロックBL[m][n]を構成する所定数の画素PXに対応するように定められた1または複数の係数Kを記憶するものであればよい。
上述した実施形態及び変形例において、所定数の係数K(例えば、9個の係数K11〜K33)は、その合計が「1」となるように定められるが、本発明はこのような態様に限定されるものではなく、所定数の係数Kの合計値は「1」以外の値となるように定められるものであってもよい。
例えば、表示装置1(上位装置)は、表示部10で表示される画像全体の明るさを設定することができ、所定数の係数Kの合計値は、表示装置1が定める画像全体の明るさに応じた値に定められるものであってもよい。
上述した実施形態及び変形例において、制御部30は単体の集積回路であるが、本発明はこのような態様に限定されるものではなく、制御部30は、複数の集積回路に分散して搭載されるものであってもよい。例えば、駆動制御回路40及び表示制御回路50は、別体の集積回路に分散して搭載されるものであってもよい。
上述した実施形態及び変形例において、表示パネル2と制御部30とは別体としたが、本発明はこのような態様に限定されるものではなく、表示パネル2及び制御部30を同一の基板上に形成してもよい。
上述した実施形態及び変形例において、階調信号Vidはデジタルの信号であるが、本発明はこのような態様に限定されるものではなく、階調信号Vidはアナログの信号であってもよい。例えば、階調信号Vidは、階調電位VD[1]〜VD[N]を時分割多重した信号であってもよい。
この場合、制御部30は、DA変換回路を備え、演算部70から出力されるデジタルの値をDA変換して階調信号Vidを生成するものであってもよい。
上述した実施形態及び変形例において、画素PXの備える画素回路11は、液晶素子CLを備えるものであるが、本発明はこのような態様に限定されるものではなく、画素回路11は、例えば、階調電位VD[1]〜VD[N]に応じた電流を流す駆動トランジスターと、当該電流に応じた輝度で発光する有機発光ダイオード(Organic Light Emitting Diode)やLED(Light Emitting Diode)等の発光素子とを備えるものであってもよい。
以上の各形態に例示した表示装置1は、各種の電子機器に利用され得る。図10から図12には、表示装置1を採用した電子機器の具体的な形態が例示されている。
Claims (4)
- 複数の画素を有する表示パネルを備え、前記複数の画素の各々に2以上の表示色のうちいずれかの表示色が割り当てられた、前記2以上の表示色を表示可能な表示装置に用いられ、前記2以上の表示色のうち前記画素に割り当てられた表示色について当該画素で表示する階調を規定する階調信号を前記表示パネルに供給する表示制御回路であって、
前記複数の画素で表示すべき階調を前記2以上の表示色毎に規定した映像信号から、前記複数の画素のうちある画素を含む所定数の画素であるブロックで表示すべき階調を前記2以上の表示色毎に規定した抽出信号を抽出する抽出部と、
前記2以上の表示色毎に、前記所定数の画素に対応して定められた係数を記憶する記憶部と、
前記抽出部が抽出した抽出信号から、前記ある画素に割り当てられた表示色について前記ブロックで表示すべき階調を規定した単色抽出信号を選択してこれを出力する第1選択部と、
前記記憶部から、前記ある画素に割り当てられた表示色について前記所定数の画素に対応して定められた係数を取得してこれを出力する第2選択部と、
前記第1選択部が出力する前記単色抽出信号、及び、前記第2選択部が出力する前記係数に基づいて、前記階調信号を出力する演算部と、
を備え、
前記演算部は、
前記第1選択部が出力する前記単色抽出信号の表す前記所定数の画素が表示すべき階調の各々を要素とするベクトルと、前記第2選択部が出力する前記所定数の画素に対応して定められた係数の各々を要素とするベクトルと、の内積を演算し、演算結果を出力する、
ことを特徴とする表示制御回路。 - 前記演算部は、
前記所定数の画素の各々について、前記第1選択部が出力する前記単色抽出信号の規定する階調と前記第2選択部が出力する前記係数との乗算を実行して乗算値を出力する乗算部と、
前記乗算部が出力する前記所定数の前記乗算値を加算する加算部と、
を備える、
ことを特徴とする、請求項1に記載の表示制御回路。 - 請求項1又は請求項2に記載の表示制御回路と、
複数の走査線と、
前記複数の走査線と交差する複数のデータ線と、
前記複数の走査線及び前記複数のデータ線の交差に対応して設けられた複数の画素と、
前記走査線を選択する走査線駆動回路と、
前記階調信号に応じた階調電位を生成してこれを前記複数のデータ線の各々に対して出力するデータ線駆動回路と、
を備える、
ことを特徴とする表示装置。 - 請求項3に記載の表示装置を具備する電子機器。
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